JP4236778B2 - 半導体装置 - Google Patents
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Description
【発明の属する技術分野】
本発明は半導体装置およびその製造方法に関する。
【0002】
【従来の技術】
近年、半導体装置の微細化にともない、金属配線の配線幅が小さくなる傾向にある。このため、マイグレーションによるアルミニウム配線の断線やヒロックを防止するために、アルミニウムに銅を0.5%程度含有させる方法が一般的に用いられている。しかし、配線幅だけではなく配線間隔も小さくなる傾向にあるため、配線と配線の間に銅を含有した析出物が存在すると、短絡(ショート)不良の原因となってしまう。そこで、高い温度においてアルミニウム膜を成膜することによって銅をアルミニウム中に固溶させた後、冷却時に銅が析出しないように急冷する方法が、例えば特開平8−186175号公報などにおいて提案されている。
【0003】
【発明が解決しようとする課題】
銅を含有したアルミニウム配線を前記の急冷処理を用いて形成する方法は、さらに配線間隔が小さくなり、0.4μm以下になった場合には十分でない。
そこで、本発明の第一の目的は、信頼性の高い半導体装置を提供することにある。また、本発明の第二の目的は、歩留りの高い半導体装置を提供することにある。本発明の第三の目的は、短絡を起こしにくい配線構造を有する半導体装置を提供することにある。
【0004】
【課題を解決するための手段】
アルミニウム配線における銅の析出は、結晶粒界および結晶粒内の銅原子が拡散することによって進行することが解っている。したがって、析出を防止するためには、アルミニウム配線における銅原子の拡散を抑制すれば良い。そして、発明者らは、銅原子の拡散を抑制する手段を得るために鋭意研究を行った結果、銅の拡散を抑制する添加元素をアルミニウム配線に含有させることによって、析出を防止できることを見出した。また、発明者は、銅の拡散を抑制する隣接膜をアルミニウム配線に接触させることによって、析出を防止できることを見出した。
【0005】
本願発明の課題は例えば、下記の構成を備えた半導体装置により解決される。
【0006】
(1):半導体基板と、前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線とを備え、前記配線には銅とニッケルとが含有されていること。
【0007】
なお、前記配線は0.4μm以下の間隔で隣接する領域を有すること、また、前記ニッケルの含有濃度が0.02at.%以上1 at.%以下であることが望ましい。
【0008】
(2):半導体基板と、前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線と、前記配線に隣接する主構成材料がチタンまたは窒化チタンである隣接膜(バリア膜)と、を備え、前記配線には銅とニッケルとが含有されていること。
【0009】
なお、前記配線は0.4μm以下の間隔で隣接する領域を有すること、また、前記ニッケルの含有濃度が0.02at.%以上1 at.%以下であることが望ましい。
【0010】
(3):半導体基板と、前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線とを備え、前記配線には銅とシリコンとが含有されていること。
【0011】
なお、前記配線は0.4μm以下の間隔で隣接する領域を有すること、また、前記シリコンの含有濃度が0.05at.%以上0.4at.%以下であることが望ましい。
【0012】
(4):半導体基板と、前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線と、前記配線に隣接する主構成材料がチタンまたは窒化チタンである隣接膜(バリア膜)と、を備え、前記配線には銅とシリコンとが含有されてえいること。
【0013】
(5):半導体基板と、前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線であって、0.4μm以下の間隔で隣接する領域を有する配線と、前記配線に隣接する主構成材料がルテニウム、白金、イリジウムからなる群から選ばれる一種類である隣接膜(バリア膜)と、を備え、前記配線には銅が含有されていること。
【0014】
なお、前記配線にはニッケルが0.02at.%以上1at.%以下含有されていること、または、前記配線にはシリコンが0.05at.%以上0.4at.%以下含有されていることが望ましい。
ここで、金属配線の主構成材料とは、金属配線に最も多く含まれる材料を意味する。
【0015】
【発明の実施の形態】
以下、本発明の実施の形態を図に示した実施例により詳細に説明する。
まず、本発明における第一の実施例である半導体装置における主要部分の断面構造を図1に示す。本実施例の半導体装置は、図1に示すように、シリコン基板1の上に拡散層2、3、4、5が形成され、この上にゲ−ト絶縁膜6、7およびゲ−ト電極8、9が形成されることによってMOSトランジスタが構成されている。ゲート絶縁膜6、7は、例えばシリコン酸化膜あるいは窒化珪素膜であり、ゲート電極8、9は、例えば多結晶シリコン膜や金属薄膜、あるいは金属シリサイド膜あるいはこれらの積層構造である。 MOSトランジスタは、例えばシリコン酸化膜からなる素子分離膜10によって分離されている。前記ゲート電極8、9の上部および側壁には例えばシリコン酸化膜からなる絶縁膜11、12が形成されている。 MOSトランジスタの上部全面には、例えばBPSG(Boron−Doped Phospho Silicate Glass)膜やSOG(Spin On Glass)膜、あるいは化学気相蒸着法やスパッタ法で形成したシリコン酸化膜や窒化膜等からなる絶縁膜13が形成されている。絶縁膜13に形成されたコンタクトホールには拡散防止用の隣接導電体膜(第一導電体膜)14a、14bに被覆された主導電体膜15からなるプラグが形成され、拡散層2、3、4、5に接続されている。このプラグを通じて、拡散防止用の隣接導電体膜16a、16bに被覆された主導電体膜17からなる第一積層配線が接続されている。この積層配線は、例えば、隣接導電体膜16aをスパッタ法等により成膜した後、主導電体膜17をスパッタ法等により形成し、この上に隣接導電体膜16bをスパッタ法等により形成してから、エッチングによって配線パターンをつくることにより得られる。このエッチングの際に、銅を含有した析出物がエッチングされずに残ると、配線間隔28が狭い場合には短絡を起こしてしまう。第一積層配線の上には、絶縁膜21に形成されたコンタクトホールに隣接導電体膜19に被覆された主導電体膜20からなるプラグが形成され、前記積層配線に接続されている。このプラグを通じて、隣接導電体膜22a、22bに被覆された主導電体膜23からなる第二積層配線が接続されている。この第二の積層配線は、例えば、隣接導電体膜22aをスパッタ法等により成膜した後、主導電体膜23をスパッタ法等により形成し、この上に隣接導電体膜22bをスパッタ法等により形成してから、エッチング等によって配線パターンをつくることにより得られる。
【0016】
ここで、例えば第一積層配線や第二積層配線における主導電体膜17や主導電体膜23の主構成材料はアルミニウムであり、これらにはマイグレーション耐性を強くするために銅が添加されている。本実施例では、配線間隔28、29が0.4μm以下の場合でも、銅析出による短絡が起こらないように、主導電体膜17や主導電体膜23にはニッケルとシリコンのうちのすくなくとも一種類の元素が添加されている。添加させる方法としては、例えば、合金のターゲットを用いたスタッパ法や、複数のターゲットを用いた多元スパッタ法を用いる。銅、ニッケル、シリコンの添加濃度については、本実施例の効果と合わせて以下に説明する。
【0017】
本実施例の効果を詳しく説明するために、分子動力学シミュレーションによる解析例を示す。分子動力学シミュレーションとは、例えばジャーナルオブアプライドフィジックス(Journal of Applied Physics)の第54巻(1983年発行)の4864ページから4878ページまでに記述されているように、原子間ポテンシャルを通して各原子に働く力を計算し、この力を基にニュートンの運動方程式を解くことによって各時刻における各原子の位置を算出する方法である。
なお、本実施例では、上記の分子動力学法に電荷移動を取り入れて異種元素間の相互作用を計算することにより、以下の関係を求めることができた。
【0018】
本実施例の主な効果は、ニッケルやシリコンの添加により銅の析出を防止することにあり、銅の添加がマイグレーション防止に有効であることは既によく知られている。しかし、銅の含有濃度を適正な値に限定するために、はじめにマイグレーション防止効果に対する銅濃度依存性ついて示す。マイグレーションとは、アルミニウム原子が熱、応力、電流の影響によって拡散し、ボイドやヒロックを形成する現象であり、拡散係数が大きいほど起こりやすい。したがって、マイグレーション防止効果は、拡散係数の減少率によって示すことができる。分子動力学シミュレーションにより拡散係数を計算する方法については、例えばフィジカルレビューB(Physical Review B)の第29巻(1984年発行)の5363ページから5371ページまでに記述されている。
【0019】
アルミニウム結晶の粒界および粒内におけるアルミニウム原子の粒界拡散係数DGB、粒内拡散係数DINの銅濃度依存性を解析した結果を図2、3に示す。図では、銅を添加していない場合の粒界拡散係数、粒内拡散係数をそれぞれDGB0、DIN0として結果を示した。図2からわかるように、銅濃度が0.01at.%以上になると拡散を抑制する効果が顕著となり、0.02at.%で効果はほぼ飽和する。また、図3からわかるように、銅濃度が2at.%を超えると拡散を抑制する効果が弱くなりはじめる。これは、添加元素があまり多くなると、主構成材料であるアルミニウムの結晶構造が乱されるので、拡散が活発になるためである。したがって、マイグレーション耐性を良好にするためには、銅の濃度は0.02at.%以上2at.%以下がより好ましい。これらは700Kにおける解析結果であり、銅がアルミニウム結晶中に固溶した状態のものである。500Kに設定すると銅の析出が見られるが、この場合でも同様に銅の添加効果を示すことができる。また、他の温度でも同様の効果を示すことができる。
【0020】
次に、ニッケルの添加による銅の析出防止効果について説明する。温度を500Kに設定して銅が析出するシミュレーションを行ない、析出速度Vのニッケル濃度依存性を解析した結果を図4、5に示す。図では、ニッケルを添加していない場合の析出速度をV0として結果を示した。シミュレーションにおける析出速度は、アルミニウム結晶中の銅原子の集まった部分に銅原子がさらに集まる速度を意味し、単位時間に集まる銅原子の個数で定義される。図4からわかるように、ニッケル濃度が0.008at.%以上になると銅の析出を防止する効果が顕著となり、0.02at.%で効果はほぼ飽和する。また、図5からわかるように、ニッケル濃度が1at.%を超えると銅の析出を防止する効果が弱くなりはじめる。したがって、銅の析出を防止するためには、ニッケル濃度は0.02at.%以上1at.%以下がより好ましい。
【0021】
続いて、シリコンの添加による銅の析出防止効果について説明する。温度を500Kに設定して銅が析出するシミュレーションを行ない、析出速度Vのシリコン濃度依存性を解析した結果を図6、7に示す。図では、シリコンを添加していない場合の析出速度をV0として結果を示した。図6からわかるように、シリコン濃度が0.02at.%以上になると銅の析出を防止する効果が顕著となり、0.05at.%で効果はほぼ飽和する。また、図7からわかるように、シリコン濃度が0.4at.%を超えると銅の析出を防止する効果が弱くなりはじめる。したがって、銅の析出を防止するためには、シリコン濃度は0.05at.%以上0.4at.%以下がより好ましい。
【0022】
なお、従来、アルミニウム配線がシリコン基板やシリコン酸化膜からシリコン原子を吸い上げることを防止するという目的で、アルミニウム配線にシリコンを約1 at.%添加することが知られているが、この添加量では銅の析出を防止することは期待できない。
【0023】
以上のニッケルとシリコンの効果は、銅が析出する温度であれば500K以外の場合でも同様に示すことができる。温度が350K以下になると銅の析出は本シミュレーションでは確認できないほど遅くなった。また、550K以上の高温になると固溶しやすくなるため、析出は起こりにくくなる。以上より、350Kから550Kのあいだの温度が最も析出しやすい温度といえる。したがって、析出を防止するためには、ニッケルやシリコンを添加する方法と、550K以上で成膜した後で急冷して350K以下に温度を下げる方法を組み合わせることが、より好ましい。ここでは、自然放置する場合に比べて早く冷却することを急冷と呼ぶ。急冷には、例えば冷却用のガスや流体を用いる。また、急冷する前に十分に固溶した状態を実現するために、原子堆積が終了した後、例えば5秒以上高温状態に保ってから急冷するのが好ましい。急冷した後で、エッチング等によって配線パターンを形成する前に熱処理を行なう場合には、銅の析出を防止するために、550K以上の高温で熱処理を行なうのが好ましく、冷却させる際には、急冷するのが好ましい。
【0024】
図4と図6を比較すると、ニッケルのほうがシリコンよりも析出防止効果が強いことがわかる。また、ニッケルを添加するほうがシリコンを添加するよりも、アルミニウム配線の抵抗を低くすることができる。一方、シリコンの添加には、アルミニウム配線がシリコン基板やシリコン酸化膜からシリコン原子を吸い上げることを防止するという別の効果もある。
【0025】
次に、本発明における第二の実施例である半導体装置における主要部分の断面構造を図8に示す。第二の実施例の第一の実施例との違いは、第一積層配線、第二積層配線におけて、主導電体膜17、23のバリア膜16a、16b、22a、22bの外側にさらに別のバリア膜26a、26b、27a、27bが形成されている点である。図には示さないが、さらに外側に一層以上の別のバリア膜が形成されていてもよい。また、主導電体膜17、23のバリア膜の層数は同じでなくてもよい。また、主導電体膜17、23のバリア膜の上と下の層数は異なっていてもよい。主導電体膜17、23が銅の添加されたアルミニウムである場合には、銅の析出防止のために、ニッケルやシリコンが添加されていることが好ましいという点は、第一の実施例と同様である。さらに銅の析出を起こりにくくするためには、バリア膜16a、16b、22a、22bの主構成材料が、ルテニウム、白金、イリジウムからなる群から選ばれる一種類であることが好ましい。ルテニウム、白金、イリジウムをバリア膜材料として使用した効果を以下に説明する。バリア膜をアルミニウム膜に接触させて、銅の析出速度Vを解析した結果を図9、図10に示す。図9では、例として、銅濃度が0.5at.%であり、ニッケル濃度が0.1at.%である場合の結果を示す。また、図10では、例として、銅濃度が0.5at.%であり、シリコン濃度が0.1at.%である場合の結果を示す。図9、図10では、通常バリア膜に用いられている窒化チタンを用いた場合の析出速度をVTiNとして結果を示した。これらの図より、ルテニウム、白金、イリジウムをバリア膜として使用した場合には、窒化チタンをバリア膜とした場合と比較して、銅の析出が抑制されることがわかる。ルテニウム、白金、イリジウムをバリア膜16a、16b、22a、22bとして用いる場合には、絶縁膜13、21、25との密着性を向上させるために、バリア膜26a、26b、27a、27bには窒化チタン膜やチタン膜、あるいはこれらの積層膜を用いるのが好ましい。プラグの主導電体膜15、20には、銅とニッケルまたは銅とシリコンを添加したアルミニウムを用いてもよく、また、例えばタングステンやシリコンのような別の材料を用いてもよい。また、主導電体膜17、23のような、配線を形成する膜の全てに、銅とニッケルまたは銅とシリコンを添加したアルミニウムを用いずに、一部に使用してもよい。
【0026】
【発明の効果】
本発明によれば、信頼性の高い半導体装置を提供できる。また、歩留りの高い半導体装置を提供できる。また、短絡を起こしにくい配線構造を有する半導体装置を提供できる。
【図面の簡単な説明】
【図1】本発明の第一の実施例に係る、半導体装置の主要部の断面図である。
【図2】本発明に係る、アルミニウムの拡散係数に対する銅濃度の依存性を低濃度領域について示した図である。
【図3】本発明に係るアルミニウムの拡散係数に対する銅濃度の依存性を高濃度領域について示した図である。
【図4】本発明に係る、銅の析出速度のニッケル濃度依存性を低濃度領域について示した図である。
【図5】本発明に係る、銅の析出速度のニッケル濃度依存性を高濃度領域について示した図である。
【図6】本発明に係る、銅の析出速度のシリコン濃度依存性を低濃度領域について示した図である。
【図7】本発明に係る、銅の析出速度のシリコン濃度依存性を高濃度領域について示した図である。
【図8】本発明の第二の実施例に係る、半導体装置の主要部の断面図である。
【図9】本発明に係る、銅とニッケルの添加されたアルミニウム膜にバリア膜を接触させた場合について銅の析出速度のバリア膜材料依存性を示した図である。
【図10】本発明に係る、銅とシリコンの添加されたアルミニウム膜にバリア膜を接触させた場合について銅の析出速度のバリア膜材料依存性を示した図である。
【符号の説明】
1…シリコン基板、2、3、4、5…拡散層、6、7…ゲート絶縁膜、8、9…ゲート電極、10…素子分離膜、11、12、13、18、21、24、25…絶縁膜、14a、14b、16a、16b、19、22a、22b…バリア隣接導電体膜、15、17、20、23…主導電体膜、26a、26b、27a、27b…バリア膜、28、29…配線間隔。
Claims (2)
- 半導体基板と、
前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線とを備え、
前記配線は0.4μm以下の間隔で隣接する領域を有し、
前記配線には、濃度0.02at.%以上2at.%以下の銅及び濃度0.02at.%以上1at.%以下のニッケルを含有することを特徴とする半導体装置。 - 半導体基板と、
前記半導体基板の一主面側に形成された主構成材料がアルミニウムである配線であって、0.4μm以下の間隔で隣接する領域を有する配線と、
前記配線に隣接する主構成材料がルテニウム又はイリジウムである隣接膜と、を備え、
前記配線には、濃度0.02at.%以上2at.%以下の銅及び濃度0.02at.%以上1at.%以下のニッケルを含有することを特徴とする半導体装置。
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US5393703A (en) * | 1993-11-12 | 1995-02-28 | Motorola, Inc. | Process for forming a conductive layer for semiconductor devices |
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US6239703B1 (en) * | 1998-01-02 | 2001-05-29 | Intermec Ip Corp | Communication pad structure for semiconductor devices |
US6534869B2 (en) * | 1998-07-29 | 2003-03-18 | Advanced Micro Devices, Inc. | Method for reducing stress-induced voids for 0.25 μm micron and smaller semiconductor chip technology by annealing interconnect lines prior to ILD deposition and semiconductor chip made thereby |
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