JP3992241B2 - 画像読み取り装置 - Google Patents
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Description
前記画像処理基板(20)は、補正データメモリ(27)と、シェーディング補正用データ取込期間信号に基づく期間の画像データに基づいて前記シェーディング補正用データを生成して前記補正データメモリに記憶させると共に該シェーディング補正用データに基づいて画像データに対してシェーディング補正を施す画像処理部(20DI)と、を備え、シェーディング補正用データを生成するための基準となる白基準板(Wp)の読み取りタイミングを示す信号(a)を前記画像読取基板に与え、
前記画像読取基板(30)は、画像光を画像信号に変換する光電変換部(31)と、該光電変換部により変換された画像信号に対してアナログ処理を施すアナログ処理部(34)と、該アナログ処理を施された画像信号をデジタル信号に変換して画像データとして出力するA/D変換部(35)と、前記光電変換部,前記アナログ処理部および前記A/D変換部の少なくともいずれかによる処理の調整用データを記憶する調整データメモリ(38)と、前記記憶された調整用データに基づいて前記光電変換部,前記アナログ処理部あるいは前記A/D変換部を調整するとともに、前記タイミングを示す信号(a)に基づいてアナログ処理部及び前記A/D変換部に対する調整を行う期間(c)を除いてシェーディング補正用データ取込期間信号(d)を前記画像処理基板に出力する制御部(37)と、を備えることを特徴とする画像読み取り装置。
2:原稿圧板
Wp:基準白板
3:原稿
4a,4b:光源
4d:ランプドライバ
5:キャリッジ
12:フレキシブルケーブル
14:操作表示ボード
15:電源部
16:直流電源
17:モータ
20:画像処理基板
20DI:デジタル処理回路
21:CPU
22:ROM
23:RAM
24:I/O
25:モ−タドライバ
26:MOSトランジスタ
26b:スイッチングドライバ
27:シェーディング処理回路
28:フィルター回路
29:ガンマ変換処理回路
30:CCD基板
30AN:アナログ処理回路
31:CCD
32:CCDドライバ回路
33:サンプルホ−ルド回路
34:信号増幅器
35:A/D変換器
36:信号処理回路
38:メモリ
100:画像読取装置
Claims (1)
- 画像読取基板と該画像読取基板からの画像データに対してシェーディング補正などの画像処理を施す画像処理基板とを有する画像読み取り装置であって、
前記画像処理基板は、補正データメモリと、シェーディング補正用データ取込期間信号に基づく期間の画像データに基づいて前記シェーディング補正用データを生成して前記補正データメモリに記憶させると共に該シェーディング補正用データに基づいて画像データに対してシェーディング補正を施す画像処理部と、を備え、シェーディング補正用データを生成するための基準となる白基準板の読み取りタイミングを示す信号を前記画像読取基板に与え、
前記画像読取基板は、画像光を画像信号に変換する光電変換部と、該光電変換部により変換された画像信号に対してアナログ処理を施すアナログ処理部と、該アナログ処理を施された画像信号をデジタル信号に変換して画像データとして出力するA/D変換部と、前記光電変換部,前記アナログ処理部および前記A/D変換部の少なくともいずれかによる処理の調整用データを記憶する調整データメモリと、前記記憶された調整用データに基づいて前記光電変換部,前記アナログ処理部あるいは前記A/D変換部を調整するとともに、前記白基準板の読み取りタイミングを示す信号に基づいて前記アナログ処理部及び前記A/D変換部に対する調整を行う期間を除いてシェーディング補正用データ取込期間信号を前記画像処理基板に出力する制御部と、を備えることを特徴とする画像読み取り装置。
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