JP3935977B2 - ノッチ付き半導体ウェーハ - Google Patents
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Description
【産業上の利用分野】
本発明は、ノッチ付き半導体ウェーハに関する。
【0002】
【従来の技術】
半導体素子の基板には主として高純度の単結晶シリコンが用いられているが、前記単結晶シリコンは主としてCZ法により製造される。CZ法においては、単結晶引き上げ装置のチャンバ内に設置したるつぼに多結晶シリコンを充填し、前記るつぼの周囲に設けたヒータによって多結晶シリコンを加熱溶解した上、シードチャックに取り付けた種結晶を融液に浸漬し、シードチャックおよびるつぼを互いに同方向または逆方向に回転しつつシードチャックを引き上げながら円柱状の単結晶シリコンを成長させる。
【0003】
上記CZ法などによって製造された単結晶シリコンインゴットの外周を所定寸法に研削した上、軸方向に直角に切断して薄板に分割し、ラッピング、エッチング、ポリシング等を施して少なくとも片面が鏡面に加工された単結晶シリコンウェーハ(以下ウェーハという)とする。前記単結晶シリコンインゴットの外周研削に先立って、結晶方位の判別を容易にするため外周の所定の位置にオリエンテーションフラット(以下オリフラという)またはノッチを設けている。また、たとえば両面に鏡面仕上げを施したウェーハ、そり方向指定ウェーハ(ウェーハ表面が凸面か凹面かを指定したウェーハ)、引き上げ方向指定ウェーハ等については、結晶方位判別とは別に表裏判別手段を必要とする。
【0004】
ウェーハの表裏判別を容易にするため、従来から主オリフラとは別に副オリフラを設けるか、またはレーザマーカを用いてノッチの近傍に所定のマークを入れている。主オリフラを設けることによりウェーハからデバイスを切り出す際の有効面積が減少するが、副オリフラカットにより前記有効面積は更に減少する。これに比べてウェーハの結晶方位判別手段としてノッチを設け、表裏判別手段にレーザマークを用いる方法は、ウェーハの有効面積減少の度合いが少なくて済むという利点がある。
【0005】
【発明が解決しようとする課題】
しかしながら、ウェーハの表裏判別手段にレーザマークを用いると、従来の加工工程の他にレーザマーク加工工程を付加しなければならず、コスト高となる。また、レーザマークによって印字された凹部に浮遊する塵埃等が入り込み、後工程で行われる洗浄の際に前記塵埃が発見されることがあるため、必ずしも好ましい識別手段とはいえない。更に、レーザマークを入れることにより、ノッチ加工のみのウェーハに比べて有効面積が減少するという欠点がある。
【0006】
本発明は上記従来の問題点に着目してなされたもので、オリフラやレーザマークの加工によるウェーハの有効面積減少、製造コスト上昇を最小限に抑え、かつ、レーザマークによる発塵等の品質的問題を起こさずにウェーハの表裏を容易に判別することが可能なノッチ付き半導体ウェーハを提供することを目的としている。
【0007】
【課題を解決するための手段】
上記目的を達成するため、本発明に係るノッチ付き半導体ウェーハの第1の発明では、半導体ウェーハの外周の所定位置に前記ウェーハの結晶方位を判別するノッチを設けたノッチ付き半導体ウェーハにおいて、ノッチの縁部に沿って設ける面取りの大きさをウェーハの表面側と裏面側とで異なる寸法とすることを特徴とする。また、第2の発明では、半導体ウェーハの外周の所定位置に前記ウェーハの結晶方位を判別するノッチを設けたノッチ付き半導体ウェーハにおいて、ノッチをウェーハ中心に対して左右いずれかの方向に傾けることを特徴とする。これにより、ウェーハの表裏判別を可能としている。
【0008】
【作用】
上記構成によれば、ウェーハの結晶方位判別手段であるノッチの縁部に設ける面取りを、ウェーハの表面側と裏面側とで異なる寸法としたので、面取り寸法の大小を目視で比較することによりウェーハの表裏を容易に判別することができる。また、ノッチの面取りを表裏で異なる寸法とする代わりに、ノッチ自体をウェーハ中心に対して左右いずれかに傾けた場合も、ウェーハの表裏判別は容易となる。いずれの場合も表裏判別のためのレーザマークは不要であり、ダブルオリフラカットに比べてウェーハ有効面積の損失が小さくなる。
【0009】
【実施例】
以下に、本発明に係るノッチ付き半導体ウェーハの実施例について、図面を参照して説明する。図1は、本発明の第1実施例に基づくウェーハのノッチ部分を拡大した模式的平面図で、ウェーハの表面を示す。図2は同じくウェーハのノッチ部分を拡大した模式的平面図で、ウェーハの裏面を示す。図3は図1のA−A断面図である。これらの図において、1は表裏両面に鏡面仕上げを施した円盤状のウェーハで、外周の所定の位置にV字状のノッチ2が設けられ、前記ウェーハ1の外周とこれに続くノッチ2の縁部にはなめらかな面取り3および4が施されている。ノッチ2の形状は、角度θ=90°、深さa=1mmである。また、ノッチ2の縁部に沿って設ける面取りの大きさは、表面側の面取り3がウェーハ1の外周の面取りと同じくC1 =100μmで、裏面側の面取り4のみC2 =600μmとなっている。前記面取り寸法C1 およびC2 は一例を示すものであり、これらの値に限定されるものではない。
【0010】
本実施例では、ノッチの縁部に沿って設ける面取りの大きさがウェーハの表面側と裏面側とで明らかに異なるため、ウェーハの表裏判別は目視により容易に行うことができる。また、ウェーハ外周の面取りは従来と同じく表裏同一寸法であるため、ウェーハの有効面積減少や強度の低下は起こらない。
【0011】
図4は、本発明の第2実施例に基づくウェーハのノッチ部分を拡大した模式的平面図で、ウェーハの表面を示す。ウェーハ1の外周には所定の位置にV字状のノッチ2が設けられているが、このノッチ2はウェーハ1の中心に対して右側に傾いている。すなわち、ウェーハ中心線5に対するノッチ2の左側の開き角θ1 と右側の開き角θ2 との関係は、θ1 ≪θ2 となっている。このように、ノッチ2に傾きを与えることにより、ウェーハの表裏を容易に目視判別することができる。なお、面取り3の大きさはウェーハ外周、ノッチ縁部を問わず、かつ、表裏ともすべて同じ寸法である。
【0012】
【発明の効果】
以上説明したように本発明によれば、なんらかの表裏判別手段を必要とするウェーハに対し、結晶方位判別手段として設けたノッチの縁部面取りをウェーハの表面側と裏面側とで異なる寸法としたので、前記面取り形状を目視比較するだけでウェーハの表裏を容易に判別することができる。また、前記ノッチをウェーハ中心に対して左右いずれかに傾けた場合も、ウェーハの表裏判別は容易である。本発明による表裏判別手段はレーザマーク加工を必要としないので、その分だけ製造コストが低減するとともに、レーザマークによる発塵という品質問題を回避することができる。更に、従来から行われているダブルオリフラカットに比べてウェーハ有効面積の損失が小さくなるので、デバイス取得率が向上する。
【図面の簡単な説明】
【図1】本発明の第1実施例に基づくウェーハのノッチ部分を拡大した模式的平面図で、ウェーハの表面を示す。
【図2】図1のウェーハの裏面を示す。
【図3】図1のA−A断面図である。
【図4】本発明の第2実施例に基づくウェーハのノッチ部分を拡大した模式的平面図で、ウェーハの表面を示す。
【符号の説明】
1 ウェーハ
2 ノッチ
3,4 面取り
5 ウェーハ中心線
Claims (1)
- 半導体ウェーハの外周の所定位置にノッチを設けたノッチ付き半導体ウェーハにおいて、ウェーハのノッチ以外の縁部に沿って設ける面取りの大きさをウェーハの表面側と裏面側とで同じ寸法とし、ノッチの縁部に沿って設ける面取りの大きさをウェーハの表面側と裏面側とで異なる寸法とすることを特徴とするノッチ付き半導体ウェーハ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14010695A JP3935977B2 (ja) | 1995-05-16 | 1995-05-16 | ノッチ付き半導体ウェーハ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14010695A JP3935977B2 (ja) | 1995-05-16 | 1995-05-16 | ノッチ付き半導体ウェーハ |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH08316112A JPH08316112A (ja) | 1996-11-29 |
JP3935977B2 true JP3935977B2 (ja) | 2007-06-27 |
Family
ID=15261082
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14010695A Expired - Fee Related JP3935977B2 (ja) | 1995-05-16 | 1995-05-16 | ノッチ付き半導体ウェーハ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3935977B2 (ja) |
Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4109371B2 (ja) * | 1999-01-28 | 2008-07-02 | Sumco Techxiv株式会社 | 半導体ウェハ |
JP2002222746A (ja) * | 2001-01-23 | 2002-08-09 | Matsushita Electric Ind Co Ltd | 窒化物半導体ウェーハ及びその製造方法 |
JP3580311B1 (ja) | 2003-03-28 | 2004-10-20 | 住友電気工業株式会社 | 表裏識別した矩形窒化物半導体基板 |
KR20070042594A (ko) * | 2005-10-19 | 2007-04-24 | 삼성코닝 주식회사 | 편평한 측면을 갖는 a면 질화물 반도체 단결정 기판 |
TWI535901B (zh) * | 2008-09-29 | 2016-06-01 | 勝高股份有限公司 | 矽晶圓及其製造方法 |
JP5548173B2 (ja) * | 2011-08-31 | 2014-07-16 | 株式会社東芝 | 半導体基板及びその製造方法 |
JP2015018960A (ja) | 2013-07-11 | 2015-01-29 | 三菱電機株式会社 | 半導体装置の製造方法 |
KR102468793B1 (ko) * | 2016-01-08 | 2022-11-18 | 삼성전자주식회사 | 반도체 웨이퍼, 반도체 구조체 및 이를 제조하는 방법 |
JP6493253B2 (ja) * | 2016-03-04 | 2019-04-03 | 株式会社Sumco | シリコンウェーハの製造方法およびシリコンウェーハ |
-
1995
- 1995-05-16 JP JP14010695A patent/JP3935977B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JPH08316112A (ja) | 1996-11-29 |
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Date | Code | Title | Description |
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A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20050425 |
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A131 | Notification of reasons for refusal |
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A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20060605 |
|
RD02 | Notification of acceptance of power of attorney |
Free format text: JAPANESE INTERMEDIATE CODE: A7422 Effective date: 20060605 |
|
A131 | Notification of reasons for refusal |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20070320 |
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A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20070322 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100330 Year of fee payment: 3 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110330 Year of fee payment: 4 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110330 Year of fee payment: 4 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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