JP3646023B2 - 大面積の接続ポストと改良された外形を有する高電流容量半導体装置パッケージとリードフレーム - Google Patents

大面積の接続ポストと改良された外形を有する高電流容量半導体装置パッケージとリードフレーム Download PDF

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【0001】
【発明の属する技術分野】
この発明は、ハイパワー半導体装置用リードフレーム及びパッケージに関し、該リードフレーム及びパッケージは、大きい接続ポストと、新規なリードシーケンスを備えかつ隣り合うリード間の誘電沿面距離を増加した導体を有し、また、改良された外形を有する。
【0002】
【従来の技術】
ダイオード、サイリスタ並びにMOSFET及びIGBT等のMOSゲート装置などの半導体装置は、普通、装置接合を有するシリコン半導体ダイに形成される。このダイは、金属化された底部ドレン又は他のパワー電極を有し、また、ソース及びゲート電極又はその他のパワー電極をその上面に有する。ダイは、大きい導電性リードフレームパッド上に取付けられ、ダイ上面のパワー電極は、ダイの導電性電極の領域から平坦な接続ポストの領域にかけて複数のワイヤでワイヤ結合される接続ワイヤを備え、そして、上記平坦な接続ポストの領域は、リードフレームの外部リード導体に接続される。これらの外部リード導体は、リードフレームとダイをモールド被覆するモールドハウジングを貫通する。リードフレームは、複数の同一のセクション、例えば、20以上のセクションを含むことがあり、それらに対しては、別個のダイを取付け、ワイヤー結合及びモールド被覆を受け入れるための加工が同時になされる。そして個々の装置は、モールド加工の後分離される。最終的な装置は、良く知られた工業規格パッケージ外形、例えば、広く知られたTO220又はTO247パケージ外形を有する。
【0003】
【発明が解決しようとする課題】
公知のパッケージ構造は、ダイパワー電極を、例えば、パワーMOSFETのソース電極又はダイオードのカソードを対応するリードフレームポストに接続することのできる。並列配置される結合ワイヤの数によって制限される電流容量を有する。リードフレームを配置するにあっては、並列配置される結合ワイヤの数を増やすことによって、パッケージサイズを大きくすることなく、パーケージ抵抗を小さくするようにすることが望ましい。
【0004】
特にパワーMOSFETのようなMOSゲート装置用の公知のパッケージ構造は、また、従来からゲート、ドレン及びソースのシーケンスにおいて平行な外部リード導体を有している。これは、ゲートリードとソースリードの離間距離を広げている。ソースポストの面積を最大にしながら、ゲートリードとソースリードを互いに隣り合わせて配置することが極めて有益である。また、ソースリード又はその他の長い外部リードの導通断面積を増加させるが望ましい。
【0005】
従来のモールドされたハウジングパッケージでは、リードフレーム導体は、高い誘電率のハウジングの内部からパッケージ外部の領域に延びている。パッケージの表面に沿う「沿面」距離は、このため外部導体の外側の離間距離に関係しており、また、それらリード間に印加される最大電圧を制限している。リードフレームのリードがパッケージから突出しているパッケージ表面に沿う沿面距離を、パケージサイズを大きくすることなく、大きくすることが望ましい。
【0006】
公知のパッケージ構造は、リードフレームからプラスティックハウジングの表面を通って外部へ延在するリード導体を有している。これらのリード導体は、従来、矩形又はV字形であり、プリント基板の金属開口に適切に嵌まり込むように設計されている。これら導体の断面積は、過剰な加熱を生じさせることなく、装置電流を流すに充分な大きさでなければならない。しかしながら、基板における開口の径は制限を受けているが、それは、開口離間の距離が装置のリード導体及びそれらの導電性ブッシングの離間によって定められているからである。こられリード導体の断面積を、導体を受け入れるプリント基板に設けられた開口の径を過度に大きくすることなく、大きくすることが望ましい。
【0007】
現在のパッケージ形状は、比較的厚手のプラスティック部分が薄手の部分に垂直の立ち上がり部でもって連結されてなる。厚手の領域は、パッケージのリード導体のエッジから、ダイの中央部上方に位置する垂直立ち上がり部まで延びている。薄手の部分は、その出力リード導体側と対向する側のパケージ端部まで延びている。パッケージの厚手の部分への垂直立ち上がり部は、厚手の部分の頂面と90度の角度を形成している。この急な角度内の材料はモールド中にプラスチック内に気泡を溜める傾向があり、これは、装置を不良なものにし廃棄品とすることになる。
【0008】
更にまた、上記の形状の装置が支持基板上表面に取付けられ、そこで片持ちバネにより適所に保持されるとき、バネは厚手のプラスティック領域の表面の上を押圧する。従って、バネ圧は、ダイ中心の上部から外れた位置に加わる。バネ圧が加わる位置を、パッケージ内に取付けられるダイ中心の上部にすることが望ましい。また、特別な道具を必要とすることがなく片持ちバネの下にパッケージの取付けを簡単化することが望ましい。
【0009】
【課題を解決するための手段】
この発明は、サイズを大きくすることなく電流容量を増加させた半導体装置であって;該半導体装置は、リードフレームと、1つのパワーMOSFETと、複数の結合ワイヤとを備え;前記リードフレームは、ダイ取付けパッドと複数の平行に離間した外部導体とを有する、薄く略々平坦な導電性本体を備え;前記複数の平行に離間した外部導体の1つは、その一端に1つの大きい結合ワイヤポストを有し、この結合ワイヤポストは前記ダイ取付けパッドの近くに位置しているがこれと離間し;前記パワーMOSFETの底部は前記ダイ取付けパッドの頂面に固定され;前記複数の結合ワイヤは、それらの一端で前記パワーMOSFETの頂面と結合され、他の端で前記1つの大きい結合ワイヤポストに結合され;前記1つの大きい結合ワイヤポストは、前記リードフレームの幅の1/2倍以上の幅を有し;前記ダイ取付けパッドは、前記複数の外部導体のうちの1つに電気的に接続され;プラスティックハウジングが前記パワーMOSFETと前記リードフレームの少なくともある複数の部分を取り囲み;前記複数の離間した導体は、前記プラスティックハウジングの内部から延び、前記ハウジングの側壁を通って、前記ハウジングの外部に至り;前記複数の離間された外部導体のうちの横方向に最も外側の2つは、くぼみ形に曲げられ、前記導体の延在自由端部の離間距離を小さくし;前記くぼみ形に曲げられた外部導体は、それらが最大の離間を有する距離となる位置において前記ハウジングの側壁を貫通し、それによって前記側壁の表面に沿う沿面距離を増していることを特徴とする。
【0010】
この発明の他の特徴によれば、例えば、MOSFETタイプのパッケージでは、リードフレームの外部リードのシーケンスを、従来のゲート、ドレン、ソースから、ゲート、ソース、ドレンの新規なシーケンスに変更した新規なリードフレーム構造が提供される。この新しいシーケンスは、ゲートとソースの接続部の離間距離を小さくすることで、装置の適用を改善し、それゆえ、ゲート回路の漏れインダクタンスを低下させることになる。この新規なシーケンスは、さらにソースポスト部の面積を増加させ、また(非常に大きな面積の底部ダイ接続面積を有する)ドレインポストの面積を減少させることを可能にし、そして、また、ダイソースからリードフレームソースパッドへの結合ワイヤの数を増加させて使うことができ、パッケージサイズを大きくすることなく、パッケージ抵抗を小さくすることを可能にする。
【0011】
この発明の更なる特徴によれば、2本の最も外側のリードが、リード導体がパッケージから出て行くところで、リード導通の断面積を小さくすることなく、最も中央のリードフレームリードから外方(リードフレーム中心から)にくぼみ形(reentrant)に曲げられることができる。このように外方にくぼみ形(reentrant)に曲げることによって、外方リードと中央リードとの間のパッケージ絶縁体の表面に沿う沿面距離が増され、装置の降状ダウン電圧を増大することになる。外方にくぼみ形(reentrant)に曲げるということは、長い導体をパッケージの中心から離れる方向の略々垂直な経路に向かわせ、その後再度、その長い導体を元の経路とは平行であるが、しかしそれから離間した経路に向かわせるということである。
【0012】
この発明の更なる特徴は、基板の孔径を実質的な増大を必要とすることなし、リードフレーム外部導体の断面積を増加させることを含む。このため、第1の実施例によれば、通常矩形をした導体の形状をより正方形に近づけ、より大きな面積の銅導体を同一径の孔に嵌入させることができることが判明した。更に、矩形の導体のエッジを僅かに面取りすることで、最終導体の総断面積を増加させることになる。
【0013】
この発明のまた更なる特徴としては、プラスチックパッケージの外形は改良され、それは均一な厚さと、リード導体エッジから延びて実質的に内部ダイの全面積の上に延在する平坦な頂部の外表面とを有する。リード導体に対向する側のパッケージの端部壁は、パッケージの底部及びエッジに向けてテーパーが施され、垂直に対し約45度の角度となっている。
【0014】
この新規な構造の結果、パッケージを片持ちバネで取付けるときに、パッケージの頂面に対するバネの押圧力の中心は、ダイの中心上方に向けることができ、これは、表面取付け装置に力を作用させるには最も効率的な位置である。
【0015】
更に、テーパーの付された端部面を使うことで、端部面と頂面との間の角度は約135度に増大され、これにより、モールド中に、ダイのこの頂部エッジ領域から気泡を排除することがより容易とすることができる。
【0016】
最後に、パッケージのテーパーが付された端面は、パッケージを楔として使用することを可能にし、それによって、特別な道具を必要とすることなく、パッケージを片持ちバネの上に向いたリップの下にそしてバネの下に押し込むことができる。
【0017】
【発明の実施の形態】
先ず、第1図、第2図および第3図において、この発明のある特徴を備えたTO220型半導体装置パッケージ20が示されている。パッケージ20は、移送成形することができる従来のプラスチックモールドハウジンク21からなり、第2図の点線で示されている半導体ダイ22を封止している。底部の主体となる導電性リードフレーム板23は、ダイ22の底部ドレン電極を受け止める。3本のリード導体25、26及び27は、プラスチックハウジング21の前壁28を通って延びている。リード25、26及び27は、それぞれダイ22(それがパワーMOSFETダイとすれば)のゲート、ドレン及びソース接点とすることができ、又は、記載されるこの発明の態様に従って、それぞれ、ゲート、ソース及びドレン接点とすることができる。
【0018】
本発明の重要な特徴によれば、導体25と27は、前面28に隣接する領域で、それぞれくぼみ形(reentrantly)に曲げた形状にしたベンド30及び31によって、リード26の中心及びパッケージ20から離れるように曲げられている。これにより、面28に沿う沿面距離32及び33を増加させ、リード25及び27と中心リード26の間のより高い電圧の使用を可能にしている。
【0019】
第4図は、第1図、第2図および第3図のパッケージ20で使用することができるマルチセクションリードフレームの1つのセクション35を示している。陰影部36は、第1図ないし第3図に示したようにハウジング21の過モールドの後、通常の手法で切り落とされるリードフレームのセクションを示している。板部23は、適当な銅又は銅合金であり、例えば、1.27mmの厚さとすることができる。半導体ダイ22を受止める板部23の頂面は、メッキをすることなく、(MOSFETダイの底部ドレンなどの)ダイ22の底部電極を板23に半田などにより結合するのを改良することができる。リードフレーム35のその他の部分は、ニッケルメッキとすることができる。
【0020】
外部リード導体を含むフレーム35の部分も、ニッケルメッキした銅とし、また0.8mmの厚さとすることができる。外部リード導体又は指部25及び27は、それぞれゲート及びソースコネクタに対応する半田ポスト40及び42までその末端がきている。ここで、半田ポスト40及び42は同一平面にあって、板23の上面の平面よりも上方の平面内にある。板23は、また導体26に整列しかつそれと連続する延長部41を有している。このように、ダイ22は、その頂部においてソース電極43及びゲート電極44を有している。ゲート電極44は、ポスト部(パッド23の上方に位置してそれから絶縁されている)ポスト40にワイヤ結合され、またソース電極43はポスト42にワイヤ結合される。なおポスト42もパッド23の上方に位置してそれから絶縁されている。(第2図参照)。ポスト42の面積が比較的小さいので、わずか20ミルの2本の結合ワイヤ45及び46を使ってソース電極43をポスト42(そして、陰影で示された余剰の金属が切り取られたとき、外部リード伝導体又は指部27)に結合する。
【0021】
第5図および第5a図は、この発明の他の態様を示している。ソース電極43に対しての追加の結合ワイヤの使用を可能にする。即ち、導体25、26及び27は、それぞれゲート、ソース及びドレンの電極であり、第5図に示されているようにソースとゲート導体を互いにより近づけている。さらに、ソースポスト50は、ここでは中央に位置し、第4図のポスト42よりも広い幅となっている。重要なことには、ポスト50を、リードフレームの幅の約1/2倍よりも大きな幅とすることができる。これにより、第4図のソース電極43から導体26から延びるポスト50までワイヤ45及び46と同一の20ミルの4本の結合ワイヤ51、52、53及び54を使用することを可能にする。2本に代えて4本の結合ワイヤの使用は、パッケージ抵抗を十分に小さくし、このためパッケージ又はダイのサイズを変更することなく、パッケージの電流容量を増加させることができる。
【0022】
結合ワイヤ45及び46、51乃至54は、好ましくは、不純の少ないアルミニュウムワイヤ( .9999の純度)であって、その径は20ミルである。一本のワイヤは、約1ミリオームの抵抗を有し、2本並列のワイヤで約0.5ミリオームの抵抗を有し、4本並列のワイヤで約0.25ミリオームの抵抗を有する。このように、ワイヤを追加して使うことは、パッケージ抵抗を実質的に小さくさせる。
【0023】
細いゲート結合ワイヤのみを受入れるゲートポスト56は、その面積が小さくされており、パッド23からのパッド延長部41は移動され、リード導体27に整列かつ接続されている。ここで、ドレイン導体27は、パッド23の電位にある。
【0024】
第6図は、新規なリードフレームを、MOSFETダイ22用ではなく、ダイオードダイ60用のものとして示している。即ち、第6図においては、ダイオードは、パッド23に結合された底部電極を有している。ワイヤ結合ポストは改良され、第5図のポスト50及び56を共に単一の大きな面積のポスト61として一体化させている。ポスト61は、ダイオード頂部電極67から5本の結合ワイヤ62、63、64、65及び66の使用を可能にしている。中央部にある導体の金属は、プラスチック封止の後の金属切取りの操作中に切り離される。
【0025】
第7図および第8図、第4図のリードシーケンスを用いたリードフレーム(2つのセクションが示されている)の他の実施例を示しており、第4図のポスト42は、改良され(大きくされ)、3本の結合ワイヤで、パッド23上のダイの上部電極をポスト70に結合させている。重要なことには、ポスト70は、リードフレームの幅の約1/2倍に近い幅を有している。なお、パッド23は、外部導体26(ドレン導体)に接続した狭くなって湾曲した延在部71を有する。
【0026】
第9図、第10図および第11図は、第1図、第2図および第3図のパッケージ20の改良を示し、表面取付け型パッケージとしている。即ち、プラスチックパッケージ80は、前述の図面のものと同様に主要ダイ支持パッド23及び3本の出力用延在リード導体81、82及び83を有するリードフレームを備えている。導体81、82及び83は、それぞれ、ゲート、ドレン及びソース導体であり、第4図又は第7図に示した基本構造を持っている。しかし、リード81及び83は、第10図および第11図に示されているように、下方に向けくぼみ形(reentrantly)に曲げられ、パッド23の底部露出面の平面と平行な平面に置かれている。このため、第9図ないし第11図の装置は、表面取付け用のものであるが、それ以外の点では第4図ないし第7図のものに関して前述した種々の利点を持っている。
【0027】
第12図は、第1図ないし第3図におけるリード導体25乃至27いずれかの断面を示している。従来のTO220パッケージでは、導体25は、約0.8ミリメートルの高さと約0.46ミリメートルの幅を有し、約0.388平方ミリメートルの断面積となっていた。これは、定格約50アンペアRMSの装置として用いられ、約0.92ミリメートル径のプリント基板孔を必要としていた。
【0028】
第5図のようにパッケージ内の結合ワイヤを増やして使用することで、装置電流を増加させることができることが分かった。即ち、第13図に示されているように、接点25の断面は、064平方ミリメートルの断面に対して0.8ミリメートル×0.8ミリメートルとすることができる。これは、基板の孔径を僅か1.15ミリメートルまで増加させるだけを必要とするが、温度上昇を加えずに或いはパッケージ抵抗を増すことなく、電流容量を65アンペアRMSまで増加させることができる。
【0029】
更に、第14図に示すように、基板の孔径を1.27ミリメートルまで増すことで、0.8ミリメートル×1.0ミリメートルの接点断面にすることができ、その電流容量を約80アンペアRMSまで増やす。
【0030】
第15図は、矩形導体25上の面取りを施したエッジ90の使用を示している。これにより、プリント基板の貫通孔91を変更することなく、導体25の銅材断面を増加して使用することができる。
【0031】
第16図は、TO220の外形などのような、プラスティックハウジングに使われる外形を示す。第1図ないし第10図のパッケージの場合のように、(この発明のリードフレームと共に示されている)パッケージ20は、平坦な棚200を有する比較的厚い領域と、平坦な棚201を有する比較的薄い領域と、垂直又は垂直に近い壁202及び203とを有している。壁202は、上面200と約90度で交差している。これは、エッジ領域204に気泡が取り込まれるというモールド上の問題を生じさせた。また、パッケージ20は、通例、その一端を支持面210に固定された片持ちバネ211によってプリント基板210又はその他の面上に表面取付けされる。バネ211は上方に向けた端縁212を持ち、この端212はまたパッケージ20を支持面に対して押圧するために頂面200に圧力を加えるための圧力点を形成する。
【0032】
従来のパッケージデザインでは、圧力点215は、ダイ22のエッジの方に移されている。フレーム23と面210との間の接触抵抗を小さくし、またダイ22の領域の上方に応力をより良好に分散させるため、加圧点をダイ22の中心に向け移動させることが好ましい。
【0033】
第16図のパッケージに関する更なる問題は、壁202と面201とが交差する個所でのパッケージのエッジが低く、リードワイヤ46の曲げにおける許容誤差を減少させていることである。
【0034】
この発明によれば、パッケージの外形は、特に第17図および第18図に示されているように変更される。即ち、第17図および第18図において、平坦な頂面220はダイ22の中心を十分に越えて延び、端壁221は垂直面に対し約45度の角度を形成している。従って、バネ211の圧力点はダイ22の中心の上方に加えられ、パッケージ20の面210への取付けを、電気的にも、また機械的にも改善している。
【0035】
更に、第17図および第18図のパッケージ20の端部が新規な楔形状をしているため、このパッケージ20を図面において単に右方向に押すことで、即ち、バネ211の端部212に近づけてパッケージ20をバネ211の下のその所望の位置にまで移動させることで、パッケージをバネ211に対して取付けできる。パッケージ20をその所望の最終位置に配置するため(図示しない)、ノッチ又は位置決めポストをパッケージ20内に形成することができる。
【0036】
第17図および第18図のパッケージ外形の更なる利点は、エッジ230は、モールドに際して空気を取り込まないということである。また、第16図のようにリードが浅い棚段にあまり近づき過ぎるといった恐れなしに、リード46及び他の同様なリードに対して追加の場所が与えられる。なお、第1図ないし第10図のパッケージで注目において第16図のエッジ202に対応するエッジには、モールド中にそのエッジでの気泡の発生を防ぐため短かい面取りがされているのが分かる。
【0037】
この発明が、その特定の実施例に関して説明されてきたが、その他多くの変形例と修正例及びその他の用例は、当業者には明らかであろう。従って、この発明は、ここでの特定の開示に制限されるのではなく、特許請求の範囲の記載に従ってのみ制限されることが望まれる。
【図面の簡単な説明】
【図1】第1図は、この発明の新規なリードフレームを含む新規なパッケージの頂面図である。
【図2】第2図は、第1図のパッケージの側面図である。
【図3】第3図は、第1図の端面図である。
【図4】第4図は、プラスチックのハウジング表面に沿う沿面距離を増すため、大きくしし外方に曲げた新規なリード導体を用い、またゲート、ドレン及びソースリード導体という公知のシーケンスを用いた、第1図、第2図および第3図のパッケージに封止することができるリードフレームの単一のセクションの頂面図である。
【図5】第5図はゲート、ソース及びドレンの新規なリード導体配列順序と大きくした面積のソースポストをもった第4図のリードフレームに類似するシーケンスリードフレームの第2の実施例である。(図5a)第5a図は、第5図の断面線5a―5aに沿ってとった第5図の断面図である。
【図6】第6図は、第5図のリードフレームセクションをダイオード用に改良したこの発明の第3の実施例である。
【図7】第7図は、ソースポスト面積を増すよう第4図のものを改良したこの発明の第4実施例を示す。
【図8】第8図は、第7図の断面線8−8に沿ってとった第7図の断面図である。
【図9】第9図は、表面取付け型パッケージに改良された、この発明の別の実施例の頂面図である。
【図10】第10図は、第9図の側面図である。
【図11】第11図は、第9図の端面図である。
【図12】第12図は、定格50アンペア用の標準TO220パッケージのリードフレーム導体の断面図である。
【図13】第13図は、この発明により生成されたより高い電流容量を持つ改良されたリードフレーム導体の断面図である。
【図14】第14図は、この発明により生成されたより高い電流容量を持つ改良されたリードフレーム導体の断面図である。
【図15】第15図は、この発明により生成された矩形の導体のエッジが面取りされ、回路基板の孔径を過度に大きくすることなく、より大きな導体断面の使用を可能にした改良されたリードフレーム伝導体の断面図である。
【図16】第16図は、取付けバネをもった従来の装置のパッケージ外形の側面図である。
【図17】第17図は、取付けバネをもったこの発明による新規なパッケージの外形の側面図である。
【図18】第18図は、第17図のパッケージの頂面図である。

Claims (5)

  1. サイズを大きくすることなく電流容量を増加させた半導体装置であって;該半導体装置は、リードフレームと、1つのパワーMOSFETと、複数の結合ワイヤとを備え;前記リードフレームは、ダイ取付けパッドと複数の平行に離間した外部導体とを有する、薄く略々平坦な導電性本体を備え;前記複数の平行に離間した外部導体の1つは、その一端に1つの大きい結合ワイヤポストを有し、この結合ワイヤポストは前記ダイ取付けパッドの近くに位置しているがこれと離間し;前記パワーMOSFETの底部は前記ダイ取付けパッドの頂面に固定され;前記複数の結合ワイヤは、それらの一端で前記パワーMOSFETの頂面と結合され、他の端で前記1つの大きい結合ワイヤポストに結合され;前記1つの大きい結合ワイヤポストは、前記リードフレームの幅の1/2倍以上の幅を有し;前記ダイ取付けパッドは、前記複数の外部導体のうちの1つに電気的に接続され;プラスティックハウジングが前記パワーMOSFETと前記リードフレームの少なくともある複数の部分を取り囲み;前記複数の離間した導体は、前記プラスティックハウジングの内部から延び、前記ハウジングの側壁を通って、前記ハウジングの外部に至り;前記複数の離間された外部導体のうちの横方向に最も外側の2つは、くぼみ形に曲げられ、前記導体の延在自由端部の離間距離を小さくし;前記くぼみ形に曲げられた外部導体は、それらが最大の離間を有する距離となる位置において前記ハウジングの側壁を貫通し、それによって前記側壁の表面に沿う沿面距離を増していることを特徴とする半導体装置。
  2. 前記外部導体の内の第2の外部導体は、前記パワーMOSFETの頂面の制御電極に接続するための大きい第2の結合ワイヤポストを有し;前記大きい結合ワイヤポストは、前記大きい第2の結合ワイヤポストの面積よりも実質的に大きい面積を有することを特徴とする特許請求の範囲第1項に記載の装置。
  3. 前記プラスティックハウジングの形状は矩形状であり、略々平坦な頂面と、略々平坦な底面と、前記頂面と底面及び前記側壁との間を延びる、一対の離間した略々垂直かつ平行なエッジ壁と、前記側壁に対向する前記ハウジングの反対側の第2の側壁とを有し;前記略々平坦な頂面は、実質的に前記ダイの全面積上方に位置することを特徴とする特許請求の範囲第1項に記載の装置。
  4. 前記第2の側壁は、垂直に対し45度の角度をなし、前記頂面と135度の内角で交差し、前記ハウジングに対し片持ち支持取付けバネの下にカム作用させるためのカム面を形成することを特徴とする特許請求の範囲第3項に記載の装置。
  5. 前記複数の外部導体の各個は、同一の矩形の形状を有し、前記複数の外部導体のエッジは、少なくともその長さ部分に対して面取りされ、それによって、面取りを行なわない導体を受入れるときの孔径よりも小さな径のプリント基板孔に挿入できるようにすると共に、所定の径のプリント基板孔に対してはより大きな断面積の使用を可能にしたことを特徴とする特許請求の範囲第1項に記載の装置。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100246366B1 (ko) * 1997-12-04 2000-03-15 김영환 에리어 어레이형 반도체 패키지 및 그 제조방법
US6476481B2 (en) * 1998-05-05 2002-11-05 International Rectifier Corporation High current capacity semiconductor device package and lead frame with large area connection posts and modified outline
GB0018643D0 (en) * 2000-07-31 2000-09-13 Koninkl Philips Electronics Nv Semiconductor devices
JP3833464B2 (ja) * 2000-11-01 2006-10-11 株式会社三井ハイテック リードフレーム
US6891256B2 (en) * 2001-10-22 2005-05-10 Fairchild Semiconductor Corporation Thin, thermally enhanced flip chip in a leaded molded package
US20040094828A1 (en) * 2002-01-16 2004-05-20 Delphi Technologies, Inc. Double-sided multi-chip circuit component
JP2004063688A (ja) * 2002-07-26 2004-02-26 Mitsubishi Electric Corp 半導体装置及び半導体アセンブリモジュール
JP3872001B2 (ja) * 2002-11-18 2007-01-24 シャープ株式会社 リードフレーム、それを用いた半導体装置の製造方法、それを用いた半導体装置、及び電子機器
KR100958422B1 (ko) * 2003-01-21 2010-05-18 페어차일드코리아반도체 주식회사 고전압 응용에 적합한 구조를 갖는 반도체 패키지
JP4248953B2 (ja) 2003-06-30 2009-04-02 株式会社ルネサステクノロジ 半導体装置およびその製造方法
US7034385B2 (en) * 2003-08-05 2006-04-25 International Rectifier Corporation Topless semiconductor package
US8395253B2 (en) * 2004-01-28 2013-03-12 International Rectifier Corporation Hermetic surface mounted power package
US7154186B2 (en) * 2004-03-18 2006-12-26 Fairchild Semiconductor Corporation Multi-flip chip on lead frame on over molded IC package and method of assembly
US7208818B2 (en) * 2004-07-20 2007-04-24 Alpha And Omega Semiconductor Ltd. Power semiconductor package
US7759775B2 (en) * 2004-07-20 2010-07-20 Alpha And Omega Semiconductor Incorporated High current semiconductor power device SOIC package
US7268447B2 (en) * 2004-09-01 2007-09-11 Yazaki North America, Inc. Power control center with solid state device for controlling power transmission
US7268446B2 (en) 2004-09-01 2007-09-11 Yazaki North America, Inc. Power control center with solid state device for controlling power transmission
US7271473B1 (en) 2005-02-08 2007-09-18 Yazaki North America, Inc. Semiconductor power transmission device
DE102005018941B4 (de) * 2005-04-22 2010-07-08 Infineon Technologies Ag Halbleiterbauteil in einem Standardgehäuse und Verfahren zur Herstellung desselben
US8334583B2 (en) * 2005-07-20 2012-12-18 Infineon Technologies Ag Leadframe strip and mold apparatus for an electronic component and method of encapsulating an electronic component
US7791182B2 (en) * 2005-09-27 2010-09-07 Infineon Technologies Ag Semiconductor component having maximized bonding areas of electrically conductive members connected to semiconductor device and connected to leadframe and method of producing
US7786558B2 (en) * 2005-10-20 2010-08-31 Infineon Technologies Ag Semiconductor component and methods to produce a semiconductor component
US7663212B2 (en) * 2006-03-21 2010-02-16 Infineon Technologies Ag Electronic component having exposed surfaces
US7541681B2 (en) * 2006-05-04 2009-06-02 Infineon Technologies Ag Interconnection structure, electronic component and method of manufacturing the same
US8116862B2 (en) * 2006-06-08 2012-02-14 Greatbatch Ltd. Tank filters placed in series with the lead wires or circuits of active medical devices to enhance MRI compatibility
KR101257811B1 (ko) * 2006-06-30 2013-04-29 엘지디스플레이 주식회사 액정표시장치용 어레이 기판과 그 제조방법
US7447041B2 (en) * 2007-03-01 2008-11-04 Delphi Technologies, Inc. Compression connection for vertical IC packages
US7586179B2 (en) * 2007-10-09 2009-09-08 Fairchild Semiconductor Corporation Wireless semiconductor package for efficient heat dissipation
US8253225B2 (en) 2008-02-22 2012-08-28 Infineon Technologies Ag Device including semiconductor chip and leads coupled to the semiconductor chip and manufacturing thereof
JP5543084B2 (ja) * 2008-06-24 2014-07-09 ピーエスフォー ルクスコ エスエイアールエル 半導体装置の製造方法
CN102522375B (zh) * 2008-07-30 2015-04-08 三洋电机株式会社 半导体装置、半导体装置的制造方法及引线框
US8324025B2 (en) * 2010-04-22 2012-12-04 Team Pacific Corporation Power semiconductor device packaging
JP5609298B2 (ja) * 2010-06-18 2014-10-22 富士電機株式会社 ラミネートブスバー
US8314489B2 (en) 2010-09-13 2012-11-20 Infineon Technologies Ag Semiconductor module and method for production thereof
DE102012019391A1 (de) * 2012-10-02 2014-04-03 Infineon Technologies Ag Leitungshalbleitergehäuse mit redundanter Funktionalität
DE102012222679A1 (de) * 2012-12-10 2014-06-12 Robert Bosch Gmbh Verfahren zur Herstellung eines Schaltmoduls und eines zugehörigen Gittermoduls sowie ein zugehöriges Gittermodul und korrespondierende elektronische Baugruppe
JP5776707B2 (ja) * 2013-02-27 2015-09-09 株式会社デンソー 半導体装置
JP5665206B2 (ja) * 2013-09-11 2015-02-04 ルネサスエレクトロニクス株式会社 半導体装置
US9041172B1 (en) * 2013-12-13 2015-05-26 Alpha & Omega Semiconductor, Inc. Semiconductor device for restraining creep-age phenomenon and fabricating method thereof
JP2016072376A (ja) * 2014-09-29 2016-05-09 ルネサスエレクトロニクス株式会社 半導体装置
US9768087B2 (en) * 2014-10-08 2017-09-19 Infineon Technologies Americas Corp. Compact high-voltage semiconductor package
JP2016040839A (ja) * 2015-10-27 2016-03-24 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
US10787303B2 (en) 2016-05-29 2020-09-29 Cellulose Material Solutions, LLC Packaging insulation products and methods of making and using same
US11078007B2 (en) 2016-06-27 2021-08-03 Cellulose Material Solutions, LLC Thermoplastic packaging insulation products and methods of making and using same
US10249557B2 (en) 2017-05-23 2019-04-02 Nxp Usa, Inc. Packaged integrated circuit device and methods
JPWO2018235330A1 (ja) 2017-06-20 2020-04-16 住友電気工業株式会社 半導体装置
US11927431B1 (en) 2018-12-11 2024-03-12 Northrop Grumman Systems Corporation Firing switch for compact capacitive discharge unit
CN111341747A (zh) 2018-12-19 2020-06-26 恩智浦美国有限公司 用以改进爬电距离的引线缩短
JP1646470S (ja) * 2019-05-14 2019-11-25
CN110310940A (zh) * 2019-07-16 2019-10-08 上海道之科技有限公司 一种新型封装的分立器件
US11581632B1 (en) 2019-11-01 2023-02-14 Northrop Grumman Systems Corporation Flexline wrap antenna for projectile
USD920264S1 (en) * 2019-11-27 2021-05-25 The Noco Company Semiconductor device
USD932452S1 (en) * 2019-11-27 2021-10-05 The Noco Company Semiconductor device

Family Cites Families (42)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3781613A (en) * 1972-10-10 1973-12-25 Collins Radio Co Rf transistor carrier
US3784884A (en) * 1972-11-03 1974-01-08 Motorola Inc Low parasitic microwave package
US4346396A (en) * 1979-03-12 1982-08-24 Western Electric Co., Inc. Electronic device assembly and methods of making same
US4546374A (en) * 1981-03-23 1985-10-08 Motorola Inc. Semiconductor device including plateless package
JPS58209147A (ja) * 1982-05-31 1983-12-06 Toshiba Corp 樹脂封止型半導体装置
JPS59130449A (ja) * 1983-01-17 1984-07-27 Nec Corp 絶縁型半導体素子用リードフレーム
JPS6116554A (ja) 1984-07-03 1986-01-24 Sony Corp 半導体装置
DE3535605C1 (de) * 1985-10-05 1986-12-04 Telefunken electronic GmbH, 7100 Heilbronn Halbleiteranordnung
JPS62150755A (ja) 1985-12-25 1987-07-04 Hitachi Ltd 電子装置およびその製造方法
JPS6310548A (ja) 1986-07-01 1988-01-18 Mitsubishi Electric Corp 半導体装置
JPH0750753B2 (ja) * 1987-08-21 1995-05-31 株式会社東芝 トランジスタ装置
JPH0815165B2 (ja) * 1987-09-17 1996-02-14 株式会社東芝 樹脂絶縁型半導体装置の製造方法
JPH0770317B2 (ja) 1987-11-27 1995-07-31 新神戸電機株式会社 鉛蓄電池用極板の製造法
JPH01216608A (ja) 1988-02-24 1989-08-30 Mitsubishi Electric Corp 半導体装置用パッケージ
JP2714037B2 (ja) 1988-09-26 1998-02-16 株式会社日立製作所 半導体装置
JPH0691119B2 (ja) 1989-07-31 1994-11-14 株式会社東芝 半導体装置
IT1239644B (it) * 1990-02-22 1993-11-11 Sgs Thomson Microelectronics Struttura di supporto degli adduttori perfezionata per contenitori di dispositivi integrati di potenza
JPH0760839B2 (ja) 1990-03-15 1995-06-28 株式会社東芝 半導体装置
IT1250405B (it) * 1991-01-31 1995-04-07 Sgs Thomson Microelectronics Piastrina metallica di dissipazione del calore di un dispositivo a semiconduttore di potenza incapsulato in resina fornita di rilievi per la saldatura dei fili di massa
ES2103341T3 (es) * 1991-04-10 1997-09-16 Caddock Electronics Inc Resistor de tipo pelicula.
IT1249388B (it) 1991-04-26 1995-02-23 Cons Ric Microelettronica Dispositivo a semiconduttore incapsulato in resina e completamente isolato per alte tensioni
JPH0523563U (ja) * 1991-07-17 1993-03-26 ソニー株式会社 半導体レーザ装置
DE4141650C2 (de) 1991-12-17 1997-03-13 Vero Electronics Gmbh Kühlkörper mit abnehmbarer Andruckklammer
JPH05218233A (ja) * 1992-02-06 1993-08-27 Mitsubishi Electric Corp 半導体装置およびその製造方法
US5309027A (en) * 1992-06-15 1994-05-03 Motorola, Inc. Encapsulated semiconductor package having protectant circular insulators
JP2695736B2 (ja) * 1992-12-11 1998-01-14 三菱電機株式会社 樹脂封止型半導体装置及びその抵抗線を備えたリードフレームの製造方法
JP2560974B2 (ja) * 1993-06-04 1996-12-04 日本電気株式会社 半導体装置
JP3027512B2 (ja) * 1994-08-23 2000-04-04 株式会社日立製作所 パワーmosfet
US5530284A (en) * 1995-03-06 1996-06-25 Motorola, Inc. Semiconductor leadframe structure compatible with differing bond wire materials
US5587608A (en) * 1995-10-27 1996-12-24 Meng; Ching-Ming Structure heat sink for power semiconductors
JPH09186390A (ja) * 1995-12-28 1997-07-15 Fuji Electric Co Ltd 半導体レーザ装置
DE19736895A1 (de) 1996-09-05 1998-04-16 Int Rectifier Corp Gehäuse für Halbleiterbauteile
US5886397A (en) 1996-09-05 1999-03-23 International Rectifier Corporation Crushable bead on lead finger side surface to improve moldability
US5767567A (en) * 1996-09-10 1998-06-16 Magemos Corporation Design of device layout for integration with power mosfet packaging to achieve better lead wire connections and lower on resistance
US6114750A (en) 1996-10-01 2000-09-05 International Rectifier Corp. Surface mount TO-220 package and process for the manufacture thereof
US5814884C1 (en) * 1996-10-24 2002-01-29 Int Rectifier Corp Commonly housed diverse semiconductor die
US5977630A (en) * 1997-08-15 1999-11-02 International Rectifier Corp. Plural semiconductor die housed in common package with split heat sink
US5917704A (en) * 1997-10-06 1999-06-29 Ford Motor Company Laser-solderable electronic component
US6144093A (en) * 1998-04-27 2000-11-07 International Rectifier Corp. Commonly housed diverse semiconductor die with reduced inductance
US6476481B2 (en) * 1998-05-05 2002-11-05 International Rectifier Corporation High current capacity semiconductor device package and lead frame with large area connection posts and modified outline
US6335548B1 (en) * 1999-03-15 2002-01-01 Gentex Corporation Semiconductor radiation emitter package
JP2002124613A (ja) * 2001-08-23 2002-04-26 Hitachi Ltd パワーmosfetの製造方法

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