JP2017152653A - 半導体発光素子の製造方法、半導体発光素子用ウェハの製造方法 - Google Patents
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Abstract
Description
成長基板を準備する工程(a)と、
前記成長基板の上層に半導体層を形成する工程(b)と、
前記半導体層に対して励起光を照射する工程(c)と、
前記工程(c)の実行時に前記半導体層から放射される蛍光を受光する工程(d)と、
前記工程(d)において受光される蛍光の光出力に基づいて前記半導体層の良否判定を行う工程(e)とを有することを特徴とする。
前記工程(e)は、前記半導体層の特定箇所から受光された、前記所定の波長帯の蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断するものとしても構わない。
成長基板を準備する工程(a)と、
前記成長基板の上層に、n型又はp型の第一半導体層、活性層、及び前記第一半導体層とは導電型の異なる第二半導体層を含む半導体層を形成する工程(b)と、
前記半導体層に対して励起光を照射する工程(c)と、
前記工程(c)の実行時に前記半導体層から放射される蛍光を受光する工程(d)と、
前記工程(d)において受光される蛍光の光出力に基づいて前記半導体層の良否判定を行う工程(e)と、
前記工程(b)の後に、前記第二半導体層の上層に第二電極を形成する工程(f)と、
前記第二電極の上層に、前記成長基板とは別の基板を貼り合わせる工程(g)と、
前記工程(g)の後に、前記成長基板を剥離して、前記第一半導体層を露出させる工程(h)と、
前記第一半導体層の上面に第一電極を形成する工程(i)とを有することを特徴とする。
前記工程(e)は、前記半導体層の特定箇所から受光された、前記所定の波長帯の蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断する工程であるものとしても構わない。
各チップに対して実装処理を行う工程(k)とを有し、
前記工程(c)、前記工程(d)、及び前記工程(e)は、前記工程(k)の前に実行され、
前記工程(e)において良品と判定された前記チップに対してのみ前記工程(k)が実行されるものとしても構わない。
前記工程(c)は、紫外光を照射する工程であるものとすることができる。
図2A〜図2Bは、半導体発光素子の一実施形態の構成を模式的に示す図面である。図2Aは光取り出し方向から見たときの平面図に対応する。図2Bは、図2A内におけるX1−X1線で切断したときの断面図に対応する。以下では、光取り出し面をX−Y平面とし、このX−Y平面に直交する方向をZ方向と規定する。
基板3は、例えばCuW、W、Moなどの導電性基板、又はSiなどの半導体基板で構成される。
本実施形態では、半導体層5は、基板3に近い側からp型半導体層11、活性層9、及びn型半導体層7が順に積層されて形成されている。本実施形態では、n型半導体層7が「第一半導体層」に対応し、p型半導体層11が「第二半導体層」に対応する。
第一電極15は、半導体層5の面のうち、基板3に対して遠い側の面に接触して形成されている。より詳細には、第一電極15は、n型半導体層7の面に接触して形成されている。
第二電極13は、p型半導体層11に接触して形成されており、p型半導体層11との間でオーミック接触が形成されている。本実施形態では、第二電極13はp側電極を構成する。
導電層20は、基板3の上層に形成されている。本実施形態では、導電層20は、保護層23、接合層21、接合層19、及び保護層17の多層構造で構成されている。
本実施形態の発光素子1は、Z方向に関して第一電極15と対向する位置であって、第二電極13に接触するように形成された、電流遮断層24を備える。電流遮断層24は、例えばSiO2、SiN、Zr2O3、AlN、Al2O3などで構成される。電流遮断層24は、活性層9を流れる電流を、XY平面に平行な方向に拡げる役割を果たしている。ただし、発光素子1が電流遮断層24を備えるか否かは任意である。
次に、発光素子1の製造方法につき、図面を参照して説明する。
まず、図3Aに示すように、成長基板25を準備する。成長基板25としては、一例としてC面を有するサファイア基板を用いることができる。
図3Bに示すように、成長基板25の上層に、下地層27、n型半導体層7、活性層9、及びp型半導体層11を順に形成する。このステップS2は、例えば以下の手順で行われる。
ステップS2で得られたウェハに対して活性化処理を行う。具体的な一例としては、RTA(Rapid Thermal Anneal:急速加熱)装置を用いて、窒素雰囲気下中650℃で15分間の活性化処理を行う。
図3Cに示すように、p型半導体層11の上層に、電流遮断層24を形成する。電流遮断層24は、例えば、SiO2、SiN、Zr2O3、AlN、又はAl2O3等をスパッタリング法等によって成膜することで形成される。なお、本ステップS4において、電流遮断層24は、後のステップS13で第一電極15を形成する予定の領域に対して、Z方向に対向する位置に形成される。
図3Cに示すように、p型半導体層11の所定の領域の上面に第二電極13を形成する。ここでは、第二電極13を電流遮断層24の上面にも形成しているが、第二電極13の形状は任意に選択される。第二電極13は、例えば、スパッタリング装置にてNi/Agを成膜した後、RTA装置を用いてドライエア雰囲気中でコンタクトアニールを行うことで形成される。ここでは、一例として、第二電極13の材料としてNiとAgの合金を挙げたが、Al、Rh、AgとPdとCuの合金等を用いることもできる。上述したように、第二電極13の材料としては、活性層9から放射される光に対する反射率の高い材料を用いるのが好ましい。
次に、図3Cに示すように、第二電極13の上面に保護層17を形成し、保護層17の上面に接合層19を形成する。
図3Dに示すように、成長基板25とは別に準備された基板3の上面に、保護層23及び接合層21を形成する。基板3としては、上述したようにCuW、W、Mo等の導電性基板、又はSi等の半導体基板を利用することができる。保護層23は、保護層17と同様に形成することができ、接合層21は、接合層19と同様に形成することができる。保護層23を設けるか否かは任意である。
図3Eに示すように、成長基板25の上層に形成された接合層19と、基板3の上層に形成された接合層21を貼り合わせることで、成長基板25と基板3の貼り合わせを行う。具体的な一例としては、280℃の温度、0.2MPaの圧力下で、貼り合わせ処理が行われる。
図3Fに示すように、成長基板25を剥離する。より具体的には、成長基板25側からレーザ光を照射する。ここで、照射するレーザ光を、成長基板25の構成材料(本実施形態ではサファイア)を透過し、下地層27の構成材料(本実施形態ではGaN)によって吸収されるような波長の光とする。これにより、下地層27でレーザ光が吸収されるため、成長基板25と下地層27の界面が高温化してGaNが分解され、成長基板25が剥離される。
ウェハ上に残存している金属Gaを塩酸等を用いて除去した後、GaN(下地層27)をICP装置を用いたドライエッチングによって除去し、n型半導体層7を露出させる(図3G参照)。
光源部51から半導体層5に対して所定の波長を有する励起光55を照射する。そして、受光部52において、半導体層5から発せられる蛍光56を受光し、受光された強度に関する情報を演算部53に出力する。演算部53では、蛍光56の強度を例えば、半導体層5内の場所毎に、所定の閾値と大小比較を行う。演算部53は、受光部52で受光された強度が閾値以下である場合には当該強度を示す半導体層5内の領域に不良部が存在すると判断する。
図3Iに示すように、隣接する素子同士を分離する。具体的には、隣接素子との境界領域に対し、ICP装置を用いて、素子分離領域に形成された電流遮断層24の上面が露出するまで半導体層5をエッチングする。このとき、電流遮断層24がエッチングストッパー層として機能する。なお、図3Iでは、半導体層5の側面が鉛直方向に対して傾斜を有するように図示しているが、これは一例であって、このような形状に限定する趣旨ではない。
図3Jに示すように、n型半導体層7の上面の一部に、第一電極15を形成する。例えば、電子線蒸着装置によって例えばNi/Al/Ni/Ti/Auからなる導電性材料を、例えば膜厚3μm程度蒸着させる。
ウェハをチップ単位に分割する。具体的な一例としては、各素子同士を例えばレーザダイシング装置によって分離する。このステップS14が工程(j)に対応する。
チップ単位に分割された各素子に対し実装処理を行う。具体的には、基板3の裏面を例えばAgペーストにてパッケージと接合し、電流供給部15aに対して電流供給線14を連結させる。例えば、50gの荷重で、Φ100μmの電流供給部15aにAuからなる電流供給線14を連結させることで、ワイヤボンディングを行う。これにより、発光素子1が形成される。
上記の方法で半導体発光素子1を製造することにより、不良部を有すると判定された発光素子については後の工程に送らずに、不良部が存在しないと判定された発光素子についてのみを後の工程に送ることができる。特に、ステップS11のように、励起光を照射して受光された蛍光の光強度を確認するのみで良不良判定が行えるため、ウェハ単位で一括して判定処理を行うことができる。また、白色光とは異なり、紫外光を励起光として照射するため、散乱光によって判定精度が低下するという課題も生じにくい。よって、製造プロセスを複雑化することなく、高精度に良不良判定を行うことができる。
以下、別実施形態について説明する。
良品として判定された領域内において、一部の領域に形成されたp型半導体層11及び活性層9を、n型半導体層7の上面が露出するまでエッチングする。
p型半導体層11の所定の領域の上面に第二電極13を形成し、露出されたn型半導体層7の所定の領域の上面に第一電極15を形成する。なお、この構造においては、第二電極13は第一電極15と同じ材料で構成しても構わない。その後、必要な実装処理を行う。
2 : 蛍光強度が周囲よりも低い領域
3 : 基板
5 : 半導体層
7 : n型半導体層
9 : 活性層
11 : p型半導体層
13 : 第二電極
14 : 電流供給線
15 : 第一電極
15a : 電流供給部
17 : 保護層
19 : 接合層
20 : 導電層
21 : 接合層
23 : 保護層
24 : 電流遮断層
25 : 成長基板
27 : 下地層
51 : 光源部
52 : 受光部
53 : 演算部
55 : 励起光
56 : 蛍光
90 : 従来の半導体発光素子
91 : 基板
92 : 導電層
93 : 反射膜
94 : 絶縁層
95 : 反射電極
96 : p型半導体層
97 : 活性層
98 : n型半導体層
99 : 半導体層
100 : n側電極
Claims (12)
- 半導体発光素子用ウェハの製造方法であって、
成長基板を準備する工程(a)と、
前記成長基板の上層に半導体層を形成する工程(b)と、
前記半導体層に対して励起光を照射する工程(c)と、
前記工程(c)の実行時に前記半導体層から放射される蛍光を受光する工程(d)と、
前記工程(d)において受光される蛍光の光出力に基づいて前記半導体層の良否判定を行う工程(e)とを有することを特徴とする半導体発光素子用ウェハの製造方法。 - 前記工程(e)は、前記半導体層の特定箇所から受光された蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断する工程であることを特徴とする請求項1に記載の半導体発光素子用ウェハの製造方法。
- 前記工程(d)は、前記蛍光のうち、所定の波長帯の光を選択して受光する工程であり、
前記工程(e)は、前記半導体層の特定箇所から受光された、前記所定の波長帯の蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断する工程であることを特徴とする請求項1に記載の半導体発光素子用ウェハの製造方法。 - 前記工程(b)は、窒化物半導体からなる前記半導体層を形成する工程であることを特徴とする請求項1〜3のいずれか1項に記載の半導体発光素子用ウェハの製造方法。
- 前記半導体層は、Alを含む窒化物半導体を有し、
前記励起光は、紫外光であることを特徴とする請求項4に記載の半導体発光素子用ウェハの製造方法。 - 半導体発光素子の製造方法であって、
成長基板を準備する工程(a)と、
前記成長基板の上層に、n型又はp型の第一半導体層、活性層、及び前記第一半導体層とは導電型の異なる第二半導体層を含む半導体層を形成する工程(b)と、
前記半導体層に対して励起光を照射する工程(c)と、
前記工程(c)の実行時に前記半導体層から放射される蛍光を受光する工程(d)と、
前記工程(d)において受光される蛍光の光出力に基づいて前記半導体層の良否判定を行う工程(e)と、
前記工程(b)の後に、前記第二半導体層の上層に第二電極を形成する工程(f)と、
前記第二電極の上層に、前記成長基板とは別の基板を貼り合わせる工程(g)と、
前記工程(g)の後に、前記成長基板を剥離して、前記第一半導体層を露出させる工程(h)と、
前記第一半導体層の上面に第一電極を形成する工程(i)とを有することを特徴とする半導体発光素子の製造方法。 - 前記工程(e)は、前記半導体層の特定箇所から受光された蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断する工程であることを特徴とする請求項6に記載の半導体発光素子の製造方法。
- 前記工程(d)は、前記蛍光のうち、所定の波長帯の光を選択して受光する工程であり、
前記工程(e)は、前記半導体層の特定箇所から受光された、前記所定の波長帯の蛍光強度が所定の閾値以下である場合に、前記半導体層の前記特定箇所に不良部を有すると判断する工程であることを特徴とする請求項6に記載の半導体発光素子の製造方法。 - 前記工程(c)、前記工程(d)、及び前記工程(e)は、前記工程(h)の後で、前記工程(i)の前に実行されることを特徴とする請求項6〜8のいずれか1項に記載の半導体発光素子の製造方法。
- 前記工程(i)の後、ウェハをチップ毎に分割する工程(j)と、
各チップに対して実装処理を行う工程(k)とを有し、
前記工程(c)、前記工程(d)、及び前記工程(e)は、前記工程(k)の前に実行され、
前記工程(e)において良品と判定された前記チップに対してのみ前記工程(k)が実行されることを特徴とする請求項6〜8のいずれか1項に記載の半導体発光素子の製造方法。 - 前記工程(b)は、窒化物半導体からなる前記半導体層を形成する工程であることを特徴とする請求項6〜10のいずれか1項に記載の半導体発光素子の製造方法。
- 前記半導体層は、Alを含む窒化物半導体を有し、
前記工程(c)は、紫外光を照射する工程であることを特徴とする請求項11に記載の半導体発光素子の製造方法。
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