JP2012178627A - 電源電圧検出回路 - Google Patents
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Abstract
【解決手段】第1スイッチ(122)と第2スイッチ(124)とは直列に接続されてスイッチ部を形成し、第1スイッチ(122)は、基準信号に基づいて開閉が制御される。判定信号生成回路(110)は、第1電源電圧(VDD)と第2電源電圧(VSS)とに基づいて電源電圧判定信号(VG)を生成し、第2スイッチ(124)は、電源電圧判定信号(VG)に基づいて開閉が制御される。第1負荷素子(126)は、第1電源電圧(VDD)とスイッチ部との間に直列に挿入される。スイッチ部は、基準信号(Vref)が所定の第1電圧を超え、電源電圧判定信号(VG)が所定の第2電圧を超えたとき回路を閉成して第1負荷素子(126)に電流を供給し、第1負荷素子(126)とスイッチ部との接続ノードから第1電源電圧(VDD)の状態を示す第1出力信号(VOUT)を出力する。
【選択図】図1
Description
図1は、本発明の第1の実施の形態に係る電源電圧検出回路の構成を示す回路図である。電源電圧検出回路は、電源電圧VDDに基づいて電源電圧判定信号VGを生成する判定信号生成回路110と、電源電圧判定信号VGと基準信号である基準電圧Vrefとに基づいて出力信号VOUTを生成する電圧生成回路120とを具備する。図1に示される電源電圧検出回路は、さらに、出力回路130、基準電圧源140を具備する。出力回路130は、出力信号VOUTを論理反転して、出力信号VO_INVを出力する。基準電圧源140は、基準電圧(基準信号)Vrefを生成して出力する基準信号生成回路である。
図6を参照して、第2の実施の形態を説明する。
図7を参照して、第3の実施の形態を説明する。第3の実施の形態に係る電源電圧検出回路では、判定信号生成回路110の構成が第1の実施の形態に係る電源電圧検出回路と異なる。第3の実施の形態に係る電源電圧検出回路の判定信号生成回路110は、負荷素子として抵抗素子114の代りにツェナーダイオード116が用いられる。したがって、判定信号生成回路110は、電源電圧VDDと電源電圧VSSとの間に直列に接続されるツェナーダイオード116と抵抗素子112とを備える。他の回路は第1の実施の形態に係る電源電圧検出回路と同じであり、説明を省略する。
112、114 抵抗素子
116 ツェナーダイオード
120 電圧生成回路
122、124 トランジスタ
126 抵抗素子
130 出力回路
133 トランジスタ
134 抵抗素子
140 基準電圧源
150 基準電流源
152 トランジスタ
300 フォトダイオード
301 I/V変換器
302 基準電圧源
303 電源電圧検出回路
304 AND回路
Claims (14)
- 基準信号に基づいて開閉が制御される第1スイッチと、
第1電源電圧と第2電源電圧とに基づいて電源電圧判定信号を生成する判定信号生成回路と、
前記電源電圧判定信号に基づいて開閉が制御される第2スイッチと、前記第1スイッチと前記第2スイッチとは直列に接続されてスイッチ部を形成し、
第1電源電圧と前記スイッチ部との間に直列に挿入される第1負荷素子と
を具備し、
前記スイッチ部は、前記基準信号が所定の第1電圧を超え、前記電源電圧判定信号が所定の第2電圧を超えたとき回路を閉成して前記第1負荷素子に電流を供給し、
前記第1負荷素子と前記スイッチ部との接続ノードから前記第1電源電圧の状態を示す第1出力信号を出力する
電源電圧検出回路。 - 前記第1電源電圧と前記第2電源電圧との間に直列に接続される第3スイッチと第2負荷素子とを備える出力回路をさらに具備し、
前記第3スイッチは、前記第1出力信号に応答して回路を開閉して前記第2負荷素子に流れる電流を制御し、
前記第3スイッチと前記第2負荷素子との接続ノードから第2出力信号を出力する
請求項1に記載の電源電圧検出回路。 - 前記第1電源電圧と前記第2電源電圧とに基づいて、前記基準信号を示す基準電圧を生成する基準電圧源をさらに具備する
請求項1または請求項2に記載の電源電圧検出回路。 - 前記第1電源電圧と前記第2電源電圧とに基づいて、基準電流を生成する基準電流源と、
前記基準電流を電圧信号に変換して前記基準信号として前記第1スイッチに供給する電流電圧変換回路と
をさらに具備する
請求項1または請求項2に記載の電源電圧検出回路。 - 判定信号生成回路は、前記第1電源電圧と前記第2電源電圧との間に直列に接続される第1抵抗素子と第2抵抗素子とを備え、
前記第1抵抗素子と前記第2抵抗素子との接続ノードの電圧を前記電源電圧判定信号として前記第2スイッチに供給する
請求項1から請求項4のいずれかに記載の電源電圧検出回路。 - 判定信号生成回路は、前記第1電源電圧と前記第2電源電圧との間に直列に接続されるツェナーダイオードと抵抗素子とを備え、
前記ツェナーダイオードと前記抵抗素子との接続ノードの電圧を前記電源電圧判定信号として前記第2スイッチに供給する
請求項1から請求項4のいずれかに記載の電源電圧検出回路。 - 前記第1スイッチ、前記第2スイッチは、半導体スイッチを含む
請求項1から請求項6のいずれかに記載の電源電圧検出回路。 - 前記第1スイッチ、前記第2スイッチは、NチャネルMOSトランジスタを含み、
前記第1負荷素子は、抵抗素子を含む
請求項1から請求項7のいずれかに記載の電源電圧検出回路。 - 前記第1スイッチ、前記第2スイッチは、NチャネルMOSトランジスタを含み、
前記電流電圧変換回路は、ゲートとドレインとが接続され、前記基準電流をドレイン電流として流すNチャネルMOSトランジスタを含み、
前記第1スイッチのNチャネルMOSトランジスタと、前記電流電圧変換回路のNチャネルMOSトランジスタとはカレントミラー回路を形成する
請求項4に記載の電源電圧検出回路。 - 前記第1スイッチ、前記第2スイッチは、NチャネルMOSトランジスタを含み、
前記第3スイッチは、PチャネルMOSトランジスタを含む
請求項2に記載の電源電圧検出回路。 - 前記第2負荷素子は、抵抗素子を含む
請求項2または請求項10に記載の電源電圧検出回路。 - 前記出力回路は、前記第1電源電圧と前記第2負荷素子との間に、前記第3スイッチと直列に接続される第4スイッチを備える
請求項2または請求項10または請求項11に記載の電源電圧検出回路。 - 前記出力回路は、前記第1電源電圧と前記第2負荷素子との間に、前記第3スイッチと並列に接続される第5スイッチを備える
請求項2または請求項10から請求項12のいずれかに記載の電源電圧検出回路。 - 前記第1電源電圧および前記第2電源電圧と異なる第3電源電圧および第4電源電圧に基づいて、前記基準信号を生成する基準信号生成回路をさらに具備する
請求項1または請求項2に記載の電源電圧検出回路。
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JP2010147979A (ja) * | 2008-12-22 | 2010-07-01 | Elpida Memory Inc | 半導体装置およびパワーオンリセット回路の調整方法 |
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