JP2008015807A - クロック切り替え回路 - Google Patents
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Abstract
【解決手段】N(Nは3以上の整数)ビットの選択信号に基づいて,同じ周波数でそれぞれ位相がずれた2N相の入力クロックから1つを選択して出力クロックとして出力するクロック切り替え回路において,それぞれ,入力される2つのクロックから1つを選択して出力する2N−1個のセレクタを有するセレクタ群と,前記2N−1個のセレクタをアクティブ状態かスリープ状態かに制御する2N−1の動作制御信号を生成する動作制御回路とを有する。前記セレクタは,選択信号によりそれぞれクロックの選択を行う。そして,動作制御回路が,選択信号に基づいて,2N−1個のセレクタのうち一部のセレクタをアクティブ状態に制御し,残りのセレクタをスリープ状態に制御する。
【選択図】図8
Description
それぞれ,入力される2つのクロックから1つを選択して出力する2N−1個のセレクタを有するセレクタ群と,
前記2N−1個のセレクタをアクティブ状態かスリープ状態かに制御する2N−1の動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第2N-1のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第2N-1+1〜第2N-1+2N-2のセレクタを有する第2層と,
さらに,同様に第3層〜第N(この場合はNは4以上)層を有し,前記第N層は,第N−1層の2つのセレクタの出力クロックを入力していずれかのクロックを選択して出力する第2N−1のセレクタを有し,
前記第1層のセレクタに第1の選択信号が正論理または負論理で供給され,前記第2層のセレクタに第2の選択信号が正論理または負論理で供給され,同様に第3層〜第N−1層のセレクタに第3〜第N−1の選択信号が正論理または負論理で供給され,前記第N層のセレクタに第Nの選択信号が供給され,
前記動作制御回路は,前記Nビットの選択信号の状態に応じて,前記2N−1個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のN個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,少なくとも,前記される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,少なくとも,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記第1〜第2N−1のセレクタは,入力する2つのクロックが同じ論理レベルになるときに,前記選択信号に応じて前記2つのクロックのいずれかに切り替え,前記動作制御信号がアクティブ状態のときに当該切り替え動作を行い,前記動作制御信号がスリープ状態のときに当該切り替え動作を行わないことを特徴とするクロック切り替え回路。
前記第1〜第2N−1のセレクタは,入力する2つのクロックが同じ論理レベルになるときに前記選択信号をラッチするフリップフロップを有する切り替え制御回路を有し,当該フリップフロップのラッチ出力信号に応答して前記2つのクロックのいずれかに切り替え,
さらに,前記フリップフロップは前記動作制御信号がアクティブ状態のときに前記選択信号をラッチし,前記動作制御信号がスリープ状態のときに前記選択信号をラッチしないことを特徴とするクロック切り替え回路。
前記第1〜第2N−1のセレクタの奇数番目のセレクタには,前記選択信号が正論理または負論理の一方の論理で供給され,偶数番目のセレクタには,前記選択信号の正論理または負論理の他方の論理で供給されることを特徴とするクロック切り替え回路。
前記第1〜第Nの選択信号は,前記第1〜第2Nの入力クロックを選択するグレイコードであることを特徴とするクロック切り替え回路。
それぞれ,入力される2つのクロックから1つを選択して出力する2N−1個のセレクタを有するセレクタ群と,
前記2N−1個のセレクタそれぞれに供給され,当該セレクタをアクティブ状態かスリープ状態かに制御する2N−1つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-1個のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-2個のセレクタを有する第2層と,
さらに,第i層の2つのセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-i個のセレクタを有する第i層(i=2〜N−1)と,
第N−1層の2つのセレクタの出力クロックを入力していずれかのクロックを選択して出力する1個のセレクタを有する第N層とを有し,
前記第1〜第Nの選択信号がそれぞれ,前記第1層〜第N層のセレクタに正論理または負論理で供給され,当該第1〜第Nの選択信号のうち1つの選択信号の切り替えに応答して,選択中の入力クロックから切り替え可能な隣接する2つの入力クロックに切り替えられ,
前記動作制御回路は,前記Nビットの選択信号の状態に応じて,前記2N−1個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のN個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
それぞれ,入力される2つのクロックから1つを選択して出力する少なくとも7個のセレクタを有するセレクタ群と,
前記7個のセレクタをアクティブ状態かスリープ状態かに制御する7つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,少なくとも
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第4のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第5〜第6のセレクタを有する第2層と,
さらに,前記第5と第6のセレクタの出力クロックを入力していずれかのクロックを選択して出力する第7のセレクタを有する第3層とを有し,
前記第1層のセレクタに第1の選択信号が正論理または負論理で供給され,前記第2層のセレクタに第2の選択信号が正論理または負論理で供給され,同様に第3層のセレクタに第3の選択信号が供給され,
前記動作制御回路は,前記3ビットの選択信号の状態に応じて,前記7個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至る3階層の3個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,少なくとも,前記される入力クロックの入力端子から前記出力クロックの出力端子に至る3階層のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至る3階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,少なくとも,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至る3階層のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至る3階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
前記第1〜第7のセレクタは,入力する2つのクロックが同じ論理レベルになるときに,前記選択信号に応じて前記2つのクロックのいずれかに切り替え,前記動作制御信号がアクティブ状態のときに当該切り替え動作を行い,前記動作制御信号がスリープ状態のときに当該切り替え動作を行わないことを特徴とするクロック切り替え回路。
それぞれ,入力される2つのクロックから1つを選択して出力する7個のセレクタを有するセレクタ群と,
前記7個のセレクタをアクティブ状態かスリープ状態かに制御する7つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第4のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第5〜第6のセレクタを有する第2層と,
さらに,前記第5と第6のセレクタの出力クロックを入力していずれかのクロックを選択して出力する第7のセレクタを有する第3層とを有し,
前記第1〜第3の選択信号がそれぞれ,前記第1層〜第3層のセレクタに正論理または負論理で供給され,当該第1〜第3の選択信号のうち1つの選択信号の切り替えに応答して,選択中の入力クロックから切り替え可能な隣接する2つの入力クロックに切り替えられ,
前記動作制御回路は,前記3ビットの選択信号の状態に応じて,前記7個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至る3階層の3個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。
OCLK:出力クロック ICODE[2:0]:選択信号
10:動作制御回路 C1〜C7:動作制御信号
Claims (10)
- N(Nは3以上の整数)ビットの選択信号に基づいて,同じ周波数でそれぞれ位相がずれた2N相の入力クロックから1つを選択して出力クロックとして出力するクロック切り替え回路において,
それぞれ,入力される2つのクロックから1つを選択して出力する2N−1個のセレクタを有するセレクタ群と,
前記2N−1個のセレクタをアクティブ状態かスリープ状態かに制御する2N−1の動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第2N-1のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第2N-1+1〜第2N-1+2N-2のセレクタを有する第2層と,
さらに,同様に第3層〜第N(この場合はNは4以上)層を有し,前記第N層は,第N−1層の2つのセレクタの出力クロックを入力していずれかのクロックを選択して出力する第2N−1のセレクタを有し,
前記第1層のセレクタに第1の選択信号が正論理または負論理で供給され,前記第2層のセレクタに第2の選択信号が正論理または負論理で供給され,同様に第3層〜第N−1層のセレクタに第3〜第N−1の選択信号が正論理または負論理で供給され,前記第N層のセレクタに第Nの選択信号が供給され,
前記動作制御回路は,前記Nビットの選択信号の状態に応じて,前記2N−1個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項1記載のクロック切り替え回路において,
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のN個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項1記載のクロック切り替え回路において,
前記動作制御回路は,少なくとも,前記される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項1記載のクロック切り替え回路において,
前記動作制御回路は,少なくとも,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタと,前記選択される入力クロックから切り替わり可能な隣接する次選択候補の入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のセレクタとに,アクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項1記載のクロック切り替え回路において,
前記第1〜第2N−1のセレクタは,入力する2つのクロックが同じ論理レベルになるときに,前記選択信号に応じて前記2つのクロックのいずれかに切り替え,前記動作制御信号がアクティブ状態のときに当該切り替え動作を行い,前記動作制御信号がスリープ状態のときに当該切り替え動作を行わないことを特徴とするクロック切り替え回路。 - N(Nは3以上の整数)ビットの選択信号に基づいて,同じ周波数でそれぞれ位相がずれた2N相の入力クロックから1つを選択して出力クロックとして出力するクロック切り替え回路において,
それぞれ,入力される2つのクロックから1つを選択して出力する2N−1個のセレクタを有するセレクタ群と,
前記2N−1個のセレクタそれぞれに供給され,当該セレクタをアクティブ状態かスリープ状態かに制御する2N−1つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-1個のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-2個のセレクタを有する第2層と,
さらに,第i層の2つのセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する2N-i個のセレクタを有する第i層(i=2〜N−1)と,
第N−1層の2つのセレクタの出力クロックを入力していずれかのクロックを選択して出力する1個のセレクタを有する第N層とを有し,
前記第1〜第Nの選択信号がそれぞれ,前記第1層〜第N層のセレクタに正論理または負論理で供給され,当該第1〜第Nの選択信号のうち1つの選択信号の切り替えに応答して,選択中の入力クロックから切り替え可能な隣接する2つの入力クロックに切り替えられ,
前記動作制御回路は,前記Nビットの選択信号の状態に応じて,前記2N−1個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項6記載のクロック切り替え回路において,
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至るN階層のN個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。 - 少なくとも3ビットの選択信号に基づいて,同じ周波数でそれぞれ位相がずれた8相の入力クロックから1つを選択して出力クロックとして出力するクロック切り替え回路において,
それぞれ,入力される2つのクロックから1つを選択して出力する少なくとも7個のセレクタを有するセレクタ群と,
前記7個のセレクタをアクティブ状態かスリープ状態かに制御する7つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,少なくとも
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第4のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第5〜第6のセレクタを有する第2層と,
さらに,前記第5と第6のセレクタの出力クロックを入力していずれかのクロックを選択して出力する第7のセレクタを有する第3層とを有し,
前記第1層のセレクタに第1の選択信号が正論理または負論理で供給され,前記第2層のセレクタに第2の選択信号が正論理または負論理で供給され,同様に第3層のセレクタに第3の選択信号が供給され,
前記動作制御回路は,前記3ビットの選択信号の状態に応じて,前記7個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。 - 請求項8記載のクロック切り替え回路において,
前記動作制御回路は,前記選択される入力クロックの入力端子から前記出力クロックの出力端子に至る3階層の3個のセレクタのうち,隣接する2つの入力クロックから当該選択される入力クロックに切り替えるために必要な2個のセレクタに,少なくともアクティブ状態の動作制御信号を生成することを特徴とするクロック切り替え回路。 - 3ビットの選択信号に基づいて,同じ周波数でそれぞれ位相がずれた8相の入力クロックから1つを選択して出力クロックとして出力するクロック切り替え回路において,
それぞれ,入力される2つのクロックから1つを選択して出力する7個のセレクタを有するセレクタ群と,
前記7個のセレクタをアクティブ状態かスリープ状態かに制御する7つの動作制御信号を生成する動作制御回路とを有し,
前記セレクタ群は,
前記入力クロックのうち2つの入力クロックをそれぞれ入力していずれかのクロックを選択して出力する第1〜第4のセレクタを有する第1層と,
前記第1層の2つセレクタの出力クロックをそれぞれ入力していずれかのクロックを選択して出力する第5〜第6のセレクタを有する第2層と,
さらに,前記第5と第6のセレクタの出力クロックを入力していずれかのクロックを選択して出力する第7のセレクタを有する第3層とを有し,
前記第1〜第3の選択信号がそれぞれ,前記第1層〜第3層のセレクタに正論理または負論理で供給され,当該第1〜第3の選択信号のうち1つの選択信号の切り替えに応答して,選択中の入力クロックから切り替え可能な隣接する2つの入力クロックに切り替えられ,
前記動作制御回路は,前記3ビットの選択信号の状態に応じて,前記7個のセレクタのうち一部のセレクタをアクティブ状態にし,残りのセレクタをスリープ状態にする前記動作制御信号を生成することを特徴とするクロック切り替え回路。
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