JP2004000796A - Game machine - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a game machine surely storing data in cutoff of a power supply and preventing a loss from inflicting on a player. <P>SOLUTION: A first power supply monitor circuit introduces +30V power supply voltage and detects an occurrence of a power supply cutoff by monitoring the +30V power supply voltage. That is to say, when the +30V power supply voltage becomes +14V or less, it issues a voltage lowering signal for preventing the occurrence of the power supply cutoff. A prize ball control CPU 371 executes a prescribed power supply cutoff according to the voltage lowering signal. A second power supply monitor circuit monitors +5V power supply voltage, or the voltage lower than the voltage monitored by the first power supply monitor circuit and, when the voltage value becomes a prescribed value or less, issues a low-level voltage lowering signal. The voltage lowering signal from the second power supply monitor circuit is inputted in a reset terminal of the prize ball control CPU 371. The power supply monitor mode is the same as the power supply monitor mode in CPU 56. <P>COPYRIGHT: (C)2004,JPO

Description

 本発明は、遊技者の操作に応じて遊技が行われるパチンコ遊技機やコイン遊技機等の遊技機に関し、特に、遊技盤における遊技領域において遊技者の操作に応じて遊技が行われる遊技機に関する。 The present invention relates to a gaming machine such as a pachinko gaming machine or a coin gaming machine in which a game is performed in accordance with an operation of a player, and more particularly to a gaming machine in which a game is performed in accordance with an operation of a player in a gaming area of a gaming board. .

 遊技機として、遊技球などの遊技媒体を発射装置によって遊技領域に発射し、遊技領域に設けられている入賞口などの入賞領域に遊技媒体が入賞すると、所定個の賞球が遊技者に払い出されるものがある。さらに、表示状態が変化可能な可変表示部が設けられ、可変表示部の表示結果があらかじめ定められた特定の表示態様となった場合に所定の遊技価値を遊技者に与えるように構成されたものがある。 As a gaming machine, a game medium such as a game ball is launched into a game area by a launching device, and when a game medium wins a winning area such as a winning opening provided in the game area, a predetermined number of prize balls are paid out to the player. There is something to be done. Further, a variable display unit whose display state can be changed is provided, and when a display result of the variable display unit becomes a predetermined specific display mode, a predetermined game value is provided to the player. There is.

 特別図柄を表示する可変表示部の表示結果があらかじめ定められた特定の表示態様の組合せとなることを、通常、「大当り」という。なお、遊技価値とは、遊技機の遊技領域に設けられた可変入賞球装置の状態が打球が入賞しやすい遊技者にとって有利な状態になることや、遊技者にとって有利な状態となるための権利を発生させたりすることである。 {Circle around (5)} The fact that the display result of the variable display unit that displays a special symbol is a combination of a predetermined specific display mode is usually referred to as a “big hit”. In addition, the game value is a right to make the state of the variable prize ball device provided in the game area of the gaming machine advantageous for a player who is easy to win a hit ball, or to a state advantageous to the player. Or to generate.

 大当りが発生すると、例えば、大入賞口が所定回数開放して打球が入賞しやすい大当り遊技状態に移行する。そして、各開放期間において、所定個(例えば10個)の大入賞口への入賞があると大入賞口は閉成する。そして、大入賞口の開放回数は、所定回数(例えば16ラウンド)に固定されている。なお、各開放について開放時間(例えば29.5秒)が決められ、入賞数が所定個に達しなくても開放時間が経過すると大入賞口は閉成する。また、大入賞口が閉成した時点で所定の条件(例えば、大入賞口内に設けられているVゾーンへの入賞)が成立していない場合には、大当り遊技状態は終了する。 す る と When a big hit occurs, for example, the big winning opening is opened a predetermined number of times, and the state shifts to a big hit game state where a hit ball is easy to win. Then, in each open period, when a predetermined number (for example, 10) of the winning prizes is won, the winning prize opening is closed. The number of opening of the special winning opening is fixed to a predetermined number (for example, 16 rounds). An opening time (for example, 29.5 seconds) is determined for each opening, and if the opening time elapses even if the number of winnings does not reach a predetermined number, the winning opening is closed. If the predetermined condition (for example, winning in the V zone provided in the special winning opening) is not satisfied at the time when the special winning opening is closed, the big hit gaming state ends.

 また、「大当り」の組合せ以外の表示態様の組合せのうち、複数の可変表示部の表示結果のうちの一部が未だに導出表示されていない段階において、既に表示結果が導出表示されている可変表示部の表示態様が特定の表示態様の組合せとなる表示条件を満たしている状態を「リーチ」という。そして、可変表示部に可変表示される識別情報の表示結果が「リーチ」となる条件を満たさない場合には「はずれ」となり、可変表示状態は終了する。遊技者は、大当りをいかにして発生させるかを楽しみつつ遊技を行う。 Also, among the combinations of display modes other than the combination of “big hits”, at the stage where some of the display results of the plurality of variable display units have not yet been derived and displayed, the variable display in which the display results have already been derived and displayed. A state in which the display mode of the section satisfies the display condition that is a combination of the specific display modes is referred to as “reach”. If the display result of the identification information variably displayed on the variable display unit does not satisfy the condition of “reach”, the result is “out” and the variable display state ends. A player plays a game while enjoying how to generate a big hit.

 そして、遊技球が遊技盤に設けられている入賞口に遊技球が入賞すると、あらかじめ決められている個数の賞球払出が行われる。遊技の進行は主基板に搭載された遊技制御手段によって制御されるので、入賞にもとづく賞球個数は、遊技制御手段によって決定され、賞球制御基板に送信される。なお、以下、遊技制御手段およびその他の制御手段を、それぞれ遊技用装置制御手段と呼ぶことがある。 {Circle around (4)} When a game ball wins in a winning opening provided on the game board, a predetermined number of payout balls are paid out. Since the progress of the game is controlled by the game control means mounted on the main board, the number of prize balls based on the winning is determined by the game control means and transmitted to the prize ball control board. Hereinafter, the game control means and other control means may be respectively referred to as game device control means.

 なお、従来の遊技機について記載した先行技術文献として、例えば、特許文献1が挙げられる。また、分割出願である本出願の出願日(すなわち、いわゆる親出願の出願日である平成11年9月22日)の後に公開された文献として、例えば、特許3354534号明細書が挙げられる。
実公平6−17458号公報
As a prior art document describing a conventional gaming machine, for example, Patent Document 1 is cited. As a document published after the filing date of the present application, which is a divisional application (that is, the so-called parent application filing date of September 22, 1999), there is, for example, Japanese Patent No. 3354534.
Japanese Utility Model Publication No. 6-17458

 以上のように、遊技機には、遊技制御手段を初めとする種々の遊技用装置制御手段が搭載されている。一般に、各遊技用装置制御手段はマイクロコンピュータで構成される。すなわち、ROM等にプログラムが格納され、制御上一時的に発生するデータや制御進行に伴って変化するデータがRAMに格納される。すると、遊技機に停電等による電源断状態が発生すると、RAM内のデータは失われてしまう。よって、停電等からの復旧時には、最初の状態(例えば、遊技店においてその日最初に遊技機に電源投入されたときの状態)に戻さざるを得ないので、遊技者に不利益がもたらされる可能性がある。例えば、大当たり遊技中において電源断が発生し遊技機が最初の状態に戻ってしまうのでは、遊技者は大当たりの発生にもとづく利益を享受することができなくなってしまう。 As described above, the gaming machine is equipped with various gaming machine control means including the game control means. Generally, each game device control means is constituted by a microcomputer. That is, a program is stored in a ROM or the like, and data that temporarily occurs in control or data that changes as the control progresses is stored in the RAM. Then, when a power-off state occurs due to a power failure or the like in the gaming machine, data in the RAM is lost. Therefore, at the time of restoration from a power failure or the like, the player must return to the initial state (for example, the state when the game machine is first turned on at the game store on the day), which may be disadvantageous to the player. There is. For example, if a power failure occurs during a jackpot game and the gaming machine returns to the initial state, the player cannot enjoy the benefits based on the jackpot occurrence.

 そのような事態を回避するには、停電等の不測の電源断が生じたときに、必要なデータを電源バックアップRAMに保存し、電源が復旧したときに保存されていたデータを復元して遊技を再開させればよい。しかし、電源断が生じたときに電源バックアップRAMに保存されるデータに誤りが生ずると、電源が復旧したときに誤った状態復元処理がなされてしまう。例えば、電源復旧時に、電源断時の遊技状態とは異なる遊技状態に設定されてしまったり、本来の賞球個数とは異なる賞球個数にもとづく賞球払出再開が行われたりしてしまう。そのような場合には、遊技者に不測の不利益が与えられてしまう。 In order to avoid such a situation, when an unexpected power failure such as a power failure occurs, the necessary data is saved in the power backup RAM, and the data saved when the power is restored is restored. Should be restarted. However, if an error occurs in the data stored in the power backup RAM when the power is turned off, an erroneous state restoration process is performed when the power is restored. For example, when the power is restored, a game state different from the game state when the power is turned off is set, or the prize ball payout is restarted based on the prize ball number different from the original prize ball number. In such a case, an unexpected disadvantage is given to the player.

 そこで、本発明は、電源投入時に電源バックアップされている内容にもとづいて遊技状態を復帰させる遊技状態復帰制御を行うことが可能である遊技機において、電源断時に確実なデータ保存を行うことができ、遊技者に不利益がもたらされることを防止することができる遊技機を提供することを目的とする。 In view of the above, the present invention provides a gaming machine capable of performing a gaming state return control for returning a gaming state based on the contents backed up when the power is turned on. It is an object of the present invention to provide a gaming machine that can prevent a disadvantage from being brought to a player.

 本発明による遊技機は、遊技球を用いて遊技が行われ、表示状態が変化可能な可変表示部(例えば、可変表示部9)が設けられ、可変表示部の表示結果があらかじめ定められた特定の表示態様(例えば、大当たり図柄)となったときに所定の遊技価値(例えば、遊技球の払い出し)を遊技者に与える遊技機であって、可変表示部の表示制御を行うCPUを搭載した表示制御基板(例えば、表示制御基板80)と、可変表示部の表示結果が特定の表示態様となったときに開放する大入賞口(例えば、開閉板20により開閉される大入賞口)と、遊技球の入賞により可変表示部の表示状態を変化させるための始動入賞口(例えば、始動入賞口14)と、遊技球の入賞により賞球を払い出すための入賞口(例えば、始動口19,24)と、大入賞口への遊技球の入賞を検出するカウントスイッチ(例えば、カウントスイッチ23)と、始動入賞口への遊技球の入賞を検出する始動口スイッチ(例えば、始動口スイッチ17)と、入賞口への遊技球の入賞を検出する入賞口スイッチ(例えば、入賞口スイッチ19a,24a)と、カウントスイッチ、始動口スイッチおよび入賞口スイッチが入賞を検出すると、賞球の払出個数を指示する払出個数指示コマンドを出力するCPU(例えば、CPU56)を搭載した遊技制御基板(例えば、主基板53)と、賞球を払い出す玉払出装置(例えば、玉払出装置97)と、払出個数指示コマンドに応じて玉払出装置を駆動する賞球制御用CPU(例えば、賞球制御用CPU371)を搭載した賞球制御基板(例えば、賞球制御基板37)と、遊技機によって使用される第1の所定電源電圧(例えば、+30V電源電圧)を監視し、第1の所定電源電圧が第1の所定値(例えば、+14V)以下に低下したことを検出する第1の電源監視回路と、遊技機によって使用される第2の所定電源電圧を監視し、第2の所定電源電圧が第1の所定値よりも低い第2の所定値(例えば、+8V)以下に低下したことを検出する第2の電源監視回路とを備え、第1の電源監視回路および第2の電源監視回路の検出出力は、賞球制御用CPUに入力され、賞球制御用CPUは、払出個数指示コマンドによって指示される払出個数の総数が記憶されるとともに、遊技機に対する電源が断しても内容が保存されるバックアップRAM領域(例えば、図24に示すバックアップRAM領域)を含み、バックアップRAM領域が記憶する払出個数の総数の値に払出個数指示コマンドによって指示された払出個数を加算し、玉払出装置を駆動して1個の払出が完了する度にバックアップRAM領域が記憶する払出個数の総数の値を1減算し、第1の電源監視回路からの検出出力が入力されたときに、RAMアクセス禁止状態に設定し、第2の電源監視回路からの検出出力が入力されたときに、システムリセットし、遊技制御基板に搭載されたCPUは、可変表示部における図柄変動を開始させるときに、図柄の変動時間を示す情報を含む変動開始コマンドを表示制御基板に搭載されたCPUに出力し、さらに確定図柄を示す図柄指定コマンドを表示制御基板に搭載されたCPUに出力し、可変表示部における図柄変動を確定させるときに、変動停止コマンドを表示制御基板に搭載されたCPUに出力することを特徴とする。 A gaming machine according to the present invention is provided with a variable display unit (for example, a variable display unit 9) in which a game is played using a game ball and a display state of which can be changed, and a display result of the variable display unit is specified in advance. Is a game machine that gives a predetermined game value (for example, payout of game balls) to a player when a display mode (for example, a jackpot symbol) is displayed, and a display on which a CPU for performing display control of a variable display unit is mounted. A control board (for example, the display control board 80), a special winning opening that is opened when the display result of the variable display unit has a specific display mode (for example, a special winning opening that is opened and closed by the opening and closing plate 20), and a game A starting winning opening (for example, starting winning opening 14) for changing the display state of the variable display section according to the winning of the ball, and a winning opening (for example, starting openings 19 and 24) for paying out the prize ball by winning the game ball. ), And a grand prize A count switch (for example, count switch 23) for detecting a winning of a game ball to the game, a starting port switch (for example, starting switch 17) for detecting a winning of a game ball to a starting winning port, and a game for a winning port. When a winning opening switch (for example, winning opening switch 19a, 24a) for detecting a winning of a ball, and a count switch, a start opening switch, and a winning opening switch detect a winning, a payout number instruction command for instructing the payout number of the winning ball is issued. A game control board (for example, main board 53) on which a CPU (for example, CPU 56) for outputting is mounted, a ball payout device (for example, ball payout device 97) for paying out prize balls, and ball payout in response to a payout number instruction command. A prize ball control board (for example, a prize ball control board 37) on which a prize ball control CPU (for example, a prize ball control CPU 371) for driving the device is mounted; A first power supply that monitors a first predetermined power supply voltage (for example, +30 V power supply voltage) used by the first power supply and detects that the first predetermined power supply voltage has dropped below a first predetermined value (for example, +14 V). The monitoring circuit monitors a second predetermined power supply voltage used by the gaming machine, and the second predetermined power supply voltage drops below a second predetermined value (for example, +8 V) lower than the first predetermined value. And a detection output of the first power supply monitoring circuit and the second power supply monitoring circuit is input to a prize ball control CPU, and the prize ball control CPU outputs a payout number instruction. A backup RAM area (for example, a backup RAM area shown in FIG. 24) in which the total number of payouts specified by the command is stored and the contents of which are retained even when the power to the gaming machine is turned off, is backed up. The payout number designated by the payout number instruction command is added to the total number of payout numbers stored in the RAM area, and the payout number stored in the backup RAM area every time one payout is completed by driving the ball payout apparatus. Is subtracted by one, and when the detection output from the first power supply monitoring circuit is input, the RAM access is disabled, and when the detection output from the second power supply monitoring circuit is input. When the system resets and the CPU mounted on the game control board starts the symbol change in the variable display section, the CPU outputs the change start command including information indicating the symbol change time to the CPU mounted on the display control board. Further, a symbol designating command indicating a determined symbol is output to the CPU mounted on the display control board, and when the symbol variation in the variable display section is determined, a variation stop command is issued. And outputs to the CPU mounted on the display control board.

 第1の電源監視回路と第2の電源監視回路とは同一の電源電圧を監視するように構成されていてもよい。 The first power supply monitoring circuit and the second power supply monitoring circuit may be configured to monitor the same power supply voltage.

 第2の電源監視回路が監視する第2の所定電源電圧は、賞球制御用CPUの駆動用電源の電圧であり、第2の電源監視回路は、駆動用電源の電圧が賞球制御用CPUの動作可能範囲内の第2の所定値以下に低下したことを検出する(例えば、通常時の電圧より低いが、賞球制御用CPU371が暫くの間動作しうる程度の電圧であるしきい値レベルが設定され、電圧がしきい値レベルに低下すると電源電圧が低下したことを検出する)ように構成されていてもよい。 The second predetermined power supply voltage monitored by the second power supply monitoring circuit is a driving power supply voltage of the prize ball control CPU, and the second power supply monitoring circuit determines that the driving power supply voltage is the prize ball control CPU. (For example, a threshold value lower than the normal voltage but a voltage at which the prize ball control CPU 371 can operate for a while) The level may be set, and when the voltage drops to the threshold level, it is detected that the power supply voltage has dropped).

 第1の電源監視回路の検出出力は賞球制御用CPUの入力ポートに入力され、賞球制御用CPUは、入力ポートを監視することによってRAMアクセス禁止状態の設定を実行するように構成されていてもよい。 The detection output of the first power supply monitoring circuit is input to the input port of the prize ball control CPU, and the prize ball control CPU is configured to execute the setting of the RAM access prohibition state by monitoring the input port. You may.

 請求項1記載の発明では、電源断時に確実なデータ保存を行うことができ、遊技者に不利益がもたらされることを防止することができる。 According to the first aspect of the invention, it is possible to reliably store data when the power is turned off, and to prevent a disadvantage to the player.

 請求項2記載の発明では、第1の電源監視回路が電圧低下信号を出力するタイミングと第2の電源監視回路が電圧低下信号を出力するタイミングの差を所望の値に確実に設定することができる。 According to the second aspect of the present invention, the difference between the timing at which the first power supply monitoring circuit outputs the voltage drop signal and the timing at which the second power supply monitoring circuit outputs the voltage drop signal can be reliably set to a desired value. it can.

 請求項3記載の発明では、RAMアクセス禁止設定の実行時間に余裕ができ、確実にRAMアクセス禁止設定が実行される。 According to the third aspect of the present invention, the execution time of the RAM access prohibition setting has a sufficient time, and the RAM access prohibition setting is reliably executed.

 請求項4記載の発明では、割込を使用しなくても、RAMアクセス禁止状態の設定を確実に実行することができる。 According to the fourth aspect of the invention, the setting of the RAM access prohibition state can be surely executed without using the interrupt.

 以下、本発明の一実施形態を図面を参照して説明する。
 まず、遊技機の一例であるパチンコ遊技機の全体の構成について説明する。図1はパチンコ遊技機1を正面からみた正面図、図2はパチンコ遊技機1の内部構造を示す全体背面図、図3はパチンコ遊技機1の遊技盤を背面からみた背面図である。なお、ここでは、遊技機の一例としてパチンコ遊技機を示すが、本発明はパチンコ遊技機に限られず、例えばコイン遊技機等であってもよい。また、画像式の遊技機やスロット機に適用することもできる。
Hereinafter, an embodiment of the present invention will be described with reference to the drawings.
First, the overall configuration of a pachinko gaming machine, which is an example of a gaming machine, will be described. 1 is a front view of the pachinko gaming machine 1 as viewed from the front, FIG. 2 is an overall rear view showing the internal structure of the pachinko gaming machine 1, and FIG. 3 is a rear view of the gaming board of the pachinko gaming machine 1 as viewed from the back. Here, a pachinko gaming machine is shown as an example of a gaming machine, but the present invention is not limited to a pachinko gaming machine, and may be, for example, a coin gaming machine. Further, the present invention can be applied to a game machine or a slot machine of an image type.

 図1に示すように、パチンコ遊技機1は、額縁状に形成されたガラス扉枠2を有する。ガラス扉枠2の下部表面には打球供給皿3がある。打球供給皿3の下部には、打球供給皿3からあふれた景品玉を貯留する余剰玉受皿4と打球を発射する打球操作ハンドル(操作ノブ)5が設けられている。ガラス扉枠2の後方には、遊技盤6が着脱可能に取り付けられている。また、遊技盤6の前面には遊技領域7が設けられている。 パ As shown in FIG. 1, the pachinko gaming machine 1 has a glass door frame 2 formed in a frame shape. On the lower surface of the glass door frame 2 is a hit ball supply tray 3. A surplus ball tray 4 for storing prize balls overflowing from the hit ball supply tray 3 and a hit ball operation handle (operation knob) 5 for firing a hit ball are provided below the hit ball supply tray 3. A game board 6 is detachably mounted behind the glass door frame 2. A game area 7 is provided on the front of the game board 6.

 遊技領域7の中央付近には、複数種類の図柄を可変表示するための可変表示部9と7セグメントLEDによる可変表示器10とを含む可変表示装置8が設けられている。この実施の形態では、可変表示部9には、「左」、「中」、「右」の3つの図柄表示エリアがある。可変表示装置8の側部には、打球を導く通過ゲート11が設けられている。通過ゲート11を通過した打球は、玉出口13を経て始動入賞口14の方に導かれる。通過ゲート11と玉出口13との間の通路には、通過ゲート11を通過した打球を検出するゲートスイッチ12がある。また、始動入賞口14に入った入賞球は、遊技盤6の背面に導かれ、始動口スイッチ17によって検出される。また、始動入賞口14の下部には開閉動作を行う可変入賞球装置15が設けられている。可変入賞球装置15は、ソレノイド16によって開状態とされる。 A variable display device 8 including a variable display unit 9 for variably displaying a plurality of types of symbols and a variable display 10 using 7-segment LEDs is provided near the center of the game area 7. In this embodiment, the variable display section 9 has three symbol display areas of “left”, “middle”, and “right”. On the side of the variable display device 8, a passing gate 11 for guiding a hit ball is provided. The hit ball that has passed through the passing gate 11 is guided to the starting winning opening 14 via the ball exit 13. In a passage between the passage gate 11 and the ball outlet 13, there is a gate switch 12 for detecting a hit ball that has passed through the passage gate 11. The winning ball that has entered the starting winning port 14 is guided to the back of the game board 6 and detected by the starting port switch 17. In addition, a variable winning ball device 15 that performs opening and closing operations is provided below the starting winning port 14. The variable winning ball device 15 is opened by the solenoid 16.

 可変入賞球装置15の下部には、特定遊技状態(大当り状態)においてソレノイド21によって開状態とされる開閉板20が設けられている。この実施の形態では、開閉板20が大入賞口を開閉する手段となる。開閉板20から遊技盤6の背面に導かれた入賞球のうち一方(Vゾーン)に入った入賞球はVカウントスイッチ22で検出される。また、開閉板20からの入賞球はカウントスイッチ23で検出される。可変表示装置8の下部には、始動入賞口14に入った入賞球数を表示する4個の表示部を有する始動入賞記憶表示器18が設けられている。この例では、4個を上限として、始動入賞がある毎に、始動入賞記憶表示器18は点灯している表示部を1つずつ増やす。そして、可変表示部9の可変表示が開始される毎に、点灯している表示部を1つ減らす。 An opening / closing plate 20 which is opened by the solenoid 21 in a specific game state (big hit state) is provided below the variable winning ball device 15. In this embodiment, the opening and closing plate 20 serves as a means for opening and closing the special winning opening. A winning ball that has entered one (V zone) of the winning balls guided from the opening / closing plate 20 to the back of the game board 6 is detected by the V count switch 22. The winning ball from the opening / closing plate 20 is detected by the count switch 23. At the lower part of the variable display device 8, there is provided a starting prize storage display 18 having four display portions for displaying the number of winning balls entering the starting prize port 14. In this example, the start winning prize storage display 18 increases the number of lit display units by one each time there is a starting prize, with the upper limit being four. Then, each time the variable display of the variable display unit 9 is started, the number of the lit display units is reduced by one.

 遊技盤6には、複数の入賞口19,24が設けられ、遊技球の入賞口19,24への入賞は入賞口スイッチ19a,24aによって検出される。遊技領域7の左右周辺には、遊技中に点滅表示される装飾ランプ25が設けられ、下部には、入賞しなかった打球を吸収するアウト口26がある。また、遊技領域7の外側の左右上部には、効果音を発する2つのスピーカ27が設けられている。遊技領域7の外周には、遊技効果LED28aおよび遊技効果ランプ28b,28cが設けられている。 The game board 6 is provided with a plurality of winning ports 19 and 24, and winning of the gaming balls to the winning ports 19 and 24 is detected by the winning port switches 19a and 24a. Decorative lamps 25 that blink during the game are provided around the left and right sides of the game area 7, and the lower part has an out opening 26 for absorbing a hit ball that has not won. In addition, two speakers 27 that emit sound effects are provided at upper left and right sides of the game area 7. A game effect LED 28a and game effect lamps 28b and 28c are provided on the outer periphery of the game area 7.

 そして、この例では、一方のスピーカ27の近傍に、景品玉払出時に点灯する賞球ランプ51が設けられ、他方のスピーカ27の近傍に、補給玉が切れたときに点灯する球切れランプ52が設けられている。さらに、図1には、パチンコ遊技台1に隣接して設置され、プリペイドカードが挿入されることによって玉貸しを可能にするカードユニット50も示されている。 In this example, a prize ball lamp 51 that is lit when a prize ball is paid out is provided near one of the speakers 27, and a ball out lamp 52 that is lit when a supply ball runs out is near the other speaker 27. Is provided. Further, FIG. 1 also shows a card unit 50 that is installed adjacent to the pachinko gaming table 1 and enables lending of balls by inserting a prepaid card.

 カードユニット50には、使用可能状態であるか否かを示す使用可表示ランプ151、カード内に記録された残額情報に端数(100円未満の数)が存在する場合にその端数を打球供給皿3の近傍に設けられる度数表示LEDに表示させるための端数表示スイッチ152、カードユニット50がいずれの側のパチンコ遊技機1に対応しているのかを示す連結台方向表示器153、カードユニット50内にカードが投入されていることを示すカード投入表示ランプ154、記録媒体としてのカードが挿入されるカード挿入口155、およびカード挿入口155の裏面に設けられているカードリーダライタの機構を点検する場合にカードユニット50を解放するためのカードユニット錠156が設けられている。 The card unit 50 has a usable indicator lamp 151 for indicating whether or not the card is in a usable state. If there is a fraction (a number less than 100 yen) in the remaining amount information recorded in the card, the fraction is displayed on the hitting plate. 3, a fraction display switch 152 for displaying on a frequency display LED provided in the vicinity of 3, a connection board direction indicator 153 indicating which side of the pachinko gaming machine 1 the card unit 50 corresponds to, and the inside of the card unit 50. A card insertion indicator 154 indicating that a card has been inserted into the card, a card insertion slot 155 into which a card as a recording medium is inserted, and a mechanism of a card reader / writer provided on the back of the card insertion slot 155 are checked. A card unit lock 156 is provided for releasing the card unit 50 in some cases.

 打球発射装置から発射された打球は、打球レールを通って遊技領域7に入り、その後、遊技領域7を下りてくる。打球が通過ゲート11を通ってゲートスイッチ12で検出されると、可変表示器10の表示数字が連続的に変化する状態になる。また、打球が始動入賞口14に入り始動口スイッチ17で検出されると、図柄の変動を開始できる状態であれば、可変表示部9内の図柄が回転を始める。図柄の変動を開始できる状態でなければ、始動入賞記憶を1増やす。 打 The hit ball fired from the hit ball launching device enters the game area 7 through the hitting ball rail, and then descends from the game area 7. When a hit ball is detected by the gate switch 12 through the passing gate 11, the display number of the variable display 10 is changed continuously. When a hit ball enters the start winning opening 14 and is detected by the start opening switch 17, the symbols in the variable display section 9 start rotating if the symbols can be changed. If it is not possible to start changing the symbol, the start winning memory is increased by one.

 可変表示部9内の画像の回転は、一定時間が経過したときに停止する。停止時の画像の組み合わせが大当り図柄の組み合わせであると、大当り遊技状態に移行する。すなわち、開閉板20が、一定時間経過するまで、または、所定個数(例えば10個)の打球が入賞するまで開放する。そして、開閉板20の開放中に打球が特定入賞領域に入賞しVカウントスイッチ22で検出されると、継続権が発生し開閉板20の開放が再度行われる。継続権の発生は、所定回数(例えば15ラウンド)許容される。 (4) The rotation of the image in the variable display section 9 stops when a certain time has elapsed. If the combination of images at the time of stoppage is a combination of big hit symbols, the game shifts to a big hit game state. That is, the opening / closing plate 20 is opened until a predetermined time elapses or until a predetermined number (for example, 10) of hit balls is won. Then, when a hit ball wins in the specific winning area while the opening and closing plate 20 is opened and is detected by the V count switch 22, a continuation right is generated and the opening and closing plate 20 is opened again. Generation of the continuation right is permitted a predetermined number of times (for example, 15 rounds).

 停止時の可変表示部9内の画像の組み合わせが確率変動を伴う大当り図柄の組み合わせである場合には、次に大当りとなる確率が高くなる。すなわち、高確率状態という遊技者にとってさらに有利な状態となる。また、可変表示器10における停止図柄が所定の図柄(当り図柄)である場合に、可変入賞球装置15が所定時間だけ開状態になる。さらに、高確率状態では、可変表示器10における停止図柄が当り図柄になる確率が高められるとともに、可変入賞球装置15の開放時間と開放回数が高められる。 場合 If the combination of images in the variable display unit 9 at the time of stop is a combination of big hit symbols with probability fluctuation, the probability of the next big hit becomes high. In other words, a high probability state, which is more advantageous for the player, is obtained. When the stop symbol on the variable display 10 is a predetermined symbol (hit symbol), the variable winning ball device 15 is opened for a predetermined time. Further, in the high probability state, the probability that the stop symbol on the variable display 10 hits the symbol is increased, and the opening time and the number of times the variable winning ball device 15 is opened are increased.

 次に、パチンコ遊技機1の裏面の構造について図2を参照して説明する。
 可変表示装置8の背面では、図2に示すように、機構板36の上部に景品玉タンク38が設けられ、パチンコ遊技機1が遊技機設置島に設置された状態でその上方から景品玉が景品玉タンク38に供給される。景品玉タンク38内の景品玉は、誘導樋39を通って玉払出装置に至る。
Next, the structure of the back surface of the pachinko gaming machine 1 will be described with reference to FIG.
On the back of the variable display device 8, as shown in FIG. 2, a prize ball tank 38 is provided above the mechanism plate 36, and when the pachinko gaming machine 1 is installed on the gaming machine installation island, a prize ball is provided from above. The prize ball tank 38 is supplied. The prize ball in the prize ball tank 38 reaches the ball payout device through the guiding gutter 39.

 機構板36には、中継基板30を介して可変表示部9を制御する可変表示制御ユニット29、基板ケース32に覆われ遊技制御用マイクロコンピュータ等が搭載された遊技制御基板(主基板)31、可変表示制御ユニット29と遊技制御基板31との間の信号を中継するための中継基板33、および景品玉の払出制御を行う賞球制御用マイクロコンピュータ等が搭載された賞球制御基板37が設置されている。さらに、機構板36の下部には、モータの回転力を利用して打球を遊技領域7に発射する打球発射装置34と、遊技効果ランプ・LED28a,28b,28c、賞球ランプ51および球切れランプ52に信号を送るためのランプ制御基板35が設置されている。 On the mechanism plate 36, a variable display control unit 29 for controlling the variable display unit 9 via the relay board 30, a game control board (main board) 31, which is covered with a board case 32 and on which a game control microcomputer and the like are mounted, A relay board 33 for relaying a signal between the variable display control unit 29 and the game control board 31 and a prize ball control board 37 on which a microcomputer for controlling a prize ball for controlling payout of prize balls are installed. Have been. Further, below the mechanism plate 36, a hitting ball firing device 34 for shooting a hitting ball into the game area 7 using the rotational force of the motor, a game effect lamp / LEDs 28a, 28b, 28c, a prize ball lamp 51, and a ball cut lamp A lamp control board 35 for sending a signal to 52 is provided.

 また、図3はパチンコ遊技機1の遊技盤を背面からみた背面図である。誘導樋39を通った玉は、図3に示されるように、球切れ検出器187a,187bを通過して玉供給樋186a,186bを経て玉払出装置97に至る。玉払出装置97から払い出された景品玉は、連絡口45を通ってパチンコ遊技機1の前面に設けられている打球供給皿3に供給される。連絡口45の側方には、パチンコ遊技機1の前面に設けられている余剰玉受皿4に連通する余剰玉通路46が形成されている。入賞にもとづく景品玉が多数払い出されて打球供給皿3が満杯になり、ついには景品玉が連絡口45に到達した後さらに景品玉が払い出されると景品玉は、余剰玉通路46を経て余剰玉受皿4に導かれる。さらに景品玉が払い出されると、感知レバー47が満タンスイッチ48を押圧して満タンスイッチ48がオンする。その状態では、玉払出装置97内のステッピングモータの回転が停止して玉払出装置97の動作が停止するとともに、必要に応じて打球発射装置34の駆動も停止する。なお、この実施の形態では、電気的駆動源の駆動によって遊技球を払い出す玉払出装置として、ステッピングモータの回転によって遊技球が払い出される玉払出装置97を例示するが、その他の駆動源によって遊技球を送り出す構造の玉払出装置を用いてもよいし、電気的駆動源の駆動によってストッパを外し遊技球の自重によって払い出しがなされる構造の玉払出装置を用いてもよい。 FIG. 3 is a rear view of the gaming board of the pachinko gaming machine 1 as viewed from the rear. As shown in FIG. 3, the ball that has passed through the guiding gutter 39 passes through the ball cutout detectors 187a and 187b and reaches the ball dispensing device 97 via the ball supply gutters 186a and 186b. The prize ball paid out from the ball payout device 97 is supplied to the hitting ball supply tray 3 provided on the front surface of the pachinko gaming machine 1 through the communication port 45. On the side of the communication port 45, a surplus ball passage 46 communicating with the surplus ball tray 4 provided on the front face of the pachinko gaming machine 1 is formed. A large number of prize balls based on the prize are paid out, and the hitting ball supply tray 3 becomes full. Finally, after the prize balls reach the communication port 45, further prize balls are paid out. It is led to the ball tray 4. When the prize ball is further paid out, the sensing lever 47 presses the full tank switch 48 and the full tank switch 48 is turned on. In this state, the rotation of the stepping motor in the ball payout device 97 stops, the operation of the ball payout device 97 stops, and the driving of the hit ball firing device 34 also stops as necessary. In this embodiment, a ball payout device 97 that pays out game balls by rotating a stepping motor is illustrated as a ball payout device 97 that pays out game balls by driving an electric drive source. A ball payout device having a structure in which a ball is sent out may be used, or a ball payout device having a structure in which a stopper is removed by driving an electric drive source to pay out the ball by its own weight may be used.

 賞球払出制御を行うために、入賞口スイッチ19a,24a、始動口スイッチ17およびVカウントスイッチ22からの信号が、主基板31に送られる。主基板31のCPU56は、始動口スイッチ17がオンすると6個の賞球払出に対応した入賞が発生したことを知る。また、カウントスイッチ23がオンすると15個の賞球払出に対応した入賞が発生したことを知る。そして、入賞口スイッチがオンすると10個の賞球払出に対応した入賞が発生したことを知る。なお、この実施の形態では、例えば、入賞口24に入賞した遊技球は、入賞口24からの入賞球流路に設けられている入賞口スイッチ24aで検出され、入賞口19に入賞した遊技球は、入賞口19からの入賞球流路に設けられている入賞口スイッチ19aで検出される。 Signals from the winning opening switches 19a and 24a, the starting opening switch 17 and the V count switch 22 are sent to the main board 31 in order to perform the prize ball payout control. When the starting port switch 17 is turned on, the CPU 56 of the main board 31 knows that a winning corresponding to the payout of six winning balls has occurred. Further, when the count switch 23 is turned on, it is known that a winning corresponding to the payout of 15 prize balls has occurred. Then, when the winning opening switch is turned on, it is known that a winning corresponding to the payout of 10 winning balls has occurred. In this embodiment, for example, a game ball that has won the winning opening 24 is detected by a winning opening switch 24 a provided in a winning ball flow path from the winning opening 24, and the game ball that has won the winning opening 19 is detected. Is detected by a winning opening switch 19a provided in a winning ball flow path from the winning opening 19.

 図4は、主基板31における回路構成の一例を示すブロック図である。なお、図4には、賞球制御基板37、ランプ制御基板35、音制御基板70、発射制御基板91および表示制御基板80も示されている。主基板31には、プログラムに従ってパチンコ遊技機1を制御する基本回路53と、ゲートスイッチ12、始動口スイッチ17、Vカウントスイッチ22、カウントスイッチ23および入賞口スイッチ19a,24aからの信号を基本回路53に与えるスイッチ回路58と、可変入賞球装置15を開閉するソレノイド16および開閉板20を開閉するソレノイド21を基本回路53からの指令に従って駆動するソレノイド回路59と、始動記憶表示器18の点灯および滅灯を行うとともに7セグメントLEDによる可変表示器10と装飾ランプ25とを駆動するランプ・LED回路60とが搭載されている。 FIG. 4 is a block diagram showing an example of a circuit configuration of the main board 31. FIG. 4 also shows the prize ball control board 37, the lamp control board 35, the sound control board 70, the emission control board 91, and the display control board 80. On the main board 31, a basic circuit 53 for controlling the pachinko gaming machine 1 in accordance with a program, and signals from the gate switch 12, the starting port switch 17, the V count switch 22, the count switch 23, and the winning port switches 19a and 24a are provided. 53, a solenoid circuit 59 that drives the solenoid 16 that opens and closes the variable winning ball device 15 and the solenoid 21 that opens and closes the opening and closing plate 20 in accordance with commands from the basic circuit 53, and turns on and off the start storage display 18. A lamp / LED circuit 60 that extinguishes the lights and drives the variable indicator 10 and the decorative lamps 25 by 7-segment LEDs is mounted.

 また、基本回路53から与えられるデータに従って、大当りの発生を示す大当り情報、可変表示部9の画像表示開始に利用された始動入賞球の個数を示す有効始動情報、確率変動が生じたことを示す確変情報等をホール管理コンピュータ等のホストコンピュータに対して出力する情報出力回路64を含む。 Also, according to the data provided from the basic circuit 53, jackpot information indicating occurrence of a jackpot, effective start information indicating the number of start winning balls used for starting image display of the variable display section 9, and indicating that a probability change has occurred. It includes an information output circuit 64 that outputs probability change information and the like to a host computer such as a hall management computer.

 基本回路53は、ゲーム制御用のプログラム等を記憶するROM54、ワークメモリとして使用されるRAM55、制御用のプログラムに従って制御動作を行うCPU56およびI/Oポート部57を含む。この実施の形態では、ROM54,RAM55はCPU56に内蔵されている。すなわち、CPU56は、1チップマイクロコンピュータである。なお、1チップマイクロコンピュータは、少なくともRAM55が内蔵されていればよく、ROM54およびI/Oポート部57は外付けであっても内蔵されていてもよい。また、I/Oポート部57は、マイクロコンピュータにおける情報入出力可能な端子である。 The basic circuit 53 includes a ROM 54 for storing a game control program and the like, a RAM 55 used as a work memory, a CPU 56 for performing a control operation in accordance with the control program, and an I / O port unit 57. In this embodiment, the ROM 54 and the RAM 55 are built in the CPU 56. That is, the CPU 56 is a one-chip microcomputer. The one-chip microcomputer only needs to include at least the RAM 55, and the ROM 54 and the I / O port unit 57 may be externally or internally provided. The I / O port unit 57 is a terminal capable of inputting and outputting information in the microcomputer.

 さらに、主基板31には、電源投入時に基本回路53をリセットするための初期リセット回路65と、基本回路53から与えられるアドレス信号をデコードしてI/Oポート部57のうちのいずれかのI/Oポートを選択するための信号を出力するアドレスデコード回路67とが設けられている。
 なお、玉払出装置97から主基板31に入力されるスイッチ情報もあるが、図4ではそれらは省略されている。
Further, the main board 31 has an initial reset circuit 65 for resetting the basic circuit 53 when the power is turned on, and decodes an address signal given from the basic circuit 53 to output any one of the I / O port units 57. An address decode circuit 67 for outputting a signal for selecting an / O port is provided.
There is also switch information input from the ball dispensing device 97 to the main board 31, but these are omitted in FIG.

 遊技球を打撃して発射する打球発射装置は発射制御基板91上の回路によって制御される駆動モータ94で駆動される。そして、駆動モータ94の駆動力は、操作ノブ5の操作量に従って調整される。すなわち、発射制御基板91上の回路によって、操作ノブ5の操作量に応じた速度で打球が発射されるように制御される。 The hit ball launching device that hits and launches a game ball is driven by a drive motor 94 controlled by a circuit on a launch control board 91. Then, the driving force of the driving motor 94 is adjusted according to the operation amount of the operation knob 5. That is, the circuit on the launch control board 91 is controlled so that the hit ball is launched at a speed corresponding to the operation amount of the operation knob 5.

 図5は、電源監視および電源バックアップのためのCPU56周りの一構成例を示すブロック図である。図5に示すように、電源監視用IC902は、+30V電源電圧を導入し、+30V電源電圧を監視することによって電源断の発生を検出する。具体的には、+30V電源電圧が所定値以下になったら、電源断が生ずるとして電圧低下信号を出力する。この実施の形態では、所定値を+16Vとする。なお、+30V電源電圧は、交流から直流に変換された直後の電圧である。電源監視用IC902からの電圧低下信号は、CPU56に接続される入力ポート570に入力されている。従って、CPU56は、入力ポート570を介して電源断の状況を確認することができる。 FIG. 5 is a block diagram showing a configuration example around the CPU 56 for power supply monitoring and power supply backup. As shown in FIG. 5, the power supply monitoring IC 902 detects the occurrence of power interruption by introducing a + 30V power supply voltage and monitoring the + 30V power supply voltage. Specifically, when the + 30V power supply voltage becomes equal to or lower than a predetermined value, a voltage drop signal is output on the assumption that power is cut off. In this embodiment, the predetermined value is + 16V. Note that the +30 V power supply voltage is a voltage immediately after conversion from AC to DC. A voltage drop signal from the power supply monitoring IC 902 is input to an input port 570 connected to the CPU 56. Therefore, the CPU 56 can confirm the power-off state via the input port 570.

 なお、入力ポート570は、遊技機に設けられている遊技球を検出するための遊技球検出手段(この例では、始動口スイッチ17、カウントスイッチ23、入賞口スイッチ19a,24a等)の出力信号を入力する入力ポートの空きビットに入力されている。すなわち、電圧低下信号は、遊技球検出手段の検出情報を入力する検出入力手段としての入力ポート570に入力される。 Note that the input port 570 is provided with an output signal of a game ball detecting means (a starting port switch 17, a count switch 23, a winning port switch 19a, 24a and the like in this example) for detecting a game ball provided in the gaming machine. Is input to a vacant bit of the input port. That is, the voltage drop signal is input to the input port 570 as detection input means for inputting detection information of the game ball detection means.

 また、電源監視手段としての電源監視用IC902からの電圧低下信号は、CPU56に対して情報伝達可能に接続されていればよく、入力ポート570は、CPU56の内蔵ポートでもよいし、外付けのポートであってもよい。なお、入力ポート570には、電源基板に設置されている初期化操作スイッチの状態を示すスイッチ入力信号も接続されている。 The voltage drop signal from the power supply monitoring IC 902 as the power supply monitoring means may be connected to the CPU 56 so as to be able to transmit information. The input port 570 may be a built-in port of the CPU 56 or an external port. It may be. The input port 570 is also connected to a switch input signal indicating the state of the initialization operation switch provided on the power supply board.

 電源監視用IC902が電源断を検知するための所定値は、通常時の電圧より低いが、CPU56が暫くの間動作しうる程度の電圧である。また、電源監視用IC902が、CPU56を駆動するための電圧(この例では+5V)よりも高く、かつ、交流から直流に変換された直後の電圧を監視するように構成されているので、CPU56が必要とする電圧に対して監視範囲を広げることができる。従って、より精密な監視を行うことができる。さらに、監視電圧として+30Vを用いる場合には、遊技機の各種スイッチに供給される電圧が+12Vであることから、電源瞬断時のスイッチオン誤検出の防止も期待できる。すなわち、+30V電源の電圧を監視すると、+30V作成の以降に作られる+12Vが落ち始める以前の段階でそれの低下を検出できる。よって、+12V電源の電圧が低下するとスイッチ出力がオン状態を呈するようになるが、+12Vより早く低下する+30V電源電圧を監視して電源断を認識すれば、スイッチ出力がオン状態を呈する前に電源復旧待ちの状態に入ってスイッチ出力を検出しない状態となることができる。 The predetermined value for the power supply monitoring IC 902 to detect the power-off is lower than the normal voltage, but is a voltage at which the CPU 56 can operate for a while. Further, since the power supply monitoring IC 902 is configured to monitor a voltage higher than the voltage for driving the CPU 56 (+5 V in this example) and immediately after the voltage is converted from AC to DC, the CPU 56 The monitoring range can be extended for the required voltage. Therefore, more precise monitoring can be performed. Further, when +30 V is used as the monitoring voltage, since the voltage supplied to the various switches of the gaming machine is +12 V, it can be expected to prevent erroneous switch-on detection at the moment of a power interruption. That is, if the voltage of the +30 V power supply is monitored, it is possible to detect a decrease in the voltage of +12 V at a stage before +12 V generated after the generation of +30 V starts to fall. Therefore, when the voltage of the + 12V power supply decreases, the switch output comes to the on state. However, if the + 30V power supply voltage that drops earlier than the + 12V is monitored and the power cutoff is recognized, the power supply is turned on before the switch output turns on. It is possible to enter a state of waiting for restoration and to enter a state in which the switch output is not detected.

 さらに、主基板31には、電源監視用IC902による第1の電源監視回路の他に、第2の電源監視回路903が搭載されている。この例では、第2の電源監視回路903において、電源監視用IC904が、第1の電源監視回路が監視する電圧よりも低い電圧である+5V電源電圧を監視して電圧値が所定値以下になるとローレベルの電圧低下信号を発生する。なお、+5V電源電圧は、遊技用装置制御マイクロコンピュータ(CPU56等)の駆動電源電圧である。 {Circle around (2)} On the main board 31, a second power supply monitoring circuit 903 is mounted in addition to the first power supply monitoring circuit by the power supply monitoring IC 902. In this example, in the second power supply monitoring circuit 903, the power supply monitoring IC 904 monitors a + 5V power supply voltage that is lower than the voltage monitored by the first power supply monitoring circuit, and when the voltage value falls below a predetermined value. Generates a low-level brownout signal. Note that the + 5V power supply voltage is a drive power supply voltage for the gaming machine control microcomputer (such as the CPU 56).

 第2の電源監視回路903からの電圧低下信号は、初期リセット回路65からの初期リセット信号と論理和をとられた後に、CPU56のリセット端子に入力される。従って、CPU56は、初期リセット回路65からの初期リセット信号がローレベルを呈しているとき、または、第2の電源監視回路903からの電圧低下信号がローレベルを呈しているときに、リセット状態(非動作状態)になる。 (4) The voltage drop signal from the second power supply monitoring circuit 903 is logically ORed with the initial reset signal from the initial reset circuit 65 and then input to the reset terminal of the CPU 56. Therefore, when the initial reset signal from the initial reset circuit 65 is at a low level, or when the voltage drop signal from the second power supply monitoring circuit 903 is at a low level, the CPU 56 is in the reset state ( Non-operating state).

 電源電圧が低下したときに、電源監視用IC904がローレベルの電圧低下信号を発生するタイミングは電源監視用IC902が電圧低下信号を発生するタイミングに対して遅くなるように、電源監視用IC904のしきい値レベル(電圧低下信号を発生する電圧レベル)が設定される。例えば、しきい値は4.25Vである。4.25Vは、通常時の電圧より低いが、CPU56が暫くの間動作しうる程度の電圧である。 When the power supply voltage decreases, the power supply monitoring IC 904 generates a low-level voltage drop signal such that the timing at which the power supply monitoring IC 904 generates a voltage drop signal is delayed with respect to the timing at which the power supply monitoring IC 902 generates the voltage drop signal. A threshold level (voltage level at which a voltage drop signal is generated) is set. For example, the threshold is 4.25V. 4.25 V is lower than the normal voltage, but is a voltage at which the CPU 56 can operate for a while.

 なお、初期リセット回路65のリセットIC651は、遊技機に電源が投入され+5V電源の電圧が上昇していくときに、+5V電源電圧が所定値以上になると、出力信号をハイレベルにする。すなわち、初期リセット信号をオフ状態にする。また、ここでは、電源監視用IC902,904が異なる電源電圧を監視しているが、同一の電源電圧を監視してもよい。例えば、ともに+30V電源電圧を監視してもよい。そして、例えば、一方の検出電圧(電圧低下信号を出力することになる電圧)を+16Vとし、他方の検出電圧を+8Vとする。そのように構成した場合には、同一の電圧を監視するので、第1の電圧監視手段が電圧低下信号を出力するタイミングと第2の電圧監視手段が電圧低下信号を出力するタイミングの差である所定期間を所望の値に確実に設定することができる。 The reset IC 651 of the initial reset circuit 65 sets the output signal to a high level when the power of the gaming machine is turned on and the voltage of the + 5V power supply rises when the + 5V power supply voltage exceeds a predetermined value. That is, the initial reset signal is turned off. Although the power supply monitoring ICs 902 and 904 monitor different power supply voltages here, the same power supply voltage may be monitored. For example, both may monitor the + 30V power supply voltage. Then, for example, one detection voltage (a voltage at which a voltage drop signal is output) is set to +16 V, and the other detection voltage is set to +8 V. In such a configuration, since the same voltage is monitored, the difference between the timing at which the first voltage monitoring means outputs the voltage drop signal and the timing at which the second voltage monitoring means outputs the voltage drop signal is obtained. The predetermined period can be reliably set to a desired value.

 さらに、それぞれの監視電圧がそれぞれの所定値にまで落ちたら、それぞれの電圧低下信号を出力するように設定された1個の電源監視用ICを用いてもよい。例えば、1個の電源監視用ICが+16Vと+8Vの双方を監視するようにしてもよい。その場合には、1個の電源監視用ICで第1の電源監視手段と第2の電源監視手段が実現できる。さらに、この実施の形態では電源監視手段は主基板31に設けられているが、電源基板に搭載してもよい。 {Circle around (1)} Further, one power supply monitoring IC set to output each voltage drop signal when each monitoring voltage drops to each predetermined value may be used. For example, one power supply monitoring IC may monitor both + 16V and + 8V. In that case, the first power supply monitoring means and the second power supply monitoring means can be realized by one power supply monitoring IC. Further, in this embodiment, the power supply monitoring means is provided on the main board 31, but may be mounted on the power supply board.

 +5V電源から電力が供給されていない間、RAMの少なくとも一部は、電源基板から供給されるバックアップ電源によってバックアップされ、遊技機に対する電源が断しても内容は保存される。そして、+5V電源が復旧すると、初期リセット回路65からリセット信号が発せられるので、CPU56は、通常の動作状態に復帰する。そのとき、必要なデータがバックアップされているので、停電等からの復旧時には停電発生時の遊技状態に復帰することができる。 While power is not being supplied from the + 5V power supply, at least a portion of the RAM is backed up by a backup power supply supplied from a power supply board, and the contents are preserved even when the power to the gaming machine is cut off. Then, when the + 5V power supply is restored, a reset signal is issued from the initial reset circuit 65, so that the CPU 56 returns to the normal operation state. At that time, since necessary data has been backed up, it is possible to return to the gaming state at the time of the occurrence of the power failure when recovery from a power failure or the like.

 図6は、電源基板910の一構成例を示すブロック図である。電源基板910は、主基板31、表示制御基板80、音制御基板70、ランプ制御基板35および賞球制御基板37等の遊技装置用制御基板と独立して設置され、遊技機内の各遊技装置用制御基板および機構部品が使用する電圧を生成する。この例では、AC24V、DC+30V、DC+21V、DC+12VおよびDC+5Vを生成する。また、バックアップ電源となるコンデンサ916は、DC+5Vすなわち各基板上のIC等を駆動する電源のラインから充電される。 FIG. 6 is a block diagram showing a configuration example of the power supply board 910. The power supply board 910 is installed independently of the gaming machine control boards such as the main board 31, the display control board 80, the sound control board 70, the lamp control board 35, and the prize ball control board 37, and is provided for each gaming machine in the gaming machine. Generates voltages used by control boards and mechanical components. In this example, AC24V, DC + 30V, DC + 21V, DC + 12V and DC + 5V are generated. Further, the capacitor 916 serving as a backup power supply is charged from DC + 5V, that is, a power supply line for driving an IC or the like on each substrate.

 トランス911は、交流電源からの交流電圧を24Vに変換する。AC24V電圧は、コネクタ915に出力される。また、整流回路912は、AC24Vから+30Vの直流電圧を生成し、DC−DCコンバータ913およびコネクタ915に出力する。DC−DCコンバータ913は、+21V、+12Vおよび+5Vを生成してコネクタ915に出力する。コネクタ915は例えば中継基板に接続され、中継基板から各遊技装置用制御基板および機構部品に必要な電圧の電力が供給される。なお、トランス911の入力側には、遊技機に対する電源供給を停止したり開始させたりするための電源スイッチ918が設置されている。 (5) The transformer 911 converts an AC voltage from an AC power supply to 24V. The AC 24 V voltage is output to connector 915. The rectifier circuit 912 generates a DC voltage of +30 V from AC 24 V and outputs the DC voltage to the DC-DC converter 913 and the connector 915. The DC-DC converter 913 generates + 21V, + 12V, and + 5V and outputs the generated voltage to the connector 915. The connector 915 is connected to, for example, a relay board, and the relay board supplies power of a voltage necessary for each game machine control board and mechanical components. Note that a power switch 918 for stopping and starting power supply to the gaming machine is provided on the input side of the transformer 911.

 DC−DCコンバータ913からの+5Vラインは分岐してバックアップ+5Vラインを形成する。バックアップ+5Vラインとグラウンドレベルとの間には大容量のコンデンサ916が接続されている。コンデンサ916は、遊技機に対する電力供給が遮断されたときの遊技装置用制御基板のバックアップRAM(電源バックアップされているRAMすなわち記憶内容保持状態となりうる変動データ記憶手段)に対するバックアップ電源となる。また、+5Vラインとバックアップ+5Vラインとの間に、逆流防止用のダイオード917が挿入される。 + The + 5V line from DC-DC converter 913 branches to form a backup + 5V line. A large-capacity capacitor 916 is connected between the backup + 5V line and the ground level. The capacitor 916 serves as a backup power supply for a backup RAM (power-backed-up RAM, that is, a variable data storage unit that can be in a storage content holding state) of the gaming machine control board when power supply to the gaming machine is cut off. Further, a diode 917 for preventing backflow is inserted between the + 5V line and the backup + 5V line.

 なお、バックアップ電源として、+5V電源から充電可能な電池を用いてもよい。電池を用いる場合には、+5V電源から電力供給されない状態が所定時間継続すると容量がなくなるような充電池が用いられる。 Note that a battery that can be charged from a + 5V power supply may be used as the backup power supply. In the case of using a battery, a rechargeable battery is used which runs out of capacity when power is not supplied from a + 5V power supply for a predetermined time.

 また、電源基板910には、初期化操作スイッチ919が搭載されている。初期化操作スイッチの状態を示す信号は主基板31に入力されるが、その役割等については後で詳しく説明する。この実施の形態では、他の制御基板とは独立して設置される電源基板910に電源スイッチ918および初期化操作スイッチ919が搭載されているので、遊技盤の入れ替え等の場合に入れ替え後の遊技盤に対して電源基板910をそのまま使用しても、入れ替え後の遊技盤において、後述する電源スイッチ918および初期化操作スイッチ919を利用した停電処理を実行することができる。 電源 Further, an initialization operation switch 919 is mounted on the power supply board 910. A signal indicating the state of the initialization operation switch is input to the main board 31, and its role will be described later in detail. In this embodiment, the power switch 918 and the initialization operation switch 919 are mounted on the power board 910 which is installed independently of the other control boards. Even if the power supply board 910 is used as it is for the board, a power failure process using a power switch 918 and an initialization operation switch 919 described later can be executed on the game board after replacement.

 次に遊技機の動作について説明する。
 図7は、主基板31におけるCPU56が実行するメイン処理を示すフローチャートである。遊技機に対する電源が投入されると、メイン処理において、CPU56は、まず、停電からの復旧時であったか否か確認する(ステップS1)。停電からの復旧時であったか否かは、例えば、電源断時にバックアップRAM領域に設定される電源断フラグによって確認される。すなわち、停電からの復旧時には、バックアップRAM領域に所定のデータが保存されているのに対して、そうでないときにはRAMの内容は不定になっていることにもとづいて、電源断フラグがセットされているか否かによって停電からの復旧時であったか否かを確認することができる。
Next, the operation of the gaming machine will be described.
FIG. 7 is a flowchart illustrating a main process executed by the CPU 56 on the main board 31. When the power to the gaming machine is turned on, in the main process, the CPU 56 first checks whether or not it has been time to recover from a power failure (step S1). Whether or not recovery from a power failure has occurred is confirmed, for example, by a power-off flag set in the backup RAM area when the power is turned off. That is, at the time of recovery from a power failure, while the predetermined data is stored in the backup RAM area, otherwise, the power-off flag is set based on the fact that the contents of the RAM are undefined. It can be confirmed whether or not the power was restored from the power failure.

 停電からの復旧時であった場合には、CPU56は、入力ポート570を介して初期化操作スイッチ919の状態を確認する(ステップS3)。この実施の形態では、初期化操作スイッチ919がオンされると、その出力がローレベルになる(図6参照)。初期化操作スイッチ919がオン状態であれば、通常の初期化処理を実行する(ステップS2)。また、初期化操作スイッチ919がオフ状態であれば、CPU56は、後述する停電復旧処理を実行する(ステップS4)。なお、初期化操作スイッチ919は、電源スイッチ918のオン前にオン状態に設定されていてもよいし、電源スイッチ918と同時に押下されてもよい。さらに、電源スイッチ918押下後にオン状態とされてもよい。電源スイッチ918押下後にオン状態とされることを考慮して、ステップS3の判定前にディレイ時間をおいてもよい。 If it is time to recover from a power failure, the CPU 56 checks the state of the initialization operation switch 919 via the input port 570 (step S3). In this embodiment, when the initialization operation switch 919 is turned on, the output goes low (see FIG. 6). If the initialization operation switch 919 is on, a normal initialization process is performed (step S2). If the initialization operation switch 919 is in the off state, the CPU 56 executes a power failure recovery process described later (step S4). Note that the initialization operation switch 919 may be set to an on state before the power switch 918 is turned on, or may be pressed simultaneously with the power switch 918. Further, it may be turned on after the power switch 918 is pressed. Considering that the power switch 918 is turned on after being pressed, a delay time may be provided before the determination in step S3.

 停電からの復旧時でない場合には、CPU56は、通常の初期化処理を実行する(ステップS1,S2)。その後、メイン処理では、タイマ割込フラグの監視(ステップS6)の確認が行われるループ処理に移行する。なお、ループ内では、表示用乱数更新処理(ステップS5)も実行される。 If it is not time to recover from a power failure, the CPU 56 executes a normal initialization process (steps S1 and S2). Thereafter, in the main process, the process shifts to a loop process in which monitoring of the timer interrupt flag (step S6) is confirmed. In the loop, a display random number update process (step S5) is also executed.

 通常の初期化処理では、図8に示すように、レジスタおよびRAMのクリア処理(ステップS2a)と、必要な初期値設定処理(ステップS2b)が行われた後に、2ms毎に定期的にタイマ割込がかかるようにCPU56に設けられているタイマレジスタの初期設定(タイムアウトが2msであることと繰り返しタイマが動作する設定)が行われる(ステップS2c)。すなわち、ステップS2cで、タイマ割込を能動化する処理と、タイマ割込インタバルを設定する処理とが実行される。 In a normal initialization process, as shown in FIG. 8, after a register and RAM clearing process (step S2a) and a necessary initial value setting process (step S2b) are performed, a timer is set periodically every 2 ms. The timer register provided in the CPU 56 is initialized (setting that the timeout is 2 ms and the timer operates repeatedly) so that the timer is operated (step S2c). That is, in step S2c, a process of activating a timer interrupt and a process of setting a timer interrupt interval are executed.

 従って、この実施の形態では、CPU56の内部タイマが繰り返しタイマ割込を発生するように設定される。この実施の形態では、繰り返し周期は2msに設定される。そして、図9に示すように、タイマ割込が発生すると、CPU56は、タイマ割込フラグをセットする(ステップS11)。 Therefore, in this embodiment, the internal timer of the CPU 56 is set to repeatedly generate a timer interrupt. In this embodiment, the repetition period is set to 2 ms. Then, as shown in FIG. 9, when a timer interrupt occurs, the CPU 56 sets a timer interrupt flag (step S11).

 CPU56は、ステップS6において、タイマ割込フラグがセットされたことを検出すると、タイマ割込フラグをリセットするとともに(ステップS7)、電圧異常の監視を行う(ステップS8)。電圧異常の監視は、入力ポート570を介して電源監視用IC902からの電圧低下信号を監視することによって実行される。電圧異常すなわち電源電圧の低下を検出したら、CPU56は、後述する停電発生処理(電源断時処理:ステップS9)を実行する。 When the CPU 56 detects that the timer interrupt flag has been set in step S6, the CPU 56 resets the timer interrupt flag (step S7) and monitors for abnormal voltage (step S8). The voltage abnormality is monitored by monitoring a voltage drop signal from the power supply monitoring IC 902 via the input port 570. When detecting an abnormal voltage, that is, a decrease in the power supply voltage, the CPU 56 executes a power failure generation process (power-off process: step S9) described later.

 電圧異常が検出されない場合には、CPU56は、遊技制御処理を実行する(ステップS9)。以上の制御によって、この実施の形態では、遊技制御処理は2ms毎に起動されることになる。 If no abnormal voltage is detected, the CPU 56 executes a game control process (step S9). According to the above control, in this embodiment, the game control process is started every 2 ms.

 図10は、遊技制御処理を示すフローチャートである。遊技制御処理において、CPU56は、まず、表示制御基板80に送出される表示制御コマンドをRAM55の所定の領域に設定する処理を行った後に(表示制御データ設定処理:ステップS21)、表示制御コマンドを出力する処理を行う(表示制御データ出力処理:ステップS22)。 FIG. 10 is a flowchart showing a game control process. In the game control process, the CPU 56 first performs a process of setting a display control command transmitted to the display control board 80 in a predetermined area of the RAM 55 (display control data setting process: step S21), and then executes the display control command. Output processing is performed (display control data output processing: step S22).

 次いで、各種出力データの格納領域の内容を各出力ポートに出力する処理を行う(データ出力処理:ステップS23)。また、ホール管理用コンピュータに出力される大当り情報、始動情報、確率変動情報などの出力データを格納領域に設定する出力データ設定処理を行う(ステップS24)。さらに、パチンコ遊技機1の内部に備えられている自己診断機能によって種々の異常診断処理が行われ、その結果に応じて必要ならば警報が発せられる(エラー処理:ステップS25)。 Next, a process of outputting the contents of the storage area for various output data to each output port is performed (data output process: step S23). Further, an output data setting process for setting output data such as big hit information, start information, and probability variation information output to the hall management computer in the storage area is performed (step S24). Further, various abnormality diagnosis processes are performed by a self-diagnosis function provided inside the pachinko gaming machine 1, and an alarm is issued if necessary according to the result (error process: step S25).

 次に、遊技制御に用いられる大当り判定用の乱数等の各判定用乱数を示す各カウンタを更新する処理を行う(ステップS26)。 Next, a process of updating each counter indicating a random number for determination such as a random number for big hit determination used in game control is performed (step S26).

 さらに、CPU56は、特別図柄プロセス処理を行う(ステップS27)。特別図柄プロセス制御では、遊技状態に応じてパチンコ遊技機1を所定の順序で制御するための特別図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、特別図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。また、普通図柄プロセス処理を行う(ステップS28)。普通図柄プロセス処理では、7セグメントLEDによる可変表示器10を所定の順序で制御するための普通図柄プロセスフラグに従って該当する処理が選び出されて実行される。そして、普通図柄プロセスフラグの値は、遊技状態に応じて各処理中に更新される。 Further, the CPU 56 performs a special symbol process (step S27). In the special symbol process control, a corresponding process is selected and executed according to a special symbol process flag for controlling the pachinko gaming machine 1 in a predetermined order according to a gaming state. Then, the value of the special symbol process flag is updated during each processing according to the gaming state. Further, a normal symbol process is performed (step S28). In the normal symbol process process, a corresponding process is selected and executed according to a normal symbol process flag for controlling the variable display 10 using the 7-segment LED in a predetermined order. Then, the value of the normal symbol process flag is updated during each processing according to the gaming state.

 さらに、CPU56は、スイッチ回路58を介して、ゲートセンサ12、始動口センサ17、カウントセンサ23および入賞口スイッチ19a,24aの状態を入力し、各入賞口や入賞装置に対する入賞があったか否か判定する(スイッチ処理:ステップS29)。CPU56は、さらに、停止図柄の種類を決定する乱数等の表示用乱数を更新する処理を行う(ステップS30)。 Further, the CPU 56 inputs the states of the gate sensor 12, the starting port sensor 17, the count sensor 23, and the winning port switches 19a and 24a via the switch circuit 58, and determines whether or not each of the winning ports and the prize apparatus has won. (Switch processing: step S29). The CPU 56 further performs a process of updating a display random number such as a random number that determines the type of stop symbol (step S30).

 また、CPU56は、賞球制御基板37との間の信号処理を行う(ステップS31)。すなわち、所定の条件が成立すると賞球制御基板37に賞球制御コマンドを出力する。賞球制御基板37に搭載されている賞球制御用CPUは、賞球制御コマンドに応じて玉払出装置97を駆動する。 {Circle around (5)} The CPU 56 performs signal processing with the award ball control board 37 (step S31). That is, when a predetermined condition is satisfied, a prize ball control command is output to the prize ball control board 37. The prize ball control CPU mounted on the prize ball control board 37 drives the ball payout device 97 according to the prize ball control command.

 以上のように、メイン処理には遊技制御処理に移行すべきか否かを判定する処理が含まれ、CPU56の内部タイマが定期的に発生するタイマ割込にもとづくタイマ割込処理で遊技制御処理に移行すべきか否かを判定するためのフラグがセットされるので、遊技制御処理の全てが確実に実行される。つまり、遊技制御処理の全てが実行されるまでは、次回の遊技制御処理に移行すべきか否かの判定が行われないので、遊技制御処理中の全ての各処理が実行完了することは保証されている。 As described above, the main process includes the process of determining whether or not to shift to the game control process, and the internal timer of the CPU 56 performs the timer control process based on the timer interrupt that is periodically generated. Since the flag for determining whether or not to shift is set, all of the game control processing is reliably executed. That is, until all of the game control processing is executed, it is not determined whether or not to shift to the next game control processing, so that it is guaranteed that all the processing during the game control processing is completed. ing.

 従来の一般的な遊技制御処理は、定期的に発生する外部割込によって、強制的に最初の状態に戻されていた。図10に示された例に則して説明すると、例えば、ステップS31の処理中であっても、強制的にステップS21の処理に戻されていた。つまり、遊技制御処理中の全ての各処理が実行完了する前に、次回の遊技制御処理が開始されてしまう可能性があった。 In the conventional general game control processing, the external game is forcibly returned to the initial state by an external interrupt that occurs periodically. Explaining with reference to the example shown in FIG. 10, for example, even during the process of step S31, the process is forcibly returned to the process of step S21. In other words, there is a possibility that the next game control process will be started before all the processes in the game control process are completed.

 なお、この実施の形態では、電源電圧低下の判定(ステップS8)は、定期的に発生するタイマ割込によって起動される遊技制御処理を実行する前に行われたが、遊技制御処理を実行した後に行ってもよい。いずれの時期に行っても、遊技制御手段が他の遊技装置用制御手段や遊技用装置との間で情報入出力を行っていない時期に電源電圧低下の判定が行われるので、情報入出力を行っているときに停電発生処理(ステップS9)が実行されることはない。すなわち、情報入出力が途中で中断されてしまうことはない。例えば、他の基板に送出される制御コマンドが確実に送出完了される。 In this embodiment, the determination of the power supply voltage drop (step S8) is performed before executing the game control process started by the timer interrupt generated periodically, but the game control process is executed. It may be done later. At any time, the power supply voltage drop is determined at a time when the game control means is not performing information input / output with another game apparatus control means or a game apparatus. The power failure occurrence process (step S9) is not performed when the power failure is being performed. That is, information input / output is not interrupted halfway. For example, a control command sent to another board is completely sent.

 また、ここでは、主基板31のCPU56が実行する遊技制御処理は、CPU56の内部タイマが定期的に発生するタイマ割込にもとづくタイマ割込処理でセットされるフラグに応じて実行されたが、定期的に(例えば2ms毎)信号を発生するハードウェア回路を設け、その回路からの信号をCPU56の外部割込端子に導入し、割込信号によって遊技制御処理に移行すべきか否かを判定するためのフラグをセットするようにしてもよい。そのように構成した場合にも、遊技制御処理の全てが実行されるまでは、フラグの判定が行われないので、遊技制御処理中の全ての各処理が実行完了することが保証される。 Here, the game control process executed by the CPU 56 of the main board 31 is executed in accordance with the flag set in the timer interrupt process based on the timer interrupt generated by the internal timer of the CPU 56 periodically. A hardware circuit that periodically generates a signal (for example, every 2 ms) is provided, a signal from the circuit is introduced to an external interrupt terminal of the CPU 56, and it is determined whether or not to shift to the game control process based on the interrupt signal. May be set. Even in such a configuration, the flag is not determined until all the game control processes are executed, so that execution of all the processes in the game control process is guaranteed to be completed.

 図11は、停電発生処理(ステップS9)の一例を示すフローチャートである。停電発生処理において、CPU56は、まず、割込禁止に設定する(ステップS41)。停電発生処理ではRAM内容の保存を確実にするためにチェックサムの生成処理を行う。その処理中に他の割込処理が行われたのではチェックサムの生成処理が完了しないうちにCPUが動作し得ない電圧にまで低下してしまうことがことも考えられるので、まず、他の割込が生じないような設定がなされる。 FIG. 11 is a flowchart showing an example of the power failure occurrence processing (step S9). In the power failure occurrence processing, the CPU 56 first sets the interruption to be prohibited (step S41). In the power failure generation process, a checksum generation process is performed to ensure that the contents of the RAM are preserved. If another interrupt process is performed during that process, the voltage may drop to a level at which the CPU cannot operate before the checksum generation process is completed. The setting is made so that no interrupt occurs.

 次いで、CPU56は、全ての出力ポートをオフ状態にする(ステップS42)。そして、必要ならば各レジスタの内容をバックアップRAM領域に格納する(ステップS43)。また、電源断フラグをセットする(ステップS44)。さらに、バックアップRAM領域のバックアップチェックデータ領域に適当な初期値を設定し(ステップS45)、初期値およびバックアップRAM領域のデータについて順次排他的論理和をとって(ステップS46)、最終的な演算値をバックアップパリティデータ領域に設定する(ステップS47)。その後、RAMアクセス禁止状態にしてループする(ステップS48)。電源電圧が低下していくときには、各種信号線のレベルが不安定になってRAM内容が化ける可能性があるが、このようにRAMアクセス禁止状態にしておけば、バックアップRAM内のデータが化けることはない。 Next, the CPU 56 turns off all the output ports (step S42). Then, if necessary, the contents of each register are stored in the backup RAM area (step S43). Further, a power-off flag is set (step S44). Further, an appropriate initial value is set in the backup check data area of the backup RAM area (step S45), and exclusive OR is sequentially performed on the initial value and the data of the backup RAM area (step S46) to obtain a final operation value. Is set in the backup parity data area (step S47). Thereafter, a loop is made with the RAM access prohibited (step S48). When the power supply voltage decreases, the levels of various signal lines may become unstable and the contents of the RAM may be corrupted. However, if the RAM access is prohibited in this manner, the data in the backup RAM may be corrupted. There is no.

 なお、RAMアクセス禁止にする前にセットされる電源断フラグは、上述したように、電源投入時において停電からの復旧か否かを判断する際に使用される。また、ステップS41からS48の処理は、第2の電源監視手段が電圧低下信号を発生する前に完了する。換言すれば、第2の電源監視手段が電圧低下信号を発生する前に完了するように、第1の電圧監視手段および第2の電圧監視手段の検出電圧の設定が行われている。 The power-off flag set before the RAM access is prohibited is used to determine whether or not to recover from a power failure when the power is turned on, as described above. Further, the processing of steps S41 to S48 is completed before the second power supply monitoring unit generates the voltage drop signal. In other words, the detection voltages of the first voltage monitoring means and the second voltage monitoring means are set such that the detection is completed before the second power supply monitoring means generates the voltage drop signal.

 図12は、停電復旧処理(ステップS4)の一例を示すフローチャートである。停電復旧処理において、CPU56は、まず、バックアップRAM領域のデータチェック(この例ではパリティチェック)を行う(ステップS51)。不測の電源断が生じた後に復旧した場合には、バックアップRAM領域のデータは保存されていたはずであるから、チェック結果は正常になる。チェック結果が正常でない場合には、内部状態を電源断時の状態に戻すことができないので、停電復旧時でない電源投入時に実行される初期化処理(ステップS2)と同様の初期化処理を実行する(ステップS52,S54)。 FIG. 12 is a flowchart showing an example of the power outage restoration process (step S4). In the power failure recovery processing, the CPU 56 first performs data check (parity check in this example) of the backup RAM area (step S51). If the power is restored after an unexpected power failure, the data in the backup RAM area should have been saved, and the check result becomes normal. If the check result is not normal, the internal state cannot be returned to the state at the time of power failure, so that the same initialization processing as the initialization processing (step S2) executed at the time of power-on without power recovery is performed. (Steps S52 and S54).

 チェック結果が正常であれば、CPU56は、内部状態を電源断時の状態に戻すための遊技状態復旧処理を行うとともに(ステップS53)、電源断フラグをクリアする(ステップS55)。 If the check result is normal, the CPU 56 performs a game state restoring process for returning the internal state to the state at the time of power-off (step S53), and clears the power-off flag (step S55).

 なお、ここでは、ステップS1で停電からの復旧か否かを確認し、停電からの復旧時であればパリティチェックを行ったが、最初に、パリティチェックを実行し、チェック結果が正常でなければ停電からの復旧ではないと判断してステップS2の初期化処理を実行し、チェック結果が正常であれば遊技状態復帰処理を行ってもよい。すなわち、パリティチェックの結果をもって停電からの復旧であるか否かを判断してもよい。 In this case, in step S1, it is confirmed whether or not the power is restored from the power failure. If the power is restored from the power failure, the parity check is performed. However, first, the parity check is performed. It is determined that the recovery is not the recovery from the power failure, the initialization process of step S2 is executed, and if the check result is normal, the game state return process may be executed. That is, it may be determined whether or not the power is restored from the power failure based on the result of the parity check.

 図13は、バックアップパリティデータ作成方法を説明するための説明図である。ただし、図13に示す例では、簡単のために、バックアップデータRAM領域のデータのサイズを3バイトとする。電源電圧低下にもとづく停電発生処理において、図13(A)に示すように、バックアップチェックデータ領域に、初期データ(この例では00H)が設定される。次に、「00H」と「F0H」の排他的論理和がとられ、その結果と「16H」の排他的論理和がとられる。さらに、その結果と「DFH」の排他的論理和がとられる。そして、その結果(この例では「39H」)がバックアップパリティデータ領域に設定される。 FIG. 13 is an explanatory diagram for explaining a backup parity data creating method. However, in the example shown in FIG. 13, the size of the data in the backup data RAM area is 3 bytes for simplicity. In the power failure generation process based on the power supply voltage drop, as shown in FIG. 13A, initial data (00H in this example) is set in the backup check data area. Next, an exclusive OR of “00H” and “F0H” is obtained, and an exclusive OR of the result and “16H” is obtained. Further, an exclusive OR of the result and “DFH” is obtained. Then, the result (in this example, “39H”) is set in the backup parity data area.

 電源が再投入されたときには、停電復旧処理においてパリティ診断が行われるが、図13(B)はパリティ診断の例を示す説明図である。バックアップ領域の全データがそのまま保存されていれば、電源再投入時に、図13(A)に示すようなデータがバックアップ領域に設定されている。 (7) When the power is turned on again, the parity diagnosis is performed in the power failure recovery process. FIG. 13B is an explanatory diagram showing an example of the parity diagnosis. If all the data in the backup area is stored as it is, the data as shown in FIG. 13A is set in the backup area when the power is turned on again.

 ステップS51の処理において、CPU56は、バックアップRAM領域のバックアップパリティデータ領域に設定されていたデータ(この例では「39H」)を初期データとして、バックアップデータ領域の各データについて順次排他的論理和をとる処理を行う。バックアップ領域の全データがそのまま保存されていれば、最終的な演算結果は、「00H」、すなわちバックアップチェックデータ領域に設定されているデータと一致する。バックアップRAM領域内のデータにビット誤りが生じていた場合には、最終的な演算結果は「00H」にならない。 In the processing in step S51, the CPU 56 sequentially exclusive-ORs each data in the backup data area with the data (39H in this example) set in the backup parity data area of the backup RAM area as initial data. Perform processing. If all the data in the backup area is stored as it is, the final operation result matches “00H”, that is, the data set in the backup check data area. If a bit error has occurred in the data in the backup RAM area, the final calculation result does not become “00H”.

 よって、CPU56は、最終的な演算結果とバックアップチェックデータ領域に設定されているデータとを比較して、一致すればパリティ診断正常とする。一致しなければ、パリティ診断異常とする。 Therefore, the CPU 56 compares the final operation result with the data set in the backup check data area, and if they match, determines that the parity diagnosis is normal. If they do not match, it is determined that the parity diagnosis is abnormal.

 なお、この実施の形態では、停電発生処理で、チェックデータ(この例ではパリティデータ)の生成が行われたが、チェックデータの生成を行わず、電源断フラグのセットのみを行うようにしてもよい。 In this embodiment, check data (parity data in this example) is generated in the power failure generation process, but the check data is not generated, and only the power-off flag is set. Good.

 以上のように、この実施の形態では、遊技制御手段には、遊技機の電源が断しても、所定期間電源バックアップされる変動データ記憶手段(この例ではバックアップRAM)が設けられ、電源投入時に、CPU56(具体的にはCPU56が実行するプログラム)は、変動データ記憶手段がバックアップ状態にあればバックアップデータにもとづいて遊技状態を回復させる遊技状態復旧処理(ステップS53)を行うように構成される。 As described above, in this embodiment, the game control means is provided with the variable data storage means (backup RAM in this example) which is backed up for a predetermined period even if the power of the gaming machine is turned off. At times, the CPU 56 (specifically, a program executed by the CPU 56) is configured to perform a game state restoration process (step S53) for restoring the game state based on the backup data if the variable data storage unit is in the backup state. You.

 その際、初期化操作スイッチ919がオン状態であれば、遊技状態復旧処理は実行されず、通常の初期化処理(ステップS2)が実行される。従って、遊技店員等は、電源スイッチ918の投入等にもとづく遊技機の電源投入時に、初期化操作スイッチ919を操作することによって、変動データ記憶手段に記憶されているバックアップデータにもとづく遊技状態復旧処理を実行するか否かを選択することができる。従って、電源断が発生しても遊技者に不利益がもたらされることを防止することができるとともに、遊技店での遊技機運用上の利便性を向上させることもできる遊技機が提供される。 At this time, if the initialization operation switch 919 is in the ON state, the game state restoration processing is not executed, and the normal initialization processing (step S2) is executed. Therefore, the game clerk operates the initialization operation switch 919 at the time of turning on the power of the gaming machine based on the turning on of the power switch 918 or the like, thereby executing the game state restoration processing based on the backup data stored in the variable data storage means. Can be selected. Therefore, there is provided a gaming machine which can prevent a disadvantage from being brought to a player even if a power failure occurs, and can also improve convenience in operating a gaming machine in a gaming arcade.

 なお、電源投入時に、変動データ記憶手段にバックアップデータが記憶されていない場合に実行される初期化処理と、変動データ記憶手段にバックアップデータが記憶されていても初期化操作スイッチ919がオフ状態である場合に実行される初期化処理とは、プログラム上兼用されている(図7のステップS2参照)。従って、遊技店での運用上の利便性を向上させる制御を付加しても、プログラム容量はさほど増えない。 Note that, when the power is turned on, the initialization process is performed when the backup data is not stored in the variable data storage unit, and the initialization operation switch 919 is turned off even if the backup data is stored in the variable data storage unit. The initialization process executed in a certain case is shared with the program (see step S2 in FIG. 7). Therefore, even if control for improving the operational convenience in the game arcade is added, the program capacity does not increase so much.

 以下、遊技状態復旧処理について説明する。
 まず、この実施の形態において、主基板31のCPU56が、表示制御基板80、音制御基板70およびランプ制御基板35に送出する表示制御コマンド、音制御コマンドおよびランプ制御コマンドについて説明する。各制御コマンドは、図10に示された遊技制御処理における特別図柄プロセス処理(ステップS28)で遊技進行に応じて送出することが決定され、表示制御データ設定処理(ステップS21)で具体的なデータが設定され、表示制御データ出力処理(ステップS22)で出力ポートから出力されることによって送出される。
Hereinafter, the game state restoration processing will be described.
First, in this embodiment, a display control command, a sound control command, and a lamp control command that the CPU 56 of the main board 31 sends to the display control board 80, the sound control board 70, and the lamp control board 35 will be described. Each control command is determined to be sent in accordance with the progress of the game in the special symbol process process (step S28) in the game control process shown in FIG. 10, and specific data is displayed in the display control data setting process (step S21). Is set, and is transmitted by being output from the output port in the display control data output process (step S22).

 図14(A)は、可変表示部9における図柄変動に関する各制御コマンドの送出タイミング例を示す説明図である。この実施の形態では、主基板31のCPU56は、図柄変動を開始させるときに、表示制御基板80、音制御基板70およびランプ制御基板35のそれぞれに対して変動開始コマンドを送出する。表示制御基板80に対しては、さらに、左右中図柄の確定図柄を示す図柄指定コマンドを送出する。 FIG. 14A is an explanatory diagram showing an example of the transmission timing of each control command relating to the symbol variation on the variable display unit 9. In this embodiment, the CPU 56 of the main board 31 sends a change start command to each of the display control board 80, the sound control board 70, and the lamp control board 35 when starting the symbol change. To the display control board 80, a symbol designating command indicating a fixed symbol of the middle left and right symbols is further transmitted.

 そして、図柄変動を確定させるときに、表示制御基板80、音制御基板70およびランプ制御基板35のそれぞれに対して変動停止コマンドを送出する。表示制御基板80、音制御基板70およびランプ制御基板35に搭載されている各CPUは、変動開始コマンドで指定された変動態様に応じた表示制御、音発生制御およびランプ点灯制御を行う。なお、変動開始コマンドには変動時間を示す情報が含まれている。 {Circle around (4)} When a symbol change is determined, a change stop command is sent to each of the display control board 80, the sound control board 70, and the lamp control board 35. Each CPU mounted on the display control board 80, the sound control board 70, and the lamp control board 35 performs display control, sound generation control, and lamp lighting control according to the variation mode specified by the variation start command. The change start command includes information indicating the change time.

 図14(B)は、可変表示部9の表示結果が所定の大当り図柄であった場合に実行される大当り遊技に関する各制御コマンドの送出タイミング例を示す説明図である。この実施の形態では、主基板31のCPU56は、大当り遊技開始時に、表示制御基板80、音制御基板70およびランプ制御基板35のそれぞれに対して大当り開始コマンドを送出する。また、所定時間経過後に、1ラウンド(1R)指定コマンドを送出する。表示制御基板80、音制御基板70およびランプ制御基板35に搭載されている各CPUは、大当り開始コマンドを受信すると、大当り開始時の表示制御、音発生制御およびランプ点灯制御を行う。また、1ラウンド指定コマンドを受信すると、大当り中の表示制御、音発生制御およびランプ点灯制御を行う。ただし、表示制御基板80のCPUは、1ラウンド目の表示を行う。 FIG. 14B is an explanatory diagram showing an example of the transmission timing of each control command related to the big hit game executed when the display result of the variable display section 9 is a predetermined big hit symbol. In this embodiment, the CPU 56 of the main board 31 sends a jackpot start command to each of the display control board 80, the sound control board 70, and the lamp control board 35 at the start of the big hit game. After a lapse of a predetermined time, a one-round (1R) designation command is transmitted. When each CPU mounted on the display control board 80, the sound control board 70, and the lamp control board 35 receives the big hit start command, it performs display control, sound generation control, and lamp lighting control at the start of the big hit. When a one-round designation command is received, display control, sound generation control, and lamp lighting control during a big hit are performed. However, the CPU of the display control board 80 performs the first round of display.

 その後、主基板31のCPU56は、表示制御基板80に対して各ラウンドを示すコマンド等を順次送出する。表示制御基板80のCPUは、それらのコマンドに応じて対応する表示制御を行う。 After that, the CPU 56 of the main board 31 sequentially sends commands indicating each round to the display control board 80. The CPU of the display control board 80 performs corresponding display control according to these commands.

 また、大当り遊技終了時に、主基板31のCPU56は、表示制御基板80、音制御基板70およびランプ制御基板35のそれぞれに対して大当り終了コマンドを送出する。そして、所定時間経過後に、通常画面表示コマンドを送出する。各遊技装置用制御手段は、通常画面表示コマンドを受信すると、制御状態を遊技待ちの状態にする。 At the end of the big hit game, the CPU 56 of the main board 31 sends a big hit end command to each of the display control board 80, the sound control board 70, and the lamp control board 35. Then, after a predetermined time has elapsed, a normal screen display command is transmitted. Upon receiving the normal screen display command, each game device control means changes the control state to a game waiting state.

 図15は、図12に示された停電復旧処理で行われる遊技状態復旧処理の一例を示すフローチャートである。この例では、CPU56は、レジスタ内容を復元する必要があれば、バックアップRAMに保存されていた値をレジスタに復元する(ステップS61)。そして、バックアップRAMに保存されていたデータにもとづいて停電時の遊技状態を確認する。例えば、特別図柄プロセス処理の進行状況に対応した特別図柄プロセスフラグの値によって遊技状態を確認することができる。 FIG. 15 is a flowchart showing an example of the game state restoring process performed in the power outage restoring process shown in FIG. In this example, if it is necessary to restore the contents of the register, the CPU 56 restores the value stored in the backup RAM to the register (step S61). Then, the game state at the time of the power failure is confirmed based on the data stored in the backup RAM. For example, the gaming state can be confirmed by the value of the special symbol process flag corresponding to the progress of the special symbol process.

 遊技状態が図柄変動中であった場合には(ステップS62)、変動開始コマンドを表示制御基板80、音制御基板70およびランプ制御基板35に送出する制御を行う(ステップS63)。また、遊技状態が大当り遊技中であった場合には(ステップS64)、停電前に最後の送出された制御コマンドを表示制御基板80、音制御基板70およびランプ制御基板35に送出する制御を行う(ステップS65)。そして、それ以外の遊技状態であった場合には、例えば、通常画面表示コマンドを制御コマンドを表示制御基板80、音制御基板70およびランプ制御基板35に送出する制御を行う(ステップS66)。また、例えば、大当り中であった場合の可変入賞球装置15の状態復帰は、RAMのデータが保存されているため、後の遊技制御処理内で自動的に行われる。 If the game state is changing symbols (step S62), control is performed to send a change start command to the display control board 80, the sound control board 70, and the lamp control board 35 (step S63). When the gaming state is the jackpot game (step S64), control is performed to transmit the last transmitted control command to the display control board 80, the sound control board 70, and the lamp control board 35 before the power failure. (Step S65). Then, when the game state is any other game state, for example, a control for transmitting a control command for a normal screen display command to the display control board 80, the sound control board 70, and the lamp control board 35 is performed (step S66). In addition, for example, the state of the variable prize ball device 15 in the case of a big hit is automatically performed in a later game control process because the data in the RAM is stored.

 図16は、停電が発生した後に復旧した場合の制御状態の一例を示す説明図である。図16において、可変表示の状態は表示制御基板80のCPU(表示制御手段)によって実現され、音の状態は音制御基板70のCPU(音制御手段)によって実現され、ランプの状態はランプ制御基板35のCPU(ランプ制御手段)によって実現される。 FIG. 16 is an explanatory diagram showing an example of a control state when the power is restored after a power failure occurs. In FIG. 16, the state of the variable display is realized by the CPU (display control means) of the display control board 80, the state of the sound is realized by the CPU (sound control means) of the sound control board 70, and the state of the lamp is the lamp control board. This is realized by 35 CPUs (lamp control means).

 図16(A)は、図柄変動中に停電が生じた後に復旧した場合の例を示す。この場合には、電源復旧時に、主基板31から変動開始コマンドが送出される(図15におけるステップS63)。変動開始コマンドは、図柄変動開始時に送出されるコマンドであるから、可変表示制御、音制御およびランプ制御の状態は、変動開始時の状態に戻る。この実施の形態では、変動開始コマンドには変動時間を指定する情報を含まれ、主基板31のCPU56は変動開始コマンド送出後では変動終了時の確定コマンド(変動停止コマンド)まで何も送出しない(図柄指定コマンドを除く)。従って、図柄変動中に停電が生じた場合には、変動途中の状態から変動を再開することはできないが、変動開始コマンドを再送出することによって、表示制御、音制御およびランプ制御は同期した状態に戻る。 FIG. 16 (A) shows an example in which the power is restored after a power failure occurs during the symbol change. In this case, when the power is restored, a change start command is sent from the main board 31 (step S63 in FIG. 15). Since the change start command is a command sent at the start of the symbol change, the state of the variable display control, the sound control, and the lamp control returns to the state at the start of the change. In this embodiment, the fluctuation start command includes information for specifying the fluctuation time, and after transmitting the fluctuation start command, the CPU 56 of the main board 31 does not transmit anything until the final change end command (the fluctuation stop command) ( Except for the symbol designating command). Therefore, if a power failure occurs during the symbol change, the change cannot be resumed from the state in the middle of the change, but the display control, sound control, and lamp control are synchronized by resending the change start command. Return to

 なお、主基板31において、変動開始時に使用した各種パラメータはバックアップRAMに保存されている。従って、電源復旧後の変動における表示結果(確定図柄)等は、停電によって中断した変動においてなされるはずであった表示結果等と同じである。従って、遊技者に不利益が与えられるということはない。 In the main board 31, various parameters used at the start of the fluctuation are stored in the backup RAM. Therefore, the display result (fixed symbol) and the like in the fluctuation after the power restoration is the same as the display result and the like that would have been made in the fluctuation interrupted by the power failure. Therefore, no disadvantage is given to the player.

 図16(B)は、大当り遊技中に停電が生じた後に復旧した場合の例を示す。この場合には、電源復旧時に、主基板31から停電前の最後に表示制御基板80、音制御基板70およびランプ制御基板35に送出されたコマンドが再送出される(図15におけるステップS65)。従って、音制御およびランプ制御は、大当り遊技中の制御状態に戻る。また、表示制御も、停電時に行われていた状態に戻る。 FIG. 16 (B) shows an example of a case where the power is restored after a power failure occurs during the big hit game. In this case, when the power is restored, the command sent from the main board 31 to the display control board 80, the sound control board 70, and the lamp control board 35 last before the power failure is sent again (step S65 in FIG. 15). Therefore, the sound control and the lamp control return to the control state during the big hit game. In addition, the display control also returns to the state performed at the time of the power failure.

 なお、主基板31において、大当り遊技中の各種パラメータ(大入賞口開放回数、大入賞口入賞球数等)はバックアップRAMに保存されている。従って、遊技者にとっての遊技状態も停電前の状態に戻るので、遊技者に不利益が与えられるということはない。 In addition, on the main board 31, various parameters during the big hit game (the number of times of opening the special winning opening, the number of winning balls of the special winning opening, etc.) are stored in the backup RAM. Therefore, since the game state for the player also returns to the state before the power failure, there is no disadvantage to the player.

 なお、上記の実施の形態では、遊技制御手段において電源監視処理、データ保存処理および復旧処理が行われる場合について説明したが、音声制御手段、ランプ制御手段および表示制御手段におけるRAMの一部も電源バックアップされ、表示制御手段、音制御手段およびランプ制御手段も、上述したような処理を行ってもよい。ただし、表示制御手段、音制御手段およびランプ制御手段は、復旧時にコマンド送出処理を行う必要はない。 In the above-described embodiment, the case where the power monitoring process, the data saving process, and the restoration process are performed in the game control unit has been described. The backup control, the display control means, the sound control means, and the lamp control means may also perform the processing described above. However, the display control means, the sound control means, and the lamp control means do not need to perform the command transmission processing at the time of restoration.

 また、この実施の形態では、図5に示されたように、主基板31に、2つの電源監視手段が搭載されている。そして、電源電圧が低下していくときに、第2の電源監視手段(この例では電源監視用IC904)が電圧低下信号を発生する時期は、第1の電源監視手段(この例では電源監視用IC902)が電圧低下信号を発生する時期よりも遅くなるように設定されている。さらに、第2の電源監視手段からの電圧低下信号は、CPU56のリセット端子に入力されている。 In addition, in this embodiment, as shown in FIG. 5, two power supply monitoring means are mounted on the main board 31. When the power supply voltage decreases, the timing at which the second power supply monitoring means (the power supply monitoring IC 904 in this example) generates the voltage drop signal is determined by the first power supply monitoring means (the power supply monitoring means in this example). IC 902) is set to be later than the time when the voltage drop signal is generated. Further, the voltage drop signal from the second power supply monitoring means is input to the reset terminal of the CPU 56.

 すると、CPU56は、図17に示すように、第1の電源監視手段(電源監視用IC902)からの電圧低下信号にもとづいて停電発生処理(電源断時処理)を実行した後に電源断待ちに入るのであるが、電源断待ち状態において、リセット状態に入ることになる。すなわち、CPU56の動作が停止する。電源待ち状態では+5V電源電圧値が徐々に低下するので入出力状態が不定になるが、CPU56はリセット状態になるので、不定データにもとづいて異常動作してしまうことは防止される。 Then, as shown in FIG. 17, the CPU 56 executes a power failure generation process (power-off process) based on a voltage drop signal from the first power-supply monitoring unit (power-supply monitoring IC 902), and then enters a power-off wait state. However, in a power-off wait state, the apparatus enters a reset state. That is, the operation of the CPU 56 stops. In the power supply waiting state, the input / output state becomes unstable because the +5 V power supply voltage value gradually decreases, but since the CPU 56 is in the reset state, abnormal operation based on the undefined data is prevented.

 このように、この実施の形態では、CPU56が、第1の電源監視手段からの検出出力の入力に応じて電源断時処理を実行するとともに、第2の電源監視手段からの検出出力の入力に応じてシステムリセットされるように構成したので、電源断時に確実なデータ保存を行うことができ、遊技者に不利益がもたらされることを防止することができる。 As described above, in this embodiment, the CPU 56 executes the power-off processing in response to the input of the detection output from the first power supply monitoring unit, and performs the processing when the detection output from the second power supply monitoring unit is input. Since the system is configured to be reset in response, the data can be reliably stored when the power is turned off, and it is possible to prevent the player from being disadvantaged.

 次に、遊技制御手段すなわち主基板31におけるCPU56と他の遊技装置用制御手段におけるCPUに対する電源断時の電圧供給状況について説明する。ここでは、遊技装置用制御手段として、玉払出装置97を制御する賞球制御手段を例にする。 Next, a description will be given of the state of voltage supply to the game control means, that is, the CPU 56 of the main board 31 and the CPU of the control means for another game apparatus when the power is turned off. Here, a prize ball control unit that controls the ball payout device 97 will be described as an example of the game device control unit.

 図18は、電源監視および電源バックアップのための賞球制御用CPU371周りの一構成例を示すブロック図である。図18に示すように、電源監視用IC932は、+30V電源電圧を導入し、+30V電源電圧を監視することによって電源断の発生を検出する。具体的には、+30V電源電圧が所定値以下になったら、電源断が生ずるとして、賞球制御用CPU371に割り込み信号を与える。この実施の形態では、所定値を+14Vとする。賞球制御用CPU371において、この割り込みは、マスク不能割込(NMI)端子に入力されている。また、NMI端子に入力される信号は、入力ポートにも入力されている。従って、賞球制御用CPU371は、NMI処理において、入力ポートのレベルを確認することによって電源断の状況を確認することができる。 FIG. 18 is a block diagram showing an example of a configuration around the CPU 371 for controlling the prize ball for power supply monitoring and power supply backup. As shown in FIG. 18, the power supply monitoring IC 932 detects the occurrence of power interruption by introducing a +30 V power supply voltage and monitoring the +30 V power supply voltage. Specifically, when the +30 V power supply voltage becomes equal to or lower than a predetermined value, it is determined that the power is cut off, and an interrupt signal is given to the CPU 371 for award ball control. In this embodiment, the predetermined value is + 14V. In the prize ball control CPU 371, this interrupt is input to a non-maskable interrupt (NMI) terminal. The signal input to the NMI terminal is also input to the input port. Therefore, in the NMI processing, the CPU 371 for controlling the prize ball can confirm the power-off state by confirming the level of the input port.

 電源監視用IC932が電源断を検知するための所定値は、通常時の電圧より低いが、賞球制御用CPU371が暫くの間動作しうる程度の電圧である。また、電源監視用IC932が、賞球制御用CPU371が必要とする電圧(この例では+5V)よりも高い電圧を監視するように構成されているので、賞球制御用CPU371が必要とする電圧に対して監視範囲を広げることができる。従って、より精密な監視を行うことができる。 The predetermined value for the power supply monitoring IC 932 to detect a power-off is lower than the normal voltage, but is a voltage at which the prize ball control CPU 371 can operate for a while. In addition, since the power supply monitoring IC 932 is configured to monitor a voltage higher than the voltage (+5 V in this example) required by the prize ball control CPU 371, the voltage required by the prize ball control CPU 371 is reduced. In contrast, the monitoring range can be extended. Therefore, more precise monitoring can be performed.

 +5V電源から電力が供給されていない間、賞球制御用CPU371の内蔵RAMの少なくとも一部は、電源基板から供給されるバックアップ電源がバックアップ端子に接続されることによってバックアップされ、遊技機に対する電源が断しても内容は保存される。そして、+5V電源が復旧すると、初期リセット回路935からリセット信号が発せられるので、賞球制御用CPU371は、通常の動作状態に復帰する。そのとき、必要なデータがバックアップされているので、停電等からの復旧時には停電発生時の遊技状態に復帰することができる。 While power is not being supplied from the + 5V power supply, at least a part of the built-in RAM of the prize ball control CPU 371 is backed up by connecting a backup power supply supplied from a power supply board to a backup terminal, so that power for the gaming machine is maintained. Even if you refuse, the contents will be saved. Then, when the + 5V power supply is restored, a reset signal is issued from the initial reset circuit 935, so that the winning ball control CPU 371 returns to a normal operation state. At that time, since necessary data has been backed up, it is possible to return to the gaming state at the time of the occurrence of the power failure when recovery from a power failure or the like.

 図19は、主基板31から賞球制御基板37に送信される賞球制御コマンドのビット構成の一例を示す説明図である。図19に示すように、1バイト中の上位4ビットが制御指定部として使用され、下位4ビットが賞球数を示す領域として用いられる。 FIG. 19 is an explanatory diagram showing an example of a bit configuration of a prize ball control command transmitted from the main board 31 to the prize ball control board 37. As shown in FIG. 19, the upper four bits in one byte are used as a control designator, and the lower four bits are used as an area indicating the number of award balls.

 図20に示すように、制御指定部において、ビット7,6,5,4が「0,1,0,0」であれば払出個数指定コマンドであることを示し、「0,1,0,1」であれば払出指定コマンドであることを示す。払出個数指定コマンドは、主基板31のCPU56が入賞を検出すると直ちに賞球制御基板37に送出される。 As shown in FIG. 20, if the bits 7, 6, 5, and 4 are "0, 1, 0, 0" in the control designation section, it indicates that the command is the payout number designation command, and "0, 1, 0, "1" indicates a payout designation command. The payout number designation command is sent to the prize ball control board 37 immediately after the CPU 56 of the main board 31 detects a winning.

 ビット7,6,5,4が「1,0,0,0」である球切れ指定コマンドは、補給玉がなくなったことが検出されたときに主基板31から送信される。また、ビット7,6,5,4が「1,0,0,1」である発射停止指定コマンドは、余剰玉受皿4が満タンになって満タンスイッチ48がオンしたとき(満タン状態フラグがオンしたとき)に主基板31から送信される。 The command to designate a broken ball, in which the bits 7, 6, 5, and 4 are "1, 0, 0, 0", is transmitted from the main board 31 when it is detected that there are no more supply balls. The firing stop designation command in which the bits 7, 6, 5, and 4 are “1, 0, 0, 1” is issued when the surplus ball tray 4 is full and the full switch 48 is turned on (the full tank state). (When the flag is turned on).

 賞球制御コマンドは、主基板31から賞球制御基板37に、1バイト(8ビット:賞球制御コマンドD7〜D0)のデータとして出力される。賞球制御コマンドD7〜D0は正論理で出力される。また、賞球制御コマンドD7〜D0が出力されたときには、負論理の賞球制御INT信号が出力される。 The award ball control command is output from the main board 31 to the award ball control board 37 as 1-byte (8 bits: award ball control commands D7 to D0) data. The award ball control commands D7 to D0 are output in positive logic. When the prize ball control commands D7 to D0 are output, a negative logic prize ball control INT signal is output.

 この実施の形態では、図21に示すように、主基板31から賞球制御コマンドD7〜D0が出力されるときに、賞球制御INT信号が5μs以上ローレベルになる。賞球制御INT信号は、賞球制御基板37において、賞球制御用CPU371の割込端子に接続されている。よって、賞球制御用CPU371は、割り込みがあると、賞球制御コマンドD7〜D0が主基板31から送出されたことを認識でき、割込処理において賞球制御コマンド受信処理を行う。 In this embodiment, as shown in FIG. 21, when the prize ball control commands D7 to D0 are output from the main board 31, the prize ball control INT signal goes low for 5 μs or more. The award ball control INT signal is connected to an interrupt terminal of the award ball control CPU 371 on the award ball control board 37. Therefore, if there is an interrupt, the award ball control CPU 371 can recognize that the award ball control commands D7 to D0 have been transmitted from the main board 31, and perform the award ball control command receiving process in the interrupt process.

 なお、図19に示されたコマンド構成は一例であって、他の構成にしてもよい。例えば、1バイト中の上位下位を、図19に示された構成とは逆にしてもよい。 Note that the command configuration shown in FIG. 19 is an example, and another configuration may be used. For example, the upper and lower parts in one byte may be reversed from the configuration shown in FIG.

 図22は、賞球制御用CPU371のメイン処理を示すフローチャートである。メイン処理では、賞球制御用CPU371は、まず、RAM領域をクリアする等の初期値設定処理を行う(ステップS701)。なお、内蔵RAMの電源バックアップされたRAM領域(バックアップRAM領域)にデータが設定されている場合には、それらの領域のクリア処理はなされない。その後、この実施の形態では、賞球制御用CPU371は、所定期間(例えば2ms)毎に発生するタイマ割込による割込処理で賞球払出制御を行う(ステップS702)。タイマ割込処理では、図23に示すように、賞球制御用CPU371は、賞球払出制御処理を実行する(ステップS711)。 FIG. 22 is a flowchart showing the main processing of the award ball control CPU 371. In the main process, the award ball control CPU 371 first performs an initial value setting process such as clearing a RAM area (step S701). If data is set in the RAM area (backup RAM area) of the internal RAM that has been backed up by power, those areas are not cleared. Thereafter, in this embodiment, the prize ball control CPU 371 performs prize ball payout control by an interrupt process by a timer interrupt generated every predetermined period (for example, 2 ms) (step S702). In the timer interruption process, as shown in FIG. 23, the prize ball control CPU 371 executes a prize ball payout control process (step S711).

 図24は、賞球制御用CPU371が内蔵するRAMの使用例を示す説明図である。この例では、バックアップRAM領域に総合個数記憶(例えば2バイト)が形成されている。総合個数記憶は、主基板31の側から指示された払出個数の総数を記憶するものである。 FIG. 24 is an explanatory diagram showing an example of use of the RAM built in the CPU 371 for controlling a prize ball. In this example, the total number storage (for example, 2 bytes) is formed in the backup RAM area. The total number storage stores the total number of payout numbers instructed from the main board 31 side.

 図25は、割込処理による賞球制御コマンド受信処理を示すフローチャートである。主基板31からの賞球制御INT信号は賞球制御用CPU371の割込端子に入力されている。よって、主基板31からの賞球制御INT信号がオン状態になると、賞球制御用CPU371に割込がかかり、図25に示す賞球制御コマンドの受信処理が開始される。 FIG. 25 is a flowchart showing a prize ball control command receiving process by the interrupt process. The award ball control INT signal from the main board 31 is input to an interrupt terminal of the award ball control CPU 371. Therefore, when the award ball control INT signal from the main board 31 is turned on, the award ball control CPU 371 is interrupted, and the receiving process of the award ball control command shown in FIG. 25 is started.

 賞球制御コマンドの受信処理において、賞球制御用CPU371は、まず、賞球制御コマンドデータの入力に割り当てられている入力ポートから1バイトのデータを読み込む(ステップS852)。読み込んだデータが払出個数指示コマンドであれば(ステップS853)、払出個数指示コマンドで指示された個数を総合個数記憶に加算する(ステップS855)。そうでなければ、通信終了フラグをセットする(ステップS854)。なお、通信終了フラグは、この例では、払出個数指示コマンド以外のコマンドを受信したことを示すフラグである。 In the receiving process of the award ball control command, the award ball control CPU 371 first reads 1-byte data from the input port assigned to the input of the award ball control command data (step S852). If the read data is a payout number instruction command (step S853), the number specified by the payout number instruction command is added to the total number storage (step S855). Otherwise, a communication end flag is set (step S854). In this example, the communication end flag is a flag indicating that a command other than the payout number instruction command has been received.

 以上のように、賞球制御基板37に搭載された賞球制御用CPU371は、主基板31のCPU56から送られた払出個数指示コマンドに含まれる賞球数をバックアップRAM領域(総合個数記憶)に記憶する。 As described above, the prize ball control CPU 371 mounted on the prize ball control board 37 stores the prize ball number included in the payout number instruction command sent from the CPU 56 of the main board 31 in the backup RAM area (total number storage). Remember.

 賞球制御用CPU371は、タイマ割込で起動される賞球制御処理(ステップS711)において、総合個数記憶の値が0でない場合には、玉払出装置97を駆動して賞球払出を行い、1個の払出が完了する度に総合個数記憶の値を1減らす。 If the value of the total number storage is not 0 in the prize ball control process (step S711) activated by the timer interrupt, the prize ball control CPU 371 drives the ball payout device 97 to perform the prize ball payout, Each time one payout is completed, the value of the total number storage is reduced by one.

 図26は、賞球制御用CPU371が実行するNMI割込処理を示すフローチャートである。図18に示された電源監視用IC932が電源電圧の低下を検出するとNMI割込が発生し、NMI割込処理が開始される。従って、NMI割込処理では、停電発生処理(電源断時処理)が実行される。電源断時処理において、賞球制御用CPU371は、RAMアクセス禁止状態に設定して(ステップS801)、その後ループする。従って、電源監視用IC932から電圧低下信号が出力されると、賞球払出制御がなされない状態になる。 FIG. 26 is a flowchart showing the NMI interrupt processing executed by the award ball control CPU 371. When the power supply monitoring IC 932 shown in FIG. 18 detects a drop in the power supply voltage, an NMI interrupt occurs, and the NMI interrupt processing is started. Accordingly, in the NMI interrupt process, a power failure occurrence process (process at the time of power failure) is executed. In the power-off processing, the prize ball control CPU 371 sets the RAM access to a prohibited state (step S801), and then loops. Therefore, when the voltage drop signal is output from the power supply monitoring IC 932, the award ball payout control is not performed.

 図27は、賞球制御用CPU371が電源投入時に実行する初期化処理の一部を示すフローチャートである。電源が投入され、または、電源が復旧したときには、賞球制御用CPU371は、まず、バックアップRAM領域に形成されている総合個数記憶の値が0でないかどうか確認する(ステップS901)。0である場合には、前回の電源オフ時に未払出賞球はなかったことになるので、通常の初期設定処理を行う。すなわち、レジスタおよび全RAM領域をクリアして(ステップS903)、スタックポインタの初期設定を行う(ステップS904)。 FIG. 27 is a flowchart showing a part of the initialization process executed by the CPU 371 for controlling the prize ball when the power is turned on. When the power is turned on or the power is restored, the award ball control CPU 371 first checks whether or not the value of the total number storage formed in the backup RAM area is 0 (step S901). If it is 0, it means that there were no unpaid prize balls at the time of the previous power-off, so that normal initialization processing is performed. That is, the register and the entire RAM area are cleared (step S903), and the stack pointer is initialized (step S904).

 総合個数記憶の値が0でない場合には、アドレスを指定してレジスタと非バックアップRAM領域をクリアする(ステップS905)。そして、賞球再開のための設定を行う。例えば、賞球中処理中フラグのセット等を行う(ステップS906)。なお、バックアップRAM領域であっても、賞球個数に関わらない領域であるならば、それらのアドレスを指定してクリアするようにしてもよい。 If the value of the total number storage is not 0, the address is designated to clear the register and the non-backup RAM area (step S905). Then, setting for restarting the prize ball is performed. For example, a flag during processing of award balls is set (step S906). If the backup RAM area is an area irrespective of the number of prize balls, those addresses may be designated and cleared.

 このように、賞球制御用CPU371は、電源投入時に、バックアップRAM領域のデータを確認するだけで、通常の初期設定処理を行うのか賞球中の状態を復元するのか決定できる。すなわち、簡単な判断によって、未払出賞球について賞球処理再開を行うことができる。 As described above, the prize ball control CPU 371 can determine whether to perform the normal initialization process or restore the state during the prize ball simply by checking the data in the backup RAM area when the power is turned on. That is, the prize ball processing can be restarted for the unpaid prize balls by a simple determination.

 この実施の形態では、賞球制御基板37に搭載されている電源監視用IC932は+30V電源電圧が+14V以下になると電圧低下信号を出力する。そして、賞球制御用CPU371は、電圧低下信号に応じて停電発生処理(この例ではNMI処理)を実行する。一方、主基板31に搭載されている電源監視用IC902は+30V電源電圧が+16V以下になると電圧低下信号を出力する。そして、CPU56は、電圧低下信号に応じて停電発生処理を実行する。従って、図28に示すように、停電等が発生したときに、遊技制御手段が停電発生処理を開始する時期は、賞球制御手段が停電発生処理を開始する時期よりも早い。すなわち、停電等が発生したときに、遊技制御手段は、賞球制御手段が賞球払出制御を停止する前に、遊技制御を停止する。 In this embodiment, the power supply monitoring IC 932 mounted on the prize ball control board 37 outputs a voltage drop signal when the +30 V power supply voltage becomes +14 V or less. Then, the prize ball control CPU 371 executes a power failure generation process (NMI process in this example) according to the voltage drop signal. On the other hand, the power supply monitoring IC 902 mounted on the main board 31 outputs a voltage drop signal when the +30 V power supply voltage becomes equal to or lower than +16 V. Then, the CPU 56 executes a power failure generation process according to the voltage drop signal. Therefore, as shown in FIG. 28, when a power failure or the like occurs, the timing at which the game control means starts the power failure occurrence processing is earlier than the time at which the prize ball control means starts the power failure occurrence processing. That is, when a power failure or the like occurs, the game control means stops the game control before the prize ball control means stops the prize ball payout control.

 従って、例えば、遊技制御手段が停電発生処理開始の直前に賞球払出個数を示す賞球制御コマンドを送出したとしても、その賞球制御コマンドは確実に賞球制御手段に受信される。そして、賞球制御手段は受信したコマンドにもとづく賞球払出個数を総合個数記憶として記憶する。総合個数記憶はバックアップRAM領域に形成されているので、停電から復旧したときに賞球払出制御が再開される。つまり、この実施の形態では、停電等が発生したときでも賞球払出個数は確実に保存され復旧時に払出が行われるので、遊技者に不利益が与えられることはない。 Therefore, for example, even if the game control means sends out a prize ball control command indicating the number of prize balls to be paid immediately before the start of the power failure generation process, the prize ball control command is reliably received by the prize ball control means. Then, the winning ball control means stores the winning ball payout number based on the received command as total number memory. Since the total number storage is formed in the backup RAM area, the prize ball payout control is restarted when the power is restored. That is, in the present embodiment, even when a power failure or the like occurs, the number of prize balls to be paid out is reliably stored and paid out at the time of restoration, so that no disadvantage is given to the player.

 なお、この実施の形態では、賞球制御用CPU371は、NMI処理によって電源断時処理を実行したが、通常の割込処理によって電源断時処理を実行してもよいし、主基板31のCPU56と同様に第1の電源監視回路の検出出力を入力ポートに導入し、割込処理によらず入力ポートを監視することによって電源断時処理を実行してもよい。また、賞球制御手段は、賞球払出個数を総合個数記憶として一括管理せずに、賞球数毎に賞球回数を記憶するようにしてもよい。 In this embodiment, the prize ball control CPU 371 executes the power-off process by the NMI process. However, the power-off process may be executed by a normal interrupt process, or the CPU 56 of the main board 31 may execute the power-off process. Similarly to the above, the detection output of the first power supply monitoring circuit may be introduced to the input port, and the power-off processing may be executed by monitoring the input port without using the interrupt processing. The prize ball control means may store the number of prize balls for each number of prize balls without collectively managing the number of prize balls paid out as the total number storage.

 また、賞球制御基板37にも、主基板31に設けられている回路と同様の第2の電源監視回路を設け、第2の電源監視回路が賞球制御用CPU371を駆動するための+5V電源電圧を監視し、第2の電源監視回路の検出出力を賞球制御用CPU371のリセット端子に接続するようにしてもよい。その場合に、2つの電源監視回路が同一の電源電圧を監視してもよい。例えば、ともに+30V電源電圧を監視してもよい。そして、例えば、一方の検出電圧を+14Vとし、他方の検出電圧を+8Vとする。さらに、1個の電源監視用ICで2つの電位を監視するようにしてもよい The prize ball control board 37 is also provided with a second power supply monitoring circuit similar to the circuit provided on the main board 31, and the second power supply monitoring circuit supplies a + 5V power supply for driving the prize ball control CPU 371. The voltage may be monitored, and the detection output of the second power supply monitoring circuit may be connected to the reset terminal of the prize ball control CPU 371. In that case, the two power supply monitoring circuits may monitor the same power supply voltage. For example, both may monitor the + 30V power supply voltage. Then, for example, one detection voltage is set to + 14V, and the other detection voltage is set to + 8V. Further, two potentials may be monitored by one power supply monitoring IC.

 そして、2つの電源監視回路を設けた場合には、賞球制御用CPU371が、第1の電源監視手段からの検出出力の入力に応じて電源断時処理を実行するとともに、第2の電源監視手段からの検出出力の入力に応じてシステムリセットされるので、電源断時に、より確実に賞球払出個数等のデータが保存され、遊技者に不利益がもたらされることを防止することができる。 When two power supply monitoring circuits are provided, the prize ball control CPU 371 executes the power-off processing in response to the input of the detection output from the first power supply monitoring means, and performs the second power supply monitoring. Since the system is reset in response to the input of the detection output from the means, when the power is turned off, the data such as the number of prize balls to be paid out is more reliably stored, and it is possible to prevent the player from being disadvantaged.

 なお、上記の実施の形態では、変動データ記憶手段としてRAMを用いた場合を示したが、変動データ記憶手段として、電気的に書き換えが可能な記憶手段であればRAM以外のものを用いてもよい。 In the above-described embodiment, the case where the RAM is used as the variable data storage means has been described. However, as the variable data storage means, any other electrically rewritable storage means other than the RAM may be used. Good.

 さらに、ここでは、遊技制御手段以外の他の遊技装置用制御手段として賞球制御手段を例示したが、表示制御手段、音制御手段およびランプ制御手段についても、電圧低下信号を発生するための電圧値が遊技制御手段における電圧値より低く設定されている電源監視用ICを設けてもよい。 Furthermore, here, the prize ball control means has been exemplified as the control means for the gaming device other than the game control means, but the display control means, the sound control means, and the lamp control means also have a voltage for generating a voltage drop signal. A power supply monitoring IC whose value is set lower than the voltage value in the game control means may be provided.

パチンコ遊技機を正面からみた正面図である。It is the front view which looked at the pachinko gaming machine from the front. パチンコ遊技機の遊技盤を正面からみた正面図である。It is the front view which looked at the game board of the pachinko gaming machine from the front. パチンコ遊技機を背面からみた背面図である。It is the back view which looked at the pachinko gaming machine from the back. 遊技制御基板(主基板)の回路構成例を示すブロック図である。It is a block diagram showing the example of circuit composition of a game control board (main board). 電源監視および電源バックアップのためのCPU周りの一構成例を示すブロック図である。FIG. 3 is a block diagram showing an example of a configuration around a CPU for power supply monitoring and power supply backup. 電源基板の一構成例を示すブロック図である。FIG. 3 is a block diagram illustrating a configuration example of a power supply board. 主基板における基本回路の動作を示すフローチャートである。6 is a flowchart showing the operation of the basic circuit on the main board. 初期化処理を示すフローチャートである。It is a flowchart which shows an initialization process. 2msタイマ割込処理を示すフローチャートである。It is a flowchart which shows a 2ms timer interruption process. 遊技制御処理を示すフローチャートである。It is a flowchart showing a game control process. 停電発生処理を示すフローチャートである。It is a flowchart which shows a power failure generation process. 停電復旧処理を示すフローチャートである。It is a flowchart which shows a power failure recovery process. バックアップパリティデータ作成方法を説明するための説明図である。FIG. 4 is an explanatory diagram for describing a backup parity data creation method. 主基板からの各制御コマンドの送出タイミング例を示す説明図である。FIG. 9 is an explanatory diagram showing an example of a transmission timing of each control command from the main board. 遊技状態復旧処理の一例を示すフローチャートである。It is a flow chart which shows an example of game state restoration processing. 停電が発生した後に復旧した場合の制御状態の一例を示す説明図である。It is explanatory drawing which shows an example of the control state when it recovers after a power failure occurs. 電圧監視手段の出力にもとづくCPUの動作状態の一例を示すタイミング図である。FIG. 9 is a timing chart showing an example of an operation state of a CPU based on an output of a voltage monitoring unit. 電源監視および電源バックアップのための賞球制御用CPU周りの一構成例を示すブロック図である。It is a block diagram showing an example of 1 composition of CPU around a prize ball control for power supply monitoring and power supply backup. 賞球制御コマンドの構成例を示す説明図である。It is an explanatory view showing a configuration example of a prize ball control command. 賞球制御コマンドのビット構成を示す説明図である。It is an explanatory view showing a bit configuration of a prize ball control command. 賞球制御コマンドデータの出力の様子を示すタイミング図である。FIG. 9 is a timing chart showing how a winning ball control command data is output. 賞球制御用CPUが実行するメイン処理を示すフローチャートである。It is a flowchart which shows the main process which CPU for award ball control performs. 賞球制御用CPUの2msタイマ割込処理を示すフローチャートである。It is a flowchart which shows the 2ms timer interruption process of CPU for award ball control. 賞球制御手段におけるRAMの一構成例を示す説明図である。FIG. 9 is an explanatory diagram showing a configuration example of a RAM in a prize ball control means. 賞球制御用CPUのコマンド受信処理を示すフローチャートである。It is a flowchart which shows the command receiving process of CPU for award ball control. 賞球制御用CPUのNMI割込処理を示すフローチャートである。It is a flowchart which shows the NMI interruption process of CPU for award ball control. 賞球制御用CPUの初期化処理の一例を示すフローチャートである。It is a flow chart which shows an example of initialization processing of CPU for award ball control. 遊技制御手段が停電発生処理を開始する時期と賞球制御手段が停電発生処理を開始する時期との関係の一例を示すタイミング図である。It is a timing chart which shows an example of the relation between the time when game control means starts a power failure occurrence process and the time when the prize ball control means starts the power failure occurrence process.

符号の説明Explanation of reference numerals

 1   パチンコ遊技機
 31  主基板
 35  ランプ制御基板
 37  賞球制御基板
 70  音制御基板
 80  表示制御基板
 53  基本回路
 56  CPU
 371 賞球制御用CPU
 570 入力ポート
 902,932 電源監視用IC
 903 第2の電源監視回路
 910 電源基板
 916 コンデンサ
 918 電源スイッチ
 919 初期化操作スイッチ
1 Pachinko gaming machine 31 Main board 35 Lamp control board 37 Winning ball control board 70 Sound control board 80 Display control board 53 Basic circuit 56 CPU
371 CPU for controlling prize balls
570 Input port 902, 932 Power supply monitoring IC
903 Second power supply monitoring circuit 910 Power supply board 916 Capacitor 918 Power switch 919 Initialization operation switch

Claims (4)

 遊技球を用いて遊技が行われ、表示状態が変化可能な可変表示部が設けられ、前記可変表示部の表示結果があらかじめ定められた特定の表示態様となったときに所定の遊技価値を遊技者に与える遊技機であって、
 前記可変表示部の表示制御を行うCPUを搭載した表示制御基板と、
 前記可変表示部の表示結果が前記特定の表示態様となったときに開放する大入賞口と、
 遊技球の入賞により前記可変表示部の表示状態を変化させるための始動入賞口と、
 遊技球の入賞により賞球を払い出すための入賞口と、
 前記大入賞口への遊技球の入賞を検出するカウントスイッチと、
 前記始動入賞口への遊技球の入賞を検出する始動口スイッチと、
 前記入賞口への遊技球の入賞を検出する入賞口スイッチと、
 前記カウントスイッチ、前記始動口スイッチおよび前記入賞口スイッチが入賞を検出すると、賞球の払出個数を指示する払出個数指示コマンドを出力するCPUを搭載した遊技制御基板と、
 賞球を払い出す玉払出装置と、
 前記払出個数指示コマンドに応じて前記玉払出装置を駆動する賞球制御用CPUを搭載した賞球制御基板と、
 遊技機によって使用される第1の所定電源電圧を監視し、前記第1の所定電源電圧が第1の所定値以下に低下したことを検出する第1の電源監視回路と、
 遊技機によって使用される第2の所定電源電圧を監視し、前記第2の所定電源電圧が前記第1の所定値よりも低い第2の所定値以下に低下したことを検出する第2の電源監視回路とを備え、
 前記第1の電源監視回路および第2の電源監視回路の検出出力は、前記賞球制御用CPUに入力され、
 前記賞球制御用CPUは、
 前記払出個数指示コマンドによって指示される払出個数の総数が記憶されるとともに、遊技機に対する電源が断しても内容が保存されるバックアップRAM領域を含み、
 前記バックアップRAM領域が記憶する払出個数の総数の値に前記払出個数指示コマンドによって指示された払出個数を加算し、前記玉払出装置を駆動して1個の払出が完了する度に前記バックアップRAM領域が記憶する払出個数の総数の値を1減算し、
 前記第1の電源監視回路からの検出出力が入力されたときに、RAMアクセス禁止状態に設定し、前記第2の電源監視回路からの検出出力が入力されたときに、システムリセットし、
 前記遊技制御基板に搭載されたCPUは、
 前記可変表示部における図柄変動を開始させるときに、図柄の変動時間を示す情報を含む変動開始コマンドを前記表示制御基板に搭載されたCPUに出力し、さらに確定図柄を示す図柄指定コマンドを前記表示制御基板に搭載されたCPUに出力し、前記可変表示部における図柄変動を確定させるときに、変動停止コマンドを前記表示制御基板に搭載されたCPUに出力する
 ことを特徴とする遊技機。
A game is played using a game ball, and a variable display unit whose display state is changeable is provided, and when a display result of the variable display unit becomes a predetermined specific display mode, a predetermined game value is played. Machine to give to the
A display control board equipped with a CPU that performs display control of the variable display unit,
A special winning opening that is opened when the display result of the variable display unit becomes the specific display mode,
A starting winning port for changing the display state of the variable display section by winning a game ball,
A winning port for paying out a prize ball by winning a game ball,
A count switch for detecting winning of a game ball to the special winning opening,
A starting port switch for detecting a winning of a game ball to the starting winning port,
A winning opening switch for detecting a winning of a game ball to the winning opening;
When the count switch, the starting port switch and the winning port switch detects a winning, a game control board equipped with a CPU that outputs a payout number instruction command for instructing the payout number of winning balls,
A ball payout device that pays out prize balls,
A prize ball control board equipped with a prize ball control CPU for driving the ball payout device in response to the payout number instruction command;
A first power supply monitoring circuit that monitors a first predetermined power supply voltage used by the gaming machine and detects that the first predetermined power supply voltage has dropped below a first predetermined value;
A second power supply for monitoring a second predetermined power supply voltage used by the gaming machine and detecting that the second predetermined power supply voltage has dropped below a second predetermined value lower than the first predetermined value. With a monitoring circuit,
Detection outputs of the first power supply monitoring circuit and the second power supply monitoring circuit are input to the prize ball control CPU,
The prize ball control CPU,
A backup RAM area in which the total number of payouts instructed by the payout number instruction command is stored and the contents of which are stored even when the power to the gaming machine is turned off,
The payout number designated by the payout number instruction command is added to the total number of payout numbers stored in the backup RAM area, and each time one ball is paid out by driving the ball payout apparatus, the backup RAM area is added. Subtracts 1 from the total number of payouts stored by
When a detection output from the first power supply monitoring circuit is input, a RAM access prohibition state is set, and when a detection output from the second power supply monitoring circuit is input, a system reset is performed.
The CPU mounted on the game control board,
When starting the symbol change in the variable display section, a change start command including information indicating the change time of the symbol is output to the CPU mounted on the display control board, and the symbol designation command indicating the fixed symbol is further displayed on the display. A game machine which outputs a change stop command to a CPU mounted on the display control board when outputting to a CPU mounted on a control board to determine a symbol change in the variable display section.
 第1の電源監視回路と第2の電源監視回路とは同一の電源電圧を監視する請求項1記載の遊技機。 The gaming machine according to claim 1, wherein the first power supply monitoring circuit and the second power supply monitoring circuit monitor the same power supply voltage.  第2の電源監視回路が監視する第2の所定電源電圧は、賞球制御用CPUの駆動用電源の電圧であり、
 前記第2の電源監視回路は、駆動用電源の電圧が賞球制御用CPUの動作可能範囲内の第2の所定値以下に低下したことを検出する
 請求項1または請求項2記載の遊技機。
The second predetermined power supply voltage monitored by the second power supply monitoring circuit is a voltage of a power supply for driving the CPU for controlling the prize ball,
The gaming machine according to claim 1 or 2, wherein the second power supply monitoring circuit detects that the voltage of the driving power supply has dropped to a second predetermined value or less within an operable range of the prize ball control CPU. .
 第1の電源監視回路の検出出力は賞球制御用CPUの入力ポートに入力され、
 前記賞球制御用CPUは、前記入力ポートを監視することによってRAMアクセス禁止状態の設定を実行する
 請求項1から請求項3のうちのいずれか1項に記載の遊技機。
The detection output of the first power supply monitoring circuit is input to the input port of the CPU for controlling the prize ball,
The gaming machine according to any one of claims 1 to 3, wherein the CPU for controlling the prize ball executes the setting of the RAM access prohibition state by monitoring the input port.
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005287772A (en) * 2004-03-31 2005-10-20 Okumura Yu-Ki Co Ltd Game machine
JP2007330350A (en) * 2006-06-12 2007-12-27 Taiyo Elec Co Ltd Pachinko game machine

Citations (26)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59166178A (en) * 1984-03-06 1984-09-19 株式会社ソフイア Pinball machine
JPS6058186A (en) * 1983-09-09 1985-04-04 オムロン株式会社 Power failure treating apparatus of game machine
JPS61259685A (en) * 1985-05-14 1986-11-17 株式会社ソフイア Pinball game machine
JPS6214878A (en) * 1985-07-13 1987-01-23 毒島 邦雄 Pinball game machine
JPH0228801A (en) * 1988-07-19 1990-01-30 Matsushita Electric Ind Co Ltd Control device for equipment
JPH02171935A (en) * 1988-12-26 1990-07-03 Fuji Electric Co Ltd Runaway preventing circuit for microprocessor
JPH03286790A (en) * 1990-04-03 1991-12-17 Sankyo Kk Pinball game machine
JPH0458975A (en) * 1990-06-28 1992-02-25 Sophia Co Ltd Card type pinball game machine
JPH0467733U (en) * 1990-10-18 1992-06-16
JPH04329988A (en) * 1991-04-30 1992-11-18 Sankyo Kk Game machine
JPH05237247A (en) * 1992-02-29 1993-09-17 Sankyo Kk Game machine
JPH05261055A (en) * 1992-03-18 1993-10-12 Hoshizaki Electric Co Ltd Controller for tableware washing machine
JPH0663230A (en) * 1992-08-12 1994-03-08 Sophia Co Ltd Game machine
JPH0671028A (en) * 1992-08-27 1994-03-15 Sophia Co Ltd Game machine
JPH0617458Y2 (en) * 1986-08-29 1994-05-11 ユニバーサル販売株式会社 Pachinko machine
JPH06233867A (en) * 1993-02-08 1994-08-23 Sophia Co Ltd Game machine
JPH06246047A (en) * 1993-02-26 1994-09-06 Sophia Co Ltd Game machine
JPH07265529A (en) * 1994-03-31 1995-10-17 Sankyo Kk Device for game
JPH08178391A (en) * 1994-12-28 1996-07-12 Matsushita Electric Ind Co Ltd Controller for air conditioning equipment
JPH09117560A (en) * 1995-10-26 1997-05-06 Sophia Co Ltd Island equipment device
JPH09266981A (en) * 1996-04-03 1997-10-14 Sankyo Kk Pachinko machine
JPH103331A (en) * 1997-02-19 1998-01-06 Sophia Co Ltd Game machine
JPH1071257A (en) * 1996-08-29 1998-03-17 Kyoraku Sangyo Kk Guard device for pachinko game machine
JP2000051500A (en) * 1999-08-31 2000-02-22 Takao:Kk Bouncing ball game machine
JP2000102664A (en) * 1999-11-02 2000-04-11 Takao:Kk Pachinko game machine
JP2000189636A (en) * 1998-12-28 2000-07-11 Samii Kk Pachinko game machine

Patent Citations (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6058186A (en) * 1983-09-09 1985-04-04 オムロン株式会社 Power failure treating apparatus of game machine
JPS59166178A (en) * 1984-03-06 1984-09-19 株式会社ソフイア Pinball machine
JPS61259685A (en) * 1985-05-14 1986-11-17 株式会社ソフイア Pinball game machine
JPS6214878A (en) * 1985-07-13 1987-01-23 毒島 邦雄 Pinball game machine
JPH0617458Y2 (en) * 1986-08-29 1994-05-11 ユニバーサル販売株式会社 Pachinko machine
JPH0228801A (en) * 1988-07-19 1990-01-30 Matsushita Electric Ind Co Ltd Control device for equipment
JPH02171935A (en) * 1988-12-26 1990-07-03 Fuji Electric Co Ltd Runaway preventing circuit for microprocessor
JPH03286790A (en) * 1990-04-03 1991-12-17 Sankyo Kk Pinball game machine
JPH0458975A (en) * 1990-06-28 1992-02-25 Sophia Co Ltd Card type pinball game machine
JPH0467733U (en) * 1990-10-18 1992-06-16
JPH04329988A (en) * 1991-04-30 1992-11-18 Sankyo Kk Game machine
JPH05237247A (en) * 1992-02-29 1993-09-17 Sankyo Kk Game machine
JPH05261055A (en) * 1992-03-18 1993-10-12 Hoshizaki Electric Co Ltd Controller for tableware washing machine
JPH0663230A (en) * 1992-08-12 1994-03-08 Sophia Co Ltd Game machine
JPH0671028A (en) * 1992-08-27 1994-03-15 Sophia Co Ltd Game machine
JPH06233867A (en) * 1993-02-08 1994-08-23 Sophia Co Ltd Game machine
JPH06246047A (en) * 1993-02-26 1994-09-06 Sophia Co Ltd Game machine
JPH07265529A (en) * 1994-03-31 1995-10-17 Sankyo Kk Device for game
JPH08178391A (en) * 1994-12-28 1996-07-12 Matsushita Electric Ind Co Ltd Controller for air conditioning equipment
JPH09117560A (en) * 1995-10-26 1997-05-06 Sophia Co Ltd Island equipment device
JPH09266981A (en) * 1996-04-03 1997-10-14 Sankyo Kk Pachinko machine
JPH1071257A (en) * 1996-08-29 1998-03-17 Kyoraku Sangyo Kk Guard device for pachinko game machine
JPH103331A (en) * 1997-02-19 1998-01-06 Sophia Co Ltd Game machine
JP2000189636A (en) * 1998-12-28 2000-07-11 Samii Kk Pachinko game machine
JP2000051500A (en) * 1999-08-31 2000-02-22 Takao:Kk Bouncing ball game machine
JP2000102664A (en) * 1999-11-02 2000-04-11 Takao:Kk Pachinko game machine
JP3354534B2 (en) * 1999-11-02 2002-12-09 株式会社高尾 Ball game machine

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005287772A (en) * 2004-03-31 2005-10-20 Okumura Yu-Ki Co Ltd Game machine
JP4529520B2 (en) * 2004-03-31 2010-08-25 奥村遊機株式会社 Game machine
JP2007330350A (en) * 2006-06-12 2007-12-27 Taiyo Elec Co Ltd Pachinko game machine
JP4710095B2 (en) * 2006-06-12 2011-06-29 タイヨーエレック株式会社 Bullet ball machine

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