DE102012111503B4 - Leistungshalbleiterbauelement und Verfahren zu dessen Herstellung - Google Patents
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Abstract
Verfahren zum Herstellen eines Leistungshalbleiterbauelements (100), wobei das Verfahren Folgendes umfasst: Vorbereiten eines Basissubstrats mit einer Oberfläche und einer gegenüberliegenden Oberfläche und ausgebildet aus einer Driftschicht (120) vom ersten Leitungstyp; Ausbilden einer Ätzmaske (10) auf einer Oberfläche des Basissubstrats, wobei die Ätzmaske (10) eine Mehrzahl offener Teile zum Ausbilden einer Mehrzahl von Gräben (130; 130a, 130b) aufweist; Ausbilden eines Primärgrabens (130a) entsprechend dem offenen Teil von einer Oberfläche des Basissubstrats in einer Dickenrichtung; Durchführen einer Ioneninjektion an dem Primärgraben (130a) und Thermodiffusion zum Ausdehnen einer Diffusionsschicht (140) vom ersten Leitungstyp in Richtung benachbarter Gräben (130) mit einer Konzentration höher als die der Driftschicht (120) vom ersten Leitungstyp; Ausbilden eines Sekundärgrabens (130b), der sich von einer unteren Oberfläche des Primärgrabens (130a) zu der Dickenrichtung erstreckt und durch die Diffusionsschicht (140) vom ersten Leitungstyp hindurchtritt; Entfernen der Ätzmaske (10) mit der Mehrzahl offener Teile zum Ausbilden der Gräben (130; 130a; 130b); Ausbilden eines ersten Isolierfilms (160) auf einer Oberfläche des Basissubstrats sowie einer Innenwand der Gräben (130); Ausbilden einer ersten Elektrode (165) in jedem der Gräben (130); und Ausbilden einer Muldenschicht (170) vom zweiten Leitungstyp auf der Diffusionsschicht (140) vom ersten Leitungstyp; wobei sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht (140) vom ersten Leitungstyp gemäß der Ioneninjektion zwischen der Muldenschicht (170) vom zweiten Leitungstyp und einer unteren Oberfläche der Gräben (130) befindet und wobei sich ein Spitzenpunkt der Muldenschicht (170) vom zweiten Leitungstyp an der einen Oberfläche des Basissubstrates befindet.
Description
- ALLGEMEINER STAND DER TECHNIK
- 1. Erfindungsgebiet
- Die vorliegende Erfindung betrifft ein Leistungshalbleiterbauelement und ein Verfahren zu dessen Herstellung.
- 2. Beschreibung des verwandten Stands der Technik
- Gemäß einer signifikanten Entwicklung von verschiedenen Formen von IGBT-Bauelementen (Insulated Gate Bipolar Transistor) einschließlich eines im Patentdokument 1 offenbarten IGBT wurden jüngst Anwendungen für eine große Kapazität von Industrie und ein Elektroauto sowie Haushaltsgeräte verwendet.
- Der größte Vorteil des IGBT-Bauelements besteht darin, dass das IGBT-Bauelement im Gegensatz zu einem Metalloxidhalbleiter-Feldeffekttransistor (MOS – Metal Oxide Semiconductor) eine bipolare Operation ausführt, wobei diese bipolare Operation ein Leitfähigkeitsmodulationsphänomen generiert, um den Reihenwiderstand in Abhängigkeit von einem Rohmaterial eines Wafers zum Zeitpunkt einer Einschaltoperation des IGBT-Bauelements zu reduzieren, so dass ein Leitungsverlust im Vergleich zu den MOSFET bezüglich Stehspannungs- und Hochstromprodukten signifikant reduziert wird, wodurch es ermöglicht wird, den Leistungsverlust zu reduzieren.
- Gemäß dem jüngsten Trend der IGBT-Technologie wurde deshalb eine Technologie entwickelt, die die Leitfähigkeitsmodulationsform maximieren kann. Dazu wird hauptsächlich eine Technologie des Akkumulierens von Lochträgern verwendet. Die Lochträger werden durch von einer P-Kollektorschicht injizierte Löcher generiert und nehmen zu einer Emitterschicht allmählich ab, so dass ein Verhältnis des Leitungsverlustes zu der Emitterschicht zunimmt.
- Aus der
US 2005/0029586 A1 DE 10 2007 043 341 A1 sind eine Halbleitervorrichtung und ein Verfahren zu deren Herstellung bekannt, bei denen unterschiedliche Störstellenkonzentrationen in grabenartigen Konfigurationen eingesetzt werden. Als weiterer Stand der Technik ist dieUS 2011/0 180 813 A1 - Die Erfindung strebt eine weitere Verbesserung der Technologie des Reduzierens einer Breite eines Graben-Graben-Gebiets (MESA) an, das ein finaler Bewegungsweg der Lochträger wird, um die Bewegung der Lochträger zu begrenzen.
- KURZE DARSTELLUNG DER ERFINDUNG
- Erfindungsgemäß wird die Aufgabe durch die Gegenstände der unabhängigen Ansprüche gelöst. Die vorliegende Erfindung erfolgte bei dem Bemühen, ein Leistungshalbleiterbauelement, das eine Leitfähigkeitsmodulationsform maximieren kann, und ein Verfahren zu dessen Herstellung bereitzustellen.
- Gemäß einer bevorzugten Ausführungsform der vorliegenden Erfindung wird ein Verfahren zum Herstellen eines Leistungshalbleiterbauelements bereitgestellt, wobei das Verfahren Folgendes umfasst: Vorbereiten eines Basissubstrats mit einer Oberfläche und der anderen Oberfläche und ausgebildet aus einer Driftschicht vom ersten Leitungstyp; Ausbilden eines Ätzresists auf einer Oberfläche des Basissubstrats, wobei der Ätzresist ein offenes Teil zum Ausbilden eines Grabens aufweist; Ausbilden eines Primärgrabens entsprechend dem offenen Teil von einer Oberfläche des Basissubstrats in einer Dickenrichtung; Durchführen einer Ioneninjektion und Thermodiffusion an dem Primärgraben zum Ausbilden einer Diffusionsschicht vom ersten Leitungstyp mit einer Konzentration höher als der der Driftschicht vom ersten Leitungstyp; und Ausbilden eines Sekundärgrabens, der sich von einer unteren Oberfläche des Primärgrabens zu der Dickenrichtung erstreckt und durch die Diffusionsschicht vom ersten Leitungstyp hindurchtritt; wobei sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht vom ersten Leitungstyp gemäß der Ioneninjektion zwischen einer Oberfläche des Basissubstrats und einer unteren Oberfläche des Sekundärgrabens befindet.
- Die Diffusionsschicht vom ersten Leitungstyp kann in einer halbkreisförmigen Form an jeder von beiden Seiten des Primär- und Sekundärgrabens auf der Basis des Primär- und Sekundärgrabens ausgebildet sein.
- Das Verfahren kann weiterhin nach dem Ausbilden des Sekundärgrabens das Entfernen des Ätzresists beinhalten.
- Das Verfahren kann weiterhin Folgendes beinhalten: nach dem Entfernen des Ätzresists 5, Ausbilden eines ersten Isolierfilms auf einer Oberfläche des Basissubstrats sowie einer Innenwand des Primär- und Sekundärgrabens; Ausbilden einer ersten Elektrode in dem Primär- und Sekundärgraben und Ausbilden einer Muldenschicht vom zweiten Leitungstyp auf der Diffusionsschicht vom ersten Leitungstyp.
- Der erste Leitungstyp kann ein N-Typ und der zweite Leitungstyp ein P-Typ sein.
- Das Verfahren kann weiterhin Folgendes beinhalten: nach dem Entfernen des Ätzresists und vor dem Ausbilden des ersten Isolierfilms,
Ausbilden eines zweiten Isolierfilms auf dem Basissubstrat sowie der Innenwand des Primär- und Sekundärgrabens und Entfernen des zweiten Isolierfilms. - Der erste Isolierfilm kann ein Gateoxidfilm und der zweite Isolierfilm ein Opferoxidfilm sein.
- Das Verfahren kann weiterhin Folgendes beinhalten: nach dem Ausbilden der Muldenschicht vom zweiten Leitungstyp, Ausbilden zweiter Elektrodengebiete auf der Muldenschicht vom zweiten Leitungstyp und auf jeder der äußeren Mulden von beiden Seiten von mehreren Primär- und Sekundärgräben; Ausbilden eines Körpergebiets vom zweiten Leitungstyp auf der Muldenschicht vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten, wobei das Körpergebiet vom zweiten Leitungstyp eine Konzentration höher als die der Muldenschicht vom zweiten Leitungstyp aufweist; Ausbilden eines dritten Isolierfilms auf dem Primärgraben in einer Oberfläche des Basissubstrats, um den ersten Isolierfilm und die erste Elektrode zu kontaktieren; und Ausbilden einer zweiten Elektrode auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm, wobei der Primär- und Sekundärgraben mehrere sind.
- Das Verfahren kann weiterhin Folgendes beinhalten: nach dem Ausbilden der zweiten Elektrode, Ausbilden eines Halbleitersubstrats vom zweiten Leitungstyp auf einer unteren Oberfläche der Driftschicht vom ersten Leitungstyp auf der Basis einer Dickenrichtung des Basissubstrats.
- Das zweite Elektrodengebiet kann ein Emittergebiet vom ersten Leitungstyp sein, und die zweite Elektrode kann eine Emitterelektrode sein.
- Der Spitzenpunkt des Verunreinigungsdotierprofils der Diffusionsschicht vom ersten Leitungstyp gemäß der Ioneninjektion kann zwischen einem Gebiet unter der Muldenschicht vom zweiten Leitungstyp und einer unteren Oberfläche des Sekundärgrabens auf der Basis einer Dickenrichtung des Leitungshalbleiterbauelements positioniert sein.
- Bei dem Ausbilden des Ätzresists kann der Ätzresist aus einem Oxidmaterial bestehen.
- Gemäß einer weiteren bevorzugten Ausführungsform der vorliegenden Erfindung wird ein Leistungshalbleiterbauelement bereitgestellt, das Folgendes enthält: ein Basissubstrat mit einer Oberfläche und der anderen Oberfläche und aus einer Driftschicht vom ersten Leitungstyp ausgebildet; ein Halbleitersubstrat, ausgebildet auf der anderen Oberfläche des Basissubstrats; eine Diffusionsschicht vom ersten Leitungstyp, ausgebildet auf einer Oberfläche des Basissubstrats und mit einer Konzentration höher als die der Driftschicht vom ersten Leitungstyp; eine Muldenschicht vom zweiten Leitungstyp, auf der Diffusionsschicht vom ersten Leitungstyp ausgebildet; einen Graben, der so ausgebildet ist, dass er durch die Muldenschicht vom zweiten Leitungstyp und die Diffusionsschicht vom ersten Leitungstyp von einer Oberfläche des Basissubstrats einschließlich der Muldenschicht vom zweiten Leitungstyp in einer Dickenrichtung hindurchgeht; einen ersten Isolierfilm, auf einer Oberfläche des Basissubstrats sowie einer Innenwand des Grabens ausgebildet; und eine in dem Graben ausgebildete erste Elektrode, wobei sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht vom ersten Leitungstyp zwischen einem Gebiet unter der Muldenschicht vom zweiten Leitungstyp und einer unteren Oberfläche des Grabens befindet.
- Der erste Leitungstyp kann ein N-Typ und der zweite Leitungstyp ein P-Typ sein.
- Die Diffusionsschicht vom ersten Leitungstyp kann in einer halbkreisförmigen Form an jeder von beiden Seiten des Grabens auf der Basis des Grabens ausgebildet sein.
- Der erste Isolierfilm kann ein Gateoxidfilm sein.
- Das Leistungshalbleiterbauelement kann weiterhin Folgendes enthalten: zweite Elektrodengebiete, auf der Muldenschicht vom zweiten Leitungstyp und jeder der äußeren Mulden von beiden Seiten der mehreren Gräben ausgebildet; ein Körpergebiet vom zweiten Leitungstyp, auf der Muldenschicht vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten ausgebildet und mit einer Konzentration höher als die der Muldenschicht vom zweiten Leitungstyp; einen dritten Isolierfilm, ausgebildet auf dem Graben einer Oberfläche des Basissubstrats, um den ersten Isolierfilm und die erste Elektrode zu kontaktieren; und eine zweite Elektrode, auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm ausgebildet, wobei die Graben mehrere sind.
- Das zweite Elektrodengebiet kann ein Emittergebiet vom ersten Leitungstyp und die zweite Elektrode eine Emitterelektrode sein.
- KURZE BESCHREIBUNG DER ZEICHNUNGEN
- Die obigen und weitere Aufgaben, Merkmale und Vorteile der vorliegenden Erfindung lassen sich anhand der folgenden ausführlichen Beschreibung in Verbindung mit den beiliegenden Zeichnungen klarer verstehen. Es zeigen:
-
1 bis6 Querschnittsansichten, die sequentiell Prozesse eines Verfahrens zum Herstellen eines Leistungshalbleiterbauelements gemäß einer bevorzugten Ausführungsform der vorliegenden Erfindung zeigen; und -
7 eine grafische Darstellung, die Dotierprofile jedes Gebiets auf der Basis der Linie A-A' des Halbleiterbauelements von6 zeigt. - BESCHREIBUNG DER BEVORZUGTEN AUSFÜHRUNGSFORMEN
- Die Aufgaben, Merkmale und Vorteile der vorliegenden Erfindung lassen sich anhand der folgenden detaillierten Beschreibung der bevorzugten Ausführungsformen in Verbindung mit den beiliegenden Zeichnungen klarer verstehen. In den beiliegenden Zeichnungen werden die gleichen Bezugszahlen verwenden, um die gleichen oder ähnliche Komponenten zu bezeichnen, und redundante Beschreibungen davon entfallen. Weiterhin werden in der folgenden Beschreibung die Ausdrücke „erster”, „zweiter”, „eine Seite”, „die andere Seite” und dergleichen verwendet, um eine gewisse Komponente von anderen Komponenten zu unterscheiden, doch sollte die Konfiguration solcher Komponenten nicht so ausgelegt sein, als wenn sie durch die Ausdrücke beschränkt wäre. Wenn weiterhin bei der Beschreibung der vorliegenden Erfindung bestimmt wird, dass die ausführliche Beschreibung des verwandten Stands der Technik den Kern der vorliegenden Erfindung verdunkeln würde, entfällt deren Beschreibung.
- Im Folgenden werden bevorzugte Ausführungsformen der vorliegenden Erfindung unter Bezugnahme auf die beigefügten Zeichnungen ausführlich beschrieben.
- Ein in der bevorzugten Ausführungsform der vorliegenden Erfindung offenbartes Leistungshalbleiterbauelement stellt einen IGBT (Insulated Gate Bipolar Transistor) dar. Die vorliegende Erfindung ist jedoch nicht darauf beschränkt.
- Verfahren zum Herstellen eines Leistungshalbleiterbauelements
- Die
1 bis6 sind Querschnittsansichten, die sequentiell Prozesse eines Verfahrens zum Herstellen eines Leistungshalbleiterbauelements gemäß einer bevorzugten Ausführungsform der vorliegenden Erfindung zeigen, und7 ist eine grafische Darstellung, die Dotierprofile jedes Gebiets auf der Basis einer Linie A-A' des Halbleiterbauelements von6 zeigt. - Zuerst kann unter Bezugnahme auf
1 ein Basissubstrat mit einer Oberfläche und der anderen Oberfläche und aus einer Driftschicht120 vom ersten Leitungstyp ausgebildet hergestellt werden. - In diesem Fall kann der erste Leitungstyp ein N-Typ und die Driftschicht
120 vom ersten Leitungstyp eine N-Driftschicht sein, doch ist die vorliegende Erfindung nicht darauf beschränkt. - Als Nächstes kann unter Bezugnahme auf
1 ein Ätzresist10 mit einem offenen Teil zum Ausbilden eines Grabens auf einer Oberfläche des Basissubstrats ausgebildet werden. - Der Ätzresist
10 kann aus einem Oxidmaterial bestehen. - Da der Ätzresist
10 aus dem Oxidmaterial besteht, ist es möglich, danach Ioneninjektions- und Thermodiffusionsprozesse durchzuführen. - Da der Ätzresist
10 aus dem Oxidmaterial besteht, können somit alle Primär- und Sekundärgräben130a und130b unter Verwendung eines einzelnen Ätzresists10 verarbeitet werden. - Als Nächstes kann unter Bezugnahme auf
1 der dem offenen Teil entsprechende Primärgraben130a von einer Oberfläche des Basissubstrats in einer Dickenrichtung ausgebildet werden. - Als Nächstes werden unter Bezugnahme auf
2 und3 die Ioneninjektions- und Thermodiffusionsprozesse an dem Primärgraben130 durchgeführt, wodurch ermöglicht wird, eine Diffusionsschicht140 vom ersten Leitungstyp mit einer Konzentration höher als die der Driftschicht120 vom ersten Leitungstyp auszubilden. - In diesem Fall kann die Diffusionsschicht
140 vom ersten Leitungstyp eine Diffusionsschicht vom NO-Typ mit der Konzentration sein, die höher als die des N-Typs der Driftschicht120 vom ersten Leitungstyp ist, doch ist die vorliegende Erfindung nicht darauf beschränkt. - Als Nächstes kann unter Bezugnahme auf
3 ein zweiter Graben130b ausgebildet werden, so dass er sich in einer Dickenrichtung von einer unteren Oberfläche des Primärgrabens130a erstreckt und durch die Diffusionsschicht140 vom ersten Leitungstyp hindurchgeht. - Das heißt, wie in
3 gezeigt, der Graben130 kann durch doppeltes Durchführen der Grabenverarbeitung ausgebildet werden. - Weiterhin kann sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht
140 vom ersten Leitungstyp gemäß der oben erwähnten Ioneninjektion in einem Gebiet zwischen einer Oberfläche des Basissubstrats und einer unteren Oberfläche des Sekundärgrabens130b befinden. - Insbesondere kann sich der Spitzenpunkt (ein Gebiet, in dem die Dotierkonzentration am tiefsten in einem Gebiet der Diffusionsschicht
140 vom ersten Leitungstyp von3 bis5 gezeigt ist und I (eine Konzentration der Spitzenakkumulation der vergrabenen Löcher (BHA)) in7 ) des Verunreinigungsdotierprofils der Diffusionsschicht140 vom ersten Leitungstyp gemäß der oben erwähnten Ioneninjektion zwischen einem Gebiet unter einer Muldenschicht170 vom zweiten Leitungstyp (siehe6 ) und der unteren Oberfläche des Sekundärgrabens130b auf der Basis der Dickenrichtung des Bauelements befinden. -
7 ist eine grafische Darstellung, die Profile von Verunreinigungsdotierkonzentrationen jedes Gebiets auf der Basis der Linie A-A' des Leistungshalbleiterbauelements von6 zeigt, zeigt eine Dotierkonzentration des N-Typs jedes Gebiets, eine Dotierkonzentration des P-Typs jedes Gebiets und eine Nettodotierung jedes Gebiets. - Da der Spitzenpunkt der Verunreinigungsdotierkonzentration der Diffusionsschicht
140 vom ersten Leitungstyp, der das I-Gebiet ist, an einem von der Muldenschicht170 vom zweiten Leitungstyp um einen vorbestimmten Abstand auf der Basis der Dicke des Leistungshalbleiterbauelements beabstandeten Punkt ausgebildet ist, kann das Leistungshalbleiterbauelement (insbesondere ein Insulated Gate Bipolar Transistor, IGBT) gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung in diesem Fall eine Variation bei einer Schwellwertspannung (Vth) trotz einer Abnahme bei Vce(sat) zum Zeitpunkt des Betreibens davon verringern. - Hierbei bedeutet die Abnahme bei Vce(sat) eine Zunahme bei einer Konzentration der Diffusionsschicht
140 vom ersten Leitungstyp. - Das heißt, bei dem Leistungshalbleiterbauelement
100 gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung werden im Vergleich zu dem Stand der Technik höher konzentrierte Verunreinigungen injiziert, um die Bewegung der Lochträger zu begrenzen, wodurch es ermöglicht wird, eine Schaltgeschwindigkeit des Leistungshalbleiterbauelements zu erhöhen und den ganzen Betrieb des Bauelements zu verbessern. - Diesbezüglich ist bei dem Prozess des Ausbildens der Diffusionsschicht
140 vom ersten Leitungstyp zu berücksichtigen, dass der Spitzenpunkt der Verunreinigungsdotierkonzentration zur Zeit des Injizierens der Ionen unter der Muldenschicht170 vom zweiten Leitungstyp (siehe6 ) ausgebildet ist und nicht von der unteren Oberfläche des Sekundärgrabens130b abweicht. - Wie in
3 gezeigt, kann die Diffusionsschicht140 vom ersten Leitungstyp in einer halbkreisförmigen Form an jedem von beiden Seiten der Primär- und Sekundärgräben130a und130b (im Folgenden als130 bezeichnet) auf der Basis der Primär- und Sekundärgräben130 ausgebildet werden. - Insbesondere kann die in einer Kreisform oder einer Ellipsenform (mit Ausnahme des Primärgrabengebiets) um die untere Oberfläche des Primärgrabens
130a herum ausgebildete Diffusionsschicht140 vom ersten Leitungstyp, wie in2 gezeigt, jeweils durch die Verarbeitung des Sekundärgrabens130b in der halbkreisförmigen Form ausgebildet werden. - Als Nächstes kann der Ätzresist
10 entfernt werden, wie in4 gezeigt. - Als Nächstes kann ein erster Isolierfilm
160 auf einer Oberfläche des Basissubstrats sowie Innenwänden des Primär- und Sekundärgrabens130a ausgebildet werden, wie in5 gezeigt. - Hier kann der erste Isolierfilm
160 ein Gateoxidfilm sein, ist aber nicht darauf beschränkt. - Als Nächstes kann eine erste Elektrode
165 in dem Primär- und Sekundärgraben130 ausgebildet werden und eine Muldenschicht170 vom zweiten Leitungstyp kann auf der Diffusionsschicht140 vom ersten Leitungstyp ausgebildet werden, wie in6 gezeigt. - Hierbei können der erste und zweite Leitungstyp ein N-Typ bzw. ein P-Typ sein, sind aber nicht darauf beschränkt.
- Unter Bezugnahme auf
6 kann die Muldenschicht170 vom zweiten Leitungstyp eine Muldenschicht vom P-Typ sein. - Außerdem kann die erste Elektrode
165 eine Gateelektrode sein, ist aber nicht darauf beschränkt. - Dabei kann, wie in
3 und4 gezeigt, nach dem Entfernen des Ätzresists10 und vor dem Ausbilden des ersten Isolierfilms160 ein zweiter Isolierfilm150 auf dem Basissubstrat sowie den Innenwänden des Primär- und Sekundärgrabens130 ausgebildet und dann entfernt werden. - Hier kann der zweite Isolierfilm
150 ein Opferoxidfilm sein. - Der Prozess des Ausbildens und Entfernens des Opferoxidfilms, der ein Prozess ist, der ein Gebiet der Primär- und Sekundärgräben
130 weich poliert, ist ein Prozess zum weichen Verarbeiten einer Beschädigung wie etwa eines Risses, der zum Zeitpunkt der Verarbeitung des Grabens auftreten kann, und Minimieren eines Defektes, der danach auftreten kann. - Wie in
6 gezeigt, können die Primär- und Sekundärgräben130 mehrere sein. - Unter Bezugnahme auf
6 kann das Verfahren zum Herstellen eines Leistungshalbleiterbauelements Folgendes beinhalten: nach dem Ausbilden der Muldenschicht170 vom zweiten Leitungstyp, Ausbilden zweiter Elektrodengebiete190 auf der Muldenschicht170 vom zweiten Leitungstyp und auf jeder der äußeren Mulden von beiden Seiten von mehreren Primär- und Sekundärgräben130 , Ausbilden eines Körpergebiets180 vom zweiten Leitungstyp auf der Muldenschicht170 vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten190 , wobei das Körpergebiet180 vom zweiten Leitungstyp eine Konzentration höher als die der Muldenschicht170 vom zweiten Leitungstyp aufweist, Ausbilden eines dritten Isolierfilms191 auf dem Primärgraben130a in einer Oberfläche des Basissubstrats, um den ersten Isolierfilm160 und eine erste Elektrode165 zu kontaktieren, und Ausbilden einer zweiten Elektrode193 auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm191 . - Das zweite Elektrodengebiet
190 und die zweite Elektrode193 , wie oben beschrieben, können ein Emittergebiet vom ersten Leitungstyp bzw. eine Emitterelektrode sein, sind aber nicht darauf beschränkt. - Weiterhin können das zweite Elektrodengebiet
190 und das Körpergebiet180 vom zweiten Leitungstyp ein N+-Typ mit der Konzentration höher als die des NO-Typs der Diffusionsschicht140 vom ersten Leitungstyp bzw. ein P+-Typ mit der Konzentration höher als die des P-Typs der Muldenschicht170 vom zweiten Leitungstyp sein, sind aber nicht darauf beschränkt. - Wie in
6 gezeigt, können die zweiten Elektrodengebiete190 mehrere sein und so ausgebildet sein, dass sie voneinander beabstandet sind. - Als Nächstes kann ein Halbleitersubstrat
110 vom zweiten Leitungstyp auf der unteren Oberfläche der Driftschicht120 vom ersten Leitungstyp auf der Basis der Dickenrichtung des Basissubstrats ausgebildet werden, wie in6 gezeigt. - Das Halbleitersubstrat
110 vom zweiten Leitungstyp kann aus einem Siliziumwafer ausgebildet werden, ist aber nicht darauf beschränkt. - Leistungshalbleiterbauelement
-
6 ist eine Ansicht, die eine Konfiguration eines Leistungshalbleiterbauelements gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung zeigt. - Hier wird das Leistungshalbleiterbauelement unter Bezugnahme auf die
1 bis5 beschrieben, die Querschnittsansichten sind, die Prozesse eines Verfahrens zum Herstellen eines Leistungshalbleiterbauelements gemäß einer bevorzugten Ausführungsform der vorliegenden Erfindung sequentiell zeigen, und7 , die eine grafische Darstellung ist, die Dotierprofile jedes Gebiets auf der Basis der Linie A-A' des Halbleiterbauelements von6 zeigt. - Wie in
6 gezeigt, kann das Halbleiterbauelement100 Folgendes enthalten: ein Basissubstrat mit einer Oberfläche und der anderen Oberfläche und aus einer Driftschicht120 vom ersten Leitungstyp ausgebildet; ein Halbleitersubstrat110 vom zweiten Leitungstyp, ausgebildet auf der anderen Oberfläche des Basissubstrats, eine Diffusionsschicht140 vom ersten Leitungstyp, ausgebildet auf einer Oberfläche des Basissubstrats und mit einer Konzentration höher als die der Driftschicht120 vom ersten Leitungstyp, eine Muldenschicht170 vom zweiten Leitungstyp, auf der Diffusionsschicht140 vom ersten Leitungstyp ausgebildet, einen Graben (130 in3 ), der so ausgebildet ist, dass er durch die Muldenschicht170 vom zweiten Leitungstyp und die Diffusionsschicht140 vom ersten Leitungstyp von einer Oberfläche des Basissubstrats einschließlich der Muldenschicht170 vom zweiten Leitungstyp in einer Dickenrichtung hindurchgeht; einen ersten Isolierfilm160 (siehe5 ), auf einer Oberfläche des Basissubstrats sowie einer Innenwand des Grabens130 ausgebildet, und eine in dem Graben130 ausgebildete erste Elektrode165 . - Hier kann sich der Spitzenpunkt (I in
7 ) des Verunreinigungsdotierprofils der Diffusionsschicht140 vom ersten Leitungstyp in einem Gebiet zwischen einem Gebiet unter der Muldenschicht170 vom zweiten Leitungstyp und der unteren Oberfläche des Grabens130 befinden. - Weiterhin können der erste und zweite Leitungstyp ein N-Typ und ein P-Typ sein, sind aber nicht darauf beschränkt.
- Weiterhin kann die Diffusionsschicht
140 vom ersten Leitungstyp in der halbkreisförmigen Form jeweils auf beiden Seiten des Grabens130 auf der Basis des Grabens130 ausgebildet werden, wie in3 bis6 gezeigt. - Weiterhin kann der erste Isolierfilm
160 ein Gateoxidfilm sein. - Dabei kann, wie in
6 gezeigt, der Graben (130 in3 ) mehrere sein. - Das Leistungshalbleiterbauelement
100 kann weiterhin Folgendes enthalten: zweite Elektrodengebiete190 , auf der Muldenschicht170 vom zweiten Leitungstyp und jeder der äußeren Mulden von beiden Seiten der mehreren Gräben130 ausgebildet, ein Körpergebiet180 vom zweiten Leitungstyp, auf der Muldenschicht170 vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten190 ausgebildet und mit einer Konzentration höher als die Muldenschicht170 vom zweiten Leitungstyp, einen dritten Isolierfilm191 , ausgebildet auf dem Graben130 einer Oberfläche des Basissubstrats, um den ersten Isolierfilm160 und die erste Elektrode165 zu kontaktieren, und eine zweite Elektrode193 , auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm191 ausgebildet. - Das zweite Elektrodengebiet
190 kann ein Emittergebiet vom ersten Leitungstyp und die zweite Elektrode193 eine Emitterelektrode sein. - Wenngleich nicht gezeigt, kann das Leistungshalbleiterbauelement
100 eine nichtgezeigte, auf einer unteren Oberfläche des Halbleitersubstrats110 vom zweiten Leitungstyp ausgebildete dritte Elektrode enthalten. Die dritte Elektrode kann eine Kollektorelektrode sein und das Halbleitersubstrat110 vom zweiten Leitungstyp kann als ein Kollektorgebiet betrieben werden. - Da bei dem Leistungshalbleiterbauelement
100 gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung die Diffusionsschicht140 vom ersten Leitungstyp mit der Konzentration höher als die des Driftgebiets120 vom ersten Leitungstyp ausgebildet ist und sich der Spitzenpunkt des Verunreinigungsdotiergebiets der Diffusionsschicht140 vom ersten Leitungstyp zwischen dem Gebiet unter der Muldenschicht170 vom zweiten Leitungstyp und der unteren Oberfläche des zweiten Grabens130 befindet, obwohl die gleiche Verunreinigungskonzentration vom ersten Leitungstyp auf das Leistungshalbleiterbauelement100 angewendet ist, kann das Leistungshalbleiterbauelement gemäß der vorliegenden Erfindung eine Spannung (Vce(sat)) unter der des Leistungshalbleiterbauelements gemäß dem Stand der Technik aufweisen. - Wegen der Struktur wie oben beschrieben, tritt in dem Leistungshalbleiterbauelement
100 gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung, da der Spitzenpunkt des Verunreinigungsdotierprofils der Diffusionsschicht140 vom ersten Leitungstyp so ausgebildet ist, dass er von der Muldenschicht170 vom zweiten Leitungstyp beabstandet ist, ein größeres Ausmaß an Lochakkumulation im Vergleich zum Stand der Technik auf, wodurch ermöglicht wird, ausgezeichnete Charakteristika zu implementieren. - Da weiterhin bei dem Leistungshalbleiterbauelement
100 gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung eine Variation bei der Schwellwertspannung gemäß der Zunahme bei der Verunreinigungsdotierkonzentration vom ersten Leitungstyp klein ist, wodurch ein Freiheitsgrad bei einem Design beim Auslegen des Leistungshalbleiterbauelements100 verbessert wird. - Mit dem Leistungshalbleiterbauelement und dem Verfahren zu dessen Herstellung gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung wird die Diffusionsschicht vom ersten Leitungstyp mit der Konzentration höher als die der Driftschicht vom ersten Leitungstyp zwischen der Driftschicht vom ersten Leitungstyp und der zweiten Muldenschicht ausgebildet, um die Bewegung des Lochträgers zu begrenzen, wodurch ermöglicht wird, den Leitungsverlust des Leistungshalbleiterbauelements zu reduzieren.
- Weiterhin wird gemäß der bevorzugten Ausführungsform der vorliegenden Erfindung die Sekundärgrabenverarbeitung angewendet, so dass der Spitzenpunkt der Verunreinigungsdotierkonzentration der Diffusionsschicht vom ersten Leitungstyp so ausgebildet wird, dass er von der Muldenschicht vom zweiten Leitungstyp beabstandet ist, wodurch ermöglicht wird, die Variation bei der Schwellwertspannung zum Zeitpunkt des Betreibens des Leistungshalbleiterbauelements, das das IGBT-Bauelement enthält, zu reduzieren.
Claims (16)
- Verfahren zum Herstellen eines Leistungshalbleiterbauelements (
100 ), wobei das Verfahren Folgendes umfasst: Vorbereiten eines Basissubstrats mit einer Oberfläche und einer gegenüberliegenden Oberfläche und ausgebildet aus einer Driftschicht (120 ) vom ersten Leitungstyp; Ausbilden einer Ätzmaske (10 ) auf einer Oberfläche des Basissubstrats, wobei die Ätzmaske (10 ) eine Mehrzahl offener Teile zum Ausbilden einer Mehrzahl von Gräben (130 ;130a ,130b ) aufweist; Ausbilden eines Primärgrabens (130a ) entsprechend dem offenen Teil von einer Oberfläche des Basissubstrats in einer Dickenrichtung; Durchführen einer Ioneninjektion an dem Primärgraben (130a ) und Thermodiffusion zum Ausdehnen einer Diffusionsschicht (140 ) vom ersten Leitungstyp in Richtung benachbarter Gräben (130 ) mit einer Konzentration höher als die der Driftschicht (120 ) vom ersten Leitungstyp; Ausbilden eines Sekundärgrabens (130b ), der sich von einer unteren Oberfläche des Primärgrabens (130a ) zu der Dickenrichtung erstreckt und durch die Diffusionsschicht (140 ) vom ersten Leitungstyp hindurchtritt; Entfernen der Ätzmaske (10 ) mit der Mehrzahl offener Teile zum Ausbilden der Gräben (130 ;130a ;130b ); Ausbilden eines ersten Isolierfilms (160 ) auf einer Oberfläche des Basissubstrats sowie einer Innenwand der Gräben (130 ); Ausbilden einer ersten Elektrode (165 ) in jedem der Gräben (130 ); und Ausbilden einer Muldenschicht (170 ) vom zweiten Leitungstyp auf der Diffusionsschicht (140 ) vom ersten Leitungstyp; wobei sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht (140 ) vom ersten Leitungstyp gemäß der Ioneninjektion zwischen der Muldenschicht (170 ) vom zweiten Leitungstyp und einer unteren Oberfläche der Gräben (130 ) befindet und wobei sich ein Spitzenpunkt der Muldenschicht (170 ) vom zweiten Leitungstyp an der einen Oberfläche des Basissubstrates befindet. - Verfahren nach Anspruch 1, wobei die Diffusionsschicht (
140 ) vom ersten Leitungstyp in einer halbkreisförmigen Form an den Seiten der Gräben (130 ) ausgebildet ist. - Verfahren nach Anspruch 1, wobei der erste Leitungstyp ein N-Typ und der zweite Leitungstyp ein P-Typ ist.
- Verfahren nach Anspruch 1, das weiterhin Folgendes umfasst: nach dem Entfernen der Ätzmaske (
10 ) und vor dem Ausbilden des ersten Isolierfilms (160 ), Ausbilden eines zweiten Isolierfilms auf dem Basissubstrat sowie der Innenwand der Gräben und Entfernen des zweiten Isolierfilms. - Verfahren nach Anspruch 4, wobei der erste Isolierfilm (
160 ) ein Gateoxidfilm und der zweite Isolierfilm ein Opferoxidfilm ist. - Verfahren nach Anspruch 1, das weiterhin Folgendes umfasst: nach dem Ausbilden der Muldenschicht (
170 ) vom zweiten Leitungstyp, Ausbilden zweiter Elektrodengebiete (190 ) auf der Muldenschicht (170 ) vom zweiten Leitungstyp und auf jeder der oberen äußeren Wände von den Seiten der Gräben (130 ); Ausbilden eines Körpergebiets (180 ) vom zweiten Leitungstyp auf der Muldenschicht (170 ) vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten (190 ), wobei das Körpergebiet (180 ) vom zweiten Leitungstyp eine Konzentration höher als die der Muldenschicht (170 ) vom zweiten Leitungstyp aufweist; Ausbilden eines dritten Isolierfilms (191 ) auf den Gräben (130 ) in einer Oberfläche des Basissubstrats, um den ersten Isolierfilm (160 ) und die erste Elektrode (165 ) zu kontaktieren; und Ausbilden einer zweiten Elektrode (190 ) auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm (191 ). - Verfahren nach Anspruch 6, weiterhin umfassend: nach dem Ausbilden der zweiten Elektrode (
190 ), Ausbilden eines Halbleitersubstrats (110 ) vom zweiten Leitungstyp auf einer unteren Oberfläche der Driftschicht (120 ) vom ersten Leitungstyp auf der Basis einer Dickenrichtung des Basissubstrats. - Verfahren nach Anspruch 6, wobei das zweite Elektrodengebiet (
190 ) ein Emittergebiet vom ersten Leitungstyp ist und die zweite Elektrode eine Emitterelektrode ist. - Verfahren nach Anspruch 1, wobei der Spitzenpunkt des Verunreinigungsdotierprofils der Diffusionsschicht (
140 ) vom ersten Leitungstyp gemäß der Ioneninjektion zwischen einem Gebiet unter der Muldenschicht (170 ) vom zweiten Leitungstyp und einer unteren Oberfläche des Sekundärgrabens (130b ) auf der Basis einer Dickenrichtung des Leistungshalbleiterbauelements (100 ) positioniert ist. - Verfahren nach Anspruch 1, wobei bei dem Ausbilden der Ätzmaske die Ätzmaske aus einem Oxidmaterial besteht.
- Leistungshalbleiterbauelement (
100 ), das Folgendes umfasst: ein Basissubstrat mit einer Oberfläche und einer gegenüberliegenden Oberfläche und aus einer Driftschicht (120 ) vom ersten Leitungstyp ausgebildet; ein Halbleitersubstrat vom zweiten Leitungstyp, ausgebildet auf der gegenüberliegenden Oberfläche des Basissubstrats; eine Diffusionsschicht (140 ) vom ersten Leitungstyp, gebildet von dem Basissubstrat und mit einer Konzentration höher als die der Driftschicht (120 ) vom ersten Leitungstyp, so dass sich ein Spitzenpunkt eines Verunreinigungsdotierprofils der Diffusionsschicht (140 ) vom ersten Leitungstyp zwischen einem Gebiet unter der Muldenschicht (170 ) vom zweiten Leitungstyp und einer unteren Oberfläche der Gräben (130 ) befindet; eine Muldenschicht (170 ) vom zweiten Leitungstyp mit einer höheren Konzentration als der der Diffusionsschicht (140 ) vom ersten Leitungstyp und auf der Diffusionsschicht (140 ) vom ersten Leitungstyp ausgebildet, so dass sich ein Spitzenpunkt der Muldenschicht (170 ) vom zweiten Leitungstyp an der einen Oberfläche des Basissubstrates befindet; eine Mehrzahl von Gräben (130 ), die so ausgebildet sind, dass sie durch die Muldenschicht (170 ) vom zweiten Leitungstyp und die Diffusionsschicht (140 ) vom ersten Leitungstyp von einer Oberfläche des Basissubstrats einschließlich der Muldenschicht (170 ) vom zweiten Leitungstyp in einer Dickenrichtung hindurchgehen; einen ersten Isolierfilm (160 ), auf einer Oberfläche des Basissubstrats sowie einer Innenwand der Gräben (130 ) ausgebildet; und eine in jedem der Gräben (130 ) ausgebildete erste Elektrode (165 ). - Leistungshalbleiterbauelement (
100 ) nach Anspruch 11, wobei der erste Leitungstyp ein N-Typ und der zweite Leitungstyp ein P-Typ ist. - Leistungshalbleiterbauelement (
100 ) nach Anspruch 11, wobei die Diffusionsschicht (140 ) vom ersten Leitungstyp in einer halbkreisförmigen Form an den Seiten der Gräben (130 ) ausgebildet ist. - Leistungshalbleiterbauelement (
100 ) nach Anspruch 11, wobei der erste Isolierfilm (160 ) ein Gateoxidfilm ist. - Leistungshalbleiterbauelement (
100 ) nach Anspruch 11, das weiterhin Folgendes umfasst: zweite Elektrodengebiete (190 ), auf der Muldenschicht (170 ) vom zweiten Leitungstyp und auf jeder der oberen äußeren Wände der Gräben (130 ) ausgebildet; ein Körpergebiet (180 ) vom zweiten Leitungstyp, auf der Muldenschicht (170 ) vom zweiten Leitungstyp und zwischen den zweiten Elektrodengebieten ausgebildet und mit einer Konzentration höher als die Muldenschicht (170 ) vom zweiten Leitungstyp; einen dritten Isolierfilm (191 ), ausgebildet auf den Gräben (130 ) einer Oberfläche des Basissubstrats, um den ersten Isolierfilm (160 ) und die erste Elektrode (165 ) zu kontaktieren; und eine zweite Elektrode (190 ), auf einer Oberfläche des Basissubstrats sowie dem dritten Isolierfilm (191 ) ausgebildet. - Leistungshalbleiterbauelement (
100 ) nach Anspruch 15, wobei das zweite Elektrodengebiet (190 ) ein Emittergebiet vom ersten Leitungstyp und die zweite Elektrode eine Emitterelektrode ist.
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Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20050029586A1 (en) * | 2003-08-05 | 2005-02-10 | Syotaro Ono | Semiconductor device having trench gate structure and manufacturing method thereof |
DE102007043341A1 (de) * | 2007-02-16 | 2008-08-28 | Mitsubishi Electric Corporation | Halbleitervorrichtung und Verfahren zu ihrer Herstellung |
Family Cites Families (17)
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---|---|---|---|---|
JP3170966B2 (ja) * | 1993-08-25 | 2001-05-28 | 富士電機株式会社 | 絶縁ゲート制御半導体装置とその製造方法 |
US5424231A (en) * | 1994-08-09 | 1995-06-13 | United Microelectronics Corp. | Method for manufacturing a VDMOS transistor |
JP3705919B2 (ja) * | 1998-03-05 | 2005-10-12 | 三菱電機株式会社 | 半導体装置及びその製造方法 |
US6552389B2 (en) * | 2000-12-14 | 2003-04-22 | Kabushiki Kaisha Toshiba | Offset-gate-type semiconductor device |
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US20050029586A1 (en) * | 2003-08-05 | 2005-02-10 | Syotaro Ono | Semiconductor device having trench gate structure and manufacturing method thereof |
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