CN112350888A - 启动状态检测***及其方法 - Google Patents
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Abstract
本发明提供一种启动状态检测***及其方法,启动状态检测***包括一设有一状态检测时间的第一逻辑处理模块、一储存模块与一第二逻辑处理模块。第一逻辑处理模块将一启动控制信号传送至第二逻辑处理模块,使其读取并执行储存模块所储存的一启动程序。第二逻辑处理模块在闲置状态下发送出一具有一第一电位的闲置信号,并在执行启动程序成功时发送出一具有一第二电位的执行成功信号。第一逻辑处理模块在状态检测时间内未接收到执行成功信号时,重新触发第二逻辑处理模块执行启动程序。
Description
技术领域
本发明涉及一种启动状态检测***及其方法,特别是涉及一种应用于通信装置的启动状态检测***及其方法。
背景技术
随着科技的进步,网卡已经成为现有连接网络设备不可或缺的通信装置,例如服务器主机、监控设备、不断电***(Uninterruptible Power Supply,USP)、网关(Gateway)等,用户可通过上述装置的独立网页接口进行管理,也为了适应使用者的需求,现今业内也在网卡上增加了许多功能,因而设计出了智能网卡,其中,增加了现场可程序化逻辑门阵列(Field Programmable Gate Array,FPGA,以下简称FPGA)功能的网卡(即FPGA增强型网卡)成为市场主流。
其中,FPGA增强型智能网卡可以提供向后兼容性,特别是对于超级管理程序的兼容性,也因为其与现有网络应用程序编程接口和接口协议兼容,因此可以使用现有的应用程序编程接口和驱动程序而不需再另行设计。
一般来说,FPGA增强型智能网卡在启动时,内部的FPGA需要加载外部储存模块所储存的大约1GigaByte(GB)大小的固件(Firmware)文档,而在读取执行固件文档的过程中,若失败的话,***会识别不出此张智能网卡而导致***出现问题,即使关闭***再重新启动也无法启动此张网卡,此时必须完全断电再重新启动才可顺利重新启动此张网卡,当用户在机房内大量遇到这些问题的话,会造成使用者非常大的不便利,因此目前现有技术仍具备改善的空间。
发明内容
有鉴于在现有技术中,如智能网卡的通信装置普遍存在需要断电才能成功重新启动而造成使用者不方便的问题。本发明的一个主要目的是提供一种启动状态检测***及其方法,通过两个逻辑处理模块之间的信号传输来解决现有技术中所述的问题。
为实现上述目的及其他相关目的,本发明的第一方面提供一种启动状态检测***,应用于一通信装置,所述启动状态检测***包括:一第一逻辑处理模块,包括:一启动控制单元,用以发送出一启动控制信号;以及一启动状态检测单元,电性连接于所述启动控制单元,并设有一状态检测时间;一储存模块,储存有一启动程序;以及一第二逻辑处理模块,通信连接于所述启动控制单元、所述启动状态检测单元与所述储存模块,用以在一闲置状态下发送出一具有一第一电位的闲置信号,并用以在接收到所述启动控制信号时,读取并执行所述启动程序,以在一执行成功状态时发送出一具有一第二电位的执行成功信号,其中,所述第二电位不同于所述第一电位;其中,所述启动状态检测单元在所述状态检测时间内接收到具有所述第二电位的所述执行成功信号时,判断所述第二逻辑处理模块成功执行所述启动程序,并判断出所述通信装置为一启动成功状态;所述启动状态检测单元在所述状态检测时间外仍接收到具有所述第一电位的所述闲置信号时,判断出所述第二逻辑处理模块为一启动失败状态,并将一具有一第三电位的重新启动信号发送至所述启动控制单元,以使所述启动控制单元重新发送出所述启动控制信号,据以使所述第二逻辑处理模块重新读取并执行所述启动程序。
于所述第一方面的一实施例中,所述通信装置为一网卡。
于所述第一方面的一实施例中,所述第一逻辑处理模块为一复杂可程序逻辑装置(Complex Programmable Logic Device,CPLD)或一***单芯片(System on a Chip,SOC),所述第二逻辑处理模块为一现场可程序化逻辑门阵列(Field Programmable Gate Array,FPGA)。
于所述第一方面的一实施例中,所述第二逻辑处理模块还包括:一处理单元,通信连接于所述启动控制单元、所述启动状态检测单元与所述储存模块,用以在一闲置状态下发送出所述闲置信号,并用以在接收到所述启动控制信号时,读取并执行所述启动程序,以在所述执行成功状态时发送出所述执行成功信号;以及一执行状态判断单元,电性连接于所述处理单元与所述启动状态检测单元,设有一包含有所述闲置状态与所述第一电位的对应关系以及包含有所述执行成功状态与所述第二电位的对应关系的状态判断表,用以在接收到所述执行成功信号时,依据所述状态判断表将具有所述第二电位的所述执行成功信号发送至所述启动状态检测单元,并用以在接收到所述闲置信号时,依据所述状态判断表将具有所述第一电位的所述闲置信号发送至所述启动状态检测单元。
于所述第一方面的一实施例中,所述第一电位与所述第三电位是标记为0的低电位,所述第二电位是标记为1的高电位。
于所述第一方面的一实施例中,所述状态检测时间为1200毫秒。
本发明的第二方面提供一种启动状态检测方法,利用本发明第一方面所述的启动状态检测***加以实施,所述启动状态检测方法包括以下步骤:(a)利用所述第一逻辑处理模块的所述启动控制单元发送出所述启动控制信号;(b)利用所述第二逻辑处理模块接收所述启动控制信号,以读取并执行所述启动程序;(c)利用所述启动状态检测单元判断是否在所述状态检测时间内接收到所述第二逻辑处理模块在所述执行成功状态时所发送出的具有所述第二电位的所述执行成功信号;(d)在步骤(c)的判断结果为是时,利用所述启动状态检测单元判断所述第二逻辑处理模块成功执行所述启动程序,并判断出所述通信装置为所述启动成功状态;以及(e)在步骤(c)的判断结果为否时,利用所述启动状态检测单元将具有所述第三电位的所述重新启动信号发送至所述启动控制单元,以使所述启动控制单元重新发送出所述启动控制信号,据以使所述第二逻辑处理模块重新读取并执行所述启动程序。
于所述第二方面的一实施例中,所述通信装置为一网卡,所述第一逻辑处理模块为一复杂可程序逻辑装置或一***单芯片,所述第二逻辑处理模块为一现场可程序化逻辑门阵列。
于所述第二方面的一实施例中,所述第一电位与所述第三电位为标记为0的低电位,所述第二电位为标记为1的高电位。
于所述第二方面的一实施例中,所述状态检测时间为1200毫秒。
如上所述,本发明所提供的启动状态检测***及其方法,由于是在状态检测时间内未接收到具有不同于第一电位的第二电位的执行成功信号,因而第一逻辑处理模块可直接触发第二逻辑处理模块再重新读取并执行启动程序,使得用户不需要再通过断电的手段才能使通信装置重新启动,因而可大幅提升使用者在使用上的便利性,并能提升通信装置的工作稳定度。
附图说明
图1显示为本发明较佳实施例所提供的启动状态检测***的方块图。
图2显示为本发明较佳实施例所提供的启动状态检测方法的流程图。
元件标号说明
1 启动状态检测***
11 第一逻辑处理模块
111 启动控制单元
112 启动状态检测单元
12 储存模块
121 启动程序
13 第二逻辑处理模块
131 处理单元
132 执行状态判断单元
1321 状态判断表
2 通信装置
S1 启动控制信号
S2 执行成功信号
S3 闲置信号
S4 重新启动信号
S101~S105 步骤
具体实施方式
下面将结合示意图对本发明的具体实施方式进行更详细的描述。根据下列描述和申请专利范围,本发明的优点和特征将更清楚。需说明的是,图式均采用非常简化的形式且均使用非精准的比例,仅用以方便、明晰地辅助说明本发明实施例的目的。
请参阅图1,图1显示为本发明较佳实施例所提供的启动状态检测***的方块图。如图所示,本发明所提供的启动状态检测***1应用于一通信装置2,通信装置2例如是一网卡,但不限于此,前述的网卡例如是现有的智能网卡。另外,本发明较佳实施例中所述的通信连接是指有线通信连接,但在其他实施例中也可为无线通信连接,视实务上的设计而定。
启动状态检测***1包含一第一逻辑处理模块11、一储存模块12以及一第二逻辑处理模块13,第一逻辑处理模块11例如可为一复杂可程序逻辑装置(ComplexProgrammable Logic Device,CPLD,以下简称CPLD)与一***单芯片(System on a Chip,SOC)之一,本发明较佳实施例中为CPLD,但其他实施利中不限于此。第一逻辑处理模块11包含一启动控制单元111以及一启动状态检测单元112,其中,启动控制单元111以及启动状态检测单元112可为现有的处理器,启动状态检测单元112电性连接于启动控制单元111,并且设有一状态检测时间,此状态检测时间例如为1200毫秒,但其他实施例中不限于此。
储存模块12储存有一启动程序121,储存模块12例如是一只读型内存,前述只读型内存例如可为一闪存(Flash Read-Only Memory,Flash ROM),而启动程序121例如是固件,但其他实施例中不限于此。
第二逻辑处理模块13通信连接于启动控制单元111、启动状态检测单元112与储存模块12,并且例如可为一现场可程序化逻辑门阵列(Field Programmable Gate Array,FPGA,以下简称为FPGA),但其他实施例中不限于此。
具体来说,本发明较佳实施例的第二逻辑处理模块13还包含一处理单元131以及一执行状态判断单元132,处理单元131通信连接于启动控制单元111、启动状态检测单元112与储存模块12。执行状态判断单元132电性连接于处理单元131与启动状态检测单元112,并设有一包含有一闲置(Idle)状态与一第一电位的对应关系以及包含有一执行成功状态与一第二电位的对应关系的状态判断表1321。另外,处理单元131以及执行状态判断单元132例如可为现有的处理器。
其中,需要一提的是,本发明所述的闲置状态也可为待机状态,而执行成功状态将在后面进行详细描述,上述第一电位为标记为0的低电位,上述第二电位为标记为1的高电位,因此,状态判断表1321例如可为下表:
状态判断表
状态 | 电位 |
闲置状态 | 0 |
执行成功状态 | 1 |
第一逻辑处理模块11的启动控制单元111用以发送出一启动控制信号S1,第二逻辑处理模块13用以在闲置状态下发送出为第一电位的闲置信号S3,举例来说,第二逻辑处理模块13由于是FPGA,实际应用中FPGA设有一设定脚位(例如是CONFIG_DONE),在闲置状态下此设定脚位所发送出的信号皆为标记为0的低电位信号。
第二逻辑处理模块13在接收到启动控制信号S1时,读取并执行启动程序121,以在一执行成功状态时发送出一为不同于第一电位的第二电位的执行成功信号S2。其中,需要一提的是,本案所定义的执行成功状态是指FPGA成功加载启动程序121并完成执行而使得通信装置2成功启动,且执行成功信号S2也是通过上述的设定脚位发送,但其他实施例中不限于此。
启动状态检测单元112在状态检测时间内接收到具有第二电位的执行成功信号S2时,判断第二逻辑处理模块13成功执行启动程序121,并判断出通信装置2为一启动成功状态。其中启动成功状态是指上述通信装置2成功启动并运作的状态。
启动状态检测单元112在状态检测时间外仍接收到具有第一电位的闲置信号S3时,判断第二逻辑处理模块13为一启动失败状态,并将一具有一第三电位的重新启动信号S4发送至启动控制单元111,以使启动控制单元111重新发送出启动控制信号S1,据以使第二逻辑处理模块13重新读取并执行启动程序121。
其中,需要一提的是,上述第三电位为标记为0的低电位,且一般来说,启动状态检测单元112若是在状态检测时间内还没接收到执行成功信号S2时,即:在状态检测时间内未检测到上述的设定接脚从低电位转换为高电位(标记由0转换为1),在此状况中即判定第二逻辑处理模块13在执行启动程序121时遭遇错误而为启动失败状态。
在其他实施例中,第二逻辑处理模块13也可设定为在执行启动程序121发生错误时,主动将具有低电位的反馈信号发送至启动状态检测单元112,使得启动状态检测单元112将重新启动信号S4传送至启动控制单元111而触发第二逻辑处理模块13重载启动程序121。
此外,本发明较佳实施例中,第二逻辑处理模块13进一步通过处理单元131与执行状态判断单元132进行处理,以具体确认送出何种电位的信号。举例来说,处理单元131在闲置状态下发送出闲置信号S3,并在接收到启动控制信号S1时,读取并执行启动程序121,以在执行成功状态时发送出执行成功信号S2。
执行状态判断单元132在接收到执行成功信号S2时,依据状态判断表1321比对出执行成功信号S2具有第二电位(即为标记为1的高电位),并将具有第二电位的执行成功信号S2发送至启动状态检测单元112,其余运作皆相同,不再赘述。
执行状态判断单元132并在接收到闲置信号S3时,依据状态判断表1321比对出闲置信号S3具有第一电位(即为0的低电位),并将具有第一电位的闲置信号S3发送至启动状态检测单元112,使得启动状态检测单元112将重新启动信号S4传送至启动控制单元111而触发第二逻辑处理模块13重载启动程序121。
请参阅图2,图2显示为本发明较佳实施例所提供的启动状态检测方法的流程图。本发明较佳实施例还提供一种启动状态检测方法,并且是利用图1所示的启动状态检测***加以实施,并包含以下步骤S101至步骤S105。
步骤S101:利用第一逻辑处理模块11的启动控制单元111发送出启动控制信号S1。
步骤S102:利用第二逻辑处理模块13接收启动控制信号S1,以读取并执行启动程序121。
步骤S103:利用启动状态检测单元112判断是否在状态检测时间内接收到第二逻辑处理模块13在执行成功状态时所发送出的具有第二电位的执行成功信号S2。
步骤S104:利用启动状态检测单元112判断第二逻辑处理模块13成功执行启动程序121,并判断出通信装置2为启动成功状态。
步骤S105:利用启动状态检测单元112将具有第三电位的重新启动信号S4发送至启动控制单元111,以使启动控制单元111重新发送出启动控制信号S1,据以使第二逻辑处理模块13重新读取并执行启动程序121。
其中,上述步骤S102至S105是关于第二逻辑处理模块13的运作,还可进一步由处理单元131与执行状态判断单元132分别进行运作,而各步骤的详细说明皆已在上述数个段落中提及,故不多加赘述。
综上所述,在采用本发明所提供的启动状态检测***及其方法后,第一逻辑处理模块在状态检测时间内未接收到具有不同于第一电位的第二电位的执行成功信号时,可直接触发第二逻辑处理模块再重新读取并执行启动程序,使得用户不需要再通过断电的手段即可使通信装置重新启动,因而可大幅提升使用者在使用上的便利性,并能提升通信装置的工作稳定度。
以上较佳具体实施例的详细描述是希望能更加清楚地描述本发明的特征与精神,而并非以上述所揭露的较佳具体实施例来对本发明的范畴加以限制。相反地,其目的是希望能涵盖各种改变及具相等性的安排于本发明所欲申请的专利范围的范畴内。
Claims (10)
1.一种启动状态检测***,其特征在于,应用于一通信装置,所述启动状态检测***包括:
一第一逻辑处理模块,包括:
一启动控制单元,用以发送出一启动控制信号;以及
一启动状态检测单元,电性连接于所述启动控制单元,并设有一状态检测时间;
一储存模块,储存有一启动程序;以及
一第二逻辑处理模块,通信连接于所述启动控制单元、所述启动状态检测单元与所述储存模块,用以在一闲置状态下发送出一具有一第一电位的闲置信号,并用以在接收到所述启动控制信号时,读取并执行所述启动程序,以在一执行成功状态时发送出一具有一第二电位的执行成功信号,其中,所述第二电位不同于所述第一电位;
其中,所述启动状态检测单元在所述状态检测时间内接收到具有所述第二电位的所述执行成功信号时,判断所述第二逻辑处理模块成功执行所述启动程序,并判断出所述通信装置为一启动成功状态;所述启动状态检测单元在所述状态检测时间外仍接收到具有所述第一电位的所述闲置信号时,判断出所述第二逻辑处理模块为一启动失败状态,并将一具有一第三电位的重新启动信号发送至所述启动控制单元,以使所述启动控制单元重新发送出所述启动控制信号,据以使所述第二逻辑处理模块重新读取并执行所述启动程序。
2.根据权利要求1所述的启动状态检测***,其特征在于:所述通信装置为一网卡。
3.根据权利要求1所述的启动状态检测***,其特征在于:所述第一逻辑处理模块为一复杂可程序逻辑装置或一***单芯片,所述第二逻辑处理模块为一现场可程序化逻辑门阵列。
4.根据权利要求1所述的启动状态检测***,其特征在于,所述第二逻辑处理模块还包括:
一处理单元,通信连接于所述启动控制单元、所述启动状态检测单元与所述储存模块,用以在一闲置状态下发送出所述闲置信号,并用以在接收到所述启动控制信号时,读取并执行所述启动程序,以在所述执行成功状态时发送出所述执行成功信号;以及
一执行状态判断单元,电性连接于所述处理单元与所述启动状态检测单元,设有一包含有所述闲置状态与所述第一电位的对应关系以及包含有所述执行成功状态与所述第二电位的对应关系的状态判断表,用以在接收到所述执行成功信号时,依据所述状态判断表将具有所述第二电位的所述执行成功信号发送至所述启动状态检测单元,并用以在接收到所述闲置信号时,依据所述状态判断表将具有所述第一电位的所述闲置信号发送至所述启动状态检测单元。
5.根据权利要求4所述的启动状态检测***,其特征在于:所述第一电位与所述第三电位是标记为0的低电位,所述第二电位是标记为1的高电位。
6.根据权利要求1所述的启动状态检测***,其特征在于:所述状态检测时间为1200毫秒。
7.一种启动状态检测方法,其特征在于,利用权利要求1所述的启动状态检测***加以实施,所述启动状态检测方法包括以下步骤:
(a)利用所述第一逻辑处理模块的所述启动控制单元发送出所述启动控制信号;
(b)利用所述第二逻辑处理模块接收所述启动控制信号,以读取并执行所述启动程序;
(c)利用所述启动状态检测单元判断是否在所述状态检测时间内接收到所述第二逻辑处理模块在所述执行成功状态时所发送出的具有所述第二电位的所述执行成功信号;
(d)在步骤(c)的判断结果为是时,利用所述启动状态检测单元判断所述第二逻辑处理模块成功执行所述启动程序,并判断出所述通信装置为所述启动成功状态;以及
(e)在步骤(c)的判断结果为否时,利用所述启动状态检测单元将具有所述第三电位的所述重新启动信号发送至所述启动控制单元,以使所述启动控制单元重新发送出所述启动控制信号,据以使所述第二逻辑处理模块重新读取并执行所述启动程序。
8.根据权利要求7所述的启动状态检测方法,其特征在于:所述通信装置为一网卡,所述第一逻辑处理模块为一复杂可程序逻辑装置或一***单芯片,所述第二逻辑处理模块为一现场可程序化逻辑门阵列。
9.根据权利要求7所述的启动状态检测方法,其特征在于:所述第一电位与所述第三电位为标记为0的低电位,所述第二电位为标记为1的高电位。
10.根据权利要求7所述的启动状态检测方法,其特征在于:所述状态检测时间为1200毫秒。
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PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
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GR01 | Patent grant | ||
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