CN107395539A - 一种适用于jesd204b协议中的8b10b编码器设计方法 - Google Patents
一种适用于jesd204b协议中的8b10b编码器设计方法 Download PDFInfo
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Abstract
本发明提出了一种适用于JESD204B协议中的8B10B编码器设计方法,该方法采用查表法与组合逻辑法相结合的方式,将K字节和D字节分开编码,简化了编码表,减少了逻辑处理的层数,同时,由于编码错误只可能是无效K码的输入,因此,编码的错误检测位于K字节编码模块中,进一步减少了D字节编码模块逻辑处理的层数。本发明提供的适用于JESD204B协议中位于***数据链路层的8B10B编码器设计方法,相较于传统方法具有一定的改进性且完全符合JESD204B协议规范,可应用于基于JESD204B协议的高速串行接口的设计中。
Description
技术领域
本发明涉及一种8B10B编码器,具体涉及一种适用于JESD204B协议中的8B10B编码器设计方法。
背景技术
JESD204B协议采用了主流的Serdes接口技术,并规定Serdes接口采用8B10B的编解码方法来满足高速传输的要求。8B10B编码方案主要功能是将8bit数据编码成10bit数据,在发送数据时可以从1024个10B码组中挑选出0、1分布尽量平衡的码组来发送,以维持链路的直流平衡,避免了零点漂移;同时,保持发送序列中0和1的最大连续长度不超过5,有利于时钟的恢复。
与传统的8B10B编码不同,JESD204B接口协议中的8B10B编码具有以下特点:1、数据字符编码中包括D11.7,D13.7,D14.7,D17.7,D18.7,D20.76个特殊字节。2、8B10B编码只用了5种控制字符,分别为K28.0、K28.3、K28.4、K28.5、K28.7。
传统的8B10B编码实现方法包括直接查表法和纯逻辑实现法。直接查表法虽然实现方便,但资源消耗大,编解码电路的工作速度受到FPGA内部存储器读取时间的限制,同时增加了芯片的面积和功耗。纯逻辑实现法电路复杂,难度大,同时由于冒险、竞争和延时的存在,使输出数据抖动严重,限制了芯片的最高工作速度。
发明内容
为了解决上述问题,本发明提出了一种适用于JESD204B协议中位于***数据链路层的8B10B编码器的设计方法。
为实现上述目的,本发明采用如下技术方案之一实现。
一种适用于JESD204B协议中的8B10B编码器设计方法,其采用查表法与组合逻辑法相结合的方式来实现8B10B编码器;8B10B编码器包括K字节编码和D字节编码;将K字节编码和D字节编码分开,简化了编码表,减少了逻辑处理的层数。其中,K字节编码采用直接查表法实现;采用加入均衡信息来简化K字节编码表,并利用均衡信息和极性信息共同决定K字节编码结果是否需要翻转,同时确定K字节编码输出极性;编码错误只可能是由于无效K码的输入,因此编码的错误检测位于K字节编码模块中,进一步减少了D字节编码模块逻辑处理的层数。K字节编码表及其编码原理如表1、表2所示。
进一步地,D字节编码分为3B4B编码模块、5B6B编码模块和极性计算模块,采用串行结构,即先进行5B6B编码,再使用5B6B编码后的极性进行3B4B编码;其中,5B6B编码模块先在输入5个字符ABCDE后加I(I=0)得到ABCDEI6位字符,然后再对这6位字符中的特定位根据设定的编码表所示规律进行必要的翻转,得到正确的编码结果。
进一步地,3B4B编码模块先在输入3个字符FGH后加J(J=0)得到FGHJ4位字符,然后再对这4位字符中的特定位根据设定的编码表所示规律进行必要的翻转,得到正确的编码结果。
进一步地,极性计算模块包括5B6B编码过程中的极性计算和3B4B编码过程中的极性计算;其中,5B6B编码过程中的极性计算根据编码表3中编码的极性入口信息规律,再据编码结果是平衡码还是非平衡码来决定是否需要翻转极性;3B4B编码过程中的极性计算与5B6B编码过程中的类似;最后根据5B6B编码的极性结果和3B4B编码的极性结果共同决定最终的编码输出极性。
更进一步,K字节编码采用直接查表的方法实现。JESD204B协议只用到5个K码,分别为K28.0、K28.3、K28.4、K28.5、K28.7,且根据极性信息,其编码结果是按位取反的。本设计采用加入均衡信息来简化K字节编码表,并利用均衡信息和极性信息共同决定K字节编码结果是否需要翻转。编码错误只可能是由于无效K码的输入,因此编码的错误检测位于K字节编码模块中。
更进一步,5B6B编码模块先在ABCDE后加I(I=0)得到ABCDEI6位字符,然后通过从高位到低位的顺序,根据编码表3所示规律,先强制其为1,再强制其为0,最后根据极性信息和输入5B字符,决定编码结果是否需要翻转。
更进一步,3B4B编码模块先在FGH后加J(J=0)得到FGHJ4位字符,然后通过从高位到低位的顺序,根据编码表4所示规律,只需要强制其为1,最后根据5B6B输出极性和输入3B字符,决定编码结果是否需要翻转。这里需要注意Dx.P7与Dx.A7之间的替换,替换规律为:当5B6B输出极性为为正且编码后的e=i=0,或者当5B6B输出极性为为负且编码后的e=i=1。
与现有技术相比,本发明所达到的有益效果:本发明采用将K字节和D字节分开编码的方式,简化了编码表,减少了逻辑处理的层数,同时由于编码错误只可能是无效K码的输入,因此编码的错误检测位于K字节编码模块中,D字节编码模块只需进行编码而不用进行错误检测,进一步减少了D字节编码模块逻辑处理的层数。
附图说明
图1为8B10B编码器结构示意图。
图2为实例中8B与10B编码对应关系图。
具体实施方式
下面结合实施例及附图,对本发明的实施作进一步说明,但本发明的实施和保护不限于此,需指出的是,以下若有未特别详细说明之处如编码表中的符号等,均是本领域技术人员可参照现有技术实现和理解的。
本实例的适用于JESD204B协议中的8B10B编码器设计,本发明采用查表法与组合逻辑法相结合的方式来实现8B10B编码器,其中,将K字节和D字节分开编码,简化了码表,减少了逻辑处理的层数。编码器结构如图1所示。8B10B编码对应关系如图2所示。
如图1所示,为8B10B编码器结构,图中各符号可参照现有技术理解,8B10B编码器可分为K字节编码模块和D字节编码模块,其中D字节编码模块分为3B4B编码模块、5B6B编码模块和极性计算模块。
K字节编码采用直接查表法实现。采用加入均衡信息来简化K字节编码表,并利用均衡信息和极性信息共同决定K字节编码结果是否需要翻转,同时确定K字节编码输出极性。编码错误只可能是由于无效K码的输入,因此编码的错误检测位于K字节编码模块中,进一步减少了D字节编码模块逻辑处理的层数。K字节编码表及其编码原理如表1、表2所示。
表1K字节编码表
HGF EDCBA | K_bal abcdei fghj(RD+) | |
K28.0 | 000 11100 | 1 110000 1011 |
K28.3 | 011 11100 | 0 110000 1100 |
K28.4 | 100 11100 | 1 110000 1101 |
K28.5 | 101 11100 | 0 110000 0101 |
K28.7 | 111 11100 | 1 110000 0111 |
表2K字节编码原理表
本发明的D字节编码模块分为3B4B编码模块、5B6B编码模块和极性计算模块,采用串行编码结构。其中,5B6B编码模块先在输入5个字符ABCDE后加I(I=0)得到ABCDEI6位字符,然后通过从高位到低位的顺序,根据编码表3所示规律,先强制其为1,再强制其为0,最后根据极性信息和输入5B字符,决定编码结果是否需要翻转。强制为1的规律是:A-a:保持不变;B-b:符合L04类型的字符;C-c:符合L04类型的字符,或者符合L13类型且D=E=1的字符;D-d:保持不变;E-e:符合L13类型且E=0的字符;I-i:符合L22类型且E=0的字符,或者符合L04类型且E=1的字符,或者符合L13类型且D=0、E=1的字符。强制为0的规律是:A-a:保持不变;B-b:符合L40类型的字符;C-c:保持不变;D-d:符合L40类型的字符;E-e:符合L13类型且D=E=1的字符;I-i:保持不变。其中,L04、L13、L22、L31、L40表示ABCD中1和0的个数,例如,L13表示ABCD中有1个1、3个0。
表3 5B6B编码表
表4 3B4B编码表
所述3B4B编码模块先在输入3个字符FGH后加J(J=0)得到FGHJ4位字符,然后通过从高位到低位的顺序,根据编码表4所示规律,只需要强制其为1,最后根据5B6B编码输出极性和输入3B字符,决定编码结果是否需要翻转。强制为1的规律是:F-f:保持不变;G-g:F=G=H=0;H-h:保持不变;J-j:F与J不同且H=0。这里需要注意Dx.P7与Dx.A7之间的替换,替换规律为:当5B6B输出极性为正且编码后的e=i=0,或者当5B6B输出极性为负且编码后的e=i=1。
所述极性计算模块包括5B6B编码过程中的极性计算和3B4B编码过程中的极性计算。其中,5B6B编码过程中的极性计算根据编码表3中编码的极性入口信息规律,再据编码结果是平衡码还是非平衡码来决定是否需要翻转极性。极性入口为正的规律是:1、既不符合L22类型,也不符合L31类型,且E=0的字符。2、符合L13类型且D=E=0的字符。极性入口为负的规律是:既不符合L22类型,也不符合L13类型,且E=1的字符。
所述3B4B编码过程中的极性计算参照5B6B编码过程,极性入口为正的规律是:F=G=0,极性入口为负的规律是:F=G=H=1。最后根据5B6B编码的极性结果和3B4B编码的极性结果共同决定最终的编码输出极性。
以上所述仅是本发明的优选实施方式,应当指出,对于本技术领域的普通技术人员来说,在不脱离本发明技术原理的前提下,还可以做出若干改进和变形,这些改进和变形也应视为本发明的保护范围。
Claims (4)
1.一种适用于JESD204B协议中的8B10B编码器设计方法,其特征在于:采用查表法与组合逻辑法相结合的方式来实现8B10B编码器;8B10B编码器包括K字节编码和D字节编码;将K字节编码和D字节编码分开,其中,K字节编码采用直接查表法实现;采用加入均衡信息来简化K字节编码表,并利用均衡信息和极性信息共同决定K字节编码结果是否需要翻转,同时确定K字节编码输出极性;编码的错误检测位于K字节编码模块中。
2.根据权利要求1所述的一种适用于JESD204B协议中的8B10B编码器设计方法,其特征在于:D字节编码分为3B4B编码模块、5B6B编码模块和极性计算模块,采用串行结构,即先进行5B6B编码,再使用5B6B编码后的极性进行3B4B编码;其中,5B6B编码模块先在输入5个字符ABCDE后加I得到ABCDEI6位字符,然后再对这6位字符中的特定位根据设定的编码表所示规律进行必要的翻转,得到正确的编码结果。
3.根据权利要求2所述的一种适用于JESD204B协议中的8B10B编码器设计方法,其特征在于:3B4B编码模块先在输入3个字符FGH后加J得到FGHJ4位字符,然后再对这4位字符中的特定位根据设定的编码表所示规律进行必要的翻转,得到正确的编码结果。
4.根据权利要求2所述的一种适用于JESD204B协议中的8B10B编码器设计方法,其特征在于:极性计算模块包括5B6B编码过程中的极性计算和3B4B编码过程中的极性计算;其中,5B6B编码过程中的极性计算根据编码表中编码的极性入口信息规律,再据编码结果是平衡码还是非平衡码来决定是否需要翻转极性;3B4B编码过程中的极性计算参照与5B6B编码过程,最后根据5B6B编码的极性结果和3B4B编码的极性结果共同决定最终的编码输出极性。
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