CN105611113A - 一种基于fpga的数字视频信号同步头极性自适应方法 - Google Patents

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Abstract

本发明揭示了一种基于FPGA的数字视频信号同步头极性自适应方法，涉及数字视频信号解码电路和同步头极性自适应功能模块，将输入的DVI标准视频信号解码成RGB信号以及符合VESA时序标准的使能信号（DE）、行同步（Hsync）和场同步（Vsync）信号；而后通过同步头极性自适应功能模块将任意极性（正极性或负极性）的同步头信号的极性转化成确定的极性，并对符合VESA时序标准的任意分辨率视频信号同步头信号自适应。本发明自适应方法，确保无论输入视频信号同步头极性是高电平还是低电平，都可以满足后续功能模块的正常工作，具有通用性。

Description

一种基于FPGA的数字视频信号同步头极性自适应方法
技术领域
本发明涉及一种数字视频信号同步头极性自适应方法。尤其是适用于机载智能显示器中实现数字视频信号同步头极性自适应的方法。
背景技术
DVI即数字视频接口，是一种高速传输数字信号的技术。DVI视频传输避免了模拟视频信号传输过程中发送端的数模转换和接收端的模数转换过程，同时也避免了模拟信号传输过程中的噪声干扰问题，因此图像损失小。
现有的机载大屏幕多功能显示器绝大多数都采用DVI作为显示器视频信号的输入格式。输入的DVI串行数字视频信号通过解码芯片解码处理，FPGA将解码后的并行的RGB信号，以及使能信号（DE）、行同步（Hsync）和场同步（Vsync）信号，经过处理后输出符合VESA时序标准的视频信号供后续电路使用。
根据VESA标准，行同步和场同步信号的同步头极性既可以为正极性，也可以为负极性。对于显示器来说，FPGA逻辑只能满足一种同步头极性的信号，如果FPGA逻辑中默认同步头极性为负极性而输入信号解码得到的同步头极性为正极性，则会出现判定错误，导致后续逻辑功能判断出错。因此，必须能够对输入的不同极性的同步信号进行自适应，无论输入信号解析出的是什么极性的同步头信号，经过自适应模块后的同步头信号极性都为负极性，以满足设计需要。
发明内容
鉴于上述现有技术存在的缺陷，本发明的目的是提出一种基于FPGA的数字视频信号同步头极性自适应方法。
本发明的上述目的，将通过以下技术方案得以实现：基于数字视频信号解码电路和同步头极性自适应功能模块实现，其中所述数字视频信号解码电路将输入的DVI标准视频信号解码成RGB信号以及符合VESA时序标准的使能信号（DE）、行同步（Hsync）和场同步（Vsync）信号；所述同步头极性自适应功能模块包括信号电平边沿判断功能模块、计数器模块和翻转赋值模块，将任意极性（正极性或负极性）的同步头信号的极性转化成确定的极性，并对符合VESA时序标准的任意分辨率视频信号同步头信号自适应。
本发明技术方案应用实施后的显著效果为：本发明数字视频信号同步头极性自适应的方法以FPGA为基础，对于输入的任意分辨率视频信号利用相应的视频解码电路进行解码，通过同步头极性自适应功能模块，对解码得到的行同步信号和场同步信号的同步头极性进行判断。根据需要将同步头信号极性转换成需要的极性。确保无论输入视频信号同步头极性是高电平还是低电平，都可以满足后续功能模块的正常工作，具有通用性。
附图说明
图1是本发明数字视频信号同步头极性自适应方法原理框图。
图2是本发明信号电平边沿判断功能模块原理框图。
图3是本发明计数器功能模块原理框图。
图4是本发明翻转赋值功能模块原理框图。
具体实施方式
以下便结合实施例附图，对本发明的具体实施方式作进一步的详述，以使本发明技术方案更易于理解、掌握。
下面通过具体实施例对本发明做详细的说明：
请参阅图1，其是本发明一种实现数字视频信号同步头极性自适应的方法的原理框图。本发明能实现数字视频信号同步头极性自适应的方法包括数字视频信号解码电路和同步头极性自适应功能模块。数字视频信号解码电路能够将输入的DVI串行数字视频信号解码成并行的RGB数字信号以及符合VESA时序标准的使能信号（DE）、行同步（Hsync）和场同步（Vsync）信号。同步头极性自适应功能模块对解码得到的行同步与场同步信号进行同步头极性判断，并根据需要将任意极性（正极性或负极性）的同步信号转化成确定极性的同步信号。
本发明中的同步头极性自适应功能模块包括信号电平边沿判断功能模块、计数器模块和翻转赋值模块。请参阅图2至图4，所述的信号电平边沿判断功能模块是计数器计数和赋值的触发条件，每来一次时钟信号，做一次判断，当同步信号为低电平时，计数器自加‘1’，当同步信号上升沿时，停止计数，将计数器的值赋值给寄存器。
所述的计数器模块在时钟的驱动下，每当满足条件时计数器自加‘1’。
所述的翻转赋值模块对输入的行场信号同步头电平进行判断，当同步头电平为低时计数器中的值VESA标准中同步头为低的信号时序吻合，则认为输入的同步头信号极性为低，否则，同步头信号极性为高。将整个同步信号极性翻转。
综上所述，对本发明基于FPGA数字视频信号同步头极性自适应方法的详细介绍可见，其优点为：兼容性强，对于任意同步头极性的输入信号具有自适应性；灵活性强，对任意分辨率的视频输入信号具有通用性。
除上述实施例外，本发明还可以有其它实施方式。凡采用等同替换或等效变换形成的技术方案，均落在本发明所要求保护的范围之内。

Claims (1)

1.一种基于FPGA的数字视频信号同步头极性自适应方法，其特征在于，基于数字视频信号解码电路和同步头极性自适应功能模块实现，其中所述数字视频信号解码电路将输入的DVI标准视频信号解码成RGB信号以及符合VESA时序标准的使能信号DE、行同步Hsync和场同步Vsync信号；所述同步头极性自适应功能模块包括信号电平边沿判断功能模块、计数器模块和翻转赋值模块，将任意极性的同步头信号的极性转化成确定的极性，并对符合VESA时序标准的任意分辨率视频信号同步头信号自适应。
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