CN104934005A - 显示面板及显示装置 - Google Patents
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Abstract
本发明提供一种显示面板及显示装置，属于显示技术领域，其可解决现有的显示面板的边框较宽的问题。本发明的显示面板，包括显示区域和周边区域，所述显示区域包括交叉设置的多条栅线和多条数据线，所述栅线和所述数据线交叉限定出多个像素单元，其中，至少一条所述栅线包括断开设置的至少两个栅线段，每一个所述栅线段对应控制至少一个像素单元，所述显示区域按照所述栅线段的断开位置分为至少两个子显示区域，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，所述移位寄存器单元用于为与其连接的所述栅线段提供栅极扫描信号。本发明的显示面板将至少部分移位寄存器单元设置在显示区域内，故其边框较窄。
Description
技术领域
本发明属于显示技术领域，具体涉及一种显示面板及显示装置。
背景技术
TFT-LCD(Thin Film Transistor-Liquid Crystal Display，薄膜晶体管液晶显示装置)实现一帧画面显示的基本原理是通过栅极(gate)驱动从上到下依次对每一行像素输入一定宽度的方波进行选通，再通过源极(source)驱动每一行像素所需的信号依次从上往下输出。目前制造这样一种结构的显示器件通常是栅极驱动电路和源极驱动电路通过COF(Chip On Film，覆晶薄膜)或COG(Chip On Glass，芯片直接固定在玻璃上)工艺制作在玻璃面板上的，但是当分辨率较高时，栅极驱动电路和源极驱动电路的输出均较多，驱动电路的长度也将增大，这将不利于模组驱动电路的压焊(Bonding)工艺。
为了克服以上问题，现有显示器件的制造采用GOA(GateDrive On Array)电路的设计，相比现有的COF或COG工艺，其不仅节约了成本，而且可以做到面板两边对称的美观设计，同时也可省去栅极驱动电路的Bonding区域以及***布线空间，从而实现了显示装置窄边框的设计，提高了显示装置的产能和良率。但是伴随着显示面板的分辨率和尺寸的增加，每个GOA的负载也随之增大，也就是说GOA电路中的每个移位寄存器的薄膜晶体管(TFT)的尺寸也越大，因此导致像素的充电越难，相应的显示面板的边框越宽。
发明内容
本发明所要解决的技术问题包括，针对现有的显示面板存在上述的问题，提供一种边框较窄、显示效果均一的显示面板及显示装置。
解决本发明技术问题所采用的技术方案是一种显示面板，包括显示区域和周边区域，所述显示区域包括交叉设置的多条栅线和多条数据线，所述栅线和所述数据线交叉限定出多个像素单元，其中，至少一条所述栅线包括断开设置的至少两个栅线段，每一个所述栅线段对应控制至少一个像素单元，所述显示区域按照所述栅线段的断开位置分为至少两个子显示区域，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，所述移位寄存器单元用于为与其连接的所述栅线段提供栅极扫描信号。
优选的是，每条所述栅线均包括断开设置的至少两个栅线段，且位于同一行的所述栅线段至少与一个所述移位寄存器单元连接。
进一步优选的是，各行所述栅线中的栅线段的断开位置相同，位于同一子显示区域中的每个所述栅线段分别连接不同的移位寄存器单元，且驱动同一子显示区域中所述栅线段的各个所述移位寄存器单元级联在一起。
更进一步优选的是，每一行所述栅线中的各个所述栅线段均连接单独的移位寄存器单元，且位于同一子显示区域中的各个所述移位寄存器单元级联在一起。
更进一步优选的是，所述显示区域包括三个子显示区域，每一所述栅线分为三个栅线段，每一所述子显示区域包括所有栅线的同一栅线段。
进一步优选的是，每条所述栅线包括长度相同的多个栅线段，位于同一子显示区域的所述栅线段分别连接不同的移位寄存器单元，且位于同一子显示区域的所述移位寄存器单元级联在一起。
优选的是，所述移位寄存器单元连接多条信号线，所述信号线与所述数据线平行设置。
优选的是，所述移位寄存器单元包括9个开关单元和一个存储电容，所述栅线段对应控制9个像素单元，每一所述像素单元设置有一个开关单元，所述存储电容设置在其中一像素单元内。
进一步优选的是，所述9个开关单元为对应的第一晶体管至第九晶体管；其中，
所述第一晶体管的第一极连接其控制极和信号输入端，第二极连接存储电容的第一端；
所述第二晶体管的第一极连接第一晶体管的第二极，第二极连接低电源端，控制极连接复位信号端；
所述第三晶体管的第一极连接时钟信号输入端，第二极连接存储电容的第二端和信号输出端，控制极连接存储电容的第一端；
所述第四晶体管的第一极连接存储电容的第二端和信号输出端，第二极连接低电源端，控制极连接第五晶体管的第二极；
所述第五晶体管的第一极连接高电压端，第二极连接第六晶体管和第七晶体管的第一极，控制极连接第九晶体管的第二极；
所述第六晶体管的第一极连接第四晶体管的控制极，第二极连接低电源端，控制极连接存储电容的第一端；
所述第七晶体管的第一极连接第四晶体管的控制极，第二极连接低电源端，控制极连接存储电容的第一端；
所述第八晶体管的第一极连接第九晶体管的第二极，第二极连接低电源端，控制极连接第六晶体管的控制极；
所述第九晶体管的第一极连接其控制极和高电压端，第二极连接第五晶体管的控制极。
其中，时钟信号端平行于数据线设置；信号输入端即为栅线；所述的第一晶体管至第九晶体管分别位于九条数据线之间的像素单元，具体的，第九晶体管位于第一数据线与第二数据线之间，第八晶体管位于第二数据线与第三数据线之间，第五晶体管位于第三数据线和第四数据线之间，第六晶体管位于第四数据线和第五数据线之间，第七晶体管位于第五数据线和第六数据线之间，第四晶体管位于第六数据线和第七数据线之间，第一晶体管位于第七数据线和第八数据线之间，第三晶体管位于第八数据线和第九数据线之间，第二晶体管位于第九数据线远离第八数据线的另一侧；特别的，所述第一晶体管的第一极和其控制极连接上一行栅线，即信号输入端；所述的第三晶体管的第二极和第四晶体管的第一极连接本行栅线，即信号输出端；所述的第二晶体管的栅极连接下一行栅线；所述的存储电容设置在第八数据线和第九数据线之间。
解决本发明技术问题所采用的技术方案是一种显示装置，其包括上述的显示面板。
本发明具有如下有益效果：
由于在本发明的显示面板中，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，也就是说至少部分移位寄存器单元是设置在显示面板的显示区域中，因此可以理解的是，该显示面板周边区域的移位寄存器单元较现有的显示面板的周边区域的移位寄存器单元的个数而言较少，故可以通过合理的布置剩余的移位寄存器单元的位置，以使显示面板的边框更窄；而且在本发明中将至少部分栅线分割成多个栅线段，与栅线段连接的负载较现有的与栅线连接的负载而言，负载明显降低，从而可以提高移位寄存器单元的驱动能力，也就缓解了栅线的压降问题，进而使得显示面板显示更加均匀。
由于本发明的显示装置包括上述显示面板，故其显示效果较好，且边框较窄。
附图说明
图1为本发明的实施例1、2的显示面板的结构示意图；
图2为本发明的实施例2的显示面板的一种优选结构的示意图；
图3为本发明的实施例1-5中的显示面板的移位寄存器单元的电路图。
具体实施方式
为使本领域技术人员更好地理解本发明的技术方案，下面结合附图和具体实施方式对本发明作进一步详细描述。
实施例1：
本实施例提供一种显示面板，包括显示区域和周边区域，所述显示区域包括交叉设置的多条栅线和多条数据线，所述栅线和所述数据线交叉限定出多个像素单元，其中，至少一条所述栅线包括断开设置的至少两个栅线段，每一个所述栅线段对应控制至少一个像素单元，所述显示区域按照所述栅线段的断开位置分为至少两个子显示区域，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，所述移位寄存器单元用于为与其连接的所述栅线段提供栅极扫描信号。
由于在本实施例的显示面板中，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，也就是说至少部分移位寄存器单元是设置在显示面板的显示区域中，因此可以理解的是，该显示面板周边区域的移位寄存器单元较现有的显示面板的周边区域的移位寄存器单元的个数而言较少，故可以通过合理的布置剩余的移位寄存器单元的位置，以使显示面板的边框更窄；而且在本实施例中将至少部分栅线分割成多个栅线段，与栅线段连接的负载较现有的与栅线连接的负载而言，负载明显降低，从而可以提高移位寄存器单元的驱动能力，也就缓解了栅线的压降问题，进而使得显示面板显示更加均匀。
其中，每条所述栅线均包括断开设置的至少两个栅线段，且位于同一行的所述栅线段至少与一个所述移位寄存器单元连接。也就是说，位于同一行的栅线段可以通过一个移位寄存器单元进行驱动，也可以是每一个栅线段均通过单独的移位寄存器单元进行驱动。具体的结合下述实施例，以对实施例1的显示面板进一步说明。
实施例2：
如图1所示，本实施例提供一种显示面板，其包括交叉设置的M条栅线和N条数据线，G(i)为其中任一条栅线，且有1≤i≤M；M为整数，S(j)为其中的任一条数据线，且有1≤j≤N；N为整数。所有栅线G(i)和所有数据线S(j)的交叉限定出多个像素单元A，各行所述栅线G(i)中的断开位置相同，将每行栅线G(i)分割成多个栅线段g；按照每行栅线G(i)的断开位置，将显示面板的显示区域划分为多个间隔设置子显示区域Q；每个栅线段g连接一个独立的移位寄存器单元GOA，所述移位寄存器单元GOA用于为与其连接的栅线段g提供栅极扫描信号。其中，驱动同一个子显示区域Q中各个移位寄存器单元GOA级联在一起，构成一个栅极驱动电路。
在本实施例中的每个栅线段g通过一个移位寄存器单元GOA，也就是说每个移位寄存器单元GOA仅仅用于驱动一个栅线段g，该移位寄存器单元GOA较用于驱动整条栅线G(i)的移位寄存器单元GOA而言，其所需的薄膜晶体管的尺寸无需很大。需要说明的是，虽然将移位寄存器单元GOA设置在像素单元A所在区域，也即显示区域将会影响显示面板的开口率，导致显示亮度的降低，但是由于每一个栅线段g均是通过一个单独的移位寄存器单元GOA驱动的，故整个显示面板的显示亮度是均匀降低的，不会出现显示不均匀的问题，而对于显示亮度则可以通过背光源的亮度增加以提升显示面板的亮度。
具体的，以包括六条栅线G(1)～G(6)，九条数据线S(1)～S(9)的显示面板为例；其中，优选的，每一行栅线G(i)具有三个栅线段g，一个栅线段g的宽度对应一个子显示区域Q的宽度，每一个子显示区域Q呈竖列状，且各子显示区域Q在行方向上间隔。每一竖列采用一个栅极驱动电路控制，此时有助于栅极驱动电路的控制，使得显示更均一。
优选的，每个所述栅极驱动电路还包括为各所述移位寄存器单元GOA提供信号的多条信号线，多条所述信号线与所述数据线S(j)平行设置。其中，多条信号线可以包括：信号输入端INPUT所引入信号时的信号引入线，时钟信号输入端CLK所引入信号时的信号引入线，高电压端VGH所引入信号时的信号引入线等。
其中，如图2所示，图2中只是示意出一条栅线G(i)中的一个栅线段g所连接的移位寄存器单元GOA，在本实施例中的移位寄存器单元GOA包括9个开关单元(也就是图中所示的M1-M9)和一个存储电容C1，所述栅线段对应控制9个像素单元，每一所述像素单元A设置有一个开关单元，所述存储电容设置在其中一像素单元A内。
具体的，时钟信号CLK平行与数据线S(9)设置；信号输入端INPUT即为栅线G(i-1)；所述的第一晶体管M1至第九晶体管M9分别位于九条数据线S(1)～S(9)之间的像素单元，具体的，第九晶体管M9位于第一数据线S(1)与第二数据线S(2)之间，第八晶体管位M8位于第二数据线S(2)与第三数据线S(3)之间，第五晶体管M5位于第三数据线S(3)和第四数据线S(4)之间，第六晶体管M6位于第四数据线S(4)和第五数据线S(5)之间，第七晶体管M7位于第五数据线S(5)和第六数据线S(6)之间，第四晶体管M4位于第六数据线S(6)和第七数据线S(7)之间，第一晶体管M1位于第七数据线S(7)和第八数据线S(8)之间，第三晶体管M3位于第八数据线S(8)和第九数据线S(9)之间，第二晶体管M2位于第九数据线S(9)远离第八数据线S(8)的另一侧；特别的，所述第一晶体管M1的第一极和其控制极连接上一行栅线G(i-1)，即信号输入端；所述的第三晶体管M3的第二极和第四晶体管M4的第一极连接本行栅线G(i)，即信号输出端；第二晶体管M2的栅极连接下一行栅线G(i+1)；所述的存储电容C1设置在第八数据线S(8)和第九数据线S(9)之间。
该种设置方式可以使得各个移位寄存器GOA中的各个的开关单元均匀的分布在不同的像素单元A，以使得显示面板的遮光位置更加均匀，也就是使得显示面板的开口更加均匀，进而使得显示面板显示的画面的亮度均一。
其中，如图3所示，在本实施例中的移位寄存器单元GOA包括的9个开关单元分别对应第一晶体管M1至第九晶体管M9；其中，所述第一晶体管M1的第一极连接其控制极和信号输入端INPUT，第二极连接存储电容C1的第一端；所述第二晶体管M2的第一极连接第一晶体管M1的第二极，第二极连接低电源端VGL，控制极连接复位信号端RESET；所述第三晶体管M3的第一极连接时钟信号输入端CLK，第二极连接存储电容C1的第二端和信号输出端OUTPUT，控制极连接存储电容C1的第一端；所述第四晶体管M4的第一极连接存储电容C1的第二端和信号输出端OUTPUT，第二极连接低电源端VGL，控制极连接第五晶体管M5的第二极；所述第五晶体管M5的第一极连接高电压端VGH，第二极连接第六晶体管M6和第七晶体管M7的第一极，控制极连接第九晶体管M9的第二极；所述第六晶体管M6的第一极连接第四晶体管M4的控制极，第二极连接低电源端VGL，控制极连接存储电容C1的第一端；所述第七晶体管M7的第一极连接第四晶体管M4的控制极，第二极连接低电源端VGL，控制极连接存储电容C1的第一端；所述第八晶体管M8的第一极连接第九晶体管M9的第二极，第二极连接低电源端VGL，控制极连接第六晶体管M6的控制极；所述第九晶体管M9的第一极连接其控制极和高电压端VGH，第二极连接第五晶体管M5的控制极。当然本实施例的移位寄存器单元GOA并布局于上述一种情况，只要是包含输入模块、输出上拉模块、复位模块的移位寄存器单元GOA均可以。
其中，在每一行像素单元A中，所述移位寄存器单元GOA位于与其连接的所述栅线段g的相对侧。之所以如此设置是因为，栅线段g上连接有用于驱动像素单元A的像素驱动电路，而将移位寄存器单元GOA设置在栅线段g的相对侧，也就是设置在像素驱动电路的相对侧，从而使得显示面板的不透光区域分布的更加均匀，从而使得显示面板在显示时更加均一。
由于在本实施例的显示面板中移位寄存器单元GOA是设置像素单元A所在区域的，也就是设置在显示面板的显示区域的，较现有的将移位寄存器单元GOA设置周边区域的显示面板而言，本实施例的显示面板的边框更窄；而且在本实施例中将每条栅线G(i)分割成多个栅线段g，与栅线段g连接的负载较现有的与栅线G(i)连接的负载而言，负载明显降低，从而可以提高移位寄存器单元GOA的驱动能力，也就缓解了栅线G(i)的压降问题，进而使得显示面板显示更加均匀。
实施例3：
本实施例同样提供一种显示面板，该显示面板的结构与实施例2中的显示面板的结构相似，区别在于，本实施例的显示面板中，位于同一行的栅线段g连接同一个移位寄存器单元GOA，也就是说一个移位寄存器单元GOA用于为一行栅线段g提供栅极扫描信号。
在本实施例中，由于位于同一行的栅线段g连接同一个移位寄存器单元GOA，此时仅需要在每个移位寄存器单元GOA上增加多个信号输出端OUTPUT即可，工艺简单，而且将移位寄存器单元GOA设置像素单元A所在区域的，也就是设置在显示面板的显示区域的，较现有的将移位寄存器单元GOA设置周边区域的显示面板而言，本实施例的显示面板的边框更窄。在本实施例中显示面板的其他结构与实施例2相同，在此不再详细描述。
实施例4：
本实施例同样提供一种显示面板，其包括交叉设置的M条栅线和N条数据线，G(i)为其中任一条栅线，且有1≤i≤M，S(j)为其中的任一条数据线，且有1≤j≤N。所有栅线G(i)和所有数据线S(j)的交叉限定出多个像素单元A，，将每行栅线G(i)分割成多个栅线段g，且各个所述栅线段g的长度相同，按照每行栅线G(i)的断开位置，将显示面板的显示区域划分为多个间隔设置子显示区域Q；每个栅线段g连接一个独立的移位寄存器单元GOA，所述移位寄存器单元GOA用于为与其连接的栅线段g提供栅极扫描信号。其中，驱动同一个子显示区域Q中各个移位寄存器单元GOA级联在一起，构成一个栅极驱动电路。
由于在实施例中各个栅线段g的长度相同，但并不能保证各行栅线G(i)的断开位置相同，因此可以理解的是，在该显示面板上的子显示区域Q的排布就有可能是不规则图形，但是尽管如此，每个移位寄存器单元GOA仅仅用于驱动一个栅线段g，该移位寄存器单元GOA较用于驱动整条栅线G(M)的移位寄存器单元GOA而言，其所需的薄膜晶体管的尺寸无需很大。需要说明的是，虽然将移位寄存器单元GOA设置在像素单元A所在区域，也即显示区域将会影响显示面板的开口率，导致显示亮度的降低，但是由于每一个栅线段g均是通过一个单独的移位寄存器单元GOA驱动的，故整个显示面板的显示亮度是均匀降低的，不会出现显示不均匀的问题，而对于显示亮度则可以通过背光源的亮度增加以提升显示面板的亮度。
在本实施例显示面板中移位寄存器单元的结构，以及其他部件与实施例1和2相同，在此不再详细描述。
实施例5：
本实施例同样提供一种显示面板，该显示面板的结构与实施例4中的显示面板的结构相似，也就是说各个栅线段g的长度相同，区别在于，本实施例的显示面板中，位于同一行的栅线段g连接同一个移位寄存器单元GOA，也就是说一个移位寄存器单元GOA用于为一行栅线段g提供栅极扫描信号。
在本实施例中，由于位于同一行的栅线段g连接同一个移位寄存器单元GOA，此时仅需要在每个移位寄存器单元GOA上增加多个信号输出端OUTPUT即可，工艺简单，而且将移位寄存器单元GOA设置像素单元A所在区域的，也就是设置在显示面板的显示区域的，较现有的将移位寄存器单元GOA设置周边区域的显示面板而言，本实施例的显示面板的边框更窄。在本实施例中显示面板的其他结构与实施例4相同，在此不再详细描述。
实施例6：
本实施例提供一种显示装置，其包括上述的显示面板。故本实施例的显示面板的显示效果更好。
该显示装置可以为：液晶面板、电子纸、OLED面板、手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
可以理解的是，以上实施方式仅仅是为了说明本发明的原理而采用的示例性实施方式，然而本发明并不局限于此。对于本领域内的普通技术人员而言，在不脱离本发明的精神和实质的情况下，可以做出各种变型和改进，这些变型和改进也视为本发明的保护范围。
Claims (10)
1.一种显示面板，包括显示区域和周边区域，所述显示区域包括交叉设置的多条栅线和多条数据线，所述栅线和所述数据线交叉限定出多个像素单元，其特征在于，至少一条所述栅线包括断开设置的至少两个栅线段，每一个所述栅线段对应控制至少一个像素单元，所述显示区域按照所述栅线段的断开位置分为至少两个子显示区域，至少一个所述子显示区域中设置有与所述栅线段连接的移位寄存器单元，所述移位寄存器单元用于为与其连接的所述栅线段提供栅极扫描信号。
2.根据权利要求1所述的显示面板，其特征在于，每条所述栅线均包括断开设置的至少两个栅线段，且位于同一行的所述栅线段至少与一个所述移位寄存器单元连接。
3.根据权利要求2所述的显示面板，其特征在于，各行所述栅线中的栅线段的断开位置相同，位于同一子显示区域中的每个所述栅线段分别连接不同的移位寄存器单元，且驱动同一子显示区域中所述栅线段的各个所述移位寄存器单元级联在一起。
4.根据权利要求3所述的显示面板，其特征在于，每一行所述栅线中的各个所述栅线段均连接单独的移位寄存器单元，且位于同一子显示区域中的各个所述移位寄存器单元级联在一起。
5.根据权利要求3所述的显示面板，其特征在于，所述显示区域包括三个子显示区域，每一所述栅线分为三个栅线段，每一所述子显示区域包括所有栅线的同一栅线段。
6.根据权利要求2所述的显示面板，其特征在于，每条所述栅线包括长度相同的多个栅线段，位于同一子显示区域的所述栅线段分别连接不同的移位寄存器单元，且位于同一子显示区域的所述移位寄存器单元级联在一起。
7.根据权利要求1-6中任一项所述的显示面板，其特征在于，所述移位寄存器单元连接多条信号线，所述信号线与所述数据线平行设置。
8.根据权利要求1-6中任一项所述的显示面板，其特征在于，所述移位寄存器单元包括9个开关单元和一个存储电容，所述开关单元对应控制9个像素单元，每一所述像素单元设置有一个开关单元，所述存储电容设置在其中一像素单元内。
9.根据权利要求8所述的显示面板，其特征在于，所述9个开关单元为对应的第一晶体管至第九晶体管；其中，
所述第一晶体管的第一极连接其控制极和信号输入端，第二极连接存储电容的第一端；
所述第二晶体管的第一极连接第一晶体管的第二极，第二极连接低电源端，控制极连接复位信号端；
所述第三晶体管的第一极连接时钟信号输入端，第二极连接存储电容的第二端和信号输出端，控制极连接存储电容的第一端；
所述第四晶体管的第一极连接存储电容的第二端和信号输出端，第二极连接低电源端，控制极连接第五晶体管的第二极；
所述第五晶体管的第一极连接高电压端，第二极连接第六晶体管和第七晶体管的第一极，控制极连接第九晶体管的第二极；
所述第六晶体管的第一极连接第四晶体管的控制极，第二极连接低电源端，控制极连接存储电容的第一端；
所述第七晶体管的第一极连接第四晶体管的控制极，第二极连接低电源端，控制极连接存储电容的第一端；
所述第八晶体管的第一极连接第九晶体管的第二极，第二极连接低电源端，控制极连接第六晶体管的控制极；
所述第九晶体管的第一极连接其控制极和高电压端，第二极连接第五晶体管的控制极。
10.一种显示装置，其特征在于，所述显示装置包括权利要求1-9中任一项所述的显示面板。
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