WO2023203710A1 - 駆動装置 - Google Patents
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- 239000004065 semiconductor Substances 0.000 claims abstract description 109
- 230000008859 change Effects 0.000 claims description 22
- 238000000034 method Methods 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 18
- 230000007423 decrease Effects 0.000 description 6
- 230000001965 increasing effect Effects 0.000 description 5
- 230000005855 radiation Effects 0.000 description 5
- 239000000470 constituent Substances 0.000 description 4
- 230000001939 inductive effect Effects 0.000 description 4
- 230000004048 modification Effects 0.000 description 4
- 238000012986 modification Methods 0.000 description 4
- 238000005516 engineering process Methods 0.000 description 3
- 238000005070 sampling Methods 0.000 description 3
- 239000002131 composite material Substances 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- JMASRVWKEDWRBT-UHFFFAOYSA-N Gallium nitride Chemical compound [Ga]#N JMASRVWKEDWRBT-UHFFFAOYSA-N 0.000 description 1
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000001514 detection method Methods 0.000 description 1
- 229910003460 diamond Inorganic materials 0.000 description 1
- 239000010432 diamond Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 230000011664 signaling Effects 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- HBMJWWWQQXIZIP-UHFFFAOYSA-N silicon carbide Chemical compound [Si+]#[C-] HBMJWWWQQXIZIP-UHFFFAOYSA-N 0.000 description 1
- 230000007704 transition Effects 0.000 description 1
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-
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/16—Modifications for eliminating interference voltages or currents
Definitions
- the present disclosure relates to a drive device.
- Patent Documents 1 and 2 propose a technique for increasing or decreasing the voltage supplied to the gate of a voltage-controlled semiconductor switching element based on the load current in order to reduce the steady-state loss of the voltage-controlled semiconductor switching element. There is.
- Patent No. 4333802 Japanese Patent Application Publication No. 2004-96830
- Patent Documents 1 and 2 simply increase the voltage applied to the gate, so when the AC load current is instantaneously zero or low, the voltage applied to the gate is suddenly increased. It may increase. In this case, there is a problem in that the turn-on speed of the semiconductor switching element becomes excessive, resulting in an increase in surge voltage and radiation noise.
- the present disclosure has been made in view of the above problems, and aims to provide a technology that can optimize the turn-on speed.
- a drive device is a drive device that drives a semiconductor switching element based on on and off of a gate drive signal, and includes a gate drive circuit power supply that can change an output voltage, and a fixed voltage lower than the output voltage. a control unit that changes the output voltage of the gate drive circuit power supply based on relevant information related to the load current of the semiconductor switching element; A delay circuit is provided that controls supplying the fixed voltage to the gate of the semiconductor switching element for a predetermined period and then supplies the output voltage to the gate.
- a gate drive signal when a gate drive signal is turned on, a fixed voltage is controlled to be supplied to the gate of a semiconductor switching element for a predetermined period of time, and then an output voltage is controlled to be supplied to the gate. conduct. According to such a configuration, the turn-on speed can be optimized.
- FIG. 1 is a circuit diagram showing the configuration of a drive device according to Embodiment 1.
- FIG. 1 is a circuit diagram showing the configuration of a drive device according to Embodiment 1.
- FIG. 3 is a diagram showing a change pattern of the power supply output voltage according to the first embodiment.
- FIG. 3 is a diagram showing the operation of the drive device according to the first embodiment. It is a circuit diagram showing the composition of the drive device concerning a modification.
- FIG. 2 is a circuit diagram showing the configuration of a drive device according to a second embodiment.
- FIG. 7 is a diagram showing the operation of the drive device according to the second embodiment.
- FIG. 3 is a circuit diagram showing the configuration of a drive device according to a third embodiment.
- FIG. 7 is a diagram for explaining the operation of the drive device according to the third embodiment.
- FIG. 7 is a diagram showing the operation of the drive device according to the third embodiment.
- FIG. 1 is a circuit diagram showing the configuration of a drive device according to the first embodiment.
- the drive device in FIG. 1 includes a gate drive circuit power source E1, a PWM control section 1 that is a control section, a gate drive circuit 2, and a resistor RG.
- the drive device in FIG. 1 is connected to the gate of a semiconductor switching element Q1, which is a voltage-controlled semiconductor switching element.
- the drive device in FIG. 1 drives the semiconductor switching element Q1 based on the on and off states of the gate drive signal.
- the semiconductor switching element Q1 is used in an inverter circuit as shown in FIG. 2, and constitutes the inverter circuit.
- flywheel diodes D1 to D6 are connected in parallel to semiconductor switching elements Q1 to Q6, respectively.
- the semiconductor switching elements Q2, Q4, Q6 of the upper arm and the semiconductor switching elements Q1, Q3, Q5 of the lower arm are connected in series, respectively, and the three sets of upper and lower arms and the power source E2 are connected in parallel.
- FIG. 1 illustration of FIG. 2 is omitted for convenience, and the semiconductor switching element Q1 is connected to the power source E2 via the load section 9.
- the semiconductor switching element Q1 will be explained as being a MOSFET (Metal Oxide Semiconductor Field Effect Transistor), but as will be described later, it is not limited to a MOSFET.
- MOSFET Metal Oxide Semiconductor Field Effect Transistor
- the gate drive circuit power supply E1 is configured to be able to change the output voltage, which is the voltage output by the gate drive circuit power supply E1.
- the output voltage of the gate drive circuit power supply E1 may be referred to as the power supply output voltage.
- the PWM control unit 1 outputs a rectangular waveform gate drive signal to the gate drive circuit 2.
- the PWM control unit 1 controls the load current of the semiconductor switching element Q1 by varying the duty ratio, which is the ratio between the on time and the off time of the gate drive signal, and controlling the output of the gate drive circuit 2.
- the load current of the semiconductor switching element Q1 is, for example, a current flowing between the source and drain of the semiconductor switching element Q1 connected to the load section 9 and the like.
- the PWM control section 1 outputs a voltage control signal to the gate drive circuit power source E1.
- the PWM control unit 1 performs control to change the power output voltage of the gate drive circuit power source E1 by changing the voltage control signal based on related information related to the load current of the semiconductor switching element Q1.
- the related information related to the load current is a predetermined change pattern of the power supply output voltage with respect to the effective value of the load current, and this change pattern is stored in the PWM control unit 1 in advance. .
- FIG. 3 is a diagram showing an example of a change pattern of the power supply output voltage.
- the thin solid line shows the instantaneous value of the load current
- the thin dotted line shows the effective value of the load current
- the thick solid line shows the change pattern of the power supply output voltage.
- the instantaneous value of the load current corresponds to the waveform of the gate drive signal, and changes depending on whether the gate drive signal is turned on or off.
- An alternating current indicated by the instantaneous value of the load current flows through the load connected to the outputs (U, V, W) in FIG.
- the PWM control unit 1 increases the power output voltage of the gate drive circuit power supply E1 when the effective value of the load current is large, and decreases the power supply output voltage of the gate drive circuit power supply E1 when the effective value of the load current is small. Then, the power supply output voltage of the gate drive circuit power supply E1 is controlled.
- the PWM control unit 1 may increase or decrease the power supply output voltage of the gate drive circuit power supply E1 stepwise as shown in FIG. 3, or may increase or decrease it in proportion to the effective value of the load current. For example, the PWM control unit 1 may change the power output voltage of the gate drive circuit power supply E1 based on the number of times the gate drive signal is turned on and off and a predetermined change pattern.
- the resistor RG in FIG. 1 is connected between the gate of the semiconductor switching element Q1 and the gate drive circuit 2.
- the gate drive circuit 2 in FIG. 1 includes a power source E3, a first switch S1, a second switch S2, a third switch S3, an inverter circuit INV that is a NOT circuit, and a delay circuit DLC.
- the power supply E3 has a fixed voltage lower than the power supply output voltage of the gate drive circuit power supply E1.
- One end of the first switch S1 is connected to the power source E3, the other end of the first switch S1 is connected to the resistor RG, and turning on and off of the first switch S1 is controlled by a delay circuit DLC.
- One end of the second switch S2 is connected to the gate drive circuit power supply E1, the other end of the second switch S2 is connected to the resistor RG, and the on and off of the second switch S2 is controlled by the delay circuit DLC. Ru.
- One end of the third switch S3 is connected to the reference voltage GND, the other end of the third switch S3 is connected to the resistor RG, and the on/off state of the third switch S3 is controlled by the gate inverted by the inverter circuit INV. Controlled by a drive signal.
- the delay circuit DLC turns on the first switch S1 and turns on the second switch so that the fixed voltage of the power source E3 is supplied to the gate of the semiconductor switching element Q1 for a predetermined period. Control is performed to turn off the switch S2.
- the delay circuit DLC controls the first switch so that after the fixed voltage of the power source E3 is supplied to the gate for a predetermined period, the power output voltage of the gate drive circuit power source E1 is supplied to the gate of the semiconductor switching element Q1. Control is performed to turn off S1 and turn on second switch S2.
- the delay circuit DLC performs control to turn off the first switch S1 and turn off the second switch S2 when the gate drive signal is turned off.
- the third switch S3 is turned on by the gate drive signal inverted by the inverter circuit INV, and the reference voltage GND is supplied to the gate of the semiconductor switching element Q1. That is, in the first embodiment, the first switch S1, the second switch S2, and the third switch S3 are exclusively turned on.
- FIG. 4 is a diagram showing the operation of the drive device according to the first embodiment.
- the output voltage of the gate drive circuit 2 may be referred to as a circuit output voltage in order to distinguish it from the power supply output voltage of the gate drive circuit power supply E1.
- FIG. 4 shows the gate drive signal, the on and off states of the first switch S1, the on and off states of the second switch S2, the circuit output voltage, and the gate voltage of the semiconductor switching element Q1.
- the gate drive signal is turned on from off
- the first switch S1 is turned on.
- the circuit output voltage becomes the voltage of the power source E3, and the gate voltage increases.
- the period from time T1 to time T2 is a mirror period, and during the mirror period, the gate voltage is constant at a voltage smaller than the voltage of power supply E3.
- the gate voltage increases to approach the fixed voltage of power source E3.
- the gate voltage becomes approximately the fixed voltage of the power source E3.
- the first switch S1 is turned off and the second switch S2 is turned on under the control of the delay circuit DLC.
- the circuit output voltage becomes the power supply output voltage of the gate drive circuit power supply E1, and the gate voltage increases even after time T3.
- the timing at which the first switches S1 and S2 are switched is the same as the timing at which the gate voltage becomes approximately the fixed voltage of the power source E3, but the timing is not limited to this.
- the timing at which the first switches S1 and S2 are switched may be before or after the timing at which the gate voltage becomes approximately the fixed voltage of the power source E3, or may be during the mirror period.
- the gate drive signal changes from on to off
- the first switch S1 and the second switch S2 are turned off, and the third switch S3 is turned on.
- the circuit output voltage becomes the reference voltage GND, the gate voltage decreases, and the semiconductor switching element Q1 is turned off.
- the PWM control unit 1 changes the power output voltage of the gate drive circuit power supply E1 based on the relevant information related to the load current of the semiconductor switching element Q1.
- the gate voltage applied to the semiconductor switching element Q1 increases when the load current increases, so the voltage when the semiconductor switching element Q1 is turned on can be reduced, and the semiconductor switching element Q1 can be turned on. Steady-state loss of element Q1 can be reduced.
- the time during which the load current operates under the maximum condition occupies a small proportion of the entire operating time, and the average voltage applied to the gate of the semiconductor switching element Q1 and the gate drive circuit 2 is reduced by the power supply of the gate drive circuit power supply E1.
- the output voltage will be lower than the maximum voltage. Therefore, it is expected that failures of the gate of the semiconductor switching element Q1 and the gate drive circuit 2 will be reduced.
- the turn-on speed of the semiconductor switching element increases. Furthermore, when the voltage applied to the gate of the semiconductor switching element during turn-on increases sharply, the turn-on speed of the semiconductor switching element increases. Therefore, in order to reduce the steady-state loss of the semiconductor switching element Q1, if the gate voltage is simply increased in response to an increase in the effective value of the load current, the gate voltage will increase when the instantaneous value of the AC load current is zero or low. There are cases where the voltage applied to the device is suddenly increased. In this case, there is a problem that the turn-on speed of the semiconductor switching element Q1 becomes excessive, resulting in an increase in surge voltage and radiation noise.
- the gate voltage initially applied when the semiconductor switching element Q1 is turned on is fixed to the fixed voltage of the power source E3. Therefore, the gate voltage of the semiconductor switching element increases slowly. Thereby, it is possible to suppress an increase in turn-on speed due to an increase in the power supply output voltage of the gate drive circuit power supply E1, and therefore it is possible to suppress an increase in surge voltage and radiation noise.
- the PWM control unit 1 changes the power output voltage of the gate drive circuit power supply E1 based on a predetermined change pattern. Therefore, even if the waveform of the load current is a sine wave or the like, the power output voltage of the gate drive circuit power supply E1 can be changed appropriately. Note that even if the waveform of the load current is a sine wave or the like, there is little need to appropriately change the power supply output voltage of the gate drive circuit power supply E1, and the actual value of the load current of the semiconductor switching element Q1 can be detected. In some cases.
- the PWM control unit 1 measures the actual value of the load current of the semiconductor switching element Q1, not based on a predetermined change pattern, and changes the gate drive circuit power supply based on the actual value.
- the power output voltage of E1 may be changed.
- the semiconductor switching element Q1 may be, for example, an IGBT (Insulated Gate Bipolar Transistor) or an RC-IGBT (Reverse Conducting - IGBT). Further, the material of the semiconductor switching element Q1 may be ordinary silicon (Si), or may be a wide bandgap semiconductor such as silicon carbide (SiC), gallium nitride (GaN), or diamond. When the material of the semiconductor switching element Q1 is a wide bandgap semiconductor, stable operation under high temperature and high voltage and high switching speed are possible.
- IGBT Insulated Gate Bipolar Transistor
- RC-IGBT Reverse Conducting - IGBT
- the material of the semiconductor switching element Q1 may be ordinary silicon (Si), or may be a wide bandgap semiconductor such as silicon carbide (SiC), gallium nitride (GaN), or diamond.
- the gate drive circuit 2 in FIG. 1 includes the inverter circuit INV
- the gate drive circuit 2 may not include the inverter circuit INV.
- the first switch S1, the second switch S2, and the third switch S3 are each composed of an NPN transistor, an NPN transistor, and a PNPN transistor, as in the complementary transistor shown in FIG. No circuit INV is required.
- the configuration of the gate drive circuit 2 is not limited to the configuration shown in FIG. 1 as long as the circuit output voltage as shown in FIG. 4 can be obtained.
- FIG. 6 is a circuit diagram showing the configuration of a drive device according to the second embodiment.
- constituent elements according to the second embodiment constituent elements that are the same or similar to the above-mentioned constituent elements will be given the same or similar reference numerals, and different constituent elements will be mainly explained.
- the configuration of the drive device in FIG. 6 is similar to the configuration of the drive device in FIG. 1 in which the PWM control section 1 is replaced with the control section 3, and the load section 9 is replaced with an inductive load L1 and a flywheel diode D1.
- the drain of the semiconductor switching element Q1 is connected to a power source E2 via an inductive load L1 and a flywheel diode D1 that are connected in parallel.
- a gate drive signal used as an S/H (sampling and hold) instruction and a load current detection signal indicating the sampled load current of the semiconductor switching element Q1 are input to the control unit 3 in FIG.
- the control unit 3 changes the power output voltage of the gate drive circuit power supply E1 based on the load current of the semiconductor switching element Q1 sampled when the gate drive signal is turned off.
- control unit 3 performs control to change the power output voltage of the gate drive circuit power source E1 by changing the voltage control signal based on the relevant information related to the load current of the semiconductor switching element Q1.
- the relevant information here is the load current sampled when the gate drive signal is turned off.
- the other configuration of the second embodiment is the same as the configuration of the first embodiment.
- the delay circuit DLC performs control to supply the fixed voltage of the power source E3 to the gate of the semiconductor switching element Q1 for a predetermined period, and then applies the gate drive signal to the gate. Control is performed to supply the power output voltage of the circuit power supply E1.
- FIG. 7 is a diagram showing the operation of the control unit 3 that changes the power supply output voltage of the gate drive circuit power supply E1, among the operations of the drive device according to the second embodiment. Note that among the operations of the drive device according to the second embodiment, the operation regarding the circuit output voltage of the gate drive circuit 2 is the same as the operation regarding the circuit output voltage described in the first embodiment using FIG. The operation of the control section 3 that changes the power supply output voltage of the gate drive circuit power supply E1 will be mainly described below.
- the control unit 3 samples the load current of the semiconductor switching element Q1 at timings t1, t3, t5, . . . when the semiconductor switching element Q1 turns off. Then, the control section 3 changes the power output voltage of the gate drive circuit power source E1 based on the sampled load current during the off periods t1 to t2, t3 to t4, . . . of the semiconductor switching element Q1, and then changes the power output voltage of the gate drive circuit power source E1 to The power supply output voltage is maintained until timing t3, t5, . For example, the control unit 3 increases the power supply output voltage if the sampled load current is larger than the previous sampling, and decreases the power supply output voltage if the sampled load current is smaller than the previous sampling. The control unit 3 may increase or decrease the power supply output voltage of the gate drive circuit power supply E1 in steps, or may make it proportional to the effective value of the load current.
- the control unit 3 changes the power output voltage of the gate drive circuit power supply E1 based on the relevant information related to the load current of the semiconductor switching element Q1.
- the steady loss of the semiconductor switching element Q1 can be reduced, and the failure of the gate of the semiconductor switching element Q1 and the gate drive circuit 2 can be reduced.
- the gate voltage initially applied when the semiconductor switching element Q1 is turned on is fixed to the fixed voltage of the power supply E3. , increases in surge voltage and radiation noise can be suppressed.
- the power output voltage of the gate drive circuit power supply E1 is changed during the period when the semiconductor switching element Q1 is on, so that the influence of the change is on the semiconductor switching element Q1. We need to keep the changes short so we don't fall short.
- the control unit 3 controls the power supply output voltage of the gate drive circuit power supply E1 based on the load current of the semiconductor switching element Q1 sampled when the gate drive signal is turned off. change.
- the power output voltage of the gate drive circuit power supply E1 can be changed during the period when the semiconductor switching element Q1 is off, so that the influence of changing the power supply output voltage is reduced to the semiconductor switching element Q1. It is possible to prevent this from happening. Further, changes in the instantaneous value of the load current can be reflected to some extent in changes in the power supply output voltage of the gate drive circuit power supply E1.
- FIG. 8 is a circuit diagram showing the configuration of the drive device according to the third embodiment.
- the same or similar components as those described above will be given the same or similar reference numerals, and different components will be mainly explained.
- the drive device in FIG. 8 includes a gate drive circuit power supply E1, a control section 4, a gate drive circuit 5, a first resistor RG1, and a second resistor RG2.
- the drive device in FIG. 8 is connected to the gate of the semiconductor switching element Q1, and drives the semiconductor switching element Q1 based on the on and off states of the gate drive signal.
- the drain of the semiconductor switching element Q1 is connected to a power source E2 via an inductive load L1 and a flywheel diode D1 that are connected in parallel.
- the gate drive circuit power supply E1 is configured to be able to change the power supply output voltage, which is the voltage output by the gate drive circuit power supply E1.
- control unit 4 Similar to the control unit 3 according to the second embodiment, the control unit 4 outputs a power source from the gate drive circuit power source E1 based on the load current of the semiconductor switching element Q1 sampled when the gate drive signal is turned off. Change voltage.
- the control unit 4 in FIG. 8 is capable of outputting an on-resistance switching signal to an AND circuit U1 of a gate drive circuit 5, which will be described later.
- the first resistor RG1 and the second resistor RG2 are connected between the gate of the semiconductor switching element Q1 and the gate drive circuit 5.
- the gate drive circuit 5 in FIG. 8 includes a first switch S1, a second switch S2, a third switch S3, an inverter circuit INV that is a NOT circuit, and an AND circuit U1.
- One end of the first switch S1 is connected to the gate drive circuit power supply E1, and the other end of the first switch S1 is connected to the first resistor RG1.
- the first switch S1 is turned on and off by a gate drive signal. controlled. Thereby, the first resistor RG1 can be connected between the gate drive circuit power supply E1 and the gate of the semiconductor switching element Q1.
- One end of the second switch S2 is connected to the gate drive circuit power supply E1, the other end of the second switch S2 is connected to the second resistor RG2, and the ON and OFF of the second switch S2 is controlled by the AND circuit U1. Controlled by output signal.
- the second resistor RG2 can be connected in parallel with the first resistor RG1 between the gate drive circuit power supply E1 and the gate of the semiconductor switching element Q1.
- One end of the third switch S3 is connected to the reference voltage GND, the other end of the third switch S3 is connected to the resistor RG, and the on/off state of the third switch S3 is controlled by the gate inverted by the inverter circuit INV. Controlled by a drive signal.
- the AND circuit U1 performs an AND operation based on the on-resistance switching signal from the control unit 4 and the gate drive signal, and outputs the result as an output signal of the AND circuit U1. That is, the AND circuit U1 outputs ON only when the ON resistance switching signal is ON and the gate drive signal is ON.
- the control unit 4 selectively performs high resistance control with a high turn-on gate resistance and low resistance control with a low turn-on gate resistance based on the load current. This operation of the control section 4 will be explained in detail later.
- the third embodiment when the load current of the semiconductor switching element Q1 sampled when the gate drive signal is on is equal to or less than the threshold value TH1 in FIG. Output.
- the on-resistance switching signal indicating off is output and the gate drive signal is on
- the first switch S1 is turned on
- the second switch S2 and third switch S3 are turned off. Therefore, the power output voltage of the gate drive circuit power supply E1 is supplied to the gate of the semiconductor switching element Q1 via the first resistor RG1. Therefore, as shown in FIG. 9, the turn-on gate resistance when the load current is less than or equal to the threshold value TH1 is the first resistance RG1.
- the control unit 4 outputs an on-resistance switching signal indicating on.
- the on-resistance switching signal indicating on is output and the gate drive signal is on, the first switch S1 and the second switch S2 are turned on, and the third switch S3 is turned off. Therefore, the power output voltage of the gate drive circuit power source E1 is supplied to the gate of the semiconductor switching element Q1 via the first resistor RG1 and the second resistor RG2. Therefore, as shown in FIG. 9, the turn-on gate resistance when the load current exceeds the threshold TH1 is a parallel composite resistance (RG1 ⁇ RG2/(RG1+RG2)) of the first resistor RG1 and the second resistor RG2.
- the turn-on gate resistance becomes the first resistance RG1.
- the turn-on gate resistance becomes a parallel composite resistance of the first resistance RG1 and the second resistance RG2. Resistance control is performed.
- the load current of the semiconductor switching element Q1 sampled when the gate drive signal is on is equal to or less than the threshold value TH2 which is larger than the threshold value TH1 in FIG. Keep output voltage constant.
- the load current of the semiconductor switching element Q1 sampled when the gate drive signal is on exceeds the threshold TH2 in FIG. Increase the power supply output voltage.
- FIG. 10 is a diagram showing the operation of the driving device according to the third embodiment, and specifically, a diagram showing the transition of the gate voltage of the semiconductor switching element Q1 due to the operation of the driving device.
- the dotted line indicates the circuit output voltage of the gate drive circuit 2 during high resistance control where the turn-on gate resistance is high
- the solid line indicates the circuit output voltage of the gate drive circuit 2 during low resistance control where the turn-on gate resistance is low.
- the control unit 4 outputs the power source of the gate drive circuit power source E1 based on the load current of the semiconductor switching element Q1 sampled when the gate drive signal is turned off. Change voltage.
- the power output voltage of the gate drive circuit power supply E1 is changed during the period when the semiconductor switching element Q1 is off, the effect of changing the power supply output voltage is exerted on the semiconductor switching element Q1. This can be suppressed. Further, changes in the instantaneous value of the load current can be reflected to some extent in changes in the power supply output voltage of the gate drive circuit power supply E1.
- the turn-on gate resistance becomes high. Therefore, since the switching speed at turn-on is reduced, surge voltage and radiation noise can be suppressed.
- the load current of the semiconductor switching element Q1 exceeds the threshold value TH1, the turn-on gate resistance becomes low. Therefore, since the switching speed during turn-on is increased, switching loss during the turn-on period can be reduced.
- a signal obtained by inverting the on-resistance switching signal may be used instead of the on-resistance switching signal.
- the turn-on gate resistance increases, so the turn-on speed can be reduced.
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Abstract
ターンオン速度を適切化可能な技術を提供することを目的とする。駆動装置は、出力電圧を変更可能なゲート駆動回路電源と、出力電圧よりも低い固定電圧を有する電源と、半導体スイッチング素子の負荷電流に関連する関連情報に基づいて、ゲート駆動回路電源の出力電圧を変更するコントロール部と、ゲート駆動信号がオンになった場合に、半導体スイッチング素子のゲートに、固定電圧を予め定められた期間供給する制御を行った後、ゲートに、出力電圧を供給する制御を行うディレイ回路とを備える。
Description
本開示は、駆動装置に関する。
電圧制御型半導体スイッチング素子などの半導体スイッチング素子を駆動する駆動装置について様々な技術が提案されている。例えば特許文献1及び2には、電圧制御型半導体スイッチング素子の定常損失を低減するために、電圧制御型半導体スイッチング素子のゲートに供給される電圧を負荷電流に基づいて増減する技術が提案されている。
一般的に、半導体スイッチング素子の負荷電流がゼロまたは低い場合には、半導体スイッチング素子のターンオン速度は増加する。また、ターンオン時に半導体スイッチング素子のゲートに印加される電圧が急峻に増加すると、半導体スイッチング素子のターンオン速度が増加する。
これらにも関わらず特許文献1及び2の技術では、ゲートに印加される電圧を単純に増加するため、交流の負荷電流が瞬間的にゼロまたは低いときに、ゲートに印加される電圧を急峻に増加する場合がある。この場合、半導体スイッチング素子のターンオン速度が過大となり、サージ電圧及び放射ノイズが大きくなってしまうという問題がある。
そこで、本開示は、上記のような問題点に鑑みてなされたものであり、ターンオン速度を適切化可能な技術を提供することを目的とする。
本開示に係る駆動装置は、ゲート駆動信号のオン及びオフに基づいて半導体スイッチング素子を駆動する駆動装置であって、出力電圧を変更可能なゲート駆動回路電源と、前記出力電圧よりも低い固定電圧を有する電源と、前記半導体スイッチング素子の負荷電流に関連する関連情報に基づいて、前記ゲート駆動回路電源の前記出力電圧を変更するコントロール部と、前記ゲート駆動信号がオンになった場合に、前記半導体スイッチング素子のゲートに、前記固定電圧を予め定められた期間供給する制御を行った後、前記ゲートに、前記出力電圧を供給する制御を行うディレイ回路とを備える。
本開示によれば、ゲート駆動信号がオンになった場合に、半導体スイッチング素子のゲートに、固定電圧を予め定められた期間供給する制御を行った後、ゲートに、出力電圧を供給する制御を行う。このような構成によれば、ターンオン速度を適切化することができる。
本開示の目的、特徴、局面及び利点は、以下の詳細な説明と添付図面とによって、より明白となる。
<実施の形態1>
図1は、本実施の形態1に係る駆動装置の構成を示す回路図である。図1の駆動装置は、ゲート駆動回路電源E1と、コントロール部であるPWM制御部1と、ゲート駆動回路2と、抵抗RGとを備える。
図1は、本実施の形態1に係る駆動装置の構成を示す回路図である。図1の駆動装置は、ゲート駆動回路電源E1と、コントロール部であるPWM制御部1と、ゲート駆動回路2と、抵抗RGとを備える。
図1の駆動装置は、電圧制御型半導体スイッチング素子である半導体スイッチング素子Q1のゲートと接続されている。図1の駆動装置は、ゲート駆動信号のオン及びオフに基づいて半導体スイッチング素子Q1を駆動する。
本実施の形態1に係る半導体スイッチング素子Q1は、図2のようにインバータ回路で用いられ、インバータ回路を構成する。図2のインバータ回路は、半導体スイッチング素子Q1~Q6に、フライホイールダイオードD1~D6がそれぞれ並列接続されている。そして、上アームである半導体スイッチング素子Q2,Q4,Q6と、下アームである半導体スイッチング素子Q1,Q3,Q5とがそれぞれ直列接続され、3組の上下アームと電源E2とが並列接続されている。なお図1では便宜上、図2の図示は省略されており、半導体スイッチング素子Q1は、負荷部9を介して電源E2に接続されている。
以下、半導体スイッチング素子Q1は、MOSFET(Metal Oxide Semiconductor Field Effect Transistor)であるものとして説明するが、後述するように、MOSFETに限ったものではない。
次に、本実施の形態1に係る駆動装置の構成要素について詳細に説明する。
ゲート駆動回路電源E1は、ゲート駆動回路電源E1が出力する電圧である出力電圧を変更可能に構成されている。以下、ゲート駆動回路電源E1の出力電圧を、電源出力電圧を記すこともある。
PWM制御部1は、矩形波状のゲート駆動信号をゲート駆動回路2に出力する。PWM制御部1は、ゲート駆動信号のオン時間とオフ時間との比であるデューティ比を可変して、ゲート駆動回路2の出力を制御することによって、半導体スイッチング素子Q1の負荷電流を制御する。半導体スイッチング素子Q1の負荷電流は、例えば、負荷部9などと接続された半導体スイッチング素子Q1のソース-ドレインなどに流れる電流である。
また、PWM制御部1は、電圧制御信号をゲート駆動回路電源E1に出力する。PWM制御部1は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、電圧制御信号を変更することにより、ゲート駆動回路電源E1の電源出力電圧を変更する制御を行う。本実施の形態1では、負荷電流に関連する関連情報は、負荷電流の実効値に対して予め定められた電源出力電圧の変更パターンであり、この変更パターンはPWM制御部1に予め記憶される。
図3は、電源出力電圧の変更パターンの一例を示す図である。細い実線は、負荷電流の瞬時値を示し、細い点線は、負荷電流の実効値を示し、太い実線は、電源出力電圧の変更パターンを示す。負荷電流の瞬時値は、ゲート駆動信号の波形に対応しており、ゲート駆動信号のオン及びオフに応じて変化する。図2の出力(U,V,W)に接続される負荷には、負荷電流の瞬時値で示される交流電流が流れる。
PWM制御部1は、負荷電流の実効値が大きい場合にゲート駆動回路電源E1の電源出力電圧を大きくし、負荷電流の実効値が小さい場合にゲート駆動回路電源E1の電源出力電圧を小さくするように、ゲート駆動回路電源E1の電源出力電圧を制御する。PWM制御部1は、ゲート駆動回路電源E1の電源出力電圧を、図3のように段階的に増減させてもよいし、負荷電流の実効値に比例させてもよい。例えばPWM制御部1は、ゲート駆動信号のオン及びオフの回数と、予め定められた変更パターンとに基づいて、ゲート駆動回路電源E1の電源出力電圧を変更してもよい。
図1の抵抗RGは、半導体スイッチング素子Q1のゲートとゲート駆動回路2との間に接続される。
図1のゲート駆動回路2は、電源E3と、第1スイッチS1と、第2スイッチS2と、第3スイッチS3と、NOT回路であるインバータ回路INVと、ディレイ回路DLCとを備える。
電源E3は、ゲート駆動回路電源E1の電源出力電圧よりも低い固定電圧を有する。
第1スイッチS1の一端は、電源E3に接続され、第1スイッチS1の他端は、抵抗RGと接続されており、第1スイッチS1のオン及びオフは、ディレイ回路DLCによって制御される。
第2スイッチS2の一端は、ゲート駆動回路電源E1に接続され、第2スイッチS2の他端は、抵抗RGと接続されており、第2スイッチS2のオン及びオフは、ディレイ回路DLCによって制御される。
第3スイッチS3の一端は、基準電圧GNDに接続され、第3スイッチS3の他端は、抵抗RGと接続されており、第3スイッチS3のオン及びオフは、インバータ回路INVで反転されたゲート駆動信号によって制御される。
ゲート駆動信号がオンになった場合、電源E3の固定電圧が、半導体スイッチング素子Q1のゲートに予め定められた期間供給されるように、ディレイ回路DLCは、第1スイッチS1をオンし、第2スイッチS2をオフする制御を行う。電源E3の固定電圧がゲートに予め定められた期間供給された後、ゲート駆動回路電源E1の電源出力電圧が、半導体スイッチング素子Q1のゲートに供給されるように、ディレイ回路DLCは、第1スイッチS1をオフし、第2スイッチS2をオンする制御を行う。
ディレイ回路DLCは、ゲート駆動信号がオフになった場合に、第1スイッチS1をオフし、第2スイッチS2をオフする制御を行う。この場合には、インバータ回路INVで反転されたゲート駆動信号によって第3スイッチS3がオンされ、半導体スイッチング素子Q1のゲートに、基準電圧GNDが供給される。つまり本実施の形態1では、第1スイッチS1、第2スイッチS2、及び、第3スイッチS3が排他的にオンされる。
<動作>
図4は、本実施の形態1に係る駆動装置の動作を示す図である。以下、ゲート駆動回路電源E1の電源出力電圧と区別するために、ゲート駆動回路2の出力電圧を、回路出力電圧と記すこともある。図4には、ゲート駆動信号と、第1スイッチS1のオン及びオフと、第2スイッチS2のオン及びオフと、回路出力電圧と、半導体スイッチング素子Q1のゲート電圧とが示されている。
図4は、本実施の形態1に係る駆動装置の動作を示す図である。以下、ゲート駆動回路電源E1の電源出力電圧と区別するために、ゲート駆動回路2の出力電圧を、回路出力電圧と記すこともある。図4には、ゲート駆動信号と、第1スイッチS1のオン及びオフと、第2スイッチS2のオン及びオフと、回路出力電圧と、半導体スイッチング素子Q1のゲート電圧とが示されている。
時点T0にて、ゲート駆動信号がオフからオンになると、第1スイッチS1がオンされる。これにより、回路出力電圧は電源E3の電圧となり、ゲート電圧は上昇する。時点T1から時点T2までの間はミラー期間であり、そのミラー期間では、ゲート電圧は、電源E3の電圧よりも小さい電圧で一定になる。時点T2にてミラー期間が終了すると、ゲート電圧は電源E3の固定電圧に近づくように上昇する。
時点T3にてゲート電圧は、電源E3の固定電圧程度になる。図4の例では、そのタイミングで、ディレイ回路DLCの制御により、第1スイッチS1がオフされ、第2スイッチS2がオンされる。これにより、回路出力電圧はゲート駆動回路電源E1の電源出力電圧となり、時点T3以降においてもゲート電圧は上昇する。
なお、図4の例では、第1スイッチS1,S2が切り替えられるタイミングは、ゲート電圧が電源E3の固定電圧程度になるタイミングと同じであったが、これに限ったものではない。例えば、第1スイッチS1,S2が切り替えられるタイミングは、ゲート電圧が電源E3の固定電圧程度になるタイミングの前または後であってもよいし、ミラー期間中であってもよい。
図4の時点T3より後では、上述したように、負荷電流が低い場合には電源出力電圧が低くなり、負荷電流が高い場合には電源出力電圧が高くなるので、そのことが、回路出力電圧、及び、ゲート電圧に反映される。
図示しないが、ゲート駆動信号がオンからオフになると、第1スイッチS1及び第2スイッチS2はオフされ、第3スイッチS3はオンされる。これにより、回路出力電圧は基準電圧GNDとなり、ゲート電圧は下降し、半導体スイッチング素子Q1はターンオフする。
<実施の形態1のまとめ>
本実施の形態1に係る駆動装置によれば、PWM制御部1は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、図3及び図4に示すように、負荷電流増加時に半導体スイッチング素子Q1へ印加されるゲート電圧が増加するので、半導体スイッチング素子Q1のオン時の電圧を低減することができ、半導体スイッチング素子Q1の定常損失を低減することができる。また、負荷電流が最大の条件で動作する時間が、動作時間全体に占める割合が低くなり、半導体スイッチング素子Q1のゲート及びゲート駆動回路2に印加される平均電圧が、ゲート駆動回路電源E1の電源出力電圧の最大電圧より低くなる。このため、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障の低減が期待できる。
本実施の形態1に係る駆動装置によれば、PWM制御部1は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、図3及び図4に示すように、負荷電流増加時に半導体スイッチング素子Q1へ印加されるゲート電圧が増加するので、半導体スイッチング素子Q1のオン時の電圧を低減することができ、半導体スイッチング素子Q1の定常損失を低減することができる。また、負荷電流が最大の条件で動作する時間が、動作時間全体に占める割合が低くなり、半導体スイッチング素子Q1のゲート及びゲート駆動回路2に印加される平均電圧が、ゲート駆動回路電源E1の電源出力電圧の最大電圧より低くなる。このため、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障の低減が期待できる。
ここで一般的に、半導体スイッチング素子の負荷電流がゼロまたは低い場合には、半導体スイッチング素子のターンオン速度は増加する。また、ターンオン時に半導体スイッチング素子のゲートに印加される電圧が急峻に増加すると、半導体スイッチング素子のターンオン速度が増加する。このため、半導体スイッチング素子Q1の定常損失低減のために、負荷電流の実効値の増加に対応させてゲート電圧を単準に増加すると、交流の負荷電流の瞬時値がゼロまたは低いときに、ゲートに印加される電圧を急峻に増加する場合がある。この場合、半導体スイッチング素子Q1のターンオン速度が過大となり、サージ電圧及び放射ノイズが大きくなってしまうという問題がある。
これに対して本実施の形態1では、半導体スイッチング素子Q1がターンオンする際に最初に印加されるゲート電圧は電源E3の固定電圧に固定される。このため、半導体スイッチング素子のゲート電圧の増加が緩やかになる。これにより、ゲート駆動回路電源E1の電源出力電圧の増加によるターンオン速度の増加を抑制することができるので、サージ電圧及び放射ノイズの増加を抑制することができる。
また本実施の形態1では、PWM制御部1は、予め定められた変更パターンに基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。このため、負荷電流の波形が正弦波などであっても、ゲート駆動回路電源E1の電源出力電圧を適切に変更することができる。なお、負荷電流の波形が正弦波などであっても、ゲート駆動回路電源E1の電源出力電圧を適切に変更する必要性が低く、かつ、半導体スイッチング素子Q1の負荷電流の実行値が検出される場合もある。そのような場合には、PWM制御部1は、予め定められた変更パターンに基づいてではなく、半導体スイッチング素子Q1の負荷電流の実行値を計測し、当該実行値に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更してもよい。
<変形例>
半導体スイッチング素子Q1は、例えば、IGBT(Insulated Gate Bipolar Transistor)、及び、RC-IGBT(Reverse Conducting - IGBT)などであってもよい。また半導体スイッチング素子Q1の材料は、通常の珪素(Si)であってもよいし、炭化珪素(SiC)、窒化ガリウム(GaN)、及び、ダイヤモンドなどのワイドバンドギャップ半導体であってもよい。半導体スイッチング素子Q1の材料がワイドバンドギャップ半導体である場合には、高温下及び高電圧下の安定動作、及び、スイッチング速度の高速化が可能となる。
半導体スイッチング素子Q1は、例えば、IGBT(Insulated Gate Bipolar Transistor)、及び、RC-IGBT(Reverse Conducting - IGBT)などであってもよい。また半導体スイッチング素子Q1の材料は、通常の珪素(Si)であってもよいし、炭化珪素(SiC)、窒化ガリウム(GaN)、及び、ダイヤモンドなどのワイドバンドギャップ半導体であってもよい。半導体スイッチング素子Q1の材料がワイドバンドギャップ半導体である場合には、高温下及び高電圧下の安定動作、及び、スイッチング速度の高速化が可能となる。
また図1のゲート駆動回路2は、インバータ回路INVを備えたが、ゲート駆動回路2は、インバータ回路INVを備えなくてもよい。例えば、図5の相補型のトランジスタのように、第1スイッチS1、第2スイッチS2、第3スイッチS3が、それぞれNPN型トランジスタ、NPN型トランジスタ、PNPN型トランジスタから構成される場合には、インバータ回路INVは不要である。また、図4のような回路出力電圧が得られるのであれば、ゲート駆動回路2の構成は図1の構成に限ったものではない。
なお、本変形例は、以下の実施の形態2以降においても適宜適用されてもよい。
<実施の形態2>
図6は、本実施の形態2に係る駆動装置の構成を示す回路図である。以下、本実施の形態2に係る構成要素のうち、上述の構成要素と同じまたは類似する構成要素については同じまたは類似する参照符号を付し、異なる構成要素について主に説明する。
図6は、本実施の形態2に係る駆動装置の構成を示す回路図である。以下、本実施の形態2に係る構成要素のうち、上述の構成要素と同じまたは類似する構成要素については同じまたは類似する参照符号を付し、異なる構成要素について主に説明する。
図6の駆動装置の構成は、図1の駆動装置の構成において、PWM制御部1をコントロール部3に置き換え、負荷部9を誘導負荷L1及びフライホイールダイオードD1に置き換えた構成と同様である。半導体スイッチング素子Q1のドレインは、並列接続された誘導負荷L1及びフライホイールダイオードD1を介して電源E2に接続されている。
図6のコントロール部3には、S/H(サンプリング&ホールド)指示として用いられるゲート駆動信号と、サンプリングされた半導体スイッチング素子Q1の負荷電流を示す負荷電流検出信号とが入力される。コントロール部3は、ゲート駆動信号がオフになったときにサンプリングされる半導体スイッチング素子Q1の負荷電流に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。
換言すれば、コントロール部3は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、電圧制御信号を変更することにより、ゲート駆動回路電源E1の電源出力電圧を変更する制御を行う。ここでいう関連情報は、ゲート駆動信号がオフになったときにサンプリングされる負荷電流である。
実施の形態2のそれ以外の構成は、実施の形態1の構成と同様である。例えば、ディレイ回路DLCは、ゲート駆動信号がオンになった場合に、半導体スイッチング素子Q1のゲートに、電源E3の固定電圧を予め定められた期間供給する制御を行った後、ゲートに、ゲート駆動回路電源E1の電源出力電圧を供給する制御を行う。
<動作>
図7は、本実施の形態2に係る駆動装置の動作のうち、ゲート駆動回路電源E1の電源出力電圧を変更するコントロール部3の動作を示す図である。なお、本実施の形態2に係る駆動装置の動作のうち、ゲート駆動回路2の回路出力電圧に関する動作は、実施の形態1で図4を用いて説明した回路出力電圧に関する動作と同様である。以下、ゲート駆動回路電源E1の電源出力電圧を変更するコントロール部3の動作について主に説明する。
図7は、本実施の形態2に係る駆動装置の動作のうち、ゲート駆動回路電源E1の電源出力電圧を変更するコントロール部3の動作を示す図である。なお、本実施の形態2に係る駆動装置の動作のうち、ゲート駆動回路2の回路出力電圧に関する動作は、実施の形態1で図4を用いて説明した回路出力電圧に関する動作と同様である。以下、ゲート駆動回路電源E1の電源出力電圧を変更するコントロール部3の動作について主に説明する。
半導体スイッチング素子Q1がターンオフした場合、図6の誘導負荷L1のため、図7の破線に示されるようにフライホイールダイオードD1に負荷電流が還流する。
コントロール部3は、半導体スイッチング素子Q1がターンオフするタイミングt1,t3,t5,…にて、半導体スイッチング素子Q1の負荷電流をサンプリングする。そして、コントロール部3は、半導体スイッチング素子Q1のオフ期間t1~t2,t3~t4,…にて、サンプリングされた負荷電流に基づいてゲート駆動回路電源E1の電源出力電圧を変更した後、次のタイミングt3,t5,…まで電源出力電圧を維持する。例えば、コントロール部3は、サンプリングされた負荷電流が前回のサンプリングよりも大きければ電源出力電圧を増加し、サンプリングされた負荷電流が前回のサンプリングよりも小さければ電源出力電圧を減少する。コントロール部3は、ゲート駆動回路電源E1の電源出力電圧を、段階的に増減させてもよいし、負荷電流の実効値に比例させてもよい。
<実施の形態2のまとめ>
本実施の形態2に係る駆動装置によれば、コントロール部3は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、実施の形態1と同様に、半導体スイッチング素子Q1の定常損失を低減することができ、かつ、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障を低減することができる。また本実施の形態2では実施の形態1と同様に、半導体スイッチング素子Q1がターンオンする際に最初に印加されるゲート電圧は電源E3の固定電圧に固定されるので、実施の形態1と同様に、サージ電圧及び放射ノイズの増加を抑制することができる。
本実施の形態2に係る駆動装置によれば、コントロール部3は、半導体スイッチング素子Q1の負荷電流に関連する関連情報に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、実施の形態1と同様に、半導体スイッチング素子Q1の定常損失を低減することができ、かつ、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障を低減することができる。また本実施の形態2では実施の形態1と同様に、半導体スイッチング素子Q1がターンオンする際に最初に印加されるゲート電圧は電源E3の固定電圧に固定されるので、実施の形態1と同様に、サージ電圧及び放射ノイズの増加を抑制することができる。
ここで例えば、特許文献2などの従来技術は、半導体スイッチング素子Q1がオンしている期間に、ゲート駆動回路電源E1の電源出力電圧を変更するので、その変更中の影響が半導体スイッチング素子Q1に及ばないように、その変更を短くする必要がある。
これに対して本実施の形態2では、コントロール部3は、ゲート駆動信号がオフになったときにサンプリングされる半導体スイッチング素子Q1の負荷電流に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。このような構成によれば、半導体スイッチング素子Q1がオフしている期間に、ゲート駆動回路電源E1の電源出力電圧を変更することができるので、電源出力電圧の変更中の影響が半導体スイッチング素子Q1に及ぶことを抑制することができる。また、負荷電流の瞬時値の変化を、ゲート駆動回路電源E1の電源出力電圧の変更にある程度反映することができる。
<実施の形態3>
図8は、本実施の形態3に係る駆動装置の構成を示す回路図である。以下、本実施の形態3に係る構成要素のうち、上述の構成要素と同じまたは類似する構成要素については同じまたは類似する参照符号を付し、異なる構成要素について主に説明する。
図8は、本実施の形態3に係る駆動装置の構成を示す回路図である。以下、本実施の形態3に係る構成要素のうち、上述の構成要素と同じまたは類似する構成要素については同じまたは類似する参照符号を付し、異なる構成要素について主に説明する。
図8の駆動装置は、ゲート駆動回路電源E1と、コントロール部4と、ゲート駆動回路5と、第1抵抗RG1と、第2抵抗RG2とを備える。
図8の駆動装置は、半導体スイッチング素子Q1のゲートと接続されており、ゲート駆動信号のオン及びオフに基づいて半導体スイッチング素子Q1を駆動する。半導体スイッチング素子Q1のドレインは、並列接続された誘導負荷L1及びフライホイールダイオードD1を介して電源E2に接続されている。
次に、本実施の形態3に係る駆動装置の構成要素について詳細に説明する。
ゲート駆動回路電源E1は、ゲート駆動回路電源E1が出力する電圧である電源出力電圧を変更可能に構成されている。
コントロール部4は、実施の形態2に係るコントロール部3と同様に、ゲート駆動信号がオフになったときにサンプリングされる半導体スイッチング素子Q1の負荷電流に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。図8のコントロール部4は、オン抵抗切替信号を、後述するゲート駆動回路5のAND回路U1に出力可能になっている。
第1抵抗RG1及び第2抵抗RG2は、半導体スイッチング素子Q1のゲートとゲート駆動回路5との間に接続される。
図8のゲート駆動回路5は、第1スイッチS1と、第2スイッチS2と、第3スイッチS3と、NOT回路であるインバータ回路INVと、AND回路U1とを備える。
第1スイッチS1の一端は、ゲート駆動回路電源E1に接続され、第1スイッチS1の他端は、第1抵抗RG1と接続されており、第1スイッチS1のオン及びオフは、ゲート駆動信号によって制御される。これにより、第1抵抗RG1は、ゲート駆動回路電源E1と半導体スイッチング素子Q1のゲートとの間に接続可能となっている。
第2スイッチS2の一端は、ゲート駆動回路電源E1に接続され、第2スイッチS2の他端は、第2抵抗RG2と接続されており、第2スイッチS2のオン及びオフは、AND回路U1の出力信号によって制御される。これにより、第2抵抗RG2は、ゲート駆動回路電源E1と半導体スイッチング素子Q1のゲートとの間に、第1抵抗RG1と並列接続可能となっている。
第3スイッチS3の一端は、基準電圧GNDに接続され、第3スイッチS3の他端は、抵抗RGと接続されており、第3スイッチS3のオン及びオフは、インバータ回路INVで反転されたゲート駆動信号によって制御される。
AND回路U1は、コントロール部4からのオン抵抗切替信号と、ゲート駆動信号とに基づいてAND演算を行い、その結果をAND回路U1の出力信号として出力する。つまり、AND回路U1は、オン抵抗切替信号がオンであり、かつ、ゲート駆動信号がオンである場合にのみオンを出力する。
以下、ターンオン時の半導体スイッチング素子Q1のゲートに接続される抵抗を、ターンオンゲート抵抗と記す。本実施の形態3に係るコントロール部4は、負荷電流に基づいて、ターンオンゲート抵抗が高い高抵抗制御と、ターンオンゲート抵抗が低い低抵抗制御とを選択的に行う。コントロール部4のこの動作については後で詳細に説明する。
<動作>
本実施の形態3に係る駆動装置の動作のうち、ゲート駆動回路電源E1の電源出力電圧を変更する動作は、実施の形態2で図7を用いて説明した動作と同様である。
本実施の形態3に係る駆動装置の動作のうち、ゲート駆動回路電源E1の電源出力電圧を変更する動作は、実施の形態2で図7を用いて説明した動作と同様である。
本実施の形態3では、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が、図9の閾値TH1以下である場合に、コントロール部4は、オフを示すオン抵抗切替信号を出力する。オフを示すオン抵抗切替信号が出力され、かつ、ゲート駆動信号がオンである場合、第1スイッチS1はオンし、第2スイッチS2及び第3スイッチS3はオフする。このため、ゲート駆動回路電源E1の電源出力電圧は、第1抵抗RG1を介して半導体スイッチング素子Q1のゲートに供給される。したがって図9のように、負荷電流が閾値TH1以下である場合のターンオンゲート抵抗は、第1抵抗RG1となる。
一方、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が、図9の閾値TH1を超える場合に、コントロール部4は、オンを示すオン抵抗切替信号を出力する。オンを示すオン抵抗切替信号が出力され、かつ、ゲート駆動信号がオンである場合、第1スイッチS1及び第2スイッチS2はオンし、第3スイッチS3はオフする。このため、ゲート駆動回路電源E1の電源出力電圧は、第1抵抗RG1及び第2抵抗RG2を介して半導体スイッチング素子Q1のゲートに供給される。したがって図9のように、負荷電流が閾値TH1を超える場合のターンオンゲート抵抗は、第1抵抗RG1と第2抵抗RG2との並列合成抵抗(RG1×RG2/(RG1+RG2))となる。
以上のように、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が閾値TH1以下である場合には、ターンオンゲート抵抗が第1抵抗RG1となる高抵抗制御が行われる。一方、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が閾値TH1を超える場合には、ターンオンゲート抵抗が第1抵抗RG1と第2抵抗RG2との並列合成抵抗となる低抵抗制御が行われる。
また、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が、図9の閾値TH1より大きい閾値TH2以下である場合には、コントロール部4は、ゲート駆動回路電源E1の電源出力電圧を一定に維持する。一方、ゲート駆動信号がオンのときにサンプリングされる半導体スイッチング素子Q1の負荷電流が、図9の閾値TH2を超える場合には、コントロール部4は、負荷電流が大きくなるにつれて、ゲート駆動回路電源E1の電源出力電圧を大きくする。
図10は、本実施の形態3に係る駆動装置の動作を示す図であり、具体的には駆動装置の動作による、半導体スイッチング素子Q1のゲート電圧の推移を示す図である。点線は、ターンオンゲート抵抗が高くなる高抵抗制御時のゲート駆動回路2の回路出力電圧を示し、実線は、ターンオンゲート抵抗が低くなる低抵抗制御時のゲート駆動回路2の回路出力電圧を示す。半導体スイッチング素子Q1の負荷電流が小さいときには、高抵抗制御が行われ、半導体スイッチング素子のゲート電圧の増加が緩やかになり、スイッチング速度が小さくなる。一方、半導体スイッチング素子Q1の負荷電流が大きいときには、低抵抗制御が行われ、スイッチング速度が大きくなる。
<実施の形態3のまとめ>
本実施の形態3に係る駆動装置によれば、コントロール部4は、ゲート駆動信号がオフになったときにサンプリングされる半導体スイッチング素子Q1の負荷電流に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、実施の形態1,2と同様に、半導体スイッチング素子Q1の定常損失を低減することができ、かつ、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障を低減することができる。
本実施の形態3に係る駆動装置によれば、コントロール部4は、ゲート駆動信号がオフになったときにサンプリングされる半導体スイッチング素子Q1の負荷電流に基づいて、ゲート駆動回路電源E1の電源出力電圧を変更する。これにより、実施の形態1,2と同様に、半導体スイッチング素子Q1の定常損失を低減することができ、かつ、半導体スイッチング素子Q1のゲート及びゲート駆動回路2の故障を低減することができる。
また実施の形態2と同様に、半導体スイッチング素子Q1がオフしている期間に、ゲート駆動回路電源E1の電源出力電圧を変更するので、電源出力電圧の変更中の影響が半導体スイッチング素子Q1に及ぶことを抑制することができる。また、負荷電流の瞬時値の変化を、ゲート駆動回路電源E1の電源出力電圧の変更にある程度反映することができる。
また本実施の形態3では、半導体スイッチング素子Q1の負荷電流が閾値TH1以下である場合には、ターンオンゲート抵抗が高くなる。このため、ターンオン時のスイッチング速度が小さくなるので、サージ電圧及び放射ノイズを抑制することができる。一方、半導体スイッチング素子Q1の負荷電流が閾値TH1を超える場合には、ターンオンゲート抵抗が低くなる。このため、ターンオン時のスイッチング速度を大きくなるので、ターンオン期間中のスイッチング損失を低減することができる。
なお、負荷電流が増加した際にターンオン速度を低減する構成を実現するのであれば、オン抵抗切替信号の代わりに、オン抵抗切替信号を反転させた信号が用いられるように構成すればよい。このように構成した場合には、ターンオンゲート抵抗が増加するので、ターンオン速度を低減することができる。
なお、各実施の形態及び各変形例を自由に組み合わせたり、各実施の形態及び各変形例を適宜、変形、省略したりすることが可能である。
上記した説明は、すべての局面において、例示であって、限定的なものではない。例示されていない無数の変形例が、想定され得るものと解される。
1 PWM制御部、3,4 コントロール部、DLC ディレイ回路、E1 ゲート駆動回路電源、E3 電源、Q1 半導体スイッチング素子、RG1 第1抵抗、RG2 第2抵抗。
Claims (4)
- ゲート駆動信号のオン及びオフに基づいて半導体スイッチング素子を駆動する駆動装置であって、
出力電圧を変更可能なゲート駆動回路電源と、
前記出力電圧よりも低い固定電圧を有する電源と、
前記半導体スイッチング素子の負荷電流に関連する関連情報に基づいて、前記ゲート駆動回路電源の前記出力電圧を変更するコントロール部と、
前記ゲート駆動信号がオンになった場合に、前記半導体スイッチング素子のゲートに、前記固定電圧を予め定められた期間供給する制御を行った後、前記ゲートに、前記出力電圧を供給する制御を行うディレイ回路と
を備える、駆動装置。 - 請求項1に記載の駆動装置であって、
前記関連情報は、前記負荷電流の実効値に対して予め定められた前記出力電圧の変更パターンである、駆動装置。 - 請求項1に記載の駆動装置であって、
前記関連情報は、前記ゲート駆動信号がオフになったときにサンプリングされる前記負荷電流である、駆動装置。 - ゲート駆動信号のオン及びオフに基づいて半導体スイッチング素子を駆動する駆動装置であって、
出力電圧を変更可能なゲート駆動回路電源と、
前記ゲート駆動信号がオフになったときにサンプリングされる前記半導体スイッチング素子の負荷電流に基づいて、前記ゲート駆動回路電源の前記出力電圧を変更するコントロール部と、
前記ゲート駆動回路電源と前記半導体スイッチング素子のゲートとの間に接続可能な第1抵抗と、
前記ゲート駆動回路電源と前記半導体スイッチング素子の前記ゲートとの間に、前記第1抵抗と並列接続可能な第2抵抗と
を備え、
前記コントロール部は、
前記負荷電流に基づいて、前記第1抵抗を介して、前記ゲートに前記ゲート駆動回路電源の前記出力電圧を供給する制御と、前記第1抵抗及び前記第2抵抗を介して、前記ゲートに前記ゲート駆動回路電源の前記出力電圧を供給する制御とを選択的に行う、駆動装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2024515995A JPWO2023203710A1 (ja) | 2022-04-21 | 2022-04-21 | |
PCT/JP2022/018385 WO2023203710A1 (ja) | 2022-04-21 | 2022-04-21 | 駆動装置 |
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2022/018385 WO2023203710A1 (ja) | 2022-04-21 | 2022-04-21 | 駆動装置 |
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---|---|
WO2023203710A1 true WO2023203710A1 (ja) | 2023-10-26 |
Family
ID=88419585
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
PCT/JP2022/018385 WO2023203710A1 (ja) | 2022-04-21 | 2022-04-21 | 駆動装置 |
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Country | Link |
---|---|
JP (1) | JPWO2023203710A1 (ja) |
WO (1) | WO2023203710A1 (ja) |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
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-
2022
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