WO2008155832A1 - 半導体装置及びその製造方法 - Google Patents
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Abstract
半導体基板10上に第1の配線28aを形成する第1の工程と、第1の配線上に記憶素子30を形成する第2の工程と、半導体基板上に、記憶素子を埋め込むように第1の絶縁膜42を形成する第3の工程と、第1の絶縁膜上及び記憶素子上に、第1の絶縁膜とエッチング特性が異なる第2の絶縁膜44を形成する第4の工程と、第1の絶縁膜をエッチングストッパとして、第2の絶縁膜をエッチングすることにより、記憶素子の上部を露出する溝46を第2の絶縁膜に形成する第5の工程と、溝内に第2の配線32aを埋め込む第6の工程とを有している。
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Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009123900A (ja) * | 2007-11-14 | 2009-06-04 | Toshiba Corp | 不揮発性半導体記憶装置 |
WO2012073503A1 (ja) * | 2010-12-03 | 2012-06-07 | パナソニック株式会社 | 不揮発性記憶素子ならびに不揮発性記憶装置及びそれらの製造方法 |
WO2020179199A1 (ja) * | 2019-03-04 | 2020-09-10 | パナソニックセミコンダクターソリューションズ株式会社 | 不揮発性記憶装置およびその製造方法 |
US11411181B2 (en) | 2020-03-30 | 2022-08-09 | Taiwan Semiconductor Manufacturing Co., Ltd. | Phase-change memory device and method |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005523575A (ja) * | 2002-04-18 | 2005-08-04 | インフィネオン テクノロジーズ アクチエンゲゼルシャフト | Mram加工におけるトンネル接合部キャップ層、トンネル接合部ハードマスク、およびトンネル接合部スタック種膜の材質の組み合わせ |
JP2005524238A (ja) * | 2002-04-30 | 2005-08-11 | マイクロン テクノロジー インコーポレイテッド | Mram素子の製造方法 |
JP2007042804A (ja) * | 2005-08-02 | 2007-02-15 | Renesas Technology Corp | 半導体装置およびその製造方法 |
-
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Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005523575A (ja) * | 2002-04-18 | 2005-08-04 | インフィネオン テクノロジーズ アクチエンゲゼルシャフト | Mram加工におけるトンネル接合部キャップ層、トンネル接合部ハードマスク、およびトンネル接合部スタック種膜の材質の組み合わせ |
JP2005524238A (ja) * | 2002-04-30 | 2005-08-11 | マイクロン テクノロジー インコーポレイテッド | Mram素子の製造方法 |
JP2007042804A (ja) * | 2005-08-02 | 2007-02-15 | Renesas Technology Corp | 半導体装置およびその製造方法 |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009123900A (ja) * | 2007-11-14 | 2009-06-04 | Toshiba Corp | 不揮発性半導体記憶装置 |
US8575589B2 (en) | 2007-11-14 | 2013-11-05 | Kabushiki Kaisha Toshiba | Nonvolatile semiconductor memory device and method of manufacturing the same |
WO2012073503A1 (ja) * | 2010-12-03 | 2012-06-07 | パナソニック株式会社 | 不揮発性記憶素子ならびに不揮発性記憶装置及びそれらの製造方法 |
CN103168359A (zh) * | 2010-12-03 | 2013-06-19 | 松下电器产业株式会社 | 非易失性存储元件和非易失性存储装置及它们的制造方法 |
JPWO2012073503A1 (ja) * | 2010-12-03 | 2014-05-19 | パナソニック株式会社 | 不揮発性記憶素子ならびに不揮発性記憶装置及びそれらの製造方法 |
US9214628B2 (en) | 2010-12-03 | 2015-12-15 | Panasonic Intellectual Property Management Co., Ltd. | Nonvolatile memory element, nonvolatile memory device, and manufacturing method for the same |
WO2020179199A1 (ja) * | 2019-03-04 | 2020-09-10 | パナソニックセミコンダクターソリューションズ株式会社 | 不揮発性記憶装置およびその製造方法 |
US11411181B2 (en) | 2020-03-30 | 2022-08-09 | Taiwan Semiconductor Manufacturing Co., Ltd. | Phase-change memory device and method |
US11997933B2 (en) | 2020-03-30 | 2024-05-28 | Taiwan Semiconductor Manufacturing Co., Ltd. | Phase-change memory device and method |
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