WO2008155832A1 - 半導体装置及びその製造方法 - Google Patents

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Abstract

 半導体基板10上に第1の配線28aを形成する第1の工程と、第1の配線上に記憶素子30を形成する第2の工程と、半導体基板上に、記憶素子を埋め込むように第1の絶縁膜42を形成する第3の工程と、第1の絶縁膜上及び記憶素子上に、第1の絶縁膜とエッチング特性が異なる第2の絶縁膜44を形成する第4の工程と、第1の絶縁膜をエッチングストッパとして、第2の絶縁膜をエッチングすることにより、記憶素子の上部を露出する溝46を第2の絶縁膜に形成する第5の工程と、溝内に第2の配線32aを埋め込む第6の工程とを有している。
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