WO1987006365A1 - Signal trace control system for pmc - Google Patents

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WO1987006365A1
WO1987006365A1 PCT/JP1987/000224 JP8700224W WO8706365A1 WO 1987006365 A1 WO1987006365 A1 WO 1987006365A1 JP 8700224 W JP8700224 W JP 8700224W WO 8706365 A1 WO8706365 A1 WO 8706365A1
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trace
signal
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pmc
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Nobuyuki Kiya
Shuji Toriyama
Yoshiharu Saiki
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Fanuc Ltd
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    • G05B19/00Programme-control systems
    • G05B19/02Programme-control systems electric
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    • G05B19/05Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
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    • G05B19/406Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form characterised by monitoring or safety
    • G05B19/4063Monitoring general control system
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Definitions

  • the present invention is applied to a signal trace control system of the PMC, and in particular, stores data in a trace buffer having a small capacity.
  • the dynamic state that is, the process of change
  • the program of the control device is changed.
  • a method of monitoring a specific symbol has been adopted.
  • ⁇ -gram cannot be changed.
  • As a method of monitoring the contents of the memory a method of storing the contents of a predetermined memory for a certain period of time is also known. However, if the contents of the memory are stored as they are, the capacity of the momentum memory is reduced. growing. Conversely, with a certain amount of memory, the time that can be monitored becomes short, and the part that causes the failure may not be covered. Disclosure of the invention The purpose of this study is to solve the above problems and to provide a PMC signal trace control method that can perform the necessary monitoring with a small amount of memory.
  • Signal monitoring means for monitoring a change in a signal of the monitored RAM; write control means for performing writing in response to a change signal from the signal monitoring means; and data of the monitored RAM by the write control means.
  • a PC signal trace control method characterized by having a trace buffer to be written and stored
  • FIG. 1 is a block diagram of one embodiment of the present invention
  • FIG. 2 is a flow chart of one embodiment of the present invention
  • the IH shows the configuration 11 of the embodiment of the present invention.
  • reference numeral 10 denotes a RAM in the PMC, which includes a monitored RA # 1 and a trace buffer 2 for storing the data.
  • 21 is a signal monitoring means for monitoring the change state of the monitored RAM.
  • 22 is a write control means for writing the data of the monitoring RAM into the trace buffer 2 by a signal from the monitored means.
  • the address of the monitored R AMI to be monitored is selected in advance.
  • the addresses of A and B which are shaded, are monitored.
  • the signal monitoring means 21 constantly monitors the change of the signals at the addresses A and B, and notifies the write control means 22 when any of the bits of the addresses A and B0 changes.
  • the write control means 22 traces the address A and B data to the trace buffer.
  • the data force of address A is written to the left of address 04 of trace bath 2 and the data force of address B is written to the right of address 04 of trace file V fa2.
  • the data of address A and address B are written to address 05 of the transistor software 2 in the same manner. Be included. As described above, data is written to trace buffer 2 only when the contents of the data change sequentially.
  • FIG. 2 shows a flowchart of the above embodiment.
  • the step numbers are represented as S1, S2, S3.
  • FIG. 3 shows a partial configuration diagram of hardware for carrying out this study.
  • reference numeral 30 denotes a PMC (Programmable Machine Controller) having a CPU 31, a ROM 32, a RAM 33, and an external interface (IXT) 34.
  • Z 'manages PMC, manages programs and controls machines
  • the control pi-gram to be controlled is stored.
  • the RAM 33 corresponds to the RAM 10 shown in FIG. 1, and the monitored RAM and the trace software are also included in the RAM.
  • the interface 34 exchanges input (DI) and output (DO) with the machine side.Some of the input and output are also sent directly to CC.
  • CP 31, R032 and RAs 33 are connected to each other by a bus 40 is a CMC (numerical control unit), and the CPU 41 and the shared RAM 42 are shown in the figure.
  • PMC 30 and CN can exchange data with each other via shared RAM 42.
  • the input (DI) and output (DO) to the machine side are temporarily input to the shared RAM 42 and transferred to the PMC 30 and the CNC 40, respectively.
  • the signal monitoring and writing control described in the present embodiment are performed in the control of the CPU 31.
  • the monitoring is described as monitoring the data in the RAM 33 in the PMC 30.
  • the signals on the CNC 40 and the input and output of the machine t via the shared RAM 42 are the same. Can be monitored.
  • monitoring data can be stored with a small amount of memory. it can.

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Description

P M c の信号 ト レース制御方式 技 術 分 野
本発明は P M Cの信号 ト レース制御方式に閔し、 特に、 少 ない容量の ト レースバ ッ フ ァ でデータを記憶するようにしィ,
P M C の信号 ト レ— ス制御方 0式に閔する。 背 景 技 術
ソ フ トウ ェアの開発中或いは、 制御機器の運転中に障害が 発生し、 そ ο原因を調查するために各部のメ モ リ の内容を知
.る必要がある。 特に、 これらの状態は静的な祅態より も、 動 的な状態即ち、 変化の過程が重要になる場合が多い。 このよ うな状態を知る方法として、 制御装置のプログラムを変更し. 特定の ¾号を監視する方式がとられていたが、 制御装置のプ πグラムが R 0 Mの場合は制櫛装置のプ αグラムを変更する ことができない。 又、 メ モリ の内容を監視する方式として 一定時間所定のメ モ リ の内容を記憶する方式も知られている , しかし、 メ モ リ の内容をそのまま記憶する と、 勢いメ モ リ の容量は大き く なる。 逆に一定量のメ モ リ では監視できる時 間が短く なり、 障害の原因となる部分をカバー出来ない場合 も生じる。 発 明 の 開 示 本究明の目的は上記問題点を解決し、 少ないメ モ リ で充分 必要な監視ができるような P M Cの信号 ト レース制御方式を 提供することにある。
本発明では上記の問題点を解決するために、
数値制御装 Ϊからの信号を受け襪狨を制御するプコグラマ ブルマシンコ ン ト ローラ ( P M C ) における f 号 ト レース制 ¾1方式において、
被監視 R A Mの信号の変化を監視する信号監視手段と、 該 信号監視手段からの変化信号を受けて書込を行う書込制御手 段と、 該書込制御手段によって前記被監視 R A Mのデータを 書込まれ、 これを記億す ト レースバッファ とを有することを 特徵とする P Cの信号 ト レース制御方式が
提供される。
本発明では全てのデータを ト レースせず、 変化のあった場 合の信号を監視するので、 少ないメ モ リ容量で有効な ト レー スを行う ことができる。 図 面 の 簡 単 な 説 明 第 1図は本発明の一実施例のプロ ック搆成図であり、 第 2図は本発明の一実施 ί列のフローチャ ー ト図であり、 第 3図は本究明の一実施例のハ一ドウュァの部分構成図で める ο
発明を実施するための最良の形態 以下本発明の一実施例を図面に基ずいて説明する。 第 I Hに本発明の一実施例のプロ 'ンク構成 11を示す。 図に おいて、 1 0 は P M C内の R A Mであり、 被監視 R A ί 1 と そのデータを記憶する ト レー スバ ッ フ ァ 2がある。 2 1 は被 監視 R A Mの変化状態を監視する信号監視手段である。 2 2 は被監視手段からの信号によって ¾監視 R A Mのデータを ト レー スバ ッ フ ァ 2 に書込むための書込制御手段である。
次に、 動作の概略について^べる。 ます、 被監視 R A M I のどのァ ドレスを監視するかを予め選 する。 図においては、 斜線を引いた Aと Bのァ ド レスが監視される。 信号監視手段 2 1 はア ド レス Aと Bの信号の変化の.伏態を常に監視し、 ァ ドレス Aと B Oいずれかのビッ 卜が変化したら、 これを書込 制御手段 2 2 に知らせる。 書込制御手段 2 2 はこの信号を受 けたら、 ア ド レス Aと B のデータを ト レ ー スバ ッ フ ァ
込む。 図においてはァ ドレス Aのデータ力、 ト レー スバソ フ ァ 2 の 0 4番地の左側に、 ア ドレス Bのデータ力く ト レースパ V ファ 2 の 0 4番地の右側にそれぞれ書込まれる。 次にァ ドレ ス Aとァ ド レス B C いずれかのビッ トがへんかした時は、 同 様にしてア ド レス Aと Bのデータは ト レ一スノ ソ フ ァ 2 の 0 5番地に書込まれる。 以上のように順次、 データの内容が変 化した場合のみデータは ト レ ースバッファ 2 に書込まれる。
次にフローチャー トにもとずいて動作の流れにいって述べ る。 第 2図に上記実施例のフローチ ャ ー ト図を示す。 図にお いてステッ プ番号は S 1 、 S 2 、 S 3 のよう に表す。
S 1 では ト レースを行うかどうかを判断し、 ト レースをし ないとき動作はなにもせず終了する。 ト レースを実行する と きは S 2 に進む。
S 2 では予め定められた ト レースすべきァ ドレス、 サイ ズ を照合し、 S 3へ進む。
S 3 で \ 被監視ァ ド レスの全ビ ッ トが変化したかどうかを チェ 'クする。 変化がないときは動作は終了する。 変化した とき s ·ίへ;!む。
S 4 前回 ¾込んだ番 が ト レースバ ッ フ ァ の最終番 ¾ かどうか判断する 最铃 ¾¾¾ ^の場合は S 6へ進む。 最終 番地のときは S. 5へ進む。
S 5では書込む ト レ一スバフファの番地が最後の番地のた め、 番地を先頭に書直す,
S 6 で 書込む ト レ ースバッ フ ァ の番 が途中番地である ので、 書込み番地はプラ ス 1 するのみでよい。
S 7では ト レースバッ フ ァ Ο蓍込む番 が決ま ったので、 被監視データを書込み動作が终了する。
以上說明したように ト レー スバ ソ フ ァはリ ング祅をしてい るので、 データの内容はつねに更新され最新のデータが記憶 される。 . 次に、 本発明を実施するためのハー ドゥヱァの構成につい て述べる。 第 3図に本究明を実施するためのハ ー ドウユアの 部分構成図を示す。 図において、 3 0 は P M C (プログラマ ブルマ シ ンコ ン ト ロ ー ラ) で C P U 3 1 、 R O M 3 2、 R A M 3 3 、 外部とのィ ンターフヱイ ス ( I X T) 3 4を有する , R 0 M 3 2 Z ' は P M Cを制街する管理プログラ ム、 機械を制 御するコ ン ト ロー ルプ πグラム等が記憶されている。 R A M 3 3 は第 1図でしめした R A M 1 0 に相当し、 被監視用 R A Mと、 ト レースノぺ ' ソ フ ァ もこの R A Mのなかにある。 イ ンタ ーフヱ イ ス 3 4は機搣側との入力 ( D I 〉 、 出力 ( D O ) う やり とりする。 入出力の一部は直接 C Cへも送られる。 C P じ 3 1 、 R 0 3 2及び R A ί 3 3 は互いにバスで結合さ れている。 4 0 は C M C (数値制御装置) であり、 図にお いては C P U 4 1 と共有 R A M 4 2 のが示してある。
P M C 3 0 と C N: C 4 0 は共有 R A M 4 2を介して互いに データを交換できる。 又、 機械側への入力 ( D I ) 、 出力 ( D O ) は一旦共有 R A M 4 2 に入力され、 それぞれ P M C 3 0、 C N C 4 0へ転送される。
本実施例で示した信号監視、 書込制御は C P U 3 1 の制御 において行われる。 上記実施例では監視は P M C 3 0 内の R A M 3 3 のデータ を監視するように述べたが、 勿論、 共有 R A M 4 2を介して C N C 4 0側の信号、 機械側 tの入力、 出力も同様に監視する ことができ る。
以上述べたように、 本発明では被監視データの変化を監視 して、 変化が生じた場合のみにデータを記憶するように構成 したから、 少ない容量のメ モ リ で監視データを記憶すること ができる。

Claims

m
1 . 数値制御装置からの信号を受け機裱を制御するプログ ラ マブルマ シ ンコ ン ト ロ ー ラ ( P M C ) における f言号 ト レ一 ス制御方式において、
被監視 R A 0 ί當号の変化を信号監視する監視手設と、 該信号監視手段からの変化信号を受けて書込を行う書込制
? 手段と、
該書込制徽手段によって求前記被監視 R A Mのデータを書込 まれ, これを記憶する ト レー スバッファ と、
を有するこ とを特徵とする P M C の信号 ト レ ース制御方式
2 . 被監視^ R A Mのデ—タを記 'ί意する ト レースバソ ファ
0
はリ ング伏にしたことを特 とする持許 ΐき求の範悪第 i 項に 記戴の P Cの信号 ト レース制御方式。
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