JPH07120163B2 - Pmcの信号トレ−ス制御方式 - Google Patents

Pmcの信号トレ−ス制御方式

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JPH07120163B2
JPH07120163B2 JP62213717A JP21371787A JPH07120163B2 JP H07120163 B2 JPH07120163 B2 JP H07120163B2 JP 62213717 A JP62213717 A JP 62213717A JP 21371787 A JP21371787 A JP 21371787A JP H07120163 B2 JPH07120163 B2 JP H07120163B2
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ram
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久仁夫 田中
紀美夫 前田
嘉春 斎木
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FANUC Corp
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    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B19/00Programme-control systems
    • G05B19/02Programme-control systems electric
    • G05B19/04Programme control other than numerical control, i.e. in sequence controllers or logic controllers
    • G05B19/05Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
    • G05B19/058Safety, monitoring
    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B2219/00Program-control systems
    • G05B2219/10Plc systems
    • G05B2219/11Plc I-O input output
    • G05B2219/1171Detect only input variation, changing, transition state of variable
    • GPHYSICS
    • G05CONTROLLING; REGULATING
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はPMCの信号トレース制御方式に関し、特にトレ
ース信号を1個所に集めてトレースをおこなうPMCの信
号トレース制御方式に関する。
〔従来の技術〕
PMC装置のシーケンスプログラムの開発時、或いは、PMC
装置の保守時に、不具合の原因を調査するために各部の
信号を知る必要がある。これらの信号はPMC装置、また
はPMC装置と結合された数値制御装置(CNC)の表示装置
に表示されるが、信号の変化が高速であったり、発生の
頻度が低いと、表示装置のみでは十分ではなく、信号を
メモリに記憶させて、再現する必要が生じる。特に、こ
れらの状態は静的な状態よりも、動的な状態即ち、変化
の過程が重要になる場合が多い。このような状態を知る
方法として、制御装置のプログラムを変更し、特定の信
号を監視する方式がとられていたが、制御装置のプログ
ラムがROMの場合は制御装置のプログラムを変更するこ
とができない。
又、信号の状態を監視する方式として一定時間所定の信
号を順次メモリに記憶する方式も知られている。この信
号を追跡して、他のメモリに記憶して再現する手法をト
レースと称する。ただし、単に信号をトレースして、メ
モリに記憶していくのみではメモリの容量が膨大になっ
てしまう。
そして、メモリの容量を減らすトレース制御方式とし
て、特願昭61−086918号がある。この方式ではトレース
すべき信号の変化を捕らえて、その信号と同一のバイ
ト、ワードをトレースするようにしている。
〔発明が解決しようとする問題点〕
しかし、従来のトレース方式では、トレースすべき信号
が、1個所になく別々の個所にあるのが一般的である。
このためにトレースの時間が長くかかるという問題点が
ある。特にトレースはシーケンスプログラムのなかで、
最も高いレベルで処理しなければならず、高いレベルで
の使用時間が長いと他のシーケンスプログラムの処理に
大きく影響してくる。
本発明の目的は上記問題点を解決し、特にトレース信号
を1個所に集めてトレースをおこなうPMCの信号トレー
ス制御方式を提供することにある。
〔問題点を解決するための手段〕
本発明では上記の問題点を解決するために、 プログラマブルマシンコントローラ(PMC)で、特定の
信号をトレースして記憶するPMCの信号トレース制御方
式において、 シーケンスプログラムを格納するRAMと、 指定されたトレース信号を1個所に集めるためのダミー
のラダーを追加する手段と、 該1個所に集められたトレース信号を監視する監視手段
と、 該監視手段からのトレース制御手段によって、トレース
信号をトレースバッファに書き込む書込制御手段と、 を有することを特徴とするPMCの信号トレース制御方式
が、 提供される。
〔作用〕
トレースすべき信号が、ダミー命令で1個所例えば、1
バイト中に集められる。トレースはこの1バイト分をそ
のままトレースバッファに書込むことができる。トレー
スの時間は短縮される。
〔実施例〕
以下本発明の実施例を図面に基づいて説明する。
第1図に本発明の実施例のブロック構成図を示す。図に
おいて、10はPMC内のRAMであり、各種の信号が記憶され
ており、その信号状態はPMCの動作によって、刻々変化
する。
ここでは、図の斜線で示す X0.0 X0.1 X1.2 X5.0 の4個の信号をトレースするものとする。この4個の信
号はダミーの命令によって、R510番地に集められて、ト
レースされる。その詳細については後述する。
2はトレースバッファであり、R510番地の信号を書き込
み、記憶する。21は被監視RAMの条件信号を監視する監
視手段であり、22は監視手段21からの信号によってトレ
ース信号のデータをトレースバッファ2に書込むための
書込制御手段である。
次に、トレースすべき信号をR510番地に集めるための方
法について述べる。第2図にトレースすべき信号を集め
るためのダミーのラダー図を示す。トレースすべき信号
を接点として、その接点でR510番地のコイルを動作させ
るラダー指令を追加する。この結果各トレース信号と同
一の信号をR510番地に書込むことができ、トレースはこ
のR510番地を読んで、トレースバッファ2に書き込め
ば、1回分のトレース動作で済む。
また、トレースすべき信号が変化した場合のみにトレー
スを行うために、監視手段21が現在と次の回のR510番地
の排他的論理和をとることにより、トレースすべき信号
のどれかが変化しても、その変化を検出することができ
る。
このラダー指令は、トレースすべき信号が指定されたと
きに、自動的にシーケンスプログラムが格納されている
RAMに追加できるようにする。これはシーケンスプログ
ラムを管理する管理プログラムの制御によって処理す
る。
次に、本発明を実施するためのハードウェアの構成につ
いて述べる。第3図に本発明を実施するためのハードウ
ェアのブロック図を示す。図において、30はPMC(プロ
グラマブルマシンコントローラ)でCPU31、ROM32、RAM3
3、外部とのインターフェイス(INT)34を有する。ROM3
2にはPMCを制御する管理プログラム等が記憶されてい
る。RAM33は第1図で示したRAM10に相当し、第1図の被
監視用RAM1と、トレースバッファ2もこのRAM33の中に
ある。さらに、機械を制御するシーケンスプログラムも
RAM33に格納されている。これは、トレースすべき信号
を1個所に集めるためのダミーのラダー指令を自動的に
書込むためである。
インターフェイス34は機械側との入力(DI)、出力(D
O)の授受を行う。入出力の一部は直接CNCへも送られ
る。CPU31、ROM32及びRAM33は互いにバスで結合されて
いる。40はCNC(数値制御装置)であり、図においてはC
PU41と共有RAM42のが示してある。
PMC30とCNC40は共有RAM42を介して互いにデータを交換
できる。又、機械側への入力(DI)、出力(DO)は一旦
共有RAM42に入力され、それぞれPMC30、CNC40へ転送さ
れる。
本実施例で示した条件信号の監視、論理状態のチェッ
ク、トレース信号の書込み等はCPU31の制御において行
われる。
上記実施例では、PMC装置は数値制御装置(CNC)に付随
する装置とし表してあるが、本発明は勿論単独のPMC装
置にも適用することもできる。
〔発明の効果〕
以上説明したように本発明では、トレースすべき信号を
ダミーのラダー指令で1個所に集めて、トレースするよ
うに構成したので、短い時間でトレースの処理を行うこ
とができる。
【図面の簡単な説明】 第1図は本発明の実施例のブロック構成図、 第2図はトレースすべき信号を集めるためのダミーのラ
ダー図、 第3図は本発明を実施するためのハードウェアのブロッ
ク図である。 1……被監視RAM 2……トレースバッファ 10……RAM 21……監視手段 22……書込制御手段 30……PMC(プログラマブルマシンコントローラ) 40……CNC(数値制御装置)

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】プログラマブルマシンコントローラ(PM
    C)で、特定の信号をトレースして記憶するPMCの信号ト
    レース制御方式において、 シーケンスプログラムを格納するRAMと、 指定されたトレース信号を1個所に集めるためのダミー
    のラダーを追加する手段と、 該1個所に集められたトレース信号を監視する監視手段
    と、 該監視手段からのトレース制御信号によって、トレース
    信号をトレースバッファに書き込む書込制御手段と、 を有することを特徴とするPMCの信号トレース制御方
    式。
JP62213717A 1987-08-27 1987-08-27 Pmcの信号トレ−ス制御方式 Expired - Lifetime JPH07120163B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP62213717A JPH07120163B2 (ja) 1987-08-27 1987-08-27 Pmcの信号トレ−ス制御方式
EP19880907368 EP0436019A4 (en) 1987-08-27 1988-08-18 Signal trace control system for pmc
PCT/JP1988/000821 WO1989002100A1 (en) 1987-08-27 1988-08-18 Signal trace control system for pmc

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP62213717A JPH07120163B2 (ja) 1987-08-27 1987-08-27 Pmcの信号トレ−ス制御方式

Publications (2)

Publication Number Publication Date
JPS6457307A JPS6457307A (en) 1989-03-03
JPH07120163B2 true JPH07120163B2 (ja) 1995-12-20

Family

ID=16643826

Family Applications (1)

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JP62213717A Expired - Lifetime JPH07120163B2 (ja) 1987-08-27 1987-08-27 Pmcの信号トレ−ス制御方式

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EP (1) EP0436019A4 (ja)
JP (1) JPH07120163B2 (ja)
WO (1) WO1989002100A1 (ja)

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Publication number Publication date
JPS6457307A (en) 1989-03-03
WO1989002100A1 (en) 1989-03-09
EP0436019A1 (en) 1991-07-10
EP0436019A4 (en) 1992-10-14

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