TWI424311B - 可變電力及響應時間之暫時低電壓重設電路 - Google Patents

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Description

可變電力及響應時間之暫時低電壓重設電路
本揭示內容係關於半導體積體電路暫時低電壓重設電路，更特定言之係關於可變電源及響應時間暫時低電壓重設電路，其電源要求及響應時間特性係可程式化。
包含積體電路之電子類比、數位及/或混合模式電路的電子器件可需要特定最小臨限電壓以正確操作。當該等器件之電源低於臨界操作電壓(例如"暫時低電壓")時，器件之電路可處於不可預測"亞穩"狀態，並且當嘗試在臨界操作電壓以下操作時電雜訊環境可進一步降級器件電路之操作。當可用於器件(例如微處理器)之輸入電壓已降至器件無法繼續操作之位準時，視為已發生暫時低電壓，因為錯誤或部分功能狀況可發生於其邏輯或儲存元件內。暫時低電壓在電壓已上升回至暫時低電壓位準以上時結束。電子電路已用於監視電子器件之電源電壓，致使在產生該電子器件之數位邏輯的暫時低電壓重設("BOR")時偵測一所需電壓臨限值。暫時低電壓偵測器偵測操作電壓何時降至稍高於暫時低電壓電壓位準並產生一信號以對電子器件指示暫時低電壓係擱置中。暫時低電壓信號可起始電子器件操作之重設或凍結，以避免其不適當操作。
通常，BOR電路一直需要靜態電流以運作。對於低電力或電池操作電子器件，此靜態電流係電池壽命減小之重要因素，特別係對於期望可長時間操作的電子器件，例如當 於睡眠模式時在非常低電力位準下操作的器件。因此，較佳的係將用於BOR電路之靜態電流保持於最小值，以獲得最長電池操作。但另一方面，當在識別BOR信號並且其可用於停用數位邏輯之適當內部電路前錯誤執行程式指令時防止高速數位邏輯進入BOR狀況亦非常重要。此狀況可潛在地導致電子器件故障，因為可在器件未在其正確電壓規格內操作時存取及執行程式指令。
因此需要一暫時低電壓重設(BOR)電路，其可經組態成當電子器件處於睡眠或低電力模式時以最小電流消耗操作，或者當電子器件處於高速模式中時以充分響應速度操作。
依據此揭示內容之特定示範性具體實施例，可變電源及響應時間之暫時低電壓重設裝置可包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係調適成可程式化地改變該比較器之速度及電源使用特性；一固定電壓參考，其具有一輸出，其中將該固定電壓參考之該輸出耦合至該比較器之該第一輸入，其中該固定電壓參考具有可程式化速度及電源特性；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器具有可程式化速度及電源特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏 壓電路、該固定電壓參考及該電源分壓器，其中在該n位元寬電源控制匯流排上程式化該比較器、該固定電壓參考及該電源分壓器之該等速度及電源使用特性；其中若來自該固定電壓參考之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則該比較器之該輸出上的一邏輯位準改變。
依據此揭示內容之另一特定示範性具體實施例，可變電源及響應時間之暫時低電壓重設裝置可包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係調適成可程式化地改變該比較器之速度及電源使用特性；一可程式化電壓參考，其具有一輸出，其中將該可程式化電壓參考之該輸出耦合至該比較器之該第一輸入，其中該可程式化電壓參考具有可程式化速度及電源特性，以及參考電壓值；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器具有可程式化速度及電源特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏壓電路、該可程式化電壓參考及該電源分壓器，其中在該n位元寬電源控制匯流排上程式化該比較器、該可程式化電壓參考及該電源分壓器之該等速度及電源使用特性；其中若來自該可程式化電壓參考之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則該比較器之該輸出上的一邏 輯位準改變。
依據此揭示內容之另一特定示範性具體實施例，可變電源及響應時間之暫時低電壓重設裝置可包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係調適成可程式化地改變該比較器之速度及電源使用特性；一可程式化電壓緩衝器，其具有一輸出及輸入，其中將該可程式化電壓參考之該輸出耦合至該比較器之該第一輸入並且將輸入耦合至一外部電壓參考，其中該可程式化電壓緩衝器具有可程式化速度及電源特性；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器具有可程式化速度及電源特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏壓電路、該可程式化電壓緩衝器及該電源分壓器，其中在該n位元寬電源控制匯流排上程式化該比較器、該可程式化電壓緩衝器及該電源分壓器之該等速度及電源使用特性；其中若來自該可程式化電壓緩衝器之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則該比較器之該輸出上的一邏輯位準改變。
現在參考圖式，示意性地說明特定示範性具體實施例的細節。圖式中相同元件將由相同數字表示，而類似元件將由具有不同小寫字母下標的相同數字來表示。
參考圖1，描述包含一電子器件及與該電子器件相關聯之一暫時低電壓重設(BOR)電路的半導體積體電路之示意性方塊圖。可在半導體積體電路100上製造一電子器件102，例如微處理器、微控制器、數位信號處理器(DSP)、可程式化邏輯陣列(PLA)、特定應用積體電路(ASIC)、類比器件、混合模式類比數位器件等等，以及一暫時低電壓重設(BOR)電路104。電子器件102具有用於介接電子系統(未顯示)之輸入及輸出(I/O)106。可從電源112(未顯示)供電給電子器件102及BOR電路104。BOR電路104可監視電源112之電壓值並可在電源112之電壓值降至特定最小電壓值以下時傳送一BOR信號108至電子器件102。電子器件102可控制BOR電路104在電源控制匯流排110上之操作特性。外部BOR信號108a可與電子系統內之其他積體電路並用。
參考圖2，描述依據此揭示內容之特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖。BOR電路104a可包含比較器220、比較器偏壓電路222、固定電壓參考224及電源分壓器226，例如電阻器網路。電源分壓器226可減小(分壓)電源112之輸出處的電壓值，並可將該輸出耦合至比較器220之輸入(－)。可將固定電壓參考224耦合至比較器220之另一輸入(＋)，致使當電源112之經分壓電壓值小於來自固定電壓參考224之電壓時，BOR信號108(比較器220之輸出)將邏輯位準，例如，從低邏輯位準改變至高邏輯位準，或反之亦然。一旦BOR信號108改變 邏輯位準，電子器件102可起始暫時低電壓重設程式序列，例如執行中程式之受控停止。
n位元寬電源控制匯流排110可用於控制BOR電路104a之操作特性及電力消耗。當BOR電路104a以較快電子器件102操作時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104a，以對變化電壓值具有較快響應，例如可藉由比較器偏壓電路222針對較快操作加偏壓於比較器220。同樣，可在較高電流汲取下加偏壓於固定電壓參考224，例如以獲得較高電壓精確度及/或較低驅動阻抗(較快RC時間常數)。同樣，電源分壓器226可為較低驅動阻抗使用較低值電阻器。此組態對電源112暫時低電壓狀況作出響應，而為BOR電路104a提供較快信號108輸出，但電力消耗適當增加。
當採用可處於低電力或睡眠模式中之電子器件102操作BOR電路104a時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104a，以具有較低電力消耗並且可對變化電壓值作出較慢響應，例如，可藉由比較器偏壓電路222針對較低電力操作加偏壓於比較器220。同樣，可在較低電流汲取下加偏壓於固定電壓參考224。同樣，電源分壓器226可為來自電源112之較小電力消耗而使用較高值電阻器。此較低電力組態導致BOR電路104a具有較低電力消耗。
預計在本揭示內容之範疇內，n位元寬電源控制匯流排110可具有複數個(2n )電源/速度組態設定，其範圍從低電 力及較慢響應時間至最快響應時間及較高電力使用。
參考圖3，描述依據此揭示內容之另一特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖。BOR電路104b可包含比較器220、比較器偏壓電路222、可程式化電壓參考324及電源分壓器226，例如電阻器網路。電源分壓器226可減小(分壓)電源112之輸出處的電壓值，並可將該輸出耦合至比較器220之輸入(－)。可將可程式化電壓參考324耦合至比較器220之另一輸入(＋)，致使當電源112之經分壓電壓值小於來自可程式化電壓參考324之電壓時，BOR信號108(比較器220之輸出)將邏輯位準，例如，從低邏輯位準改變至高邏輯位準，或反之亦然。一旦BOR信號108改變邏輯位準，電子器件102可起始暫時低電壓重設程式序列，例如執行中程式之受控停止。可藉由程式命令在n位元寬電源控制匯流排110上設定來自可程式化電壓參考324之特定參考電壓值。具有可程式化參考電壓值使不同電源電壓位準可用於供電給電子器件102，並且仍具有依據此揭示內容之教導的暫時低電壓重設功能。
n位元寬電源控制匯流排110可用於控制BOR電路104b之操作特性，例如操作速度及參考電壓值，以及電力消耗。當BOR電路104b以較快電子器件102操作時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104b，以對變化電壓值具有較快響應，例如可藉由比較器偏壓電路222針對較快操作加偏壓於比較器220。同樣，可在較高電流汲取下加偏壓於可程式化電壓參考324，例如以獲得 較高電壓精確度及/或較低驅動阻抗(較快RC時間常數)。同樣，電源分壓器226可為較低驅動阻抗使用較低值電阻器。此組態對電源112暫時低電壓狀況作出響應而為BOR電路104b提供較快信號108輸出，但電力消耗適當增加。
當採用可處於低電力或睡眠模式中之電子器件102操作BOR電路104b時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104b，以具有較低電力消耗並且可對變化電壓值作出較慢響應，例如，可藉由比較器偏壓電路222針對較低電力操作加偏壓於比較器220。同樣，可在較低電流汲取及/或較低參考電壓值下加偏壓於可程式化電壓參考324。同樣，電源分壓器226可為來自電源112之較小電力消耗使用較高值電阻器。此較低電力組態導致BOR電路104b具有較低電力消耗及/或不同可選擇電壓位準下之暫時低電壓重設。
預計在本揭示內容之範疇內，n位元寬電源控制匯流排110可具有複數個(2n )電源/速度/電壓參考組態設定(其範圍從低電力及較慢響應時間至最快響應時間及較高電力使用)以及額外的可選擇暫時低電壓重設電壓位準。
參考圖4，描述依據此揭示內容之另一特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖。BOR電路104c可包含比較器220、比較器偏壓電路222、可程式化電壓緩衝器424及電源分壓器226，例如電阻器網路。電源分壓器226可減小(分壓)電源112之輸出處的電壓值，並可將該輸出耦合至比較器220之輸入(－)。可將可程 式化電壓緩衝器424耦合至比較器220之另一輸入(＋)，致使當電源112之經分壓電壓值小於來自可程式化電壓緩衝器424之電壓時，BOR信號108(比較器220之輸出)將改變邏輯位準，例如，從低邏輯位準改變至高邏輯位準，或反之亦然。一旦BOR信號108改變邏輯位準，電子器件102可起始暫時低電壓重設程式序列，例如執行中程式之受控停止。可採用可程式化電壓緩衝器424，藉由n位元寬電源控制匯流排110上之程式命令將外部參考電壓428值程式化至期望參考電壓。具有可程式化參考電壓值使不同電源電壓位準可用於供電給電子器件102，並且仍具有依據此揭示內容之教導的暫時低電壓重設功能。使用外部電壓參考428可更具成本效率及/或允許BOR電路102之較低電力消耗。
n位元寬電源控制匯流排110可用於控制BOR電路104c之操作特性(例如操作速度及參考電壓值)以及電力消耗。當BOR電路104c以較快電子器件102操作時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104c，以對變化電壓值具有較快響應，例如可藉由比較器偏壓電路222針對較快操作加偏壓於比較器220。同樣，可在較高電流汲取下加偏壓於可程式化電壓緩衝器424，例如以獲得較高電壓精確度及/或較低驅動阻抗(較快RC時間常數)。同樣，電源分壓器226可為較低驅動阻抗使用較低值電阻器。此組態對電源112暫時低電壓狀況作出響應而為BOR電路104c提供較快信號108輸出，但電力消耗適當增加。
當採用可處於低電力或睡眠模式中之電子器件102操作BOR電路104c時，可在n位元寬電源控制匯流排110上用組態信號來組態BOR電路104c，以具有較低電力消耗並且可對變化電壓值作出較慢響應，例如，可藉由比較器偏壓電路222針對較低電力操作加偏壓於比較器220。同樣，可在較低電流汲取及/或較低參考電壓值下加偏壓於可程式化電壓緩衝器424。同樣，電源分壓器226可為來自電源112之較小電力消耗使用較高值電阻器。此較低電力組態導致BOR電路104c具有較低電力消耗及/或不同可選擇電壓位準下之暫時低電壓重設。
預計在本揭示內容之範疇內，n位元寬電源控制匯流排110可具有複數個(2n )電源/速度/電壓參考組態設定(其範圍從低電力及較慢響應時間至最快響應時間及較高電力使用)以及額外的可選擇暫時低電壓重設電壓位準。
預計在本揭示內容之範疇內，可使用串列電源控制匯流排，例如其中n＝1之單線式匯流排，代替前述多位元n位元寬電源控制匯流排110，致使可從電子器件102及/或外部程式化來源以序列方式程式化BOR 104之操作特性，例如，積體電路100上之外部程式化接針(未顯示)。熟習數位積體電路電子設計技術人士及可受益於本揭示內容之教導內容者可容易地完成串列電源控制匯流排及/或多位元n位元寬電源控制匯流排110之實施方案。
雖然已參考本揭示內容的範例性具體實施例來描述、說明及定義此揭示內容的具體實施例，但此類參考並不暗示 本揭示內容上之一限制，且不推斷此限制。正如熟習此項技術者及受益於此揭示內容者所知，可在形式及功能上對所揭示之標的進行相當大的修改、變更及等效改變。此揭示內容所描述與說明的具體實施例僅係範例，並非詳盡說明本揭示內容之範疇。
100‧‧‧半導體積體電路
102‧‧‧電子器件
104‧‧‧暫時低電壓重設電路
104a‧‧‧BOR電路
104b‧‧‧BOR電路
104c‧‧‧BOR電路
106‧‧‧輸入及輸出
108‧‧‧BOR信號
108a‧‧‧外部BOR信號
110‧‧‧電源控制匯流排
112‧‧‧電源
220‧‧‧比較器
222‧‧‧比較器偏壓電路
224‧‧‧固定電壓參考
226‧‧‧電源分壓器
324‧‧‧可程式化電壓參考
424‧‧‧可程式化電壓緩衝器
428‧‧‧外部參考電壓
參考上述說明，結合附圖，便可更完整地瞭解本揭示內容，其中：圖1說明包含一電子器件及與該電子器件相關聯之一暫時低電壓重設(BOR)電路的半導體積體電路之示意性方塊圖；圖2說明依據此揭示內容之特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖；圖3說明依據此揭示內容之另一特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖；以及圖4說明依據此揭示內容之另一特定示範性具體實施例之用於圖1之BOR電路的更詳細示意性方塊圖。
雖然本揭示內容容許有各種修改與替代形式，但圖式中顯示其特定示範性具體實施例且於本文中作詳細說明。然而，應明白，本文中特定示範性具體實施例之說明並非意欲將本揭示內容限制在本文揭示的特定形式中，相反，此揭示內容涵蓋隨附申請專利範圍所定義之所有修改與等效物。
104a‧‧‧BOR電路
108‧‧‧BOR信號
110‧‧‧電源控制匯流排
112‧‧‧電源
220‧‧‧比較器
222‧‧‧比較器偏壓電路
224‧‧‧固定電壓參考
226‧‧‧電源分壓器

Claims (31)

  1. 一種可變電源及響應時間之暫時低電壓重設裝置，其包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係數位地可程式化以改變該比較器之速度及電源使用特性；一固定電壓參考，其具有一輸出，其中將該固定電壓參考之該輸出耦合至該比較器之該第一輸入，其中該固定電壓參考係數位地可程式化以改變該固定電壓參考之速度及電源使用特性；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器係數位地可程式化以改變該電源分壓器之速度及電源特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏壓電路、該固定電壓參考及該電源分壓器，其中在該n位元寬電源控制匯流排上數位地程式化該比較器、該固定電壓參考及該電源分壓器之該等速度及電源使用特性；其中若來自該固定電壓參考之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則 該比較器之該輸出上的一邏輯位準改變。
  2. 如請求項1之裝置，其中該比較器之該輸出用作一暫時低電壓重設信號。
  3. 如請求項1之裝置，其中該比較器之該輸出用作一外部暫時低電壓重設信號。
  4. 如請求項1之裝置，其進一步包含耦合至該比較器之該輸出的一電子器件，其中當該比較器之該輸出上的該邏輯位準改變時，該電子器件進入一暫時低電壓重設模式。
  5. 如請求項4之裝置，其中該電子器件係選自由微處理器、微控制器、數位信號處理器(DSP)、可程式化邏輯陣列(PLA)、特定應用積體電路(ASIC)、類比器件及類比數位混合模式器件所組成之群組。
  6. 如請求項5之裝置，其中在一半導體積體電路上製造該電子器件、該比較器、該比較器偏壓電路、該固定電壓參考、該電源分壓器及該n位元寬電源控制匯流排。
  7. 如請求項1之裝置，其中該比較器、該固定電壓參考及該電源分壓器之該等速度及電源使用特性可從緩慢速度及低電力程式化至高速度及高電力。
  8. 如請求項1之裝置，其中存在用於該比較器、該固定電壓參考及該電源分壓器之該等速度及電源使用特性的2n 個可程式化選擇。
  9. 如請求項1之裝置，其中該n位元寬電源控制匯流排係一位元寬，並且以序列方式程式化該比較器、該固定電壓 參考及該電源分壓器之該等速度及電源使用特性。
  10. 如請求項1之裝置，其中該n位元寬電源供應匯流排係一位元寬且該電源分壓器係以序列方式程式化。
  11. 一種可變電源及響應時間之暫時低電壓重設裝置，其包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係數位地可程式化以改變該比較器之速度及電源使用特性；一可程式化電壓參考，其具有一輸出，其中將該可程式化電壓參考之該輸出耦合至該比較器之該第一輸入，其中該可程式化電壓參考係數位地可程式化以改變該可程式化電壓參考之速度及電源使用特性，以及參考電壓值；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器係數位地可程式化以改變該電源分壓器之速度及電源特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏壓電路、該可程式化電壓參考及該電源分壓器，其中在該n位元寬電源控制匯流排上數位地程式化該比較器、該可程式化電壓參考及該電源分壓器之該等速度及電源 使用特性；其中若來自該可程式化電壓參考之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則該比較器之該輸出上的一邏輯位準改變。
  12. 如請求項11之裝置，其中該比較器之該輸出用作一暫時低電壓重設信號。
  13. 如請求項11之裝置，其中該比較器之該輸出用作一外部暫時低電壓重設信號。
  14. 如請求項11之裝置，其進一步包含耦合至該比較器之該輸出的一電子器件，其中當該比較器之該輸出上的該邏輯位準改變時，該電子器件進入一暫時低電壓重設模式。
  15. 如請求項14之裝置，其中該電子器件係選自由微處理器、微控制器、數位信號處理器(DSP)、可程式化邏輯陣列(PLA)、特定應用積體電路(ASIC)、類比器件及類比數位混合模式器件所組成之群組。
  16. 如請求項15之裝置，其中在一半導體積體電路上製造該電子器件、該比較器、該比較器偏壓電路、該可程式化電壓參考、該電源分壓器及該n位元寬電源控制匯流排。
  17. 如請求項11之裝置，其中該比較器、該可程式化電壓參考及該電源分壓器之該等速度及電源使用特性可從緩慢速度及低電力程式化至高速度及高電力。
  18. 如請求項11之裝置，其中存在用於該比較器、該可程式 化電壓參考及該電源分壓器之該等速度及電源使用特性的2n 個可程式化選擇。
  19. 如請求項11之裝置，其中該n位元寬電源控制匯流排係一位元寬並且以序列方式程式化該比較器、該可程式化電壓參考及該電源分壓器之該等速度及電源使用特性。
  20. 如請求項11之裝置，其中該n位元寬電源控制匯流排係一位元寬並且以序列方式程式化該可程式化電壓參考之該參考電壓值。
  21. 一種可變電源及響應時間之暫時低電壓重設裝置，其包含：一比較器，其具有一第一輸入、一第二輸入及一輸出；一比較器偏壓電路，其係耦合至該比較器，其中該比較器偏壓電路係數位地可程式化以改變該比較器之速度及電源使用特性；一可程式化電壓緩衝器，其具有一輸出及一輸入，其中將該可程式化電壓參考之該輸出耦合至該比較器之該第一輸入並且將該輸入耦合至一外部電壓參考，其中該可程式化電壓緩衝器係可程式化以改變該可程式化電壓緩衝器之速度及電源特性；一電源分壓器，其具有一輸入及一輸出，其中將該電源分壓器之該輸入耦合至一電源並且將該電源分壓器之該輸出耦合至該比較器之該第二輸入，其中該電源分壓器係可數位地程式化以改變該電源分壓器之速度及電源 特性；以及一n位元寬電源控制匯流排，其係耦合至該比較器偏壓電路、該可程式化電壓緩衝器及該電源分壓器，其中在該n位元寬電源控制匯流排上數位地程式化該比較器、該可程式化電壓緩衝器及該電源分壓器之該等速度及電源使用特性；其中若來自該可程式化電壓緩衝器之該輸出的一參考電壓大於來自該電源分壓器之該輸出的一經分壓電源電壓，則該比較器之該輸出上的一邏輯位準改變。
  22. 如請求項21之裝置，其中該比較器之該輸出用作一暫時低電壓重設信號。
  23. 如請求項21之裝置，其中該比較器之該輸出用作一外部暫時低電壓重設信號。
  24. 如請求項21之裝置，其進一步包含耦合至該比較器之該輸出的一電子器件，其中當該比較器之該輸出上的該邏輯位準改變時，該電子器件進入一暫時低電壓重設模式。
  25. 如請求項24之裝置，其中該電子器件係選自由微處理器、微控制器、數位信號處理器(DSP)、可程式化邏輯陣列(PLA)、特定應用積體電路(ASIC)、類比器件及類比數位混合模式器件所組成之群組。
  26. 如請求項25之裝置，其中在一半導體積體電路上製造該電子器件、該比較器、該比較器偏壓電路、該可程式化電壓緩衝器、該電源分壓器及該n位元寬電源控制匯流 排。
  27. 如請求項21之裝置，其中該比較器、該可程式化電壓緩衝器及該電源分壓器之該等速度及電源使用特性可從緩慢速度及低電力程式化至高速度及高電力。
  28. 如請求項21之裝置，其中存在用於該比較器、該可程式化電壓緩衝器及該電源分壓器之該等速度及電源使用特性的2n 個可程式化選擇。
  29. 如請求項21之裝置，其中該n位元寬電源控制匯流排係一位元寬並且以序列方式程式化該比較器、該可程式化電壓緩衝器及該電源分壓器之該等速度及電源使用特性。
  30. 如請求項21之裝置，其中該可程式化電壓緩衝器之輸出上具有一可程式化電壓位準。
  31. 如請求項30之裝置，其中該n位元寬電源控制匯流排係一位元寬並且以序列方式程式化該可程式化電壓緩衝器之該電壓位準。
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