JP6903398B2 - 駆動装置および液晶表示装置 - Google Patents

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Description

本発明は、液晶パネルの画素領域を駆動する駆動装置、および当該駆動装置を備える液晶表示装置に関する。
近年、異なるサイズの液晶表示装置で同一部品を使用することによって、同一部品の購入数量を増やしてコスト（部品の単価）を下げる、または開発期間の短縮化および設計リソースの削減のために「プラットフォーム」化するというようなことが行われており、多種多様な液晶パネルに同一部品が共通して使用されるようになってきた。
また、一般的に、液晶表示装置の高解像度化およびサイズの拡大化に伴って、液晶パネルを駆動するドライバーＩＣ（Integrated Circuit）の出力段に接続される負荷は重くなる傾向にあり、ドライバーＩＣは高負荷であっても駆動可能な回路を有している。一例として、高負荷を駆動可能なドライバーＩＣでは、出力アンプの駆動能力だけでは十分な出力（電流）が得られない場合のために、出力アンプの出力をアシスト（補助）するアシスト回路（補助回路）を備えているものがある。
ところで、液晶表示のアプリケーションによっては低消費電力の要求があり、液晶パネルの負荷をできるだけ軽くするような多くの試みがなされており、ソースラインの容量または抵抗を低減した液晶パネル構造がある（例えば、特許文献１，２参照）。プラットフォーム化と、多種多様な液晶パネルの負荷を駆動することとを踏まえて、結果的に高負荷の液晶パネルを駆動することが可能なドライバーＩＣを使用して低負荷の液晶パネルを駆動するケースが出てきている。
特開平５−４１６５１号公報 特開２００１−２５５８５７号公報
従来のアシスト回路は、元々想定した高負荷時の動作については問題ないが、低負荷時には条件次第では貫通電流が発生してしまうという問題がある。また、貫通電流は、増加しても表示に影響を及ぼさないため、貫通電流が発生したか否かを製品の状態で簡単にモニタすることができず、液晶パネルが異常状態であるか否かを簡単に知ることができなかった。
本発明は、このような問題を解決するためになされたものであり、アシスト回路に貫通電流を発生させないようにすることが可能な駆動装置および当該駆動装置を備える液晶表示装置を提供することを目的とする。
上記の課題を解決するために、本発明による駆動装置は、液晶パネルに備えられ、液晶パネルの画素領域を駆動する駆動装置であって、外部から入力されたアナログ電源であって、分離された第１のアナログ電源の電位と第２のアナログ電源の電位とを比較して電位差を検出する比較回路と、比較回路で検出された電位差が予め定められた閾値以上である場合に異常状態であると判定する判定回路とを備え、出力アンプと、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタと、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮして大電流が出力されないように設けられた第１の回路および第２の回路とを有し、出力アンプから画素領域への出力を補助する補助回路と、一端が判定回路に接続され、他端が第１の回路を介してＰＭＯＳトランジスタのゲートに接続され、ＰＭＯＳトランジスタ自体の動作を制御する第１の制御スイッチと、一端が判定回路に接続され、他端が第２の回路を介してＮＭＯＳトランジスタのゲートに接続され、ＮＭＯＳトランジスタ自体の動作を制御する第２の制御スイッチとをさらに備え、判定回路が異常状態であると判定した場合において、第１の制御スイッチおよび第２の制御スイッチの各々は、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮしないように制御し、第１のアナログ電源は、比較回路、補助回路、および出力アンプに供給され、第２のアナログ電源は、比較回路に供給され、異常状態は、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮして貫通電流が発生する状態である。
本発明によると、駆動装置は、液晶パネルに備えられ、液晶パネルの画素領域を駆動する駆動装置であって、外部から入力されたアナログ電源であって、分離された第１のアナログ電源の電位と第２のアナログ電源の電位とを比較して電位差を検出する比較回路と、比較回路で検出された電位差が予め定められた閾値以上である場合に異常状態であると判定する判定回路とを備え、出力アンプと、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタと、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮして大電流が出力されないように設けられた第１の回路および第２の回路とを有し、出力アンプから画素領域への出力を補助する補助回路と、一端が判定回路に接続され、他端が第１の回路を介してＰＭＯＳトランジスタのゲートに接続され、ＰＭＯＳトランジスタ自体の動作を制御する第１の制御スイッチと、一端が判定回路に接続され、他端が第２の回路を介してＮＭＯＳトランジスタのゲートに接続され、ＮＭＯＳトランジスタ自体の動作を制御する第２の制御スイッチとをさらに備え、判定回路が異常状態であると判定した場合において、第１の制御スイッチおよび第２の制御スイッチの各々は、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮしないように制御し、第１のアナログ電源は、比較回路、補助回路、および出力アンプに供給され、第２のアナログ電源は、比較回路に供給され、異常状態は、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮして貫通電流が発生する状態であるため、アシスト回路に貫通電流を発生させないようにすることが可能となる。
本発明の実施の形態１によるソースドライバーＩＣの構成の一例を示す図である。 一般的なＶＤＤＡの接続の一例を示す図である。 本発明の実施の形態１によるＶＤＤＡの接続の一例を示す図である。 本発明の実施の形態１による比較回路の一例を示す図である。 本発明の実施の形態１によるソースドライバーＩＣの構成の他の一例を示す図である。 本発明の実施の形態１による液晶表示装置の構成の他の一例を示すブロック図である。 本発明の実施の形態１による液晶表示装置の構成の他の一例を示すブロック図である。 本発明の実施の形態２によるＶＤＤＡの接続の一例を示す図である。 本発明の実施の形態３によるＶＤＤＡの接続の一例を示す図である。 水平解像度とソースドライバーＩＣの出力数および使用個数との関係の一例を示す図である。 一般的な液晶表示装置の構成の一例を示す図である。 一般的な液晶表示装置の構成の他の一例を示す図である。 一般的な液晶表示装置の構成の一例を示すブロック図である。 ドライバーＩＣの構成の一例を示す図である。 電流制御回路の構成の一例を示す図である。 出力アンプのＶＤＤＡ波形の一例を示す図である。 高負荷時および低負荷時のソースドライバーＩＣの書き込みタイミングにおける、出力アンプ電位およびアシスト回路のＮＭＯＳトランジスタのゲート部電位の変化の一例を示す図である。
本発明の実施の形態について、図面に基づいて以下に説明する。
＜前提技術＞
近年、液晶表示装置のコストを低減するために、ドライバーＩＣの出力チャンネル数を増やすことによってドライバーＩＣの使用個数を減らす動きが活発に行われている（図１０参照）。図１０の例では、水平解像度とソースドライバーＩＣの出力数および使用個数との関係の一例を示している。ＴＣＰ（Tape Carrier Package）またはＣＯＦ（Chip On Film）は、液晶パネルに貼り付ける側に設ける端子ピッチを容易に小さくできないため、特に中小型の液晶表示装置ではＣＯＧ（Chip On Glass）化が盛んになってきている。
また、上述の通り、多種多様な液晶パネルに同一部品が共通して使用されるようになってきている（図１１，１２参照）。なお、図１１，１２において、インターフェースコネクタ２０ａ，２０ｂは、単にインターフェースコネクタ２０ともいう。ＥＥＰＲＯＭ２１ａ，２１ｂは、単にＥＥＰＲＯＭ２１ともいう。電源回路２３ａ，２３ｂは、単に電源回路２３ともいう。階調参照電圧生成回路２４ａ，２４ｂは、単に階調参照電圧生成回路２４ともいう。回路基板２６ａ，２６ｂは、単に回路基板２６ともいう。液晶パネル３０ａ，３０ｂは単に液晶パネル３０ともいう。画素領域３１ａ，３１ｂは単に画素領域３１ともいう。
一般的な液晶表示装置では、図１３に示すように、タイミングコントローラーであるＴＣＯＮ１９、ＴＣＯＮ１９の設定データを保存しているＥＥＰＲＯＭ（Electrically Erasable Programmable Read Only Memory、Ｅ２ＰＲＯＭともいう）２１、ソースドライバーＩＣ３２、ゲートドライバーＩＣ２２、電源回路２３、および階調参照電圧生成回路２４などを備えている。なお、図１３において、ＲＳＤＳ Ｔｘ／Ｒｘは、ｍｉｎｉ−ＬＶＤＳ Ｔｘ／Ｒｘなど、他のＴＣＯＮ１９とソースドライバーＩＣ３２との間を接続するインターフェースであってもよい。また、ＬＶＤＳ Ｒｘは、ＴＴＬまたはｅＤＰなど、他のシステム側（図示しない外部機器側。当該外部機器から画像データや同期信号等を液晶表示装置に入力する。）とＴＣＯＮ１９との間を接続するインターフェースであってもよい。
高負荷を駆動可能なドライバーＩＣには、アシスト回路８を備えているものがある（図１４参照）。アシスト回路８は、出力アンプ６とは別個の電流源となっており、液晶パネル３０の画素領域３１への出力を補助する。また、アシスト回路８は、電源側のスイッチであるＰＭＯＳトランジスタと、ＧＮＤ側のスイッチであるＮＭＯＳトランジスタと、ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮして大電流が出力されないような種々の回路（回路Ａ、回路Ｂ）を有している。
また、高負荷の液晶パネルを駆動することが可能なドライバーＩＣを使用して低負荷の液晶パネルを駆動する場合は、電流制御回路５を用いて、外部から入力された信号（入力選択信号）に基づいて出力アンプ６に入力する電流量を変える方法が一般的に行われている（図１５参照）。なお、図１５において、出力アンプに入力する電流量は、「Ａ＞Ｂ＞Ｃ＞Ｄ」となっている。電流制御回路５を用いることによって、低負荷の液晶パネルを駆動するときの消費電流が増えないようにしている。
しかし、近年の出力チャンネル数の増加に伴ってドライバーＩＣに内蔵される出力アンプ数も増加傾向にあることと、解像度の増加が要因となって、例えば１水平期間の時間が短くなってきており、液晶駆動のタイミング設定も厳しくなってきている。例えば、図１６に示すように、ソースドライバーＩＣは、ＴＣＯＮ１９からソースドライバーＩＣ３２に伝送される制御信号の１つであるラッチパルスの立下り後または少し遅れて、ソースラインに対して一斉に、またはある出力端子ブロック毎に少しずつずらして書き込む動作（一般的には「充電」ともいう）を行う。ある１水平期間にソースラインに書き込んだ電圧から次の１水平期間に書き込むためには電圧値を変えるために一度アンプ側とソースラインを切り離す（Hi-Z状態）必要があり、図１４のスイッチ９にて行う。書き込みと同時にＶＤＤＡ電流（アナログ回路用電流）が一気に増加し、それによってＶＤＤＡ電圧（アナログ電源用電圧）が一時的に落ち込むが、これらは徐々に回復していく。このような変動は、一般的に負荷変動と呼ばれており、液晶パネルの解像度、サイズ、または構造ごとに変わる。解像度の増加によって１水平期間の時間は短くなるが、ラッチパルスの「Ｈ」の期間幅は一定期間設ける必要がある。例えば、ソースドライバーＩＣの全出力をショートし一旦中間電位にしてからソースラインに書き込むチャージシェア機能の場合には、ラッチパルスの「Ｈ」幅は１〜３μｓｅｃ程度の時間を確保するのが一般的であり、チャージシェア機能無しの場合においても〜１μｓｅｃ程度は必要である。また、解像度・パネルサイズが増えるに従ってソースラインの容量・抵抗成分は一般的に増える傾向であり、負荷変動が回復するまでの時間が不足する状況が起き易くなる。従って、解像度の増加に伴って電源回路２３の強化が必要になるが、負荷変動は完全に削減できないためＶＤＤＡの電圧レベルとしては変動する機会が増えることになる。
アシスト回路８は、元々想定した高負荷時の動作については問題ないが、アンプ出力制御回路７における寄生容量などの作りこみといった条件次第ではＮＭＯＳトランジスタのゲート部電位が影響を受け、充電するためにＯＮ状態のＰＭＯＳトランジスタと同時にＯＮして貫通電流が発生してしまう（図１７参照）。貫通電流が発生すると、当該貫通電流によって電源およびＧＮＤが揺らされ（電源およびＧＮＤの電位が変動し）、さらに貫通電流が増大するといった悪循環に陥る不具合が生じる。また、アシスト回路８は、ドライバーＩＣに供給される電源ラインのインダクタおよび抵抗成分が多くなってくると、上記の不安定動作がより増幅され、延いてはＦＰＣ２７（図１１，１２参照）からドライバー入力端子（例えば、図１４のＶＤＤＡ端子）までの全体的な抵抗値の変化に弱いものとなる。貫通電流は、増加しても表示に影響を及ぼさないため、貫通電流が発生しているか否かは例えば図３に示すＶＤＤＡの出力に対して電流計を設けてモニタするか、電源回路２３に入力接続する外付け電源ラインに対して電流計を設けてモニタするしかない。したがって、液晶表示装置の製品状態で簡単にモニタすることができないため、液晶パネルが異常状態であるか否かを簡単に知ることができない。
本発明は、このような問題を解決するものであり、以下に詳細に説明する。
＜実施の形態１＞
図１は、本発明の実施の形態１によるソースドライバーＩＣ１の構成の一例を示す図である。なお、ソースドライバーＩＣ１は、図１１〜１３に示すソースドライバー３２に代わるものである。
図１に示すように、ソースドライバーＩＣ１は、ＶＤＤＡ入力端子２と、比較回路３と、判定回路４と、制御スイッチ１０（第１の制御スイッチ）と、制御スイッチ１１（第２の制御スイッチ）とを備えることを特徴としている。その他の構成は、図１４に示すドライバーＩＣの構成と同様であるため、ここでは詳細な説明を省略する。
ソースドライバーＩＣには、ロジック用の電源（ＶＤＤＤ）と、アナログ回路用の電源（ＶＤＤＡ）とがある。図２に示すように、一般的なソースドライバーＩＣ１３では、同電位の端子同士をまとめて配線している。図２の例では、同電位のＶＤＤＡ接続端子１５をまとめて配線し、ソースドライバーＩＣ１３のＶＤＤＡ入力端子１４に接続する場合の一例を示している。ＶＤＤＡ接続端子１５は、液晶パネル１２の周縁部に配置されており、ＦＰＣ２７に設けられた端子と接続可能となっている。なお、ソースドライバーＩＣ１３は、図１３のソースドライバーＩＣ３２であってもよい。液晶パネル１２は、液晶パネル３０（図１１，１２参照）であってもよい。
一方、図３に示すように、本実施の形態１では、ＶＤＤＡ接続端子１７において外部から入力されたＶＤＤＡ（アナログ電源）がＶＤＤＡ１（第１のアナログ電源）の端子とＶＤＤＡ２（第２のアナログ電源）の端子とに物理的に分離されており、ソースドライバーＩＣ１のＶＤＤＡ入力端子２においてもＶＤＤＡ１の端子とＶＤＤＡ２の端子とに物理的に分離されている。ＶＤＤＡ入力端子２におけるＶＤＤＡ１の端子およびＶＤＤＡ２の端子の各々は、比較回路３に接続されている。ＶＤＤＡ接続端子１７は、液晶パネル１６の周縁部に配置されており、ＦＰＣ２７に設けられたＶＤＤＡの端子と接続可能となっている。なお、液晶パネル１６は、液晶パネル３０（図１１，１２参照）であってもよい。
比較回路３は、例えば図４に示すようなコンパレーターを有しており、ＶＤＤＡ１の電位とＶＤＤＡ２の電位との電位差を検出し、検出した電位差を２値論理に変換してから判定回路４に出力する。
判定回路４は、比較回路３で検出された電位差が予め定められた閾値以上である場合に異常状態であると判定する。例えば、判定回路４は、比較回路３から入力された２値論理が「Ｈ」である場合において異常状態であると判定する。判定回路４による判定結果は、電流制御回路５に出力される。
電流制御回路５（図１５参照）は、判定回路４から異常状態である旨の信号（入力選択信号）が入力されると、出力アンプに入力する電流量が少なくなるように切り替える（例えば、ＡからＤに切り替える）。すなわち、判定回路４が異常状態であると判定した場合において、電流制御回路５は、出力アンプ６から画素領域３１（図１１，１２参照）に出力される電流量が少なくなるように制御する。
また、判定回路４が異常状態であると判定した場合において、制御スイッチ１０，１１は、判定回路４から異常状態である旨の信号が入力されると、アシスト回路８が異常に動作しないように、すなわちＰＭＯＳトランジスタおよびＮＭＯＳトランジスタが同時にＯＮしないように制御する。
なお、判定回路４は、異常状態であると判定した場合において、異常状態である旨をシステム側（図示しない）に出力可能にしてもよい。例えば、図５に示すように、ソースドライバーＩＣ１にモニタ端子１８を設け、異常状態である旨の信号（モニタ信号）を、モニタ端子１８を介してＴＣＯＮ１９に出力してもよい（図６参照）。図６において、ＴＣＯＮ１９は、ソースドライバーＩＣ１から入力されたモニタ信号を認識した後、エラー信号としてインターフェースコネクタ２０を介してシステム側に出力することができる。
また、異常状態である旨をシステム側に出力する他の方法として、図７に示すように、異常状態である旨の信号（モニタ信号）を、モニタ端子１８を介してインターフェースコネクタ２０に直接出力するようにしてもよい。この場合、システム側では、異常状態を直接モニタすることができる。
以上のことから、本実施の形態１によれば、低負荷時のアシスト回路８における貫通電流の発生を抑制することができる。従って、ＶＤＤＡの電流値を下げることができ、液晶表示装置の全体的な消費電力を下げることができる。また、液晶パネルが異常状態であるか否かを簡単にモニタすることができる。近年、車載の機能安全規格であるＩＳＯ２６２６２を意識したシステム構築を行う上でそのリスク管理が問われるが、本実施の形態１によれば異常状態（例えば、断線状態）を監視（モニタ）することができる。異常状態をシステム側で監視することが可能であり、仮に液晶パネルが異常状態になったとしても表示自体は行うことができるため、液晶パネルの状態を画面に表示してユーザーに知らせることが可能である。そして、液晶パネルが異常状態である場合は、ユーザーに対して異常状態に対する対処を促すことも可能である。
＜実施の形態２＞
実施の形態１では、図３に示すＶＤＤＡ１およびＶＤＤＡ２を電源回路２３から出力されるＶＤＤＡに共通して接続する場合について説明した。本発明の実施の形態２では、図８に示すように、レギュレータ回路などの安定化回路であるＶＤＤＡ２生成部２９を備えることを特徴としている。なお、ＶＤＤＡ１およびＶＤＤＡ２以外にＶＤＤＤ端子やＧＮＤ端子、設定端子、何も接続しないダミー端子などその他の端子については、「その他」と記載して省略している。構成および動作は、実施の形態１と同様であるため、ここでは詳細な説明を省略する。
図８に示すように、電源回路２３のＶＤＤＡ生成部２８から出力されたＶＤＤＡは、ＶＤＤＡ１とＶＤＤＡ２とに分離される。そして、ＶＤＤＡ２に対して安定化回路であるＶＤＤＡ２生成部２９を備え、ＶＤＤＡ２生成部２９で生成されたＶＤＤＡ２は、ＦＰＣ２７を介してソースドライバーＩＣ１のＶＤＤＡ入力端子２におけるＶＤＤＡ２の端子に入力される。この場合、ＶＤＤＡ２は、出力アンプ６の電源（電流源）として供給されるＶＤＤＡ１と完全に分離される。
以上のことから、本実施の形態２によれば、ＶＤＤＡ２については、図１６に示すような負荷変動を抑制することができる。従って、負荷変動を受けるＶＤＤＡ１との比較が容易となり、アシスト回路８の不安定な動作をより検出し易くなる。
＜実施の形態３＞
本発明の実施の形態３では、図９に示すように、液晶パネル１６に設けられたＶＤＤＡ接続端子１７におけるＶＤＤＡ２の端子をＦＰＣ２７の端側部に対応する位置に配置することを特徴としている。その他の構成および動作は、実施の形態１または２と同様であるため、ここでは詳細な説明を省略する。
図１１，１２に示す液晶表示装置に対して振動または衝撃などのストレスが加わると、ＦＰＣ２７の端側部に応力がかかりやすくなり、ＦＰＣ２７の端部（特に、端側部）から断線しやすくなる。図９に示すように、液晶パネル１６に設けられたＶＤＤＡ接続端子１７におけるＶＤＤＡ２の端子（第２の接続端子）をＦＰＣ２７の端側部に対応する位置に配置した場合において、液晶表示装置に対してストレスが加わると、ＦＰＣ２７の端部の中央側に配置されたＶＤＤＡ１の端子（第１の接続端子）に接続された配線よりも、端側部に配置されたＶＤＤＡ２の端子に接続された配線の方が先に断線することになる。断線した配線の抵抗値は大きく上昇する。液晶パネル１６の配線抵抗と異方性導電膜（ＡＣＦ：Anisotropic Conductive Film）の抵抗とを合計すると、電源およびＧＮＤラインは通常１０Ω以下程度の抵抗値になることが多い（ＦＰＣと回路基板２６上の銅配線部分とは、１Ωよりもはるかに小さいレベルの低抵抗であるため、液晶パネル３０における配線抵抗のばらつきと比較して無視できるレベルである）。また、完全に断線した場合の抵抗値はＭΩオーダーになるが、断線しかかっている場合の抵抗値は通常時の抵抗値と断線時の抵抗値との間の値となる。
以上のことから、本実施の形態３によれば、ＶＤＤＡ１の配線よりも先にＶＤＤＡ２の配線が断線するとＶＤＤＡ２の配線の抵抗値が上昇し、これを比較回路３が検出することができる。また、比較回路３による検出結果に基づいて判定回路４で異常状態を判定し、その結果をシステム側に出力することによって、システム側でＶＤＤＡ２の断線をモニタすることができるようになる。
なお、本発明は、その発明の範囲内において、各実施の形態を自由に組み合わせたり、各実施の形態を適宜、変形、省略することが可能である。また、回路ブロックの一部が他の部品のブロックに移動した形態も可能である。例えば、ＴＣＯＮ１９がソースドライバーＩＣ内部に踏襲されたＴＣＯＮ内蔵ドライバーＩＣのケースでは、図６，７のＲＳＤＳ Ｔｘ／Ｒｘ部分は削除される。あるいは電源回路２３と階調参照電圧生成回路２４が一体となったもの、電源回路２３または階調参照電圧生成回路２４の一部がソースドライバーＩＣ１、またはゲートドライバーＩＣ２２に踏襲された形態も可能である。
１ ソースドライバーＩＣ、２ ＶＤＤＡ入力端子、３ 比較回路、４ 判定回路、５ 電流制御回路、６ 出力アンプ、７ アンプ出力制御回路、８ アシスト回路、９ スイッチ、１０，１１ 制御スイッチ、１２ 液晶パネル、１３ ソースドライバーＩＣ、１４ ＶＤＤＡ入力端子、１５ ＶＤＤＡ接続端子、１６ 液晶パネル、１７ ＶＤＤＡ接続端子、１８ モニタ端子、１９ ＴＣＯＮ、２０ インターフェースコネクタ、２１ ＥＥＰＲＯＭ、２２ ゲートドライバーＩＣ、２３ 電源回路、２４ 階調参照電圧生成回路、２５ 液晶パネル、２６ 回路基板、２７ ＦＰＣ、２８ ＶＤＤＡ生成部、２９ ＶＤＤＡ２生成部、３０ 液晶パネル、３１ 画素領域。

Claims (6)

  1. 液晶パネルに備えられ、前記液晶パネルの画素領域を駆動する駆動装置であって、
    外部から入力されたアナログ電源であって、分離された第１のアナログ電源の電位と第２のアナログ電源の電位とを比較して電位差を検出する比較回路と、
    前記比較回路で検出された前記電位差が予め定められた閾値以上である場合に異常状態であると判定する判定回路と、
    を備え、
    出力アンプと、
    ＰＭＯＳトランジスタおよびＮＭＯＳトランジスタと、前記ＰＭＯＳトランジスタおよび前記ＮＭＯＳトランジスタが同時にＯＮして大電流が出力されないように設けられた第１の回路および第２の回路とを有し、前記出力アンプから前記画素領域への出力を補助する補助回路と、
    一端が前記判定回路に接続され、他端が前記第１の回路を介して前記ＰＭＯＳトランジスタのゲートに接続され、前記ＰＭＯＳトランジスタ自体の動作を制御する第１の制御スイッチと、
    一端が前記判定回路に接続され、他端が前記第２の回路を介して前記ＮＭＯＳトランジスタのゲートに接続され、前記ＮＭＯＳトランジスタ自体の動作を制御する第２の制御スイッチと、
    をさらに備え、
    前記判定回路が前記異常状態であると判定した場合において、
    前記第１の制御スイッチおよび前記第２の制御スイッチの各々は、前記ＰＭＯＳトランジスタおよび前記ＮＭＯＳトランジスタが同時にＯＮしないように制御し、
    前記第１のアナログ電源は、前記比較回路、前記補助回路、および前記出力アンプに供給され、
    前記第２のアナログ電源は、前記比較回路に供給され、
    前記異常状態は、前記ＰＭＯＳトランジスタおよび前記ＮＭＯＳトランジスタが同時にＯＮして貫通電流が発生する状態であることを特徴とする、駆動装置。
  2. 前記出力アンプから前記画素領域に出力される電流量を制御する電流制御回路をさらに備え、
    前記電流制御回路は、前記判定回路が前記異常状態であると判定した場合において、前記出力アンプから出力される前記電流量が少なくなるように制御することを特徴とする、請求項１に記載の駆動装置。
  3. 前記判定回路は、前記異常状態であると判定した場合において、前記異常状態であることを示す信号を外部に出力することを特徴とする、請求項１または２に記載の駆動装置。
  4. 請求項１から３のいずれか１項に記載の駆動装置を備える、液晶表示装置。
  5. 前記第１のアナログ電源および前記第２のアナログ電源は、ＦＰＣ（Flexible Printed Circuit）を介して前記駆動装置に供給され、
    前記液晶パネルは、前記第１のアナログ電源について前記ＦＰＣと接続可能な第１の接続端子と、前記第２のアナログ電源について前記ＦＰＣと接続可能な第２の接続端子とを備え、
    前記第２の接続端子は、前記ＦＰＣの端側部に対応する位置に配置されることを特徴とする、請求項４に記載の液晶表示装置。
  6. 前記第２のアナログ電源は、安定化回路を介して前記駆動装置に供給されることを特徴とする、請求項５に記載の液晶表示装置。
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