KR970024513A - 연산증폭기 및 디지탈신호전달회로 - Google Patents

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Abstract

입력에 잡음이 들어가도 그 영향을 출력에 미치지 않는 잡음제거기능을 갖는 연산증폭기 및 그 연산증폭기를 사용한 디지탈신호 전달회로에 관한 것으로서, 하이에서 로우로 변화하는 잡음등이 입력신호에 혼재한 경우에도 출력전압은 그의 잡음에 의해 급격하게 저하하지 않는 연산증폭기 및 디지탈신호 전달회로를 제공하기 위해서, 콜렉터가 베이스에 접속되는 제1트랜지스터와 이미터가 제1트랜지스터의 이미터에 접속되는 제2트랜지터에 의해 구성되는 차동쌍트랜지스터, 이 차동쌍트랜지스터의 출력노드에 콜렉터가 접속되는 제3트랜지스터와 베이스가 제3트랜지스터의 베이스에 접속되는 제4트랜지스터로 구성되는 전류미러회로, 콜렉터가 출력단에 접속되고 베이스가 전류미러회로의 출력노드에 접속되는 제5트랜지스터 및 전류미러회로의 출력노드와 출력단사이에 접속되는 용량성소자로 되는 구성으로 하였다. 이러한 구성으로 하는 것에 의해, 반도체집적회로화에 적합한 디지탈 신호 전달회로 및 잡음제거회로에 적용할 수 있고, 또 입력신호가 하이에서 로우로 급격하게 변화했다고 해도 그 변화에 의해 입력단에서 출력단에 영향을 미치지 않도록 할 수 있는 효과가 얻어진다.

Description

연산증폭기 및 디지탈신호전달회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시 형태1의 연산증폭기를 도시한 도면.
제2도는 본 발명의 실시 형태2의 연산증폭기를 도시한 도면.
제3도는 본발명의 실시 형태3의 연산증폭기를 도시한 도면.

Claims (2)

  1. 제어전극에 입력신호를 받고 한쪽의 주전극이 제1전원전위노드에 접속되 는 제1도전형의 제1트랜지스터와 제어전극을 출력신호에 받고 다른쪽의 주전극이 상기 제1트랜지스터의 다른쪽의 주전극에 접속되는 제1도전형의 제2트랜지스터를 갖고, 이 제2트랜지스터의 한쪽의 주전극이 출력노드로 되는 차동쌍트랜지스터, 이 차동쌍트랜지스터의 출력노드에 한쪽의 주전극과 제어전극이 접속되고 다른쪽의 주전극이 상기 제1전원전위노드에 접속되는 제2도전형의 제3트랜지스터와 제어전극이 상기 제3트랜지스터의 제어전극에 접속되고 다른쪽의 주전극이 상기 제1전원전위노드에 접속되는 제2도전형의 제4트랜지스터를 갖고, 이 제4트랜지스터의 한쪽의 주전극이 출력노드로 되는 전류미러회로, 한쪽의 주전극이 출력단에 접속되고 다른쪽의 주전극이 상기 제1전원전위노드에 접속되며 제어전극이 상기 전류미러회로의 출력노드에 접속되는 제2도전형의 제5트랜지스터 및 상기 전류미러회로의 출력노드와 상기 출력단 사이에 접속되는 용량성소자를 구비한 것을 특징으로 하는 연산증폭기.
  2. 비반전입력단에 디지탈입력신호를 받는 연산증폭기와 이 연산증폭기의 출력을 비반전입력단에 받고 반전입력단에 기준전압을 받는 비교기를 구비한 디지탈신호 전달회로로서, 상기 연산증폭기는 제어전극이 비반전입력단에 접속되는 제1도전형의 제1트랜지스터와 제어전극에 기준전압을 받고 다른쪽의 주전극이 상기 제1트랜지스터의 다른쪽의 주전극에 접속되는 제1도전형의 제2트랜지스터를 갖는 차동쌍트랜지스터, 상기 제2트랜지스터의 한쪽의 주전극에 한쪽의 주전극과 제어전극이 접속되고 다른쪽의 주전극이 제1전원전위노드에 접속되는 제2도전형의 제3트랜지스터와 제어전극이 상기 제3트랜지스터의 제어전극에 접속되고 한쪽의 주전극이 상기 제1트랜지스터의 한쪽의 주전극에 접속되며 다른쪽의 주전극이 상기 제1전원전위노드에 접속되는 제2도전형의 제4트랜지스터를 갖고, 이 제4트랜지스터의 한쪽의 주전극이 출력노드로 되는 전류미러회로, 한쪽의 주전극이 출력단에 접속되고 다른쪽의 주전극이 제1전원전위노드에 접속되며 제어전극이 상기 전류미러회로의 출력노드에 접속되는 제2도전형의 제5트랜지스터 및 상기 전류미러회로의 출력노드와 상기 출력단 사이에 접속되는 용량성소자를 구비한 것을 특징으로 하는 디지탈신호 전달회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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