KR960012917B1 - 주파수 안정화 수단을 구비한 발진기 - Google Patents

주파수 안정화 수단을 구비한 발진기 Download PDF

Info

Publication number
KR960012917B1
KR960012917B1 KR1019880009846A KR880009846A KR960012917B1 KR 960012917 B1 KR960012917 B1 KR 960012917B1 KR 1019880009846 A KR1019880009846 A KR 1019880009846A KR 880009846 A KR880009846 A KR 880009846A KR 960012917 B1 KR960012917 B1 KR 960012917B1
Authority
KR
South Korea
Prior art keywords
current
current source
oscillator
transistors
transistor
Prior art date
Application number
KR1019880009846A
Other languages
English (en)
Other versions
KR890004481A (ko
Inventor
페릭스 톰멘 베르너
Original Assignee
엔. 브이. 필립스 글로아이람펜파브 리켄
이반 밀러 레르너
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 엔. 브이. 필립스 글로아이람펜파브 리켄, 이반 밀러 레르너 filed Critical 엔. 브이. 필립스 글로아이람펜파브 리켄
Publication of KR890004481A publication Critical patent/KR890004481A/ko
Application granted granted Critical
Publication of KR960012917B1 publication Critical patent/KR960012917B1/ko

Links

Images

Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03B—GENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
    • H03B5/00—Generation of oscillations using amplifier with regenerative feedback from output to input
    • H03B5/08—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance
    • H03B5/12—Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element comprising lumped inductance and capacitance active element in amplifier being semiconductor device
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
    • H03K3/027—Generators characterised by the type of circuit or by the means used for producing pulses by the use of logic circuits, with internal or external positive feedback
    • H03K3/03—Astable circuits
    • H03K3/0315—Ring oscillators
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
    • H03K3/353—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of field-effect transistors with internal or external positive feedback
    • H03K3/354—Astable circuits
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L1/00—Stabilisation of generator output against variations of physical values, e.g. power supply

Landscapes

  • Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

내용없음

Description

주파수 안정화 수단을 구비한 발진기
제1도는 본 발명에 따른 주파수 안정화 수단을 구비한 발진기의 회로선도.
제2도는 제1도에 도시된 회로의 제1실시예도.
제3도는 제1도에 도시된 회로의 제2실시예도.
제4도는 제1도에 도시된 회로의 또 다른 실시예도.
* 도면의 주요부분에 대한 부호의 설명
CCS : 전류원SWEL : 스위칭 소자
DELC : 지연 회로FS : 주파수 안정화 수단
B1: 제1전류 브랜치B2: 제2전류 브랜치
RCS : 바이어스 전류원
본 발명은 제1 및 제2전력 공급단자간에 연결되며, 주파수 안정화 수단에 의해 제어 가능하고 제2전력 공급단자에 연결된 전류원의 직렬 접속부와 용량성 부하의 병렬 접속부와 스위칭 소자의 전류 경로를 포함하는 발진기에 관한 것인데, 상기 병렬 접속부는 제1전력 공급단자 및 제어가능한 전류원과 피이드백되는 병렬 접속부간의 접합점에 연결되며 지연회로를 통해 스위칭 소자의 제어 접속부에 연결된다.
상기 종류의 발진기는 미합중국 특허 제4,015,219호에서 공지되었다. 상기 공지된 발진기는 주기적으로 캐스캐이드(cascade)된 단을 포함하는 링(ring) 발진기이며 상기 단은 제1 및 제2전계효과 트랜지스터의 전류 경로의 직렬 접속부를 포함한다. 상기 제1 및 제2트랜지스터의 전류 경로는 각각의 제1 및 제2전력 공급단자에 연결된다. 상기 전류 경로간의 접합점은 그 다음 단에서 제1트랜지스터의 게이트 전극에 연결된다. 하나를 제외한 모든 단에 있어서, 접합점은 캐패시턴스를 통해 제1전력 공급단자에 연결된다. 이러한 캐패시턴스를 포함하지 않는 단은 출력단으로써 작동한다. 제2트랜지스터의 게이트 전극은 주파수 안정화 수단에 연결된다. 이들 주파수 안정화 수단은 제1전력 공급단자의 한쪽과 저항기를 통해 제2전력 공급단자의 다른 한쪽에 연결된 제3 및 제4트랜지스터의 전류 경로의 병렬 접속부를 포함한다. 상기 제3 및 제4트랜지스터의 게이트 전극은 각기 제1 및 제2전력 공급단자에 연결된다. 병렬 접속부와 저항기간의 접합점은 제2트랜지스터의 게이트 전극에 연결된다. P-채널 증진형의 제1 및 제3트랜지스터는 실제로 동일하며, P-채널 소모형의 제2 및 제4트랜지스터는 실제로 동일하다. 공지된 주파수 안정화 수단의 동작은 아래와 같다. 회로의 온도가 상승할 시에 제어된 전류원으로써 연결된 제2트랜지스터로부터 전류를 전도하는데 필수적인 제1트랜지스터로부터 전류를 전도하는데 필수적인 제1트랜지스터의 스위칭 역치는 증가한다. 따라서, 긴 시간의 주기가 스위칭 역치와 동등한 전압에 캐패시턴스를 발생하기 위해 요구되므로 충전 전류는 감소하고 발진은 증가한다. 주파수 안정화 수단내에서 병렬 접속부의 임피던스는 접합점에서 전압이 증가하도록 또한 증가한다. 따라서, 제2트랜지스터는 보다 많은 전류를 공급하며, 온도 상승의 영향을 방해한다. 제2전력 공급 단자상의 전압이 증가할 시에, 제2트랜지스터를 통해 전류는 증가한다. 상기는 캐패시턴스의 양단전압이 스위칭 역치에 빠르게 증가하기 때문에 발진 주기를 감소한다. 그러나 제3트랜지스터를 통해 전류가 또한 증가하며 따라서 접합점에서 전압은 제2트랜지스터를 위해 제어 전압의 감소를 야기하고 전류가 감소한다. 상기는 전력 공급 전압상의 변동의 영향을 방해한다.
공지된 주파수 안정화 수단은 과보상 또는 부족 보상을 피하기 위해 매우 정확히 조화되야 한다. 이러한 것은 제1 및 제3트랜지스터가 제2 및 제4트랜지스터 유사하게 실제로 동일하더라도, 상기 동일 트랜지스터의 동작 범위는 서로 상관 관계가 없다는 사실에 기인한다. 상기는 이하 설명될 것이다. 각 제2트랜지스터는 저항기 양단의 전압 강하에 의해 결정되는 제어 전압을 수신한다. 상기 전압 강하는 제3 및 제4트랜지스터의 채널을 통해 전류에 의해 야기된다. 그러나, 제2트랜지스터와 실제로 동일한 제4트랜지스터는 상기 트랜지스터의 게이트 전극상의 제1전력 공급 단자의 전압을 수신하고 저항기 양단의 전압 강하에 의해 야기된 유도 전압에 직면한다.
각 제1트랜지스터는 제1전력 공급단자 및 제2전력 공급단자에서 전압간에 변화하는 제어전압 특히 단의 수에 의해 제어된다. 그후 각 제1트랜지스터는 전력 공급단자에서 전압간에 변화하는 유도 전압에 직면한다. 제3트랜지스터의 게이트 전극은 제2공급 단자의 전압을 수신한다. 그러나 제3트랜지스터의 유도 전압은 저항기 양단의 전압 강하에 의해 결정된다. 그러므로, 제1 및 제2트랜지스터는 각기 제3 및 제4트랜지스터의 동작 범위로부터 벗어난 범위에서 동작하며 따라서, 주파수 안정화 수단의 세팅은 표류하기 쉽기 때문에 안정될 수 없다.
본 발명의 목적은 발진 주파수에 대해 안정한 기준을 제공하는 주파수 안정화 수단을 포함하는 발진기를 제공하는 것인데 상기 발진 주파수는 제조동안 피하기 어렵게 도입되는 파라미터 스프레드(spread)에 보다 적은 영향을 받는다. 상기를 성취하기 위해, 본 발명에 따른 주파수 안정화 수단을 포함하는 발진기에 있어서, 상기 주파수 안정화 수단은 각각의 제1 및 제2전력 공급 단자에 연결된 바이어스 전류원과 저항을 가진 제1전류 브랜치, 스위칭 소자와 실제로 동일하며 각각의 제1 및 제2전력 공급 단자에 연결된 또 다른 전류원 및 전류 경로와 동일 센스에서 기준 소자의 제어 연결이 저항기에 결합되기 위해 바이어스 전류원에 결합되고 실제로 동일한 전류를 공급하는 제어가능한 전류원과 또다른 전류원을 가지는 제2전류 브랜치 및 상기 제2전류 브랜치에서 기준 소자 및 전류에 대한 제어 전압의 비율이 실제로 상수이며 바이어스 전류원이 조정될 수 있도록 제1전류 브랜치를 위해 제2전류 브랜치 내의 기준 소자의 양단 전압을 피이드백하는 피이드백 수단을 포함하는 것을 특징으로 한다. 저항기를 통해, 주파수 안정화 수단은 제어가능한 전류원에 의해 공급되도록 전류를 전도하기 위해 필요한 스위칭 소자의 입력에 제어 전압(스위칭 역치)의 비율을 결정하고 상기 전류는 공급된다. 상기 동일 비율은 발진 주파수를 결정한다.
본 발명에 따른 주파수 안정화 수단을 구비하는 발진기의 실시예에 있어서, 바이어스 전류원, 또 다른 전류원 및 제어가능한 전류원은 각각의 제1, 제2 및 제3트랜지스터를 포함하는 전류 밀러를 형성하며, 상기 트랜지스터의 제어 전극은 실제로 동일한 제2 및 제3트랜지스터에 상호 연결되며, 제1, 제2 및 제3트랜지스터는 제1전도형이고 제2전력 공급단자에 연결된 각각의 전류 경로를 가지며, 기준 소자 및 스위칭 소자는 제2전도형의 제4 및 제5트랜지스터를 구비하는 것을 특징으로 한다. 전류 밀러의 사용 결과로써, 전류는 바이어스 전류원, 또 다른 전류원 및 제어가능한 전류원에 의해 공급되고 그들의 비율이 간단히 규정된다.
본 발명에 따른 주파수 안정화 수단을 구비하는 발진기의 또 다른 실시예는 피이드백 수단이 제2전도형의 제6트랜지스터, 저항과 바이어스 전류원간의 제1전류 브랜치내에 포함된 전류경로, 기준 소자와 다른 전류원간의 제2전류 브랜치에 연결된 제어 전극 및 제6트랜지스터와 바이어스 전류원간의 접합점에 연결된 제1, 제2 및 제3트랜지스터를 포함하는 것을 특징으로 한다. 제6트랜지스터에 의해 간단한 피이드백은 스위칭 역치와 전류의 상기 비율의 안정한 셋팅을 초래한다.
전계효과 트랜지스터에 의해 안정한 전류원의 실현은 그레이와 메이어, 윌리와 선즈에 의해 명칭이 아날로그 집적회로의 분석 및 설계인 1984년도 제2판 페이지 732에서 공지된다. 본 발명에 따른 회로에 있어서, 상기 공지된 전류원은 상기 공지된 전류원에서 나타나는 저항을 사용하여 발진 주기의 표현에서 나타나는 스위칭 역치와 전류의 비를 정의하는데 이용된다.
공지된 발진기의 다른 결정은 발진기의 출력상의 부하가 발진 주파수에 영향을 미친다는 것이다. 상기는 예를 들면 미합중국 특허 제4,072,910호에서 기술된 회로에서와 같이 출력에 버퍼를 연결하므로 방지될 수 있다. 여기서 다른 인버터의 형태에 있어서 버퍼는 직렬 인버터를 가진 링 발진기의 출력에 연결된다. 상기 버퍼는, 상기 버퍼의 출력단자상의 신호에 명백히 되는 버퍼 자체내의 온도영향을 제외하고, 예를 들면 온도-증속 엣지 경사도의 형태내에서 부하에 의한 발진 주파수의 영향을 방지한다.
본 발명의 목적은 주파수 안정화 수단과 상기 주파수 안정화 수단에 의해 제어가능한 출력단을 포함하는 발진기를 제공하는 것이다.
상기를 성취하기 위해, 본 발명에 따른 주파수 안정화 수단을 구비하는 발진기의 실시예에 있어서, 상기 발진기는 제1 및 제2전력 공급단자간의 주파수 안정화 수단 및 출력 스위칭 소자의 전류 경로에 의해 제어가능한 출력 전류원의 직렬 연결을 포함하는 출력단을 연결하며 출력 스위칭 소자의 제어 입력은 제어가능한 전류원과 병렬 연결간에 접속되며, 상기 출력 스위칭 소자는 실제로 기준 소자와 동일하며, 전류의 비율은 출력 전류원과 실제로 상수인 제어가능한 전류원에 의해 제공되는 것을 특징으로 한다. 부가적 출력단은 발진기에 결합되고 클럭 펄스에 대해 제공되는 부하에 의해 발진 주기의 영향을 방지한다. 게다가, 주파수 안정화 수단에 의해 출력 전류원을 제어하므로, 출력단의 출력 신호는 출력단이 발진기 내에서 성분에 동일한 성분을 포함하기 때문에 발진기 신호에 대해 동기될 수 있다. 상기 발진기 신호는 출력단의 출력보다 온도에 대해 안정된다.
또 다른 장점은 신호 진폭이 증가될 수 있다는 점이다. 상기 단부에서, 상기 전류몫은 출력 전류원 및 제어가능한 전류원에 의해 제공되는 전류몫을 증가시켜야 하는 출력단상의 용량성 부하 및 발진기내의 병렬 접속에 대한 용량성 부하에 의해 제공된다.
본 발명에 또다른 주파수 안정화 수단을 구비하는 발진기의 또 다른 실시예에 있어서, 각각의 상기 전류원은 제1전도형의 트랜지스터의 직렬 연결을 포함하는 것을 특징으로 한다. 바이어스 전류원을 실현하므로, 상기 전류원의 출력 임피던스가 증가되는 직렬 연결에 의해 또 다른 전류원과 제어가능한 전류원은 공급 전압 변동에 대해 발진 주기의 자화율을 감소한다.
이하, 첨부된 도면을 참조로 하여 본원 명세서를 더욱 상세히 설명하기로 한다.
제1도는 본 발명에 따른 주파수 안정화 수단을 포함하는 발진기의 회로선도이다. 발진기는 전류원 CCS, 용량성 부하 C와 스위칭 소자 SWEL의 병렬 연결 및 지연회로 DELC를 포함한다. 상기 지연회로 DELC는 예를 들면 소극적 RC 회로 또는 CCS, C 및 SWEL을 가진 세개의 유사단을 포함하며, 따라서 공지된 링 발진기를 형성한다. 지연회로 DELC는 용량성 부하 C상의 신호 V(t)가 스위칭 소자 SWEL의 제어 입력에 연결될 시에 지연 TD를 도입한다. 전류원 CCS은 용량성 부하 C를 충전하거나 스위칭 역치 V0가 제어 입력상에 초과된 후 스위칭 소자 SWEL에 의해 전도되는 전류 I0를 공급한다. 이들 데이타로부터, 발진기의 발진 주기 T가 T=2TD+C·V0/±0에 의해 주어지게 되는 것을 간단히 유도할 수 있다. 스위칭 역치 V0와 전류 I0및 주기 T는 제조 공정에서 초래된 온도, 공급 전압 및 파라미터 스프레드에 좌우된다. 그러나 발진 주기 T에 대한 표현에 있어서, 단지 V0와 I0의 비율만 발생한다. 그러므로 안정한 발진 주기를 위, 이들 두 양 V0및 I0의 고정된 비율이 충분하다. 그러므로, 주파수 안정화 수단 FS이 제공된다. 이들 수단은 제1전류 브랜치 CB1, 제2전류 브랜치 CB2, 스위칭 소자 SWEL에 실제로 동등한 기준소자 REFEL, 저항기 R, 제1 및 제2전류 브랜치간의 피이드백 회로 FBM, 전류 I1을 공급하는 바이어스 전류원 RCS 및 I1=a±0로 고정된 I1과 I0의 비율인 제2전류 브랜치 CB2를 통해 I0에 동등한 전류 I2를 전도하는 제어수단 CM을 포함한다. 피이드백 회로는 기준소자 REFEL 전류 I2=I0를 전도하도록 저항기 R에 인가된 신호를 조정하며 상기는 기준 소자 REFEL의 제어 입력상의 스위칭 역치 V0에 동등한 제어 전압을 요구한다. 따라서 전압 V0는 전류 I1에 기인하여 저항기 R 양단에 나타난다. I1과 I0의 비율이 고정되기 때문에, V0와 I0의 비율은 V0/I0=aV0/I1+aR로 실제로 일정한 저항기 R의 비율수 및 값에만 종속한다. 발진 주기 T에 대한 표현에 있어서, 상기 결과의 대체는 T=2TD+aRC를 유도하며 상기 표현은 단지 상수만을 포함한다.
제2도는 본 발명에 따른 회로의 제1실시예를 도시한다. 발진기는 공지된 링 발진기로써 구성되고 P-채널 MOS 트랜지스터 P3, P4, P5, N-채널 MOS 트랜지스터 N3, N4, N5및 용량성 부하 C3, C4, C5를 포함한다. 후자 성분이 명백히 도시되었더라도, 이들은 각각 N4, N5및 N3의 입력 캐패시턴스만 교번적으로 나타낸다. 주파수 안정화 수단은 P-채널 MOS 트랜지스터 P1과 P2, N-채널 MOS 트랜지스터 N1과 N2및 저항기 R을 포함한다. 링 발진기에서 발진 주기는 모든 단위 지연시간 합계에 의해 결정된다.
이미 기술된 바와 같이 스위칭 역치 V0와 전류 I0의 몫은 일정한 발진 주기 T를 유지하기 위해 단마다 일정하게 유지해야 한다. 제2도에 도시된 P 트랜지스터 P1내지 P5는 N 트랜지스터 N1내지 N5와 용량성 부하 C3, C4, C5처럼 실제로 동일하다. 그후 발진주기 T는 아래와 같이 결정된다. 전류원으로써 연결된 각각의 트랜지스터 P1내지 P5는 동일 제어 전압을 수신하고, 그러므로 각 트랜지스터는 동일 진폭의 전류 I1내지 I5를 전도한다. 평형 상태의 단에 있어서, 상기 전류는 트랜지스터 N2를 통해 동일 전류를 전도하기 위해 트랜지스터 N2의 제어 전극상에 요구된 전압을 저항기 R 양단에 야기하기 위해 충분히 크다. 그후 상기 전압 V0(스위칭 역치)와 전도 전류 I2의 비율은 저항기 R의 값과 동일하다. 예를 들면 P4, N4및 C4와 같은 발진기의 단에서 스위칭 소자(N4)는 전류원(P4)이 용량성 부하(C4)를 충전하도록 차단될 시에, 다음단(N5)의 스위칭 소자의 제어 입력상의 전압 V4는 증가한다. 제어 전압 V4가 스위칭 역치 레벨 V0에 도달하며 그후 다음단(N5)의 스위칭 소자가 관련된 전류원(P5)으로부터 전류를 전도할 시에 관련 용량성 부하(C5)는 방전된다. 그후 후속단(P3, N3및 C3)에서 스위칭 소자(N3)는 상기 단의 제어 입력상의 낮은 제어 전압 V5를 수신하며 따라서, 상기 스위칭 소자(N3)는 차단되고 관련 용량성 부하(C3)는 관련 전류원(P3)에 의해 충전된다. 따라서, 다음 단(P4, N4및 C4)는 상기 단의 스위칭 소자(N4)의 제어 입력상의 증가 전압 V3을 수신하도록 연결되며, 상기 제어 전압 V3는 관련 용량성 부하(C4)의 전압이 스위칭 역치 V0를 초과할 때마다 방전되는 것을 보장한다. 링 발진기 회로에 있어서, 상기 패턴은 단을 통해 대칭적으로 시프트된다. 매 단마다 지연시간은 다음 단에서 스위칭 소자의 스위칭 역치를 위해 제로와 동등한 전압으로부터 관련 캐패시턴스를 충전하기 위해 요구된 시간의 주기에 실제로 가까우며, 그후 상기 스위칭 소자는 전류원으로부터 전류를 전도한다. 온도 상승에 기인하여 트랜지스터 N2(및 또한 트랜지스터 N3, N4및 N5)의 임피던스가 증가할 시에, 보다 높은 스위칭 역치 전압 V0이 동일 전류를 전도하기 위해 요구된다. 그후 위치 A에서 전압 V2가 증가하며, 따라서 트랜지스터 N1은 보다 많이 전도되고 전압은 위치 B에서 감소하며, 따라서 전류원 I1은 보다 많은 전류를 공급하며, 저항기 R의 양단 전압을 증가한다. 트랜지스터 N2는 전압이 위치 A에서 더 이상 증가하지 않을 때까지 보다 많이 전도하도록 동작한다. 이것은 트랜지스터 N2가 트랜지스터 P2에 의해 공급된 전류 전부를 전도하는 경우이다. 트랜지스터 P1이 보다 많은 전류를 공급하기 때문에, 트랜지스터 P2내지 P5또한 상기와 같이 동작한다. 그후, 전류와 스위칭 역치의 비율이 R의 값과 다시 동등하며, 따라서 발진 주기는 일정하게 유지한다.
제3도는 제2도에 도시된 회로의 또다른 실시예를 도시하며, 제2도와 상승한 소자는 상응한 기준에 의해 표시된다. 제3도에 도시된 회로는 트랜지스터 P1내지 P5에 관련하여 각각의 캐스코우드(cascode, P1/P6내지 P5/P10을 형성하는 P-채널 트랜지스터 P6내지 P10을 또한 포함한다. 캐스코우드 연결은 출력 임피던스를 증가하며, 따라서 공급 전압 VDD에서 변동에 발진 주기 T의 자화율을 감소한다.
트랜지스터가 제2 및 3도에서 전계효과 트랜지스터로써 도시된 경우라도, 등가회로는 바이폴라(bipolar) 트랜지스터에 의해 실현될 수 있다.
제4도는 본 발명에 따른 주파수 안정화 수단을 포함하는 발진기의 또 다른 실시예를 도시한다. 상기 발진기는 PNP 트랜지스터 P4, P5및 P6, NPN 트랜지스터 N1, N2및 저항 R을 포함한다. 피이드백은 트랜지스터 N1및 P2를 통해 실현된다.
평행 상태의 단에서, 트랜지스터 P1, P2및 P3는 저항 R, 트랜지스터 N1및 트랜지스터 N2에 의해 드레인된 만큼의 전류를 공급한다. 저항기 R의 양단 전압은 단지 트랜지스터 P3로부터 트랜지스터 N1의 베이스 전류를 뺀 전류를 전도하는 트랜지스터 N2를 형성하기에 충분하다. 트랜지스터 N1이 트랜지스터 N2보다 적기 때문에 이하 기술될 바와 같이 트랜지스터 N1의 베이스 전류는 무시된다. 트랜지스터 N1는 접합점 K에서 전압에 대해 센서로써 작동한다. 트랜지스터 N1을 형성하는 평형 상태로부터 접합점 K에서 전압의 분배는 얼마간 전도하며, 따라서 접합점 L에서 전압도 또한 변동한다. 상기 접합점 L에서 전압은 트랜지스터 P1내지 P3을 통해 전류를 계속하여 제어한다. 트랜지스터 N1가 보다 적은 트랜지스터 P2를 통한 전류와 트랜지스터 P1및 P3의 베이스 전류를 드레인하기 때문에, 트랜지스터 N1은 트랜지스터 N2보다 적다. 트랜지스터 P2가 트랜지스터 N1에 관련하여 트랜지스터 P1및 P3를 제어하는 단자 L에서 전압을 형성하기 때문에, 트랜지스터 P2는 트랜지스터 P1및 P3보다 적다. 따라서 트랜지스터 P2는 큰 전류를 전도할 필요가 없다.

Claims (8)

  1. 제1 및 제2전력 공급단자간에 연결되며, 주파수 안정화 수단에 의해 제어 가능하고 제2전력 공급단자에 연결된 전류원의 직렬 접속부와 용량성 부하의 병렬 접속부와 스위칭 소자의 전류 경로를 포함하는 발진기에 있어서, 상기 주파수 안정화 수단은 각각의 제1 및 제2전력 공급단자에 연결된 바이어스 전류원과 저항을 가진 제1전류 브랜치, 스위칭 소자와 실제로 동일하며 각각의 제1 및 제2전력 공급단자에 연결된 또다른 전류원 및 전류 경로와 동일 센스에서 기준소자의 제어 연결이 저항기에 결합되기 위해 바이어스 전류원에 결합되고 실제로 동일한 전류를 공급하는 제어가능한 전류원과 또다른 전류원을 가지는 제2전류 브랜치 및, 상기 제2전류 브랜치에서 기준 소자 및 전류에 대한 제어 전압의 비율이 실제로 상수이며 바이어스 전류원이 조정될 수 있도록 제1전류 브랜치를 위해 제2전류 브랜치내의 기준 소자의 양단 전압을 피이드백하는 피이드백 수단을 포함하는 것을 특징으로 하는 발진기.
  2. 제1항에 청구된 바와 같이 주파수 안정화 수단을 포함하는 발진기에 있어서, 바이어스 전류원, 또다른 전류원 및 제어 가능한 전류원은 각각의 제1, 제2 및 제3트랜지스터를 포함하는 전류 밀러를 형성하며, 상기 트랜지스터의 제어 전극은 실제로 동일한 제2 및 제3트랜지스터에 상호 연결되며, 제1, 제2 및 제3트랜지스터는 제1전도형이고 제2전력 공급단자에 연결된 각각의 전류 경로를 가지며, 기준 소자 및 스위칭 소자는 제2전도형의 제4 및 제5트랜지스터를 구비하는 것을 특징으로 하는 발진기.
  3. 제2항에 청구된 바와 같은 주파수 안정화 수단을 포함하는 발진기에 있어서, 피이드백 수단이 제2전도형의 제6트랜지스터, 저항과 바이어스 전류원간의 제1전류 브랜치내에 포함된 전류 경로, 기준 소자와 다른 전류원간의 제2전류 브랜치에 연결된 제어 전극 및 제6트랜지스터와 바이어스 전류원간의 접합점에 연결된 제1, 제2 및 제3트랜지스터를 포함하는 것을 특징으로 하는 발진기.
  4. 제2항에 청구된 바와 같은 주파수 안정화 수단을 포함하는 발진기에 있어서, 피이드백 수단은 각각의 제1 및 제2전도형의 제6 및 제7트랜지스터, 제1전력 공급단자에 제2전력 공급단자를 연결하는 제6 및 제7트랜지스터의 전류 경로의 직렬 연결, 제1, 제2 및 제3트랜지스터의 제어 전극에 연결되고 제6과 제7트랜지스터의 전류 경로간에 연결된 제6트랜지스터의 제어 전극 및 제3트랜지스터와 기준 소자간의 제2전류 브랜치에 연결된 제7트랜지스터와 제어 입력을 포함하는 것을 특징으로 하는 발진기.
  5. 제1,2,3 또는 4항에 청구된 바와 같이 주파수 안정화 수단을 포함하는 발진기에 있어서, 상기 발진기는 제1 및 제2전력 공급단자간의 주파수 안정화 수단 및 출력 스위칭 소자의 전류 경로에 의해 제어가능한 출력 전류원의 직렬 연결을 포함하는 출력단을 연결하며 출력 스위칭 소자의 제어 입력은 제어 가능한 전류원과 병렬 연결간에 접속되며, 상기 출력 스위칭 소자는 실제로 기준 소자와 동일하며, 전류의 비율은 출력 전류원과 실제로 상수인 제어가능한 전류원에 의해 제공되는 것을 특징으로 하는 발진기.
  6. 제2,3,4 또는 5항에서 청구된 바와 같이 주파수 안정화 수단을 포함하는 발진기에 있어서, 각각의 상기 전류원은 제1전도형의 트랜지스터의 직렬 연결을 포함하는 것을 특징으로 하는 발진기.
  7. 선행항중 어느 한 항에서 청구된 바와 같이 주파수 안정화 수단을 포함하는 발진기에 있어서, 바이어스 전류원은 또다른 전류원에 의해 공급된 전류와 실제로 동일한 전류를 공급하는 것을 특징으로 하는 발진기.
  8. 선행항중 어느 한 항에서 청구된 바와 같이 주파수 안정화 수단을 포함하는 발진기에 있어서, 저항기는 가변인 것을 특징으로 하는 발진기.
KR1019880009846A 1987-08-04 1988-08-02 주파수 안정화 수단을 구비한 발진기 KR960012917B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
NL8701831 1987-08-04
NL8701831A NL8701831A (nl) 1987-08-04 1987-08-04 Oscillator met frekwentiestabilisatiemiddelen.

Publications (2)

Publication Number Publication Date
KR890004481A KR890004481A (ko) 1989-04-22
KR960012917B1 true KR960012917B1 (ko) 1996-09-25

Family

ID=19850409

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019880009846A KR960012917B1 (ko) 1987-08-04 1988-08-02 주파수 안정화 수단을 구비한 발진기

Country Status (5)

Country Link
US (1) US4893095A (ko)
EP (1) EP0304975A1 (ko)
JP (1) JPS6451818A (ko)
KR (1) KR960012917B1 (ko)
NL (1) NL8701831A (ko)

Families Citing this family (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5239274A (en) * 1992-05-26 1993-08-24 Digital Equipment Corporation Voltage-controlled ring oscillator using complementary differential buffers for generating multiple phase signals
US5485490A (en) * 1992-05-28 1996-01-16 Rambus, Inc. Method and circuitry for clock synchronization
USRE38482E1 (en) * 1992-05-28 2004-03-30 Rambus Inc. Delay stage circuitry for a ring oscillator
US5285173A (en) * 1992-07-13 1994-02-08 Analog Devices, Inc. Signal-controlled ring oscillator with delay cells having constant gain with change in frequency
JPH07240670A (ja) * 1994-02-28 1995-09-12 Toshiba Corp リング発振回路
US5406228A (en) * 1994-07-12 1995-04-11 General Instrument Ring oscillator with frequency control loop
WO1996036902A1 (fr) 1995-05-17 1996-11-21 Seiko Epson Corporation Affichage a cristaux liquides, son procede d'excitation, circuit d'excitation et alimentation electrique employes a cet effet
US20040012449A1 (en) * 2002-07-16 2004-01-22 Illegems Paul F. Ring oscillator with frequency stabilization
US7283005B2 (en) * 2004-02-10 2007-10-16 Stmicroelectronics S.R.L. Clock-pulse generator circuit
EP1564886A1 (en) * 2004-02-10 2005-08-17 STMicroelectronics S.r.l. Time-delay circuit
JP2005333484A (ja) * 2004-05-20 2005-12-02 Nec Electronics Corp リング発振回路
US7116181B2 (en) * 2004-12-21 2006-10-03 Actel Corporation Voltage- and temperature-compensated RC oscillator circuit
US7102452B1 (en) 2004-12-31 2006-09-05 Zilog, Inc. Temperature-compensated RC oscillator
JP4641221B2 (ja) * 2005-06-27 2011-03-02 シャープ株式会社 発振回路および電子機器
JP4796927B2 (ja) * 2005-11-28 2011-10-19 株式会社豊田中央研究所 クロック信号出力回路
EP1966889B1 (en) * 2005-12-20 2011-11-02 Nxp B.V. Electronic circuit with low noise delay circuit
JP4882474B2 (ja) * 2006-04-14 2012-02-22 セイコーエプソン株式会社 発振器
JP5346459B2 (ja) * 2006-10-31 2013-11-20 株式会社半導体エネルギー研究所 発振回路およびそれを備えた半導体装置
JP5325493B2 (ja) * 2007-09-28 2013-10-23 ローム株式会社 オシレータ
US8384462B2 (en) 2007-11-29 2013-02-26 Nlt Technologies, Ltd. Delay element, variable delay line, and voltage controlled oscillator, as well as display device and system comprising the same
JP5440831B2 (ja) * 2007-11-29 2014-03-12 Ｎｌｔテクノロジー株式会社 電圧制御発振器並びにそれを備えた表示装置及びシステム
IT201800001115A1 (it) * 2018-01-16 2019-07-16 St Microelectronics Srl Un circuito oscillatore, e relativo circuito integrato

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
USB387171I5 (ko) * 1973-08-09 1975-01-28
US4015219A (en) * 1974-01-16 1977-03-29 Hitachi, Ltd. Electronic circuit using field effect transistor with compensation means
US3904989A (en) * 1974-09-19 1975-09-09 Bell Telephone Labor Inc Voltage controlled emitter-coupled multivibrator with temperature compensation
US4072910A (en) * 1976-04-09 1978-02-07 Rca Corporation Voltage controlled oscillator having equally controlled current source and current sink
US4592087B1 (en) * 1983-12-08 1996-08-13 Knowles Electronics Inc Class D hearing aid amplifier

Also Published As

Publication number Publication date
EP0304975A1 (en) 1989-03-01
US4893095A (en) 1990-01-09
NL8701831A (nl) 1989-03-01
JPS6451818A (en) 1989-02-28
KR890004481A (ko) 1989-04-22

Similar Documents

Publication Publication Date Title
KR960012917B1 (ko) 주파수 안정화 수단을 구비한 발진기
US5136260A (en) PLL clock synthesizer using current controlled ring oscillator
US5231319A (en) Voltage variable delay circuit
US3904988A (en) CMOS voltage controlled oscillator
US6476656B2 (en) Low-power low-jitter variable delay timing circuit
KR100393287B1 (ko) 전압 제어 발진기
US9325323B2 (en) CMOS oscillator having stable frequency with process, temperature, and voltage variation
US7126431B2 (en) Differential delay cell having controllable amplitude output
US6809603B1 (en) Ring oscillator having a stable output signal without influence of MOS devices
US3725822A (en) Phase shift oscillators using insulated-gate field-effect transistors
JPS62219813A (ja) デジタル信号用ｍｏｓｆｅｔ集積遅延回路
GB2214017A (en) Ring oscillator
EP0085697A4 (en) HIGH SPEED CMOS COMPARISON.
JPH01161910A (ja) 電圧制御発振器
KR100441470B1 (ko) 모놀리식집적된발진기회로를갖는디지털방식으로조정가능한수정발진기
US5585764A (en) High-speed voltage controlled oscillator which is insensitive to changes in power supply voltage
US6452430B1 (en) Phase-locked loop circuit
US6222423B1 (en) Voltage controlled ring oscillator delay
US6509803B2 (en) Voltage-controlled oscillator having short synchronous pull-in time
JP2591981B2 (ja) アナログ電圧比較器
US5262690A (en) Variable delay clock circuit
US3829795A (en) Crystal oscillator using field effect transistors in an integrated circuit
US3566301A (en) Multivibrator with linearly variable voltage controlled duty cycle
KR970004438B1 (ko) 발진기 회로
KR0143552B1 (ko) 에미터-결합 멀티바이브레이터 회로

Legal Events

Date Code Title Description
A201 Request for examination
G160 Decision to publish patent application
E701 Decision to grant or registration of patent right
NORF Unpaid initial registration fee