KR910017809A - 디지탈 신호 프로세서 - Google Patents

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KR910017809A
KR910017809A KR1019910004191A KR910004191A KR910017809A KR 910017809 A KR910017809 A KR 910017809A KR 1019910004191 A KR1019910004191 A KR 1019910004191A KR 910004191 A KR910004191 A KR 910004191A KR 910017809 A KR910017809 A KR 910017809A
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고지 이마자와
아끼라 기꾸찌
미쯔마사 사또
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미다 가쓰시게
가부시까가이샤 히다찌세이사꾸쇼
오노 미노루
히다찌초 엘 에스 아이엔지니어링 가부시끼가이샤
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Publication date
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00—Analogue/digital conversion; Digital/analogue conversion
    • H03M1/12—Analogue/digital converters
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F7/00—Methods or arrangements for processing data by operating upon the order or content of the data handled
    • G06F7/38—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation
    • G06F7/48—Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices
    • G06F7/57—Arithmetic logic units [ALU], i.e. arrangements or devices for performing two or more of the operations covered by groups G06F7/483 – G06F7/556 or for performing logical operations
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
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Abstract

내용 없음

Description

디지탈 신호 프로세서
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 관한 디지탈 신호 프로세서의 1실시예인 블럭도, 제2도는 제1도의 디지탈 신호 프로세서의 일예인 동작 타이밍도.

Claims (18)

  1. 다수의 제1외부단자, 다수의 제2외부단자, 상기 다수의 제1외부단자에 결합되고, 상기 다수의 제1외부단자에서 공급된 아날로그 신호를 디지탈 신호로 변환시키기위한 제1변환수단, 상기 다수의 제2외부단자에 결합되고, 디지탈 신호를 받아 상기 다수의 제2외부단자에 공급해야할 아날로그 신호로 변환하기 위한 제2변환수단과 상기 제1 및 제2변환수단에 결합되고, 상기 제1변환 수단에서 공급된 상기 디지탈 신호의 승산가산의 연산 및 상기 제2변환수단으로 공급해야할 상기 디지탈 신호의 승산가산의 연산을 시분할로 실행하는 프로세서를 포함하는 디지탈 신호 프로세서.
  2. 특허청구의 범위 제1항에 있어서, 상기 제1변환수단은 다수의 아날로그 디지탈 변환회로를 포함하고, 하나의 아날로그 디지탈 변환회로가 하나의 제1외부단자에 결합되도록 상기 다수의 아날로그 디지탈 변환회로는 상기 다수의 제1외부단자에 결합되어 있는 디지탈 신호 프로세서.
  3. 특허청구의 범위 제2항에 있어서, 상기 제2변환수단은 다수의 아날로그 디지탈 변환회로를 포함하고, 하나의 디지탈 아날로그 변환회로가 하나의 제2외부단자에 결합되도록 상기 다수의 디지탈 아날로그 변환회로는 상기 다수의 제2외부단자에 결합되어 있는 디지탈 신호 프로세서.
  4. 특허청구의 범위 제3항에 있어서, 또 상기 다수의 아날로그 디지탈 변환회로중 하나를 선택하고, 상기 프로세서와 그 선택된 아날로그 디지탈 변환회로를 결합하기위한 제1선택수단을 포함하는 디지탈 신호 프로세서.
  5. 특허청구의 범위 제4항에 있어서, 또 상기 다수의 디지탈 아날로그 변환회로중 하나를 선택하고, 상기 프로세서와 그 선택된 디지탈 아날로그 변환회로를 결합하기위한 제2선택수단을 포함하는 디지탈 신호 프로세서.
  6. 특허청구의 범위 제1항에 있어서, 상기 제1변환수단은 하나의 아날로그 디지탈 변환회로를 포함하고 있는 디지탈 신호 프로세서.
  7. 특허청구의 범위 제6항에 있어서, 상기 제2변환수단은 하나의 디지탈 아날로그 변환회로를 포함하고 있는 디지탈 신호 프로세서.
  8. 특허청구의 범위 제7항에 있어서, 또 상기 다수의 제1외부단자에서 하나의 외부단자를 선택하고, 상기 아날로그 디지탈 변환회로와 그 선택된 외부단자를 결합하기 위한 제1선택 수단을 포함하는 디지탈 신호 프로세서.
  9. 특허청구의 범위 제8항에 있어서, 또 상기 다수의 제2외부단자에서 하나의 외부단자를 선택하고, 상기 디지탈 아날로그 변환회로와 그 선택된 외부단자를 결합하기 위한 제2선택 수단을 포함하는 디지탈 신호 프로세서.
  10. 하나의 제1외부단자에 하나의 제1외부장치가 결합되는 다수의 제1외부단자, 하나의 제2외부단자에 하나의 제2외부장치가 결합되는 다수의 제2외부단자, 상기 다수의 제1외부단자에 결합되고, 상기 다수의 제1외부장치에서 공급된 아날로그 신호를 디지탈 신호로 변환하기 위한 제1변환수단, 상기 다수의 제2외부단자에 결합되고, 디지탈 신호를 받아 상기 다수의 제2외부장치에 공급해야할 아날로그 신호로 변환하기 위한 제2변환수단과 상기 제1 및 제2변환수단에 결합되고, 상기 제1변환수단의 연산을 시분할로 실행하는 프로세서를 포함하는 디지탈 신호 프로세서 시스템.
  11. 특허청구의 범위 제10항에 있어서, 상기 제1변환수단은 다수의 아날로그 디지탈 변환회로를 포함하고, 하나의 아날로그 디지탈 변환회로가 하나의 제1외부단자에 결합되도록 상기 다수의 아날로그 디지탈 변환수단은 상기 다수의 제1외부단자에 결합되어 있는 디지탈 신호 프로세서 시스템.
  12. 특허청구의 범위 제11항에 있어서, 상기 제2변환수단은 다수의 디지탈 아날로그 변환회로를 포함하고, 하나의 디지탈 아날로그 변환회로가 하나의 제2외부단자에 결합되도록 상기 다수의 디지탈 아날로그 변환회로은 상기 다수의 제2외부단자에 결합되어 있는 디지탈 신호 프로세서 시스템.
  13. 특허청구의 범위 12항에 있어서, 또 상기 다수의 아날로그 디지탈 변환회로중 하나를 선택하고, 상기 프로세서와 그선택된 아날로그 디지탈 변환회로를 결합하기 위한 제1선택수단을 포함하는 디지탈 신호 프로세서 시스템.
  14. 특허청구의 범위 13항에 있어서, 또 상기 다수의 디지탈 아날로그 변환회로중 하나를 선택하고, 상기 프로세서와 그선택된 디지탈 아날로그 변환회로를 결합하기 위한 제2선택수단을 포함하는 디지탈 신호 프로세서 시스템.
  15. 특허청구의 범위 제10항에 있어서, 상기 제1변환수단은 하나의 아날로그 디지탈 변환회로를 포함하고 있는 디지탈 신호 프로세서 시스템.
  16. 특허청구의 범위 제15항에 있어서, 상기 제2변환수단은 하나의 디지탈 아날로그 변환회로를 포함하고 있는 디지탈 신호 프로세서 시스템.
  17. 특허청구의 범위 제16항에 있어서, 또 상기 다수의 제1외부단자에서 하나의 외부단자를 선택하고, 상기 아날로그 디지탈 변환회로와 그 선택된 외부 단자를 결합하기 위한 제1선택수단을 포함하는 디지탈 신호 프로세서 시스템.
  18. 특허청구의 범위 제17항에 있어서, 또 상기 다수의 제2외부단자에서 하나의 외부단자를 선택하고, 상기 디지탈 아날로그 변환회로와 그 선택된 외부 단자를 결합하기 위한 제2선택수단을 포함하는 디지탈 신호 프로세서 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910004191A 1990-03-27 1991-03-16 디지탈 신호 프로세서 KR0176255B1 (ko)

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