KR20200011236A - 유기발광 표시장치 - Google Patents
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Abstract
본 발명에 의한 유기발광 표시장치는 제1 유기발광다이오드와 제1 구동 트랜지스터가 배치된 제1 픽셀, 및 제2 유기발광다이오드 및 제2 구동 트랜지스터가 배치된 제2 픽셀을 포함한다. 제1 픽셀 및 제2 픽셀은 제1 데이터라인과 연결된다. 제1 구동 트랜지스터의 소스전극은 제1 기준전압라인과 연결되고, 제2 구동 트랜지스터의 소스전극은 제2 기준전압라인과 연결된다.
Description
본 발명은 휘도 편차를 개선할 수 있는 유기발광 표시장치에 관한 것이다.
액티브 매트릭스 타입(active matrix type)의 유기발광 표시장치는 스스로 발광하는 유기발광다이오드(Organic Light Emitting Diode: OLED)를 포함하며, 응답속도가 빠르고 발광효율, 휘도 및 시야각이 큰 장점이 있다.
자발광 소자인 유기발광다이오드 는 애노드전극 및 캐소드전극과, 이들 사이에 형성된 유기 화합물층을 포함한다. 유기 화합물층은 정공주입층(Hole Injection layer, HIL), 정공수송층(Hole transport layer, HTL), 발광층(Emission layer, EML), 전자수송층(Electron transport layer, ETL) 및 전자주입층(Electron Injection layer, EIL)으로 이루어진다. 애노드전극과 캐소드전극에 전원전압이 인가되면 정공수송층(HTL)을 통과한 정공과 전자수송층(ETL)을 통과한 전자가 발광층(EML)으로 이동되어 여기자를 형성하고, 그 결과 발광층(EML)이 가시광을 발생하게 된다.
유기발광 표시장치는 유기발광다이오드와 구동 트랜지스터를 각각 포함한 픽셀들을 매트릭스 형태로 배열하고 영상 데이터의 계조에 따라 픽셀들에서 구현되는 입력 영상의 휘도를 조절한다. 구동 트랜지스터는 자신의 게이트전극과 소스전극 사이에 걸리는 전압에 따라 유기발광다이오드에 흐르는 구동전류를 제어한다. 구동전류에 따라 유기발광다이오드의 발광량이 결정되며, 유기발광다이오드의 발광량에 따라 영상의 휘도가 결정된다.
구동 트랜지스터의 게이트-소스 전압은 데이터전압과 기준전압에 의해서 결정된다. 원하는 휘도를 얻기 위해서는 모든 픽셀들에 공급되는 기준전압이 일정하여야 하는데, 구동 방식에 따라 인접하는 라인들에 인가되는 기준전압이 달라지는 경우가 발생한다. 픽셀들에 인가되는 기준전압이 달라지면 동일한 데이터전압을 제공받아도 휘도가 달라져서, 라인들 간의 휘도 편차가 발생한다.
본 발명은 픽셀들의 구동 트랜지스터에 공급되는 기준전압의 편차를 개선할 수 있는 유기발광 표시장치를 제공하기 위한 것이다.
본 발명에 의한 유기발광 표시장치는 제1 유기발광다이오드와 제1 구동 트랜지스터가 배치된 제1 픽셀, 및 제2 유기발광다이오드 및 제2 구동 트랜지스터가 배치된 제2 픽셀을 포함한다. 제1 픽셀 및 제2 픽셀은 제1 데이터라인과 연결된다. 제1 구동 트랜지스터의 소스전극은 제1 기준전압라인과 연결되고, 제2 구동 트랜지스터의 소스전극은 제2 기준전압라인과 연결된다.
본 발명은 픽셀들에 인가되는 기준전압의 IR 편차가 달라지는 것을 개선할 수 있다. 본 발명은 모든 픽셀들이 동일한 크기의 IR 편차를 갖도록 하여, 픽셀들에 인가되는 기준전압을 동일하게 할 수 있다. 그 결과, 본 발명은 픽셀들 간의 휘도 편차가 발생하는 것을 개선할 수 있다.
도 1은 본 발명에 의한 유기발광 표시장치를 나타내는 도면이다.
도 2는 동일한 데이터라인에 연결된 제1 및 제2 픽셀의 회로도이다.
도 3 내지 도 5는 블랙 데이터 삽입 구동을 설명하는 도면들이다.
도 6은 프로그래밍 구간에서 픽셀의 등가회로도이다.
도 7은 발광 구간에서 픽셀의 등가회로도이다.
도 8은 블랙 데이터 삽입 구간에서 픽셀의 등가회로도이다.
도 9는 첫 번째 컬럼라인에 배치된 픽셀들을 나타내는 도면이다.
도 10은 제6 내지 제10 수평기간 동안의 스캔신호 및 센스신호를 나타내는 도면이다.
도 11은 본 발명에 의한 픽셀들의 IR 편차를 설명하는 도면이다.
도 12는 비교 예에 의한 픽셀들의 IR 편차를 설명하는 도면이다.
도 13 및 도 14는 제1 및 제2 기준전압라인들이 배치되는 실시 예를 나타내는 도면이다.
도 2는 동일한 데이터라인에 연결된 제1 및 제2 픽셀의 회로도이다.
도 3 내지 도 5는 블랙 데이터 삽입 구동을 설명하는 도면들이다.
도 6은 프로그래밍 구간에서 픽셀의 등가회로도이다.
도 7은 발광 구간에서 픽셀의 등가회로도이다.
도 8은 블랙 데이터 삽입 구간에서 픽셀의 등가회로도이다.
도 9는 첫 번째 컬럼라인에 배치된 픽셀들을 나타내는 도면이다.
도 10은 제6 내지 제10 수평기간 동안의 스캔신호 및 센스신호를 나타내는 도면이다.
도 11은 본 발명에 의한 픽셀들의 IR 편차를 설명하는 도면이다.
도 12는 비교 예에 의한 픽셀들의 IR 편차를 설명하는 도면이다.
도 13 및 도 14는 제1 및 제2 기준전압라인들이 배치되는 실시 예를 나타내는 도면이다.
이하 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시예들을 상세히 설명한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 실질적으로 동일한 구성요소들을 의미한다. 이하의 설명에서, 본 발명과 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우, 그 상세한 설명을 생략한다.
본 발명에서 스위치 소자들은 n 타입 또는 p 타입 MOSFET(Metal Oxide Semiconductor Field Effect Transistor) 구조의 트랜지스터로 구현될 수 있다. 트랜지스터는 게이트(gate), 소스(source) 및 드레인(drain)을 포함한 3 전극 소자이다. 소스는 캐리어(carrier)를 트랜지스터에 공급하는 전극이다. 트랜지스터 내에서 캐리어는 소스로부터 흐르기 시작한다. 드레인은 트랜지스터에서 캐리어가 외부로 나가는 전극이다. 즉, MOSFET에서의 캐리어의 흐름은 소스로부터 드레인으로 흐른다. n 타입 MOSFET(NMOS)의 경우, 캐리어 가 전자(electron)이기 때문에 소스에서 드레인으로 전자가 흐를 수 있도록 소스 전압이 드레인 전압보다 낮은 전압을 가진다. n 타입 MOSFET에서 전자가 소스로부터 드레인 쪽으로 흐르기 때문에 전류의 방향은 드레인으로부터 소스 쪽으로 흐른다. p 타입 MOSFET(PMOS)의 경우, 캐리어가 정공(hole)이기 때문에 소스로부터 드레인으로 정공이 흐를 수 있도록 소스 전압이 드레인 전압보다 높다. p 타입 MOSFET에서 정공이 소스로부터 드레인 쪽으로 흐르기 때문에 전류가 소스로부터 드레인 쪽으로 흐른다. MOSFET의 소스와 드레인은 고정된 것이 아니라는 것에 주의하여야 한다. 예컨대, MOSFET의 소스와 드레인은 인가 전압에 따라 변경될 수 있다. 이하의 실시예에서 트랜지스터의 소스와 드레인으로 인하여 발명이 제한되어서는 안된다.
도 1은 유기발광 표시장치를 개략적으로 나타낸 블록도이다.
도 1을 참조하면, 본 발명의 실시예에 따른 유기발광 표시장치는 픽셀(P)들이 형성된 표시패널(DIS)과, 타이밍 제어신호를 생성하는 타이밍 콘트롤러(200), 게이트라인들(GL1~GLn)을 구동시키기 위한 게이트 구동부(400,500), 데이터라인들(DL1~DLm)을 구동시키기 위한 데이터 구동부(300)를 포함한다.
표시패널(DIS)은 픽셀(P)들이 배치되어 영상을 표시하는 표시영역(AA) 및 영상 표시를 하지 않는 비표시영역(NAA)를 포함한다. 비표시영역(NAA)에는 시프트레지스터(NAA)가 배치될 수 있다. 도면에서 비표시영역(NAA)은 시프트레지스터(500)가 배치된 영역을 표시하고 있지만, 비표시영역(NAA)은 픽셀 어레이의 가장자리를 둘러싸는 베젤(bezel)을 통칭한다.
표시패널(DIS)의 표시영역(AA)에는 다수의 데이터라인들(DL1~DLm)과 다수의 게이트라인들(GL1~GLn)이 교차되고, 이 교차영역마다 픽셀(P)들이 매트릭스 형태로 배치된다. 각 픽셀라인들(HL1~HLn)은 동일한 행에 배치된 픽셀들을 포함한다. 표시영역(AA)에 배치된 픽셀(P)들이 mХn개일 때, 표시영역(AA)은 n개의 픽셀라인들을 포함한다. 본 명세서에서 픽셀(P)들 각각은 컬러 구현을 위하여 적색 서브 픽셀, 녹색 서브 픽셀, 청색 서브 픽셀 중 어느 하나를 지칭한다. 픽셀(P)들을 구성하는 트랜지스터들은 산화물 반도체층을 포함한 산화물 트랜지스터로 구현될 수 있다. 산화물 트랜지스터는 전자 이동도, 공정 편차 등을 모두 고려할 때 표시패널(DIS)의 대면적화에 유리하다. 다만, 본 발명은 이에 한정되지 않고 트랜지스터의 반도체층을 아몰포스 실리콘 또는, 폴리 실리콘 등으로 형성할 수도 있다.
제1 픽셀라인(HL1)에 배치된 픽셀(P)들은 제1 게이트라인(GL1)과 접속되고, 제n 픽셀라인(HLn)에 배치된 픽셀(P)들은 제n 게이트라인(GLn)과 접속된다. 게이트라인(GL1~GLn)들은 각각의 게이트신호들을 제공하는 다수의 라인들을 포함할 수 있다.
타이밍 콘트롤러(200)는 호스트(100)로부터 제공받는 입력 영상데이터(DATA)를 표시패널(DIS)의 해상도에 맞게 재정렬하여 데이터 구동부(300)에 공급한다. 또한, 타이밍 콘트롤러(200)는 수직 동기신호(Vsync), 수평 동기신호(Hsync) 및 데이터 인에이블신호(DE) 등의 타이밍 신호들에 기초하여 데이터 구동부(300)의 동작 타이밍을 제어하기 위한 데이터 제어신호를 생성한다.
데이터 구동부(300)는 데이터 제어신호를 기반으로 타이밍 콘트롤러(200)로부터 제공받는 입력 영상데이터(DATA)를 아날로그 데이터전압으로 변환한다.
게이트 구동부(400,500)는 레벨 쉬프터(400) 및 시프트레지스터(400)를 포함한다. 레벨 쉬프터(400)는 타이밍 콘트롤러(200)로부터 제공받는 게이트 제어신호(GDC)를 바탕으로, 스캔클럭(SCCLK) 및 센스클럭(SECLK)을 생성한다.
시프트레지스터(500)는 레벨 쉬프터(400)가 출력하는 스캔클럭(SCCLK)을 순차적으로 쉬프트시키면서 스캔신호들을 생성하고, 스캔신호를 스캔라인들(SLA1~SLA(n))에 제공한다. 시프트레지스터(500)는 센스클럭(SECLK)을 순차적으로 쉬프트시키면서 센스신호들을 생성하고, 센스신호를 센스라인들(SLB1~SLB(n))에 제공한다. 이를 위해서, 시프트레지스터(500)는 서로 종속적으로 접속하는 스테이지를 포함한다. 시프트레지스터(500)는 GIP(Gate-driver In Panel) 공정을 이용하여 표시패널(DIS)의 비표시영역(NAA) 상에 직접 형성될 수 있다.
도 2는 제1 픽셀라인에 배치된 제1 픽셀 및 제2 픽셀라인에 배치된 제2 픽셀의 실시 예를 나타내는 도면이다. 도 2는 제1 데이터라인에 연결된 픽셀들을 도시하고 있다.
도 2를 참조하면, 제1 픽셀(P1)은 제1 유기발광다이오드(OLED1), 제1 구동 트랜지스터(DT1), 스토리지 커패시터(Cst), 제1 스캔 트랜지스터(Tsc1) 및 제1 센스 트랜지스터(Tse1)를 구비한다. 제1 구동 트랜지스터(DT1)는 게이트-소스 간 전압(Vgs)에 따라 유기발광다이오드(OLED)에 흐르는 구동전류를 제어한다. 구동 트랜지스터(DT)는 제1 노드(Ng)에 접속된 게이트전극, 고전위 구동전압(EVDD)의 입력단에 접속된 드레인전극, 및 제2 노드(Ns)에 접속된 소스전극을 포함한다. 스토리지 커패시터(Cst)는 제1 노드(Ng)와 제2 노드(Ns) 사이에 접속된다. 제1 스캔 트랜지스터(Tsc1)는 제1 스캔라인(SLA1)에 연결되는 게이트전극, 제1 데이터라인(DL1)에 연결되는 드레인전극, 및 제1 노드(Ng)에 연결되는 소스전극을 포함한다. 제1 센스 트랜지스터(Tse1)는 제1 센스라인(SLB1)에 연결되는 게이트전극, 제2 노드(Ns)에 연결되는 드레인전극, 및 제1 기준전압라인(RL1)에 연결되는 소스전극을 포함한다.
마찬가지로, 제2 픽셀(P2)은 제2 유기발광다이오드(OLED2), 제2 구동 트랜지스터(DT2), 스토리지 커패시터(Cst), 제2 스캔 트랜지스터(Tsc2) 및 제2 센스 트랜지스터(Tse2)를 구비할 수 있다. 제2 픽셀(P2)에서 제2 유기발광다이오드(OLED2), 제2 구동 트랜지스터(DT2), 스토리지 커패시터(Cst), 제2 스캔 트랜지스터(Tsc2)의 연결관계는 제1 픽셀(P1)의 연결관계와 유사한 형태이기 때문에 자세한 설명은 생략한다. 제2 센스 트랜지스터(Tse2)는 제2 센스라인(SLB2)에 연결되는 게이트전극, 제2 노드(Ns)에 연결되는 드레인전극, 및 제2 기준전압라인(RL2)에 연결되는 소스전극을 포함한다.
제1 데이터라인(DL1)은 데이터 구동부(300)의 디지털 아날로그 변환기(DAC)를 통해서 데이터전압을 공급받고, 제1 및 제2 기준전압라인(RL1, RL2)은 센싱부(SU)와 연결된다. 센싱부(SU)는 픽셀의 제1 및 제2 기준전압라인(RL1, RL2)을 통해서 기준전압을 공급하거나, 제1 픽셀(P1) 및 제2 픽셀(P2)들 각각의 제1 노드(Ng) 전압을 센싱전압으로 획득한다. 이하, 센싱전압을 획득하고 이를 바탕으로 구동특성을 보상하는 방법은 공지된 어떠한 것을 이용하여도 무방하기 때문에, 본 명세서에서는 이에 대한 자세한 설명을 생략하기로 한다.
본 발명에 의한 유기발광 표시장치는 동영상 응답시간(Motion Picture Response Time, 이하 MPRT)을 단축하기 위해서 블랙 영상을 삽입하는 기술이 적용될 수 있다. 블랙 영상 삽입(Black Data Inserting: 이하, BDI) 기술은 이웃한 영상 프레임들 사이에 블랙 영상을 표시하여 이전 프레임의 영상을 효과적으로 소거하기 위한 것이다.
도 3은 제1 픽셀라인에 인가되는 스캔신호 및 센스신호를 나타내는 도면이다. 도 4는 BDI 구동을 위한 제1 내지 제10 스캔신호들의 타이밍을 나타내는 도면이다. 도 5는 BDI 구동을 위한 스캔신호들이 인가되는 타이밍을 프레임 단위로 나타내는 도면이다.
도 2 내지 도 5를 참조하여, 제1 데이터라인과 연결되는 픽셀들의 BDI 구동을 살펴보면 다음과 같다.
스캔신호들과 센스신호들 각각은 출력기간이 1H 이상으로 설정되어 오버랩 구동을 한다. 스캔신호들과 센스신호들의 출력기간은 턴-온 전압으로 유지되는 기간을 지칭한다. 1H 기간은 하나의 픽셀라인(HL)에 배치된 픽셀들에 데이터전압을 기입하는 기간을 지칭한다. 스캔신호들 각각은 데이터 기입용 스캔신호(SCI) 및 BDI용 스캔신호(SCB)를 포함한다.
영상데이터 기입 구간은 하나의 그룹에 속한 수평라인들에 순차적으로 데이터를 기입하는 구간을 지칭한다. BDI 구간은 하나의 그룹에 속한 수평라인들에 블랙데이터를 동시에 기입하는 구간을 지칭한다. 하나의 그룹에 속한 수평라인들의 개수는 설계에 따라 달라질 수 있으며, 이하 본 명세서는 8개의 수평라인들을 하나의 그룹으로 설정한 실시 예를 중심으로 설명하기로 한다.
제1 영상데이터 기입 구간(IDW1) 동안, 제1 내지 제8 스캔신호들(SCAN1~SCAN8)의 데이터 기입용 스캔신호(SCI)들은 순차적으로 표시패널(100)에 인가된다. 제1 스캔신호(SCAN1)는 제1 스캔라인(SLA1)에 인가되고, 제2 스캔신호(SCAN2)는 제2 스캔라인(SLA2)에 인가된다. 마찬가지로 제8 스캔신호(SCAN8)는 제8 스캔라인(SLA8)에 인가된다. 제1 영상데이터 기입 구간(IDW1) 동안, 제1 데이터라인(DL1)에는 데이터기입용 스캔신호(SCI)들에 동기되어 화상 표시를 위한 데이터전압(VDATA)이 공급된다.
1H 기간의 제1 BDI 구간(BDI1) 동안, 서로 연속적인 8개 픽셀라인들에 BDI용 스캔신호(SCB)들이 동시에 인가된다. 제1 내지 제8 픽셀라인(HL1~HL8)에 인가되는 BDI용 스캔신호들은 BDI 구간(BDI(j))(j는 "n/8"이하의 임의의 자연수)에 인가될 수 있다. BDI 구간 동안, 제1 데이터라인(DL1)에는 블랙영상 표시를 위한 블랙데이터전압이 인가된다.
1H 기간의 제1 프리챠지 구간(PRE1)은 제9 스캔신호(SCAN9)를 이용하여 9번째 픽셀라인(HL9)을 프리챠지하는 구간이다.
도 3에 도시된 프로그래밍 구간(Tp), 발광 구간(Te) 및 BDI 구간(BDI) 동안의 제1 픽셀의 동작을 살펴보면 다음과 같다.
도 6은 프로그래밍 구간에 대응되는 제1 픽셀의 등가회로도이고, 도 7은 발광구간에 대응되는 제1 픽셀의 등가회로도이다. 도 8은 블랙 데이터 삽입 구간에 대응되는 제1 픽셀의 등가회로도이다.
도 2, 도 3 및 도 6을 참조하면, 프로그래밍 구간(Tp)에서 제1 스캔 트랜지스터(Tsc1)는 영상 데이터 기입용 스캔신호(SCI)에 응답하여, 제1 노드(Ng)에 영상 데이터 기입용 데이터전압(VIDW)을 인가한다. 프로그래밍 기간(Tp)에서 제1 센스 트랜지스터(Tsc2)는 센스신호(SEN)에 따라 턴 온 되어 제2 노드(Ns)에 기준전압(Vref)을 인가한다. 이를 통해 프로그래밍 기간(Tp)에서 제1 픽셀(P1)의 제1 노드(Ng)와 제2 노드(Ns) 간의 전압이 원하는 픽셀 전류에 맞게 설정된다.
도 2, 도 3 및 도 7을 참조하면, 발광 구간(Te)에서 제1 스캔 트랜지스터(Tsc1)와 제1 센스 트랜지스터(Tse1)는 턴 오프 된다. 프로그래밍 구간(Tp)에서 제1 픽셀(P1)에 기 설정된 제1 노드(Ng)와 제2 노드(Ns) 간의 전압(Vgs)은 발광 구간(Te)에서도 유지된다. 이러한 제1 노드(Ng)와 제2 노드(Ns) 간의 전압(Vgs)은 제1 구동 트랜지스터(DT1)의 문턱전압보다 크기 때문에, 발광 구간(Te) 동안 제1 구동 트랜지스터(DT1)에는 픽셀 전류(Ioled)가 흐른다. 이 픽셀 전류(Ioled)에 의해 발광 구간(Te)에서 제1 노드(Ng)의 전위와 제2 노드(Ns)의 전위가 제1 노드(Ng)와 제2 노드(Ns) 간의 전압(Vgs)을 유지한 채 부스팅된다. 제2 노드(Ns)의 전위가 유기발광다이오드(OLED)의 동작점 레벨까지 부스팅되면 유기발광다이오드(OLED)는 발광한다.
도 2, 도 3 및 도 8을 참조하면, BDI 구간(Tb)에서 제1 스캔 트랜지스터(Tsc1)는 BDI용 스캔 신호(SCB)에 따라 턴 온 되어 제1 노드(Ng)에 BDI용 데이터전압(VBDI)을 인가한다. BDI 구간(Tb)에서 제1 센스 트랜지스터(Tse1)는 턴 오프 상태를 유지하므로, 제2 노드(Ns)의 전위가 유기발광다이오드(OLED)의 동작점 레벨을 유지한다. BDI용 데이터전압(VBDI)은 유기발광다이오드(OLED)의 동작점 레벨보다 낮은 전압이다. 따라서, BDI 구간 (Tb)에서 제1 노드(Ng)와 제2 노드(Ns) 간의 전압(Vgs)은 구동 트랜지스터(DT)의 문턱전압보다 작기 때문에, 제1 픽셀(P1)의 구동 트랜지스터(DT)에는 픽셀 전류(Ioled)가 흐르지 못하고 유기발광다이오드(OLED)는 발광을 멈춘다.
살펴본 바와 같이, 발광 구간(Te)에서 유기발광다이오드(OLED)의 휘도는 프로그래밍 구간(Tp)에서 설정된 구동 트랜지스터(DT)의 제1 노드(Ng)와 제2 노드(Ns)의 전압차이(Vgs)에 의해서 결정된다. 따라서, 프로그래밍 구간(Tp) 동안에 모든 픽셀(P)들의 제2 노드(Ns)에 세팅되는 전압은 동일하여야 한다. 이상적으로 각 픽셀들의 제2 노드(Ns)는 기준전압(Vref)으로 세팅되지만, 기준전압라인과 제2 노드(Ns) 간의 전류로 인한 "IХR" 크기에 비례하는 "IR 편차"가 발생한다. 모든 픽셀(P)들에서 동일한 크기의 "IR 편차"가 발생하면 픽셀들 간의 휘도 편차는 발생하지 않지만, "IR 편차"의 크기가 달라지면 휘도 편차가 발생한다.
본 발명은 인접하는 픽셀들 간의 "IR 편차"의 크기가 달라지는 것을 개선하기 위해서 기수 번째 픽셀라인의 픽셀들과 우수 번째 픽셀라인의 픽셀들에 연결되는 기준전압라인을 분리한다. 이를 살펴보면 다음과 같다.
도 9는 본 발명의 픽셀 어레이에서 첫 번째 컬럼라인에 배치된 픽셀들을 나타내는 도면이다. 도 10은 제6 수평기간 내지 제10 수평기간에 인가되는 제1 내지 제10 스캔신호들 및 센스신호들을 나타내는 도면이다.
도 9를 참조하면, 제1 데이터라인(DL1)과 연결되는 픽셀들 중에서 기수 번째 픽셀들(P1,P5,P7)은 제1 기준전압라인(RL1)과 연결되고 우수 번째 픽셀들(P2,P6,P8)은 제2 기준전압라인(RL2)과 연결된다.
도 10에서 제6 수평기간(6-H)은 제6 픽셀라인에 배치된 픽셀(P6, 이하 제6 픽셀)의 프로그래밍 구간이다. 제7 수평기간(7-H)은 제7 픽셀라인에 배치된 픽셀(P7, 이하 제7 픽셀)의 프로그래밍 구간이고, 제8 수평기간(8-H)은 제8 픽셀라인에 배치된 픽셀(P8, 이하 제8 픽셀)의 프로그래밍 구간이다. 도 10에서와 같이, 오버랩 구동을 할 때에는 k(k는 n이하의 자연수)번째 픽셀의 프로그래밍 구간(Tp)과 (k+1)번째 픽셀의 프리챠지 구간(PRE)은 중첩된다. 예컨대, 제6 수평기간(6-H) 내에서 제6 픽셀(P6)의 프로그래밍 구간(Tp)과 제7 픽셀(P7)의 프리챠지 구간(PRE)은 중첩된다. 다만, 제1 영상 데이터 기입 구간(IDW1)에서 제8 수평기간(8-H) 이후는 BDI 구간이기 때문에, 제8 픽셀(8P)의 프로그래밍 구간(Tp)은 제9 픽셀(9P)의 프리챠지 구간과 중첩되지 않는다.
도 11은 본 발명에 따른 제6 내지 제8 픽셀들의 IR 편차를 나타내는 도면이다.
도 10 및 도 11을 참조하면, 제6 수평기간(6-H) 동안 제6 및 제7 센스신호들(SEN6,SEN7)은 턴-온 전압이다. 이에 따라 제6 픽셀(P6)은 제2 기준전압라인(RL2)으로부터 기준전압(Vref)을 제공받는다. 그 결과, 제6 픽셀(P6)의 제2 노드(Ns)는 기준전압(Vref)으로부터 "I2ХR2" 크기의 "IR 편차"가 반영된 전압으로 세팅된다. 이때, "I2"는 제2 기준전압라인(RL2)을 통해서 흐르는 전류를 지칭하고, "R2"는 제2 기준전압라인(RL2)의 저항값을 지칭한다. 제7 픽셀(P7)은 제1 기준전압라인(RL1)으로부터 기준전압(Vref)을 제공받는다. 제7 픽셀(P7)의 제2 노드(Ns)는 기준전압(Vref)으로부터 "I1ХR1" 크기의 "IR 편차"가 반영된 전압이 인가된다. 이때, "I1"는 제1 기준전압라인(RL1)을 통해서 흐르는 전류를 지칭하고, "R1"는 제1 기준전압라인(RL1)의 저항값을 지칭한다.
제1 기준전압라인(RL1)과 제2 기준전압라인(RL2)은 동일한 기준전압(Vref)을 출력하기 때문에, "R1" 및 R2"가 "R"로 동일하면 "I1" 및 "I2"도 같아진다. 그 결과, 제6 픽셀(P6)의 제2 노드(Ns)와 제7 픽셀(P7)의 제2 노드(Ns)는 서로 동일하게 "IХR"크기를 갖는 "IR 편차"가 발생한다.
제7 수평기간(7-H) 동안 제7 및 제8 센스신호들(SEN7,SEN8)은 턴-온 전압이다. 이에 따라 제7 픽셀(P7)은 제1 기준전압라인(RL1)으로부터 기준전압(Vref)을 제공받고, 제8 픽셀(P8)은 제2 기준전압라인(RL2)으로부터 기준전압(Vref)을 제공받는다. 그 결과, 제7 픽셀(P7) 및 제8 픽셀(P8)은 동일한 크기를 갖는 "IR 편차"가 반영된 기준전압(Vref)으로 세팅된다.
제8 수평기간(8-H) 동안, 제8 센스신호(SEN7)은 턴-온 전압이고, 제9 센스신호(SEN9)는 턴-오프 전압이다. 이에 따라 제8 픽셀(P8)은 제2 기준전압라인(RL2)으로부터 기준전압(Vref)을 제공받는다. 그 결과, 제8 픽셀(P8)은 "IХR" 크기를 갖는 "IR 편차"가 반영된 기준전압(Vref)으로 세팅된다.
살펴본 바와 같이, 본 발명에서 서로 인접한 픽셀들에 연결되는 기준전압라인은 다르다. 따라서, 오버랩 구동을 하더라도 제1 픽셀(P1)의 프로그래밍 과정에서, 제1 픽셀(P1)은 제2 픽셀(P2)의 프리챠지로 인한 "IR 편차"가 반영되지 않는다. 그 결과, 본 발명에 따른 픽셀들 각각의 제2 노드(Ns)는 프로그래밍 구간(Tp)에서 "IR 편차"가 반영된 기준전압(Vref)이 세팅된다. 즉, 모든 픽셀들에서 동일한 크기의 "IR 편차"가 발생하기 때문에, 인접하는 라인들 간의 휘도 편차가 발생하지 않는다.
이를 비교예와 더불어 추가로 설명하면 다음과 같다.
도 12는 비교예에 의한 픽셀들의 프로그래밍 동작을 설명하는 도면이다.
도 12를 참조하면, 비교예에 의한 픽셀 어레이는 제6 내지 제8 픽셀들(P6,P7,P8)이 동일한 기준전압라인(RL)에 연결된다. 도 12에서 도시하지는 않았지만, 제6 내지 제8 픽셀들(P6,P7,P8)은 동일한 데이터라인과 연결된다. 도 12에 도시된 픽셀들의 스캔신호 및 센스신호는 도 10에 도시된 타이밍을 갖는다.
도 10 및 도 12를 참조하면, 제6 수평기간(6-H) 동안 제6 및 제7 센스신호들(SEN6,SEN7)은 턴-온 전압이고, 이에 따라 제6 및 제7 픽셀들(P6,P7)의 제2 노드(Ns)와 기준전압라인(RL) 간에는 전류가 흐른다. 그 결과, 제6 픽셀(P6)의 제2 노드(Ns)와 제7 픽셀(P7)의 제2 노드(Ns)는 기준전압(Vref)에서 "2IХR" 크기의 "IR 편차"가 반영된 전압이 세팅된다. 이때, "I"는 기준전압라인(RL)으로부터 픽셀들 각각의 제2 노드(Ns)로 흐르는 전류값을 지칭하고, "R"은 기준전압라인(RL)의 저항값을 지칭한다.
제7 수평기간(7-H) 동안 제7 및 제8 센스신호들(SEN7,SEN8)은 턴-온 전압이고, 이에 따라 제7 및 제8 픽셀들(P7,P8)의 제2 노드(Ns)와 기준전압라인(RL) 간에는 전류가 흐른다. 그 결과, 제7 픽셀(P7)의 제2 노드(Ns)와 제8 픽셀(P8)의 제2 노드(Ns)는 기준전압(Vref)에서 "2IХR" 크기의 "IR 편차"가 반영된 전압이 세팅된다.
제8 수평기간(8-H) 동안 제8 센스신호(SEN)는 턴-온 전압이고, 이에 따라 제8 픽셀(P8)의 제2 노드(Ns)와 기준전압라인(RL) 간에는 전류가 흐른다. 그리고, 제8 픽셀(P8)의 제2 노드(Ns)는 기준전압(Vref)에서 "IХR" 크기의 "IR 편차"가 반영된 전압이 세팅된다.
살펴본 바와 같이, 제6 픽셀(P6)의 제2 노드(Ns)와 제7 픽셀(P7)의 제2 노드(Ns)는 기준전압(Vref)으로부터 "2IХR"크기의 전압편차를 갖는 상태로 프로그래밍된다. 이에 반해서, 제8 픽셀(P8)의 제2 노드(Ns)는 "IХR" 크기의 "IR 편차"를 갖는 상태로 프로그래밍된다. 따라서, 제6 내지 제8 픽셀들(P6~P8)에 동일한 데이터전압이 인가될지라도, 제8 수평기간(8-H) 내에서 프로그래밍 된 제8 픽셀(P8)은 제6 및 제7 픽셀들(P6,P7)에 대비하여 다른 휘도를 표시한다.
이에 반해서, 본 발명에 따른 픽셀들은 프로그래밍 구간에서 기준전압(Vref)으로부터 동일한 "IR 편차"를 갖기 때문에, "IR 편차"로 인한 휘도 차이를 개선할 수 있다.
도 13 및 도 14는 기준전압라인들이 배치되는 실시 예를 나타내는 도면이다.
도 13을 참조하면, 제1-1 픽셀(P1_1)과 제2-1 픽셀(P2_1)은 제1 데이터라인(DL1)에 연결되고, 제1-2 픽셀(P1_2)과 제2-2 픽셀(P2_2)은 제2 데이터라인(DL2)에 연결된다. 제1 기준전압라인(RL1) 및 제2 기준전압라인(RL2)은 첫 번째 컬럼라인에 배치된 픽셀들(P1_1, P1_2)과 두 번째 컬럼라인에 배치된 픽셀들(P2_1, P2_2) 사이에 위치할 수 있다.
기수 번째 픽셀라인에 배치된 제1-1 픽셀(P1_1)과 제1-2 픽셀(P1_2)은 제1 브릿지(Br1)를 통해서 제1 기준전압라인(RL1)과 연결된다. 우수 번째 픽셀라인에 배치된 제2-1 픽셀(P2_1)과 제2-2 픽셀(P2_2)은 제2 브릿지(Br2)를 통해서 제2 기준전압라인(RL2)과 연결된다.
이와 같이, 동일한 픽셀라인에 배치된 복수의 픽셀들은 제1 브릿지(Br1) 또는 제2 브릿지(Br2)를 통해서 제1 기준전압라인(RL1) 또는 제2 기준전압라인(RL2)과 연결될 수 있다. 제1 기준전압라인(RL1) 또는 제2 기준전압라인(RL2)과 각각 연결되는 픽셀들의 개수는 둘 이상일 수 있으며, RC 딜레이를 고려하여 설정될 수 있다.
도 14를 참조하면, 기수 번째 픽셀라인에 배치된 제1-1 픽셀(P1_1)과 제1-2 픽셀(P1_2)은 제1 브릿지(Br1)를 통해서 제1 기준전압라인(RL1)과 연결된다. 우수 번째 픽셀라인에 배치된 제2-1 픽셀(P2_1)과 제2-2 픽셀(P2_2)은 제2 브릿지(Br2)를 통해서 제2 기준전압라인(RL2)과 연결된다. 제2 기준전압라인(RL2)은 제2 컬럼라인에 배치된 픽셀들(P1_2, P2_2)을 사이에 두고 제1 기준전압라인(RL1)과 이격되어 배치될 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
DIS: 표시패널
200: 타이밍 콘트롤러
300: 데이터 구동회로 500: 시프트레지스터
400: 레벨 쉬프터 RL1: 제1 기준전압라인
RL2: 제2 기준전압라인
300: 데이터 구동회로 500: 시프트레지스터
400: 레벨 쉬프터 RL1: 제1 기준전압라인
RL2: 제2 기준전압라인
Claims (9)
- 제1 유기발광다이오드 및 제1 구동 트랜지스터가 배치된 제1 픽셀;
제2 유기발광다이오드 및 제2 구동 트랜지스터가 배치된 제2 픽셀;
상기 제1 픽셀 및 상기 제2 픽셀과 연결된 제1 데이터라인;
상기 제1 구동 트랜지스터의 소스전극과 연결된 제1 기준전압라인; 및
상기 제2 구동 트랜지스터의 소스전극과 연결된 제2 기준전압라인을 포함하는 유기발광 표시장치. - 제 1 항에 있어서,
상기 제1 및 제2 기준전압라인은 동일한 전압레벨의 기준전압을 공급받는 유기발광 표시장치. - 제 1 항에 있어서,
상기 제1 및 제2 기준전압라인의 저항값을 동일한 유기발광 표시장치. - 제 1 항에 있어서,
제2 데이터라인과 연결되고, 상기 제1 픽셀과 동일한 픽셀라인에 배치된 제3 픽셀;
상기 제2 데이터라인과 연결되고, 상기 제2 픽셀과 동일한 픽셀라인에 배치된 제4 픽셀;
상기 제3 픽셀과 상기 제1 기준전압라인과 연결하는 제1 브릿지; 및
상기 제4 픽셀과 상기 제2 기준전압라인을 연결하는 제2 브릿지를 더 포함하는 유기발광 표시장치. - 제 1 항에 있어서,
상기 제1 및 제2 구동 트랜지스터 각각의 드레인전극은 고전위 구동전압의 입력단에 연결되는 유기발광 표시장치. - 제 5 항에 있어서,
상기 데이터라인은 상기 제1 및 제2 구동 트랜지스터 각각의 게이트전극에 데이터전압을 공급하고,
상기 제1 및 제2 픽셀은 각각, 상기 제1 및 제2 구동트랜지스터들 각각의 게이트전극과 소스전극 간의 전압 차이에 의해서 휘도가 결정되는 유기발광 표시장치. - 제 6 항에 있어서,
상기 제1 픽셀은 제1 스캔라인에 접속된 게이트전극, 상기 데이터라인에 접속된 드레인전극, 및 상기 제1 구동 트랜지스터의 게이트전극에 접속된 소스전극으로 이루어지는 제1 스캔 트랜지스터를 포함하고,
상기 제2 픽셀은 제2 스캔라인에 접속된 게이트전극, 상기 데이터라인에 접속된 드레인전극, 및 상기 제2 구동 트랜지스터의 게이트전극에 접속된 소스전극으로 이루어지는 제2 스캔 트랜지스터를 포함하며,
상기 제1 스캔라인에 인가되는 제1 스캔신호 및 상기 제2 스캔라인에 인가되는 제2 스캔신호는 1H 이상인 유기발광 표시장치. - 제 7 항에 있어서,
상기 제1 픽셀은 제1 센스라인에 접속된 게이트전극, 상기 제1 기준전압라인에 접속된 드레인전극, 및 상기 제1 구동 트랜지스터의 소스전극에 접속된 소스전극으로 이루어지는 제1 센스 트랜지스터를 포함하고,
상기 제2 픽셀은 제2 센스라인에 접속된 게이트전극, 상기 제2 기준전압라인에 접속된 드레인전극, 및 상기 제2 구동 트랜지스터의 소스전극에 접속된 소스전극으로 이루어지는 제2 스캔 트랜지스터를 포함하며,
입력 영상데이터를 상기 제1 및 제2 픽셀에 기입하는 영상 데이터 기입 구간에서,
상기 제1 센스라인에 인가되는 제1 센스신호는 상기 제1 스캔신호에 동기되고, 상기 제2 센스라인에 인가되는 제2 센스신호는 상기 제2 센스신호에 동기되는 유기발광 표시장치. - 제 8 항에 있어서,
블랙 데이터 삽입 구간 동안 상기 제1 및 제2 픽셀은 동시에 블랙 영상데이터를 제공받고,
상기 블랙 데이터 삽입 구간에서 상기 제1 및 제2 센스신호는 턴-오프 상태인 유기발광 표시장치.
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