KR20050096967A - 통신 수신기에서 다중 반송파 신호의 자동 이득 제어 방법및 장치 - Google Patents

통신 수신기에서 다중 반송파 신호의 자동 이득 제어 방법및 장치 Download PDF

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Abstract

수신기는 대응하는 개수의 내부 루프 및 외부 루프 AGC 처리를 통해 다중 반송파 신호에 대한 AGC 동작을 한다. 제한된 양의 간섭을 가진 다중 반송파 신호를 나타내는 제 1 비트 수가 교정 모드 처리를 통해 결정된다. 제 1 비트 수는 외부 루프 AGC에서 다중 반송파 신호의 양자화에 대해 최대 양자화 레벨을 제공한다. 수신 신호 전력 추정치가 미리 결정된 "ON" 임계치에 이른 후, 외부 루프 AGC는 제 1 비트 수보다 높은 제 2 비트 수로 동작하여 제 1 및 제 2 비트 수의 차에 따라 가능한 간섭의 양자화를 가능하게 한다. 외부 루프 AGC는 수신 신호 전력 추정치가 미리 결정된 "OFF" 임계치 아래로 떨어지면 제 1 비트 수를 이용하도록 다시 전환된다.

Description

통신 수신기에서 다중 반송파 신호의 자동 이득 제어 방법 및 장치{METHOD AND APPARATUS FOR AUTOMATIC GAIN CONTROL OF A MULTI-CARRIER SIGNAL IN A COMMUNICATION RECEIVER}
본 출원은 "Improving Demodulation Performance at Low Geometries with Few Adjacent Cells"라는 명칭으로 2003년 2월 1일자 제출된 미국 예비출원 일련번호 60/444,283호로부터의 우선권을 주장한다.
본 발명은 일반적으로 통신 분야에 관한 것으로, 보다 구체적으로는 통신 수신기에서 다중 반송파 신호의 자동 이득 제어에 관한 것이다.
일반적으로, 신호에 대한 다양한 형태의 자동 이득 제어(AGC)가 공지되어 있다. 수신된 신호에 대한 AGC 처리는 수신 신호의 복조 처리 전에 수신 신호의 왜곡 레벨 제한을 고려할 수 있다. AGC 동작은 일반적으로 수신 신호의 신호 세기와 임계치의 비교를 포함한다. 임계 레벨에 대한 신호 세기 레벨에 따라, 수신기 처리를 위해 수신 신호를 증폭하는 증폭기가 증폭 레벨을 변화시킬 수 있다. 다른 양상에서 증폭 처리는 수신 신호 세기 레벨을 기초로 수신 신호의 감쇠를 변화시킬 수 있다. 신호의 적당한 복조를 위해, 수신기는 일반적으로 수신된 데이터를 실어 보내는 신호의 주파수 범위 바깥의 신호들을 어느 정도 필터링하는 필터를 신호 경로에 가질 수 있다. 그 결과, 수신된 신호 세기 레벨은 주로 대역 내 신호의 신호 세기를 나타낸다. 신호의 AGC 처리 후 신호는 수신 정보를 추출하기 위한 복조기로 전달된다.
그러나 다중 반송파 신호의 수신 처리를 위해, 전단 필터는 다중 반송파의 전체 대역을 고려한 넓은 주파수 대역폭을 갖는다. 당업자는 다중 반송파 신호에 대한 복조 처리가 다중 반송파 신호의 각 반송파에 대해 상이한 복조 처리를 포함한다는 것을 인식할 수 있다. 이와 같이, 다중 반송파 신호의 각 반송파는 독립적인 AGC 처리를 필요로 할 수 있다. 다중 반송파 신호에 대한 광대역 필터에 의해, AGC 처리에서의 수신 신호 세기는 다중 반송파 신호의 모든 반송파들의 신호 세기를 나타낸다. 따라서 통신 수신기에서 다중 반송파 신호의 전단 AGC 처리 및 각 반송파 신호의 독립적인 AGC 처리 및 복조를 위한 방법 및 장치가 필요하다.
도 1은 수신 신호를 처리하기 위한 수신기 부분을 나타낸다.
도 2는 본 발명의 여러 가지 양상에 따라 동작할 수 있는 수신된 다중 반송파 신호를 처리하기 위한 수신기 부분을 나타낸다.
도 3은 다중 반송파 신호를 수신하는 수신기의 내부 또는 외부 루프의 이득을 제어하는 자동 이득 제어 동작 블록도를 나타낸다.
도 4는 다중 반송파 신호를 수신하는 수신기 부분의 외부 루프 및 내부 루프를 나타낸다.
수신기는 대응하는 개수의 내부 루프 및 외부 루프 AGC 처리를 통해 다중 반송파 신호에 대한 AGC 동작을 할 수 있다. 감쇠 레벨을 결정하기 위해 언급한 외부 루프 교정 및 동작 모드는 내부 루프들이 원하는 부분의 수신 신호에 대해 최소 양자 왜곡을 갖는 다중 반송파 신호의 각 반송파에 대해 효과적으로 동작할 수 있게 한다. 제한된 양의 간섭을 가진 다중 반송파 신호를 나타내는 제 1 비트 수가 교정 모드 처리를 통해 결정된다. 제 1 비트 수는 외부 루프 AGC에서 다중 반송파 신호의 양자화에 대해 최대 양자화 레벨을 제공한다. 수신 신호 전력 추정치가 미리 결정된 "ON" 임계치에 이른 후, 외부 루프 AGC는 제 1 비트 수보다 높은 제 2 비트 수로 동작하여 제 1 및 제 2 비트수의 차에 따라 가능한 간섭의 양자화를 가능하게 한다. 외부 루프 AGC는 수신 신호 전력 추정치가 미리 결정된 "OFF" 임계치 아래로 떨어지면 제 1 비트 수를 이용하도록 다시 전환된다. 더욱이, 외부 루프 AGC는 제 1 비트 수를 사용할 때 감쇠 레벨(비활성 또는 "OFF" 상태)을 정할 수 있고, 제 2 비트 수를 사용할 때 활성 또는 "ON" 상태로 전환한다. ON 및 OFF 임계치는 제 1 및 제 2 비트 수의 사용을 서로 전환하는 히스테리시스를 피하도록 다른 레벨에 있다.
본 발명의 특징, 과제 및 이점들은 도면과 관련한 하기의 상세한 설명으로부터 보다 명백해지며, 도면 전체에 걸쳐 동일 부분들은 동일 참조 부호로 나타낸다.
일반적으로, 본 발명의 여러 가지 양상은 대응하는 개수의 내부 루프 및 외부 루프 AGC 처리를 통해 다중 반송파 신호에 대한 자동 이득 제어 동작을 하는 수신기를 제공한다. 언급한 외부 루프 교정 및 동작 모드는 내부 루프들이 원하는 부분의 수신 신호에 대해 최소 양자 왜곡을 갖는 다중 반송파 신호의 각 반송파에 대해 효과적으로 동작할 수 있게 하는 동시에 외부 루프 AGC의 아날로그-디지털 변환기(ADC)가 흡수할 수 있는 바람직하지 못한 신호의 양을 최대화하는 수신 신호의 양자화를 위해 적어도 두 가지 다른 비트 수에 의한 동작을 제공한다. 흡수된 바람직하지 않은 신호는 내부 루프 AGC의 각각의 채널 디지털 처리(CDP) 블록에 의해 거부될 수 있다. 본원에 개시된 하나 이상의 전형적인 실시예는 디지털 무선 데이터 통신 시스템과 관련하여 설명한다. 이러한 정황에서의 사용이 유리하지만, 본 발명의 다른 실시예들은 다른 환경이나 구성에 통합될 수도 있다. 일반적으로, 본원에 개시된 각종 시스템들은 소프트웨어 제어 처리기, 집적 회로 또는 이산 논리를 이용하여 형성될 수 있다. 출원 전반에 걸쳐 참고로 인용하고 있는 데이터, 지시, 명령, 정보, 신호, 기호 및 칩은 전압, 전류, 전자파, 자계 또는 입자, 광섬유 또는 입자, 또는 이들의 조합으로 유리하게 나타낸다. 또한, 각 블록도에 도시된 블록들은 하드웨어 또는 방법 단계들을 나타낼 수 있다.
보다 구체적으로, 본 발명의 각종 실시예들은 통신 사업자 협회(TIA: Telecommunication Industry Association) 및 다른 표준 기구들에 의해 공개된 각종 표준에 개략적으로 개시된 통신 표준에 따라 동작하는 무선 통신 시스템에 통합될 수 있다. 이러한 표준들은 TIA/EIA-95 표준, TIA/EIA-IS-2000 표준, IMT-2000 표준, UMTS 및 WCDMA 표준, GSM 표준을 포함하며, 모두 본원에 참조로 포함된다. 표준들의 사본은 미국의 TIA 표준 및 기술부(2500 Wilson Boulevard, Arlington, VA 22201, USA)에 기재함으로써 얻을 수 있다. 일반적으로 본원에 참조로 포함된 UMTS 표준으로 확인되는 표준들은 프랑스의 3GPP 지원국(650 Route des Lucioles-Sophia Antipolis, Valbonne-France)과 접촉함으로써 얻을 수 있다.
도 1은 신호를 수신하고, 수신된 신호의 자동 이득 제어를 하고, 복조 처리를 위해 수신 신호를 아날로그에서 디지털로 변환하는 수신기 부분(100)을 나타낸다. 복조기는 도시하지 않는다. 전단 필터(101)는 대역 내 주파수 대역폭에 따라 수신 신호를 필터링한다. 필터(101)가 정보를 반송하는 신호를 통과시켜 바람직하지 않은 다른 모든 신호들을 필터링하도록 대역 내 주파수 대역폭이 선택된다. 필터링된 신호는 AGC(105)에 의해 생성된 자동 이득 제어(AGC) 신호에 따라 수신 신호를 감쇠 또는 증폭하는 전단 감쇠기/증폭기(102)로 전달된다. 아날로그-디지털 변환기(ADC;103)는 결과적인 신호를 변환하여 그 신호를 복조기에 전달한다. 전력 추정 회로(104)는 ADC(103)의 출력에서 신호 세기를 판단한다. AGC(105)로 정보가 전달된다. AGC(105)는 추정된 신호 세기를 임계치와 비교한다. 신호 세기가 임계치 이하이면, AGC(105)는 감쇠기/증폭기(102)에 수신 신호의 증폭 레벨을 증가시키거나 감쇠 레벨을 감소시킬 것을 지시한다. 신호 세기가 임계치 이상이면, AGC(105)는 감쇠기/증폭기(102)에 수신 신호의 증폭 레벨을 감소시키거나 감쇠 레벨을 증가시킬 것을 지시한다. 임계치는 ADC(103)에서의 입력 신호 레벨이 ADC(103)의 양자화 한계 이내로 유지되도록 선택된다. 이와 같이, ADC(103)의 출력을 수신하는 복조기는 불필요한 왜곡을 어느 정도 없앤 신호에 대해 동작한다.
일반적으로, 신호 전력의 디지털 계산은 랜덤 프로세스에 기반한다. "x"가 신호의 샘플을 나타내면, "E(x2)"는 신호 전력을 나타낸다. 신호 전력 "E(x2)"는 일반적으로 "x"의 분산 Var(x)과 "x"의 평균값의 제곱 "E2(x)"의 합, 즉 "E(x2) = Var(x)+E2(x)"와 같다. 평균값이 0의 값에 가까우면, 신호 전력은 "x"의 분산, 즉 E(x2)=Var(x)과 같다. 수신기 전단은 예를 들어 일반적으로 알려진 직접 변환 프로세스에 따라 신호의 DC 성분을 없애 제로 평균 신호를 생성할 수 있다. 이러한 경우, 수신 신호의 평균값은 0의 값에 가깝다. 이와 같이 신호 전력을 계산함으로써, 이에 따라 Var(x)이 결정될 수 있다.
제로 평균에서 신호 샘플들의 표준 편차(시그마)는 E(x2)의 제곱근, 즉 Var(x)의 제곱근과 같다. 신호의 처리 왜곡을 제한하기 위해, 신호를 나타내는데 필요한 비트 수는 신호 샘플들의 표준 편차에 근거한다. 동작에 필요한 표준 비트 수는 log2(시그마+1)+1로 나타낼 수 있다. 4비트 ADC에 대해 최대 신호 대 양자화 잡음비를 달성하기 위한 최적 시그마는 3과 같다. 신호 진폭을 실제로 나타내는데 2비트가 사용될 수 있다. 한 비트는 샘플 기호를 위해 확보되고 한 비트는 ADC(103) 입력의 포화를 방지하기 위한 백오프(back-off)를 위해 확보될 수 있다. 신호의 E(x2)는 숫자 도메인에서 9개의 유닛을 가질 수 있다. 4비트 ADC에 대해 20㏈ 약간 아래의 신호 대 양자화 잡음비를 산출하면, 최적 입력 신호 레벨은 신호의 복잡한 처리를 위한 18(신호 펄스당 9)과 거의 같다. ADC(103)에 의해 생성된 디지털 샘플들은 적당한 복조 처리를 위한 복조기에 디지털로 제공된다. 수신기 부분(100)은 하향 변환기 믹서 및 다른 블록들을 가질 수 있지만, 간결성을 위해 도시하지 않는다. 더욱이, 몇 단계의 필터링을 통해 필터링 처리가 일어날 수 있다.
다중 반송파 신호는 하나 이상의 인접한 또는 인접하지 않은 반송파 주파수 신호들로 구성된다. 전단 처리 후, 각 반송파에 대해 독립적으로 다른 복조 리소스에 의해 디지털 복조가 행해진다. 도 2를 참조하면, 본 발명의 각종 양상에 따라 동작할 수 있는 다중 반송파 수신부(200)의 블록도가 도시된다. 필터(201), 감쇠기/증폭기(202), ADC(203), 전력 추정기(205) 및 AGC(204)의 동작은 도 1의 대응하는 블록들과 같다. 전단 필터링(201)의 대역폭은 몇 개의 인접하는 반송파들(예를 들어, 3개의 인접하는 cdma2000 반송파들)의 대역폭에 대응할 수 있다. cdma2000 다중 반송파 파형(3개의 인접한 반송파까지)의 처리 및 WCDMA에 동일한 수신기가 사용되면, 전단 필터링의 대역폭은 5㎒ 정도가 될 수 있다.
채널 디지털 처리(CDP) 블록들(206-208)은 수신된 다중 반송파 신호의 각각의 반송파에 대해 ADC 샘플을 처리한다. 각각의 반송파 신호에 대해, 내부 루프(AGC)는 각각의 반송파 신호의 복조에 사용되는 복조기의 한계 내에서 신호 레벨을 한정하기 위해 수용 가능한 양자화 레벨에서 반송파에 대응하는 디지털 샘플을 유지하도록 동작한다. 예를 들어, CDP(206)에 의해 형성된 내부 루프(AGC), 전력 추정기(214) 및 AGC(209)는 제 1 변조기로 전달된 디지털 샘플의 양자화를 제어한다. 제 1 변조기(미도시)는 프로세싱 동안 CDP(206)에 의해 선택된 신호에 대응하는 반송파 신호에 운반된 정보를 추출하도록 동작한다. CDP(207)에 의해 형성된, 제 2 내부 루프 AGC, 전력 추정기(213) 및 AGC(210)은 제 2 변조기로 전달된 디지털 샘플의 양자화를 제어하도록 동작한다. 제 2 복조기(미도시)는 프로세싱 동안 CDP(207)에 의해 선택된 신호에 대응하는 반송파 신호에 의해 운반된 정보를 추출한다. 제 3 내부 CDP(208)에 의해 형성된 제 3 내부 루프(AGC), 전력 추정기(212) 및 AGC(211)는 제 3 변조기로 전달된 디지털 샘플의 양자화를 제어한다. 제 3 복조기(미도시)는 프로세싱 동안 CDP(208)에 의해 선택된 신호에 대응하는 반송파 신호에 의해 운반된 정보를 추출한다. 각각의 CDP 내의 프로세싱은 반송파 신호 각각에 대한 대역 밖의 원하지 않는 신호들에 대한 주파수 제거를 강화할 수 있는 필터링에 의해 동반된 샘플링 속도 하향-변환을 포함한다. 따라서, 각각의 CDP 블록은 반송파 신호 각각에 대한 정보의 처리를 위한 신호를 결정한다.
광역 전단 필터링은 수신된 신호의 디지털 표시로 많은 레벨을 제공하기 위해 도 1에 도시된 단일 반송파 실행에서 4비트에 비교하여 예를 들어, 14 비트와 같은 많은 비트와 함께 ADC(203)를 사용하는 것을 필수적이게 한다. 그 결과, CDP(206-208)는 적절한 필터링 및 디지털 처리가 가능하도록 수신된 디지털 샘플의 다수 레벨에 대해 동작할 수도 있다. 내부 루프(AGC)는 각각의 복조기에 대해 디지털 샘플의 형태로 단일 전력을 제어한다. 4비트 복조기의 경우, 내부 루프(AGC)는 도 1에 도시된 단일 반송파 수신기에 대해 처리되면서, 복조기로 향하는 샘플의 전력을 복소 도메인에서 18개의 평균 신호 파워 레벨로 조정한다. 수신기 부분(200)과 같은 각각의 광대역 수신기는 하나의 외부 루프(AGC), 및 다중 반송파 신호의 각각의 반송파에 대해 하나의 내부 AGC 루프를 가질 수도 있다. 내부 루프 AGC가 자신의 AGC 블록을 통해 계산하는 이득은 대응하는 CDP 블록으로 제공된다. CDP 블록은 그에 따라 신호 이득을 증가 또는 감소시킨다. 각각의 내부 루프 AGC는 동일하거나 상이한 AGC 임계값과 함께 상이한 시간에서 상이한 이득 레벨을 가질 수도 있다. 내부 루프(AGC)는 도 1에 도시된 바와 같이, 종래의 수신기들의 AGC 루프의 시정수와 비교 가능한 시정수를 가질 수도 있다. 시정수는 100마이크로초의 단위일 수도 있다. 각각의 AGC 루프에 대한 시정수는 또한 상이할 수도 있다. 그에 따라, 내부 루프 AGC 루프는 서로 독립적으로 동작할 수도 있다. 조인트 외부/내부 루프 AGC의 적절한 동작은 내부 루프 AGC의 시정수보다 더 큰 크기의 시정수를 갖는 외부 루프 AGC를 필요로 할 수도 있다. 100밀리초 단위의 값은 외부 루프 AGC 시정수의 예로써 적당하다.
본 발명의 다양한 특징에 따라, 외부 루프 AGC는 신호의 관심 부분의 왜곡을 최소화하고, ADC(203)가 흡수할 수도 있는 원하지 않는 신호의 양을 최소화하도록 요구되는 전단 감쇠/증폭 레벨을 제어한다. 원하지 않는 신호(대역 밖의 신호)가 무시될 수 있을 경우 공칭 조건에서, 외부 루프 AGC는 작은 수의 비트가 신호를 디지털화하도록 ADC(203)의 입력에서, 소정의 추가된 수신기 잡음을 포함하여 수신된 다중 반송파 신호 전력 레벨을 제어한다. 작은 수의 비트들이 단일 반송파 신호를 프로세싱하는데 사용된 비트 수와 비교될 수도 있다. 이러한 상황에서, 간섭 레벨이 무시될 수 있는 경우, 사용된 비트의 수는 4 내지 6비트 범위일 것이다. 이러한 상황(비활성 상태)에서, 외부 루프 AGC는 "개방"되고, ADC(203)의 입력에서 신호 및 수신기 잡음의 이득/감쇠를 변화시키지 않을 것이다. 다른 상황(활성 상태)에서, 간섭 레벨이 공칭값 이상일 경우, ADC(203)는 원하는 신호 및 원하지 않는 신호의 조합의 디지털화를 조정하기 위해 많은 수의 비트를 사용한다. 신호 프로세싱은 고유하게 소정의 수신기 잡음을 처리하는 것을 포함한다는 것을 주지하는 것은 중요하다. 전단 필터링을 통과한 원하지 않는 신호의 제거는 디지털 신호 프로세싱을 통해 각각의 내부 루프 CDP 블록에서 발생한다. CDP 블록은 가능한 많이, 원하지 않는 모든 신호를 제거하도록 동작한다. 각각의 내부 루프 AGC에서, 원하지 않는 신호들은 다중 반송파 신호의 다른 반송파 신호 및 다른 가능한 간섭을 포함한다. 각각의 CDP는 반송파들 중 하나를 프로세싱한다.
이하의 표 1은 (소정의 수신기 발생 잡음을 포함하는) 원하는 신호의 프로세싱 동안 유지된 ADC의 비트의 수와 ADC에 의해 흡수될 수 있는 간섭 신호 사이의 트레이드-오프를 요약한 것이다. 전체적으로 허가된 시그마("σ")는 신호 및 간섭에 대한 고려된 시그마의 조합을 포함한다. 간섭 및 신호가 독립된 프로세스로 고려되기 때문에, 전체 시그마는 신호 및 간섭에 할당된 시그마 제곱("σ2")의 선형 조합에 기초한다.
13비트에 대해 전체적으로 허가된 시그마는 4095이다.
표 1
신호/잡음에 대한 비트 신호/잡음에 대한 시그마 간섭에 대한 시그마 간섭에 대한 비트 신호 dB에 대한 간섭
3 3 4095.00 13.00 62.70
4 7 4094.99 13.00 55.34
5 15 4094.97 13.00 48.72
6 31 4094.88 13.00 42.42
7 63 4094.52 13.00 36.26
8 127 4093.03 13.00 30.16
9 255 4087.05 13.00 24.10
10 511 4062.99 12.99 18.01
11 1023 3965.16 12.95 11.77
12 2047 3546.66 12.79 4.77
13 4095 0.00 1.00 -∞
표 1로부터, 전단 수신기를 포화시키기 전에 원하지 않는 신호를 나타내기 위한 여지로서 비트의 수가 중요하다는 것이 명백하다. 작은 비트의 수가 원하는 신호의 신호 대 양자화 잡음 표시하는데 할당되면서, 상기 잡음은 감소될 수도 있다. 대신에 ADC는 ADC 내에서 원하지 않는 신호의 조정을 위한 추가의 여지를 가질 수도 있다. 내부 루프의 CDP를 통한 필터링은 ADC(203)을 통해 진행한 대역 밖의 원하지 않는 신호를 제거할 수도 있다.
외부 루프 AGC(203)는 인입 신호/잡음비가 원하지 않는 신호가 없을 경우 양호한 신호 대 양자화비를 보장할 정도의 비트 수(예를 들어, 6 비트)가 되게 한다. 전단 이득/감쇠가 이러한 조건으로 고정되기 때문에, 원하지 않는 신호가 존재하지 않는 경우라도 원하지 않는 신호의 전력이 예로써, 표 1에 도시된 범위 내에 있는 동안, 신호/잡음을 표시하기 위해 상기한 작은 비트 수는 유지된다. 따라서, 동일한 신호 대 양자화 비는 원하지 않는 신호가 존재하는 경우에도 유지될 수 있다. 내부 루프 CDP는 다중 반송파 신호의 각각의 반송파에 대해 복조 처리 전에 원하지 않는 신호를 가장 적절하게 제거한다. 원하지 않는 신호의 전력이 표 1에 도시된 범위보다 큰 경우, ADC(203)은 큰 수의 비트를 사용하여 전환되고 외부 루프 AGC는 전체 ADC 범위(예를 들어, 14 비트)에 근접하도록, 원하는 신호 및 원하지 않는 신호를 포함하여, 인입 신호의 전단 이득/감쇠를 제어할 수도 있다. 외부 루프(AGC)는 표 1에서 효율적으로 "상향"(예를 들어, 신호/잡음에 대해 할당된 6-비트로부터 3 또는 4 비트로)으로 이동한다. 최대 감쇠는 외부 루프(AGC)가 신호/잡음 표시에 대해 적어도 3 비트로 유지되도록 고정될 수도 있다. 상기한 고정된 레벨 이상의 더 많은 감쇠는 대개 관심 신호를 감쇠시킨다.
통상적으로 말해서, 방법 및 장치는 다중 반송파 신호를 프로세싱하기 위해 통신 시스템 수신기를 제공한다. 제 1 비트 수가 한정된 양의 간섭을 갖는 다중 반송파 신호를 나타내기 위해 결정된다. 제 1 비트 수는 결정된 제 1 비트의 수에 의해 제공된 최대 양자화 레벨에 대한 수신 처리를 위해 외부 루프(AGC)에서 다중 반송파 신호의 양자화를 가능하게 한다. 비활성 상태에서 외부 루프(AGC) 이득/감쇠는 제 1 비트의 수가 수신된 신호의 양자화에 사용되는 경우 예정된 레벨로 고정된다. 활성 상태의 경우, 수신된 신호의 전력 추정치가 "ON" 임계값에 도달한 것을 검출한 후 외부 루프(AGC)는 제 1 비트 수보다 더 큰 제 2 비트 수로 동작된다. 이러한 조건에서, 수신된 신호 및 가능한 간섭의 양자화는 제 2 비트 수에 따르며, 외부 루프(AGC)는 신호 레벨을 제어하도록 동작하기 위해 "ON"으로 된다. 내부 루프 채널(CDP)은 전단 필터링을 통과한 원하지 않는 신호를 제거하기 위한 디지털 신호 프로세싱을 제공한다. 외부 루프에서, 간섭을 갖는 다중 반송파 신호가 "OFF" 임계값에 도달한 후, 외부 루프(AGC)는 제 1 비트의 수로 동작하고, 비활성 상태에서 고정된 이득/감쇠 레벨에서 동작하도록 "OFF"로 된다.
하나 이상의 알고리즘이 수신기 부분(200)의 조정 모드 및 정규 동작 모드에 사용될 수도 있다. 조정 모드는, 제 1 비트 수가 양자화 처리에 사용된 경우, 블록(203)의 전단 이득/감쇠의 고정된 값의 적절한 결정을 위해 요구될 수도 있다. 고정된 값은 정규 동작 모드 동안 외부 루프(AGC)의 비활성 상태를 위해 사용된다. 조정 모드는 수신기 부분을 제조 또는 설치, 그리고 부분 교체의 경우 행해질 수 있다.
조정 모드는 필터(201)의 입력인 수신기 입력이 소정의 불필요한 신호의 입수를 방지하기 위해 종료되도록 하는 것을 필요로 한다. 상기한 경우, ADC(203)은 수신기 열 잡음에 대해 디지털화할 수도 있다. 이러한 동작 모드의 목적은 ADC의 입력에서 신호 전력(열 잡음)이 특정 희망값에 대응할 정도의 값으로 전단 감쇠를 설정하는 것이다. 다시 말해, ADC는 열 잡음을 디지털화하기 위해 결정된 비트 수를 사용하는 것이다. CDMA 신호는 본래 잡음 레벨 아래에 있기 때문에, 다중 반송파 신호가 동작 모드 동안 존재하는 경우, 동일한 수의 비트가 사용될 수도 있다. 14비트 ADC가 사용되기 때문에, AGC 레벨링은 매우 높은 신호 대 양자화비를 달성하는 4-6비트로 설정될 수도 있다. 이하의 표 2는 다양한 수의 비트를 갖는 신호를 나타내기 위해 AGC에 의해 목표된 표준 편차를 요약한다.
표 2. 비트 대 목표 표준 편차 맵핑
비트 수 σ설정포인트
3 3
4 7
5 15
6 31
CDMA 역방향 링크의 정규 동작은 3-4dB이하의 열적 상승을 초래할 수도 있다. 따라서, 4-6 비트의 ACG로의 완료된 입력을 갖는 수신기를 조정하고 14-비트 ADC를 갖는 것은 모든 공칭 범위에 대해 인입 신호의 불량한 비지털화를 가능하게 한다. 조정 모드의 경우, AGC 블록은 ADC의 출력에서 원하는 표준 편차를 얻는 전단 이득/감쇠에 수렴 (예를 들어, 만일 ADC가 6 비트로 설정된 경우, σ설정 포인트=31)할 수도 있다. 수렴된 이득/감쇠 레벨의 값은 외부 루프(AGC) 비활성 동작의 고정된 값으로 사용될 수 있다.
도 3은 조정을 위해 AGC 블록(204)의 동작 블록 다이어그램(300)을 도시한다. 블록(301)의 입력에서 σ설정 포인트의 값은 열 잡음 레벨을 디지털화하는데 사용되는 비트의 수에 의존한다. 표 2는 사용될 수도 있는 값들의 몇몇 예들을 제공한다. "그룹(Gloop)" 파라미터 입력은 이러한 제 1 오더 루프에 대한 루프 이득이며, 그 값은 달성되기를 희망하는 시정수에 의존한다. 최종적으로, AGC 블록(204)에서 진폭 최종 감쇠 값을 얻기 위해, "dB" 도메인으로부터 선형 도메인으로의 변환이 필요할 수도 있다. 이러한 감쇠 레벨은 적용 전에 적절하게 양자화될 수도 있다. 예를 들어, 0.5dB의 레졸루션의 경우, 합계 누적 출력은 0.5dB 레졸루션으로 양자화된다.
조정이 실행되기만 하면, 루프는 다수의 시정수(5 시정수면 충분)를 대기함으로써 수렴 가능할 수 있다. "감쇠(Atten)" 및 "σ" 평균값들은 몇몇 실행을 통해 얻어질 수 있다. 평균은 시간 임계적이지 않으며 따라서 펌웨어에서 추가의 계산을 방지하기 위해 소프트웨어로 실행될 수도 있다. 감쇠값의 입도에 의존하여, σ의 값은 목표값 σ설정 포인트에 더 근접하거나 멀어질 수도 있다.
얻어진 평균 감쇠 값은 작은 수의 비트가 양자화를 위해 사용된 경우 외부 루프 AGC를 위한 공칭 감쇠가 될 수도 있다. 상기 값은 외부 루프 정규 동작 모드에서 사용되는 고정된 감쇠값(Atten0)에 대해 사용된다. 동시에, 유사한 동작이 조정 프로세스의 일부로서 내부 루프 AGC 이득값의 평균값을 저장하도록 내부 루프에 대해 실행될 수도 있다. 내부 루프 AGC의 이득값은 설명된 다른 부분에서 제거될 수도 있다.
정규 동작 모드는 상기 동작 모드의 상태 기계를 도시하는 하기의 상태 다이어그램으로부터 이해될 수 있다:
비활성 상태 동안, 외부 루프 AGC는 개방되고, 따라서, 전단 감쇠는 측정(Atten0)동안 획득된 값으로 결정된다. 그러나, 수신기는 ADC(203)의 출력에서 전체 전력을 모니터링하는 것을 유지한다. 측정된 σ는 특정 임계치(Thr0) 이상일 때마다, 상태의 변화는 트리거되고 처리는 비활성 상태로부터 활성 상태로 이동한다. 수신기가 더 뚜렷한 레벨의 원하지 않는 신호를 수신할 때마다 비활성 상태가 되거나, 비활성 상태로 이동하는 것은 바람직하다. 활성 상태일 때, 외부 루프 AGC는 폐쇄될 수 있고, AGC 처리가 ADC의 입력/출력에서 특정 수의 비트들을 제공하도록 한다. ADC의 동적 범위를 완전히 사용하기 위해, 외부 루프 AGC는 13비트까지(ADC의 전체 범위 미만의 범위) 자동 이득 제어를 시도할 수 있다. 활성 상태에서, 몇가지 옵션들이 제공될 수 있다. 제 1 옵션은 최대 전단 감쇠 레벨을 세팅하여 ADC 입력에서 신호/잡음 입력을 표시하는데 최소 비트가 할당되도록 하는 것이다. 제 2 옵션은 최대 전단 감쇠에 대하여 강제하지 않는 것이다. 최대 전단 감쇠를 강제하지 않음으로써, 중요한 신호가 ADC 발생 신호로부터 제거될 수 있다. 효율적으로, 제 1 옵션은 활성 상태 설정 포인트로의 루프를 폐쇄하지 않고, 따라서 임의의 추가의 포화 상태를 허용하는 것을 감안하여 중요한 신호에 할당된 최소 비트를 유지한다. 만약 원하지 않는 신호 전력이 너무 커서 허용된 최대 감쇠를 위한 ADC를 심하게 포화시키면, 중요한 신호의 복원은 불가능하게될 것이다. 그러나, 감쇠가 심하지 않으면, 신호는 복원가능하다.
전단 입력(전단 감쇠 이전의)에 참조된 측정된 σ(즉, σ×Atten)이 특정 임계치(Thr1×Atten0) 미만이면, 프로세스는 ADC가 디폴트 전단 감쇠(ATTen0)를 가지는 입력 신호를 디지털화할 수 있음을 공지하는 알고리즘의 비활성 상태로 다시 진행할 수 있다. 비활성 상태에서, 알고리즘은 루프를 개방하고, 디폴트 전단 감쇠(Atten0)를 복원할 수 있다. 일반적으로, 몇몇의 가설에 활성 상태로부터 비활성 상태로의 트리거 및 이와 반대의 트리거를 추가하기 위해, Thr1은 Thr0 보다 작은 값으로 세팅될 수 있다. "Thr1"은 "OFF" 임계치로 참조되고, "Thr0"은 "ON" 임계치로 참조될 수 있다.
도 4는 다시 온도 상승(ROT) 결정에 대한 설명과 관련하여 수신기 부분(다중 반송파 신호의 반송파들 중 하나에 대한)의 동작 블록도(400)를 도시한다. CDP(405)를 통한 이득은 고정 부분과 가변 부분으로 구성된다. 고정 부분은 열잡음의 상승 레벨 및 열잡음 레벨의 크기와 동일하게 제공되고, 따라서, ROT 추정치로 제공되지 않을 수 있다. 가변 부분은 블록(405-407)로 형성된 내부 루프 AGC 이득(G)으로 구성된다. ADC(402)를 통한 표준 편차 압축을 무시할 때, 좌측 변수는 블록(401)의 전단 감쇠이다. 그러므로, ROT는 다음과 같이 표현될 수 있다:
상기에서,
● Atten0는 측정으로부터 획득된 정규 감쇠이다.
● G0는 측정동안 저장되었던 내부 AGC 루프 이득이다.
● Atten은 전단 감쇠기의 현재 사용되는 값이다.
● G는 내부 AGC 루프에서 현재 사용되는 이득의 평균이다.
● σo는 측정 모드 및 정규 동작 모드를 위한 내부 루프 AGC에 의해 목표된 표준 편차이다.
수신된 신호 세기(RSSI)는 수신기 전단의 잡음 플로어에 등가인 값에 의해 ROT 값을 오프셋함으로써 용이하게 측정될 수 있다. 수신기 잡음 플로어는 수신기의 제작동안 결정될 수 있거나 가변 설계 기준에 기초하는 공지된 값으로 미리 결정될 수 있다. 이와 같이, 수신기는 내부 루프 및 외부 루프 AGC 프로세스를 통해 다중 반송파 신호를 자동 이득 제어하도록 동작할 수 있다. 감쇠 레벨을 결정하기 위해 설명되는 것과 같은 외부 루프 측정 및 동작 모드들은 내부 루프가 수신된 신호의 원하는 부분에 대한 최소 양자화 왜곡을 가지는 다중 반송파 신호의 각 반송파상에 효율적으로 동작하도록 한다.
또한, 몇몇의 인접 셀을 가지는 기하학 구조에서 복조 성능을 개선하는 것은 정의들에 의해 개선될 수 있다. 용어 "PilotDrop"는 활성 세트 또는 후보 세트내의 파일럿에 대한 파일럿 드롭 타이머를 개시하기 위해 가입자국 또는 액세스 터미널에 의해 사용되는 값을 의미한다. PilotDrop의 값은 네트워크에 의해 가입자국으로 전달될 수 있다. 개념적으로 PilotDrop의 값은 파일럿이 더이상 복조를 위해 사용될 수 없는 신호 세기 임계치 미만으로 세팅된다. 용어 "PilotDropTimer"는 활성 세트 또는 후보 세트의 멤버인 파일럿에 대한 액세스 터미널에 의해 동작이 수행되는 타이머 값을 의미하며, 상기 타이머 값의 세기는 PilotDrop에 의해 규정된 값 이상이 될 수 없다. 만약 파일럿이 활성 세트의 멤버, RouteUpdate, 또는 유사한 메시지이면, 연결 상태 내에서 전송될 수 있다. 만약 파일럿이 후보 세트의 멤버이면, 이웃 세트로 이동될 수 있다. 용어 "활성 세트"는 현재 액세스 터미널을 서비스하는 섹터들과 연관된 파일럿들의 세트(파일럿의 PN 오프셋 및 파일럿의 CDMA 채널에 의해 규정된)를 의미한다. 접속이 개방되면, 섹터는 액세스 터미널에 할당된 순방향 트래픽 채널, 트래픽 채널, 및 역방향 전력 제어 채널이 제공될 때 액세스 터미널을 서비스하는 것으로 고려된다. 접속이 개방되지 않으면, 섹터는 액세스 터미널이 섹터의 제어 채널을 모니터링할 때 액세스 터미널을 서비스하는 것으로 고려된다. 용어 "후보 세트"는 활성 세트내에 있지 않지만, 그들을 전송하는 섹터들이 활성 세트내에 포함된 우수한 후보들임을 표시하는데 충분한 세기를 가지는 액세스 터미널에 의해 수신되는 파일럿들의 세트(파일럿의 PN 오프셋 및 파일럿의 CDMA 채널에 의해 규정된)를 의미한다. 복조기는 핑거들의 레이크를 가지는 레이크 수신기를 포함할 수 있다. 핑거들은 복조기내의 주요 리소스로 고려되며, 복조기 내에 제한된다. 각각의 핑거는 입력된 신호의 단일 경로를 트래킹하여 복조하도록 사용될 수 있다. 그러므로, 다수의 핑거들을 구비함으로써, 경로 다이버시티가 사용될 수 있다. 복조기내에 제한된 양의 자원들, 즉, 핑거들을 효율적으로 할당함으로써, 최적의 성능이 달성될 수 있다. "핑거 고정" 및 "임계치들 고정"의 개념들은 상기 목적을 달성하기 위해 사용될 수 있다. 복조기는 핑거들의 각각에 의해 트래킹된 파일럿들의 세기를 계속해서 모니터링하도록 사용될 수 있다. 상기 모니터링으로부터, 복조기들은 핑거들 각각을 "내부-고정" 또는 "외부-고정"으로 라벨화할 수 있다. 상기 라벨은 "핑거 고정 상태"로 표시된다. 도 1은 파일럿 신호 세기의 함수로서 핑거 고정 상태의 일례를 도시한다. 상기 특정 예를 위해, 상태의 변화시 가설이 존재한다. 복조기의 일 실시예에서, 특정량의 시간 동안 외부 고정된 핑거들의 할당을 해제하는 알고리즘이 제공될 수 있다. 네트워크는 파일럿이 복조를 위해 제거되어야 하는 경우에 가입자국으로 전달하기 위해 PilotDrop값을 사용할 수 있다. 사실, 파일럿의 신호 세기가 PilotDropTimer보다 긴 시간 구간동안 PilotDrop 임계치 미만일 때마다, 가입자국은 복조를 위해 상기 파일럿을 제거할 수 있고, 따라서 하나의 핑거는 비어있게 될 것이다. 네트워크 운영자는 자신의 네트워크를 위해 네트워크 토폴로지, 인접 셀들의 개수, 등등에 따라 결정될 수 있는 것과 같은 PilotDrop의 값을 최대한으로 사용할 것을 시도할 수 있다. 복조기의 일 실시예에서, 핑거 고정 임계치들 및 PilotDriop 임계치 사이의 링크는 성능을 최적으로 사용하기 위해 제공될 수 있다. 종래에는, 파일럿 고정 임계치들은 모뎀의 파라미터들로 고정되었다. 상기 임계치들은 일반적으로 모뎀내에서 세팅되었다. 몇가지 상황들 중 네트워크가 낮은 PilotDrop값을 전달 할 수 있는 상황이 계획될 수 있다. 이는 네트워크가 이동국에 인식되는 몇몇의 파일럿들을 가지는 것으로 예측할 수 있음을 의미한다. 예를 들어, 몇몇의 이웃 셀들을 가지는 매우 큰 지방 또는 교외의 셀들에 대하여, 가입자국은 대부분은 경로 다이버시티를 가지지 않는 하나의 강한 파일럿을 인식할 것이다. 따라서, 대부분의 시간 동안 복조기는 핑거를 제한하지 않을 것이다. 대신에, 복조기는 임의의 파일럿이 미약한 것으로 인식되는 경우라도 상기 임의의 파일럿을 가상으로 트래킹 할 수 있다. 셀의 에지에서, 사용 가능한 파일럿들이 너무 미약하여 정규 핑거 고정 임계치들이 복조기가 상기 파일럿들을 트래킹하여 복조하지 못할 수 있다. 따라서, 복조기의 일 실시예에서, PilotDrop는 핑거 고정 임계치들의 값들로 링크될 수 있다. 링크는 특정 애플리케이션, 전체 설계 파라미터들 또는 당업자에 의해 적절하게 고려되는 임의의 다른 인자들에 따라 결정되는 임의의 링크가 될 수 있다. 링크는 범위에 따라 결정될 수 있으며, 다시말해서, PilotDrop의 정규 값들에 대하여, 파일럿 고정 임계치들은 그들의 디폴트 값들로 남겨질 수 있다. 그러나, 만약 예기치 못한 낮은 PilotDrop 값이 네트워크에 의해 전달된다면, 이는 터미널에서 핑거 고정 임계치들내에서의 변경을 트리거할 수 있다. 핑거 고정 임계치들의 변경은 핑거들이 내부-고정되는 것을 유지하는 범위를 연장할 수 있으며, 따라서, 미약한 파일럿들의 복조를 허용할 수 있다. 선택적으로, PilotDrop과 핑거 고정 임계치들 사이의 링크는 선형일 수 있다. 임의의 경우들에서, 두가지 맵핑 방식들 사이에서 더 복잡한 맵핑 방식들이 사용될 수 있다. 가설로 인해 하위 및 상위 핑거 고정 임계치들간의 차이가 제공될 수 있다. 복조기는 하위 및 상위 임계치들 사이에서 동일한 비율을 유지하도록 구성될 수 있거나, 상기 비율이 별경될 수 있다. 가설은 핑거 고정 임계치들로 구성되기 때문에, 핑거 "내부-고정" 상태로 돌아가는 것은 가입자국에 전송된 패킷들 또는 프레임이 손실 될 수 있는 더 긴 시간 구간을 필요로 할 수 있다. 디폴트 핑거 고정 임계치들을 일상의 값들보다 낮게 변경함으로써, 복조기는 더 미약한 신호들을 위한 경로들상에서 핑거들을 유지할 수 있고, 따라서, 복조 성능을 개선할 수 있다. 또한, 데이터를 복조하기 위한 복조기의 응답 시간은 채널 환경들이 복원되자마자 개선될 수 있다.
당업자는 또한 본 명세서에 개시된 실시예들과 관련하여 설명된 논리적인 블록들, 모듈들, 회로들, 및 알고리즘 단계들이 전자하드웨어, 컴퓨터 소프트웨어, 또는 그들의 조합으로서 실행될 수 있음을 인식할 것이다. 상기 하드웨어 및 소프트웨어의 상호교환가능성을 명백히 설명하기 위해, 다양한 요소들, 블록들, 모듈들, 회로들, 및 단계들이 그들의 기능성에 관련하여 전술되었다. 상기 기능성이 하드웨어로 실행되는지 또는 소프트웨어로 실행되는지의 여부는 전체 시스템에 부과된 특정 애플리케이션 및 설계 제약에 따라 결정한다. 당업자는 각각의 특정 애플리케이션을 위해 다양한 방식들로 설명된 기능성을 실행할 수 있지만, 상기 실행 결정들은 본 발명의 영역으로부터 벗어나는 것으로 해석될 수 없다.
본 명세서에서 개시된 실시예와 관련하여 다양하게 설명되는 논리 블록들, 모듈들, 및 회로들은 범용 프로세서, 디지털 신호 처리기(DSP), 주문형 집적 회로(ASIC), 현장 프로그램 가능한 게이트 어레이(FPGA), 또는 다른 프로그램 가능한 논리 디바이스, 이산 게이트 또는 트랜지스터 논리, 이산 하드웨어 요소들, 또는 본 명세서에 개시된 기능을 수행하도록 설계된 그들의 임의의 조합을 사용하여 실행되거나 수행될 수 있다. 범용 프로세서는 마이크로프로세서가 될 수 있지만, 선택적으로 프로세서는 임의의 종래의 프로세서, 제어기, 마이크로제어기, 또는 상태 기계가 될 수 있다. 프로세서는 또한 예를 들어, DSP 및 마이크로프로세서의 조합, 복수의 마이크로프로세서, DSP 코어와 결합된 하나 또는 그이상의 마이크로프로세서, 또는 임의의 다른 구성과 같은 컴퓨팅 장치들의 조합으로서 실행될 수 있다.
본 명세서에 개시된 실시예와 관련하여 설명되는 방법 또는 알고리즘의 단계는 하드웨어에서, 프로세서에 의해 실행되는 소프트웨어 모듈에서, 또는 그들의 조합에서 즉시 구현될 수 있다. 소프트웨어 모듈은 RAM 메모리, 플래시 메모리, ROM 메모리, EPROM 메모리, EEPROM 메모리, 레지스터들, 하드디스크, 제거가능한 디스크, CD-ROM 또는 임의의 다른 저장 매체 형태로 당업자에게 공지된다. 예시적인 저장 매체는 저장매체로부터 정보를 판독하고 정보를 기록할 수 있는 프로세서에 접속된다. 선택적으로, 저장 매체는 프로세서의 필수 구성요소이다. 프로세서 및 저장 매체는 ASIC 내에 상주할 수 있다. ASIC은 사용자 터미널 내에 상주할 수 있다. 선택적으로, 프로세서 및 저장 매체는 사용자 디바이스내에서 이산요소들로서 상주할 수 있다.
개시된 실시예의 전술된 설명은 당업자가 본 발명을 구현하고 이용하기에 용이하도록 하기 위하여 제공되었다. 이들 실시예에 대한 여러 가지 변형은 당업자에게 자명하며, 여기서 한정된 포괄적인 원리는 본 발명의 사용 없이도 다른 실시예에 적용될 수 있다. 따라서, 본 발명은 설명된 실시예에 한정되는 것이 아니며, 여기에 개시된 원리 및 신규한 특징에 나타낸 가장 넓은 범위에 따른다.

Claims (9)

  1. 통신 시스템 수신기에 대한 다중 반송파 신호를 처리하는 방법으로서,
    상기 처리를 위한 외부 루프 자동 이득 제어시 상기 다중 반송파 신호의 양자화를 위한 제 1 비트 수를 결정하는 단계;
    상기 외부 루프의 감쇠 레벨을 일정한 값으로 고정함으로써 비활성 모드인 상기 제 1 비트 수로, 그리고 상기 다중 반송파 신호의 전력 추정치가 ON 임계치에 이르면 활성 상태인 제 2 비트 수로 상기 외부 루프 자동 이득 제어를 동작시키는 단계; 및
    수신된 신호의 상기 전력 추정치가 OFF 임계치에 이르면 상기 활성 상태인 상기 제 2 비트 수에서 상기 비활성 상태인 상기 제 1 비트 수로 전환하도록 상기 외부 루프 자동 이득 제어를 동작시키는 단계를 포함하는, 다중 반송파 신호 처리 방법.
  2. 제 1 항에 있어서, 상기 외부 루프 자동 이득 제어를 포함하는 외부 루프 신호 처리를 통해 처리된 바람직하지 않은 신호를 거부하는 내부 루프 디지털 신호 처리를 더 포함하는 것을 특징으로 하는 다중 반송파 신호 처리 방법.
  3. 통신 시스템 수신기에 대한 다중 반송파 신호를 처리하는 장치로서,
    외부 루프의 감쇠 레벨을 일정한 값으로 고정함으로써 비활성 모드인 제 1 비트 수로, 그리고 상기 다중 반송파 신호의 전력 추정치가 ON 임계치에 이르면 활성 상태인 제 2 비트 수로 동작하며, 수신된 신호의 상기 전력 추정치가 OFF 임계치에 이르면 상기 활성 상태인 상기 제 2 비트 수에서 상기 비활성 상태인 상기 제 1 비트 수로 전환하도록 구성된 외부 루프 자동 이득 제어를 포함하는, 다중 반송파 신호 처리 장치.
  4. 제 3 항에 있어서, 상기 외부 루프 자동 이득 제어를 포함하는 외부 루프 신호 처리를 통해 처리된 바람직하지 않은 신호를 거부하는 내부 루프 디지털 신호 처리기를 더 포함하는 것을 특징으로 하는 다중 반송파 신호 처리 장치.
  5. 통신 시스템에 대한 방법으로서,
    외부 루프의 감쇠 레벨을 일정한 값으로 고정함으로써 비활성 모드인 제 1 비트 수로, 그리고 상기 다중 반송파 신호의 전력 추정치가 ON 임계치에 이르면 활성 상태인 제 2 비트 수로 다중 반송파 신호를 양자화하는 외부 루프 자동 이득 제어의 동작에 따라 상기 다중 반송파 신호의 이득을 제어하는 것을 포함하는, 통신 시스템에 대한 방법.
  6. 제 5 항에 있어서, 상기 다중 반송파 신호의 이득 제어는 수신된 신호의 상기 전력 추정치가 OFF 임계치에 이를 때 상기 활성 상태인 상기 제 2 비트 수에서 상기 비활성 상태인 상기 제 1 비트 수로의 전환을 더 포함하는 것을 특징으로 하는 통신 시스템에 대한 방법.
  7. 제 5 항에 있어서, 상기 외부 루프 자동 이득 제어를 포함하는 외부 루프 신호 처리를 통해 처리된 바람직하지 않은 신호를 내부 루프 디지털 신호 처리를 통해 거부하는 것을 더 포함하는 것을 특징으로 하는 통신 시스템에 대한 방법.
  8. 다중 반송파 신호를 처리하는 장치로서,
    외부 루프의 감쇠 레벨을 일정한 값으로 고정함으로써 비활성 모드인 제 1 비트 수로, 그리고 상기 다중 반송파 신호의 전력 추정치가 ON 임계치에 이르면 활성 상태인 제 2 비트 수로 상기 다중 반송파 신호를 양자화하는 수단, 및 수신된 신호의 상기 전력 추정치가 OFF 임계치에 이르면 상기 활성 상태인 상기 제 2 비트 수에서 상기 비활성 상태인 상기 제 1 비트 수로 전환하는 수단을 포함하며, 상기 다중 반송파 신호의 이득을 제어하기 위한 외부 루프 자동 이득 제어를 포함하는, 다중 반송파 신호 처리 장치.
  9. 제 8 항에 있어서, 상기 다중 반송파 신호의 각각의 반송파에 대한 상기 외부 루프 자동 이득 제어를 포함하는 외부 루프 신호 처리를 통해 처리된 바람직하지 않은 신호를 거부하는 내부 루프 디지털 신호 처리기를 더 더 포함하는 것을 특징으로 하는 다중 반송파 신호 처리 장치.
KR1020057014171A 2003-02-01 2004-02-02 통신 수신기에서 다중 반송파 신호의 자동 이득 제어 방법및 장치 KR101040548B1 (ko)

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US10/437,203 US7995684B2 (en) 2003-02-01 2003-05-12 Method and apparatus for automatic gain control of a multi-carrier signal in a communication receiver
US10/437,203 2003-05-12

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