KR20040030972A - 열에 병렬로 아날로그 디지털 변환기들을 구비한 cmos센서의 속도 2배화 - Google Patents
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Abstract
Description
Claims (23)
- 행들(row)과 열들(column)에 배열된 다수의 화소들을 구비하며, 상기 각 열들내의 상기 화소들이 열 출력 라인에 선택적으로 접속된 화소 어레이;각각이 상기 열 출력 라인들에 접속된 제1 복수의 제1 처리 회로들을 구비하는 제1 디지털화 회로; 및각각이 상기 열 출력 라인들에 접속된 제2 복수의 제2 처리 회로들을 구비하는 제2 디지털화 회로를 구비하고,상기 각 열 출력 라인은 상기 제1 및 제2 디지털화 회로들 각각에서의 적어도 하나의 처리 회로에 화소 신호들을 제공하는 것을 특징으로 하는 이미징 시스템.
- 제 1 항에 있어서, 상기 제1 복수의 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제1 입력;제1 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제1 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제2 입력;제2 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제2 인에이블 라인을 더 구비하는 것을 특징으로 하는 이미징 시스템.
- 제 2 항에 있어서, 상기 제2 복수의 제2 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제3 입력;제3 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제3 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제4 입력;제4 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제4 인에이블 라인을 더 구비하는 것을 특징으로 하는 이미징 시스템.
- 제 3 항에 있어서, 상기 제1 복수는 상기 제2 복수와 동일한 것을 특징으로 하는 이미징 시스템.
- 제 3 항에 있어서, 상기 제1 및 제3 인에이블 라인들은 동일한 제1 제어 신호를 수송하는 것을 특징으로 하는 이미징 시스템.
- 제 5 항에 있어서, 상기 제2 및 제4 인에이블 라인들은 동일한 제2 제어 신호를 수송하는 것을 특징으로 하는 이미징 시스템.
- 제 3 항에 있어서, 상기 제1 디지털화 회로는,상기 열 출력 라인들에 각각 접속된 제3 복수의 제3 처리 회로들을 더 구비하고,상기 제3 복수의 제3 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제5 입력;제5 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제5 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제6 입력;제6 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제6 인에이블 라인을 더 구비하는 것을 특징으로 하는 이미징 시스템.
- 제 7 항에 있어서, 상기 제2 디지털화 회로는,상기 열 출력 라인들에 각각 접속된 제4 복수의 제4 처리 회로들을 더 구비하고,상기 제4 복수의 제4 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제7 입력;제7 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제7 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제8 입력;제8 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제8 인에이블 라인을 더 구비하는 것을 특징으로 하는 이미징 시스템.
- 제 8 항에 있어서, 상기 제3 복수는 상기 제1 복수와 동일한 것을 특징으로 하는 이미징 시스템.
- 제 8 항에 있어서, 상기 제3 복수는 상기 제4 복수와 동일한 것을 특징으로 하는 이미징 시스템.
- 기준 빔을 생성하기 위한 레이저;홀로그래픽 매체;상기 레이저와 상기 홀로그래픽 매체 사이에 위치된 제1 광학 시스템;이미징 시스템; 및상기 기준 빔으로부터 상기 홀로그래픽 매체에 의하여 생성된 회절된 빔을 따라, 상기 홀로그래픽 매체와 상기 이미징 시스템 사이에 위치된 제2 광학 시스템을 구비하고,상기 이미징 시스템은,행들과 열들에 배열된 다수의 화소들을 구비하며, 상기 각 열들에서의 상기 화소들이 열 출력 라인에 선택적으로 접속되는 것인 화소 어레이;각각이 상기 열 출력 라인들에 접속된 제1 복수의 제1 처리 회로들을 구비하는 제1 디지털화 회로; 및각각이 상기 열 출력 라인들에 접속된 제2 복수의 제2 처리 회로들을 구비하는 제2 디지털화 회로를 더 구비하고,상기 각 열 출력 라인은 상기 제1 및 제2 디지털화 회로들 각각에서의 적어도 하나의 처리 회로에 화소 신호들을 제공하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 11 항에 있어서, 상기 제1 복수의 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기들을 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제1 입력;제1 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제1 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기들은,상기 제1 출력들 중 하나에 각각 접속된 제2 입력;제2 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제2 인에이블 라인을 더 구비하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 12 항에 있어서, 상기 제2 복수의 제2 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제3 입력;제3 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제3 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제4 입력;제4 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제4 인에이블 라인을 더 구비하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 13 항에 있어서, 상기 제1 복수는 상기 제2 복수와 동일한 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 13 항에 있어서, 상기 제1 및 제3 인에이블 라인들은 동일한 제1 제어 신호를 수송하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 15 항에 있어서, 상기 제2 및 제4 인에이블 라인들은 동일한 제2 제어 신호를 수송하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 13 항에 있어서, 상기 제1 디지털화 회로는,상기 열 출력 라인들에 각각 접속된 제3 복수의 제3 처리 회로들을 더 구비하고,상기 제3 복수의 제3 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제5 입력;제5 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제5 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제6 입력;제6 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제6 인에이블 라인을 더 구비하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 17 항에 있어서, 상기 제2 디지털화 회로는,상기 열 출력 라인들에 각각 접속된 제4 복수의 제4 처리 회로들을 더 구비하고,상기 제4 복수의 제4 처리 회로들 각각은,샘플 홀드 회로; 및아날로그-디지털 변환기를 더 구비하고,상기 샘플 홀드 회로는,상기 열 출력 라인들의 각각에 접속된 제7 입력;제7 출력; 및상기 복수의 샘플 홀드 회로들의 각각에 접속된 제7 인에이블 라인을 더 구비하고,상기 아날로그-디지털 변환기는,상기 제1 출력들 중 하나에 각각 접속된 제8 입력;제8 출력; 및상기 복수의 아날로그-디지털 변환기들의 각각에 접속된 제8 인에이블 라인을 더 구비하는 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 18 항에 있어서, 상기 제3 복수는 상기 제1 복수와 동일한 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 제 18 항에 있어서, 상기 제1 복수는 상기 제4 복수와 동일한 것을 특징으로 하는 홀로그래픽 메모리 시스템.
- 복수의 공통 출력 라인들을 통하여 제1 및 제2 디지털화 회로들에 접속된 화소 어레이의 반대측들 근처에 위치된 제1 및 제2 디지털화 회로들을 가지는 이미징 시스템을 동작시키는 방법에 있어서,현재 선택된 행이 상기 복수의 공통 출력 라인들에 제2 복수의 화소 신호들을 출력하도록 하는 단계;상기 제1 디지털화 회로에서, 상기 제2 복수의 화소 신호들을 샘플링하여 유지하는 단계; 및상기 제2 디지털화 회로에서, 이미 샘플링되고 유지되었던 제1 복수의 화소 신호들을 디지털 형태로 변환시키는 단계를 구비하고,상기 제1 디지털화 회로에서의 상기 샘플링하여 유지하는 단계와 상기 제2 디지털화 회로에서 상기 디지털 형태로 변환시키는 단계는 실질적으로 동시에 초기화되는 것을 특징으로 하는 이미징 시스템 동작 방법.
- 제 21 항에 있어서,다음에 선택된 행이 상기 복수의 공통 출력 라인들에 제3 복수의 화소 신호들을 출력하도록 하는 단계;상기 제1 디지털화 회로에서, 상기 제2 복수의 화소 신호들을 디지털 형태로 변환시키는 단계; 및상기 제2 디지털화 회로에서, 상기 제3 복수의 화소 신호들을 샘플링하여 유지하는 단계를 구비하고,상기 제1 디지털화 회로에서의 상기 디지털로 변환시키는 단계와 상기 제2 디지털화 회로에서 상기 샘플링하여 유지하는 단계는 실질적으로 동시에 초기화되는 것을 특징으로 하는 이미징 시스템 동작 방법.
- 복수의 공통 출력 라인들을 통하여 제1, 제2, 제3, 및 제4 디지털화 회로들에 접속된 화소 어레이의 일측 부근에 위치된 제1 및 제2 디지털화 회로들과, 상기 화소 어레이의 상기 제1 측의 반대측 부근에 위치된 제3 및 제4 디지털화 회로들을 가지는 이미징 시스템을 동작시키는 방법에 있어서,현재 선택된 행이 상기 복수의 공통 출력 라인들에 제2 복수의 화소 신호들을 출력하도록 하는 단계;상기 제1 디지털화 회로에서, 상기 제3 복수의 화소 신호들을 샘플링하여 유지하는 단계;상기 제2 디지털화 회로에서, 이미 샘플링되고 유지되었던 제1 복수의 화소 신호들을 디지털 형태로 변환시키는 단계;다음에 선택된 행이 상기 복수의 공통 출력 라인들에 상기 제3 복수의 화소 신호들을 출력시키도록 하는 단계;상기 제3 디지털화 회로에서, 상기 제3 복수의 화소 신호들을 샘플링하여 유지하는 단계; 및상기 제4 디지털화 회로에서, 이미 샘플링되고 유지되었던 제2 복수의 화소 신호들을 디지털 형태로 변환시키는 단계를 구비하고,상기 제1 디지털화 회로에서 상기 샘플링하여 유지하는 단계와 상기 제2 디지털화 회로에서 상기 디지털 형태로 변환시키는 단계는 실질적으로 동시에 초기화되고,상기 제3 디지털화 회로에서 상기 샘플링하여 유지하는 단계와 상기 제4 디지털화 회로에서 상기 디지털 형태로 변환시키는 단계는 실질적으로 동시에 초기화되는 것을 특징으로 하는 이미징 시스템 동작 방법.
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