KR102058982B1 - 액정 표시 장치 - Google Patents

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Abstract

액정 표시 장치가 제공된다. 액정 표시 장치는 킥백 전압 검출 신호를 생성하는 검출부, 상기 킥백 전압 검출 신호가 인가되는 검출라인 및 상기 검출 라인의 일측에 인접하여 상기 검출 라인을 따라 형성된 그라운드 패턴을 포함하는 액정 패널 및 상기 검출라인과 연결되고, 상기 킥백 전압 검출 신호에 대응되는 공통전압을 발생하여 상기 액정 패널에 제공하는 공통전압 생성부를 포함한다.

Description

액정 표시 장치{LIQUID CRYSTAL DISPLAY DEVICE}
본 발명은 액정 표시 장치에 관한 것으로서, 보다 상세하게는 킥백 전압에 의한 화질 저하를 감소시킬 수 있는 액정 표시 장치에 관한 것이다.
TV 및 모니터와 같은 가정용 표시 장치뿐만 아니라, 노트북, 핸드폰 및 PMP 등의 휴대용 표시 장치의 경량화 및 박형화 추세에 따라 다양한 평판 표시 장치가 널리 사용된다. 평판 표시 장치에는 액정 표시 장치, 유기 전계 표시 장치 및 전기 영동 표시 장치 등의 다양한 종류가 있다.
평판 표시 장치 중 액정 표시 장치는 액정 입자를 포함하는 액정층을 포함한다. 액정층에 인가되는 전압에 따라 액정 입자의 배열이 변하게 되고, 액정 입자의 배열의 변화에 따라 액정층의 광투과율이 변경된다. 액정 표시 장치는 복수의 화소를 포함하며, 복수의 화소 영역에 포함된 액정층 각각에 인가되는 전압을 제어하여 원하는 화상을 표시할 수 있다. 각각의 복수의 화소 영역에 포함된 액정층은 캐패시턴스로 작용하며, 이를 액정 캐피시터라고 칭할 수 있다. 즉, 액정 표시 장치는 액정 캐패시터의 양단에 인가되는 전압을 제어하여 원하는 화상을 표시할 수 있다.
액정 표시 장치는 액정 캐패시터에 전압을 인가하기 위한 스위칭 소자로서 박막 트랜지스터를 이용할 수 있다. 박막 트랜지스터의 게이트와 드레인 사이에 형성되는 기생 용량으로 인하여 킥백 전압이 발생할 수 있다. 킥백 전압이 발생하면 액정 커패시터에 인가되는 전압이 변동되어, 액정 표시 장치에 표시되는 화상에 플리커 또는 잔상이 나타날 수 있다. 예를 들어, 60Hz로 데이터 전압이 반전구동하는 액정 표시 장치의 경우 캑백 전압으로 인하여 기수 프레임과 우수 프레임 사이에 휘도차가 발생하여 30Hz의 플리커가 발생할 수 있다. 또한, 킥백 전압이 발생하는 상태에서 액정 표시 장치가 지속적으로 동작하면 액정층에 직류 옵셋(DC offset)이 인가되어 액정층의 전압에 대한 광 투과율 특성이 변화하고, 잔상이 발생될 수 있다.
이에 본 발명이 해결하고자 하는 과제는, 킥백 전압에 의한 표시 품질의 저하를 줄일 수 있는 액정 표시 장치를 제공하고자 하는 것이다.
본 발명이 해결하고자 하는 또 다른 과제는, 킥백 전압을 정확하게 검출할 수 있는 액정 표시 장치를 제공하고자 하는 것이다.
본 발명의 과제들은 이상에서 언급한 기술적 과제로 제한되지 않으며, 언급되지 않은 또 다른 기술적 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
상기 과제를 해결하기 위한 본 발명의 일 실시예에 따른 액정 표시 장치는 킥백 전압 검출 신호를 생성하는 검출부, 상기 킥백 전압 검출 신호가 인가되는 검출라인 및 상기 검출 라인의 일측에 인접하여 상기 검출 라인을 따라 형성된 그라운드 패턴을 포함하는 액정 패널 및 상기 검출라인과 연결되고, 상기 킥백 전압 검출 신호에 대응되는 공통전압을 발생하여 상기 액정 패널에 제공하는 공통전압 생성부를 포함한다.
상기 과제를 해결하기 위한 본 발명의 다른 실시예에 따른 액정 표시 장치는 킥백 전압 검출 신호를 생성하는 검출부, 상기 킥백 전압 검출 신호가 인가되는 검출 라인, 상기 검출 라인의 일측에 인접하여 상기 검출 라인을 따라 형성된 제1 그라운드 패턴 및 상기 검출 라인의 타측에 인접하여 상기 검출 라인을 따라 형성된 제2 그라운드 패턴을 포함하는 액정 패널 및 상기 검출 라인과 연결되고, 상기 킥백 전압 검출 신호에 대응되는 공통전압을 발생하여 상기 액정 패널에 제공하는 공통전압 생성부를 포함한다.
기타 실시예의 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.
본 발명의 실시예들에 의하면 적어도 다음과 같은 효과 있다.
즉, 킥백 전압에 의한 표시 품질을 저하를 감소시킬 수 있는 액정 표시 장치를 제공할 수 있다.
또, 킥백 전압을 정확하게 검출할 수 있는 액정 표시 장치를 제공할 수 있다.
본 발명에 따른 효과는 이상에서 예시된 내용에 의해 제한되지 않으며, 더욱 다양한 효과들이 본 명세서 내에 포함되어 있다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 블록도이다.
도 2는 본 발명의 일 실시예에 따른 화소의 회로도이다.
도 3은 본 발명의 일 실시예에 따른 검출 화소의 회로도이다.
도 4는 본 발명의 일 실시예에 따른 게이트 신호, 액정 전압, 데이터 전압, 제1 공통전압 및 제2 공통전압의 그래프이다.
도 5는 본 발명의 일 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 6는 본 발명의 일 실시예에 따른 액정 패널의 사시도이다.
도 7은 본 발명의 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 8은 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 9는 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 10은 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다.
소자(elements) 또는 층이 다른 소자 또는 층의 "위(on)"로 지칭되는 것은 다른 소자 바로 위에 또는 중간에 다른 층 또는 다른 소자를 개재한 경우를 모두 포함한다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
비록 제1, 제2 등이 다양한 구성요소들을 서술하기 위해서 사용되나, 이들 구성요소들은 이들 용어에 의해 제한되지 않음은 물론이다. 이들 용어들은 단지 하나의 구성요소를 다른 구성요소와 구별하기 위하여 사용하는 것이다. 따라서, 이하에서 언급되는 제1 구성요소는 본 발명의 기술적 사상 내에서 제2 구성요소일 수도 있음은 물론이다.
이하, 첨부된 도면을 참고로 하여 본 발명의 실시예들에 대해 설명한다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 블록도이다.
도 1을 참조하면 본 발명의 일 실시예에 따른 액정 표시 장치(1000)는 액정 패널(100) 및 공통전압 생성부(210)를 포함한다.
액정 패널(100)은 화상이 표시되는 표시 영역(DR) 및 표시 영역 이외(DR)의 비표시 영역을 포함할 수 있다. 액정 패널(100)은 게이트 라인(G1, G2, ..., Gn) 및 데이터 라인(D1, D2, ..., Dm)을 포함할 수 있다. 액정 패널(100)은 표시 영역(DR)에 게이트 라인(G1, G2, ..., Gn) 및 데이터 라인(D1, D2, ..., Dm)이 교차하는 영역에 의하여 정의되는 매트릭스 형상으로 배치된 복수의 화소를 포함할 수 있다. 이하, 화소에 관하여 도 2를 참조하여 상세히 설명하도록 한다.
도 2는 본 발명의 일 실시예에 따른 화소의 회로도이다. 도 2를 참조하면, 화소는 박막 트랜지스터(T) 액정 캐패시터(Clc) 및 스토리지 캐패시터(Cst)를 포함할 수 있다.
박막 트랜지스터(T)는 게이트가 제i 게이트 라인(Gi)에 연결되고, 소스는 제j 데이터 라인(Gj)에 연결되고, 드레인은 액정 캐패시터(Clc)의 일단 및 스토리지 캐패시터(Cst)의 일단에 연결될 수 있다. 단, i는 1 이상 n 이하의 자연수이고, j는 1 이상 m 이하의 자연수이다. 박막 트랜지스터(T)는 제i 게이트 라인(Gi)에 인가되는 게이트 신호에 대응하여 턴온 또는 턴오프된다. 박막 트랜지스터(T)가 턴온되면 제j 데이터 라인(Dj)에 인가된 데이터 신호가 액정 캐패시터(Clc) 및 스토리지 캐패시터(Cst)에 전달된다.
박막 트랜지스터(T)의 게이트와 드레인 간에는 기생 캐패시턴스(Cgd)가 형성될 수 있다. 박막 트랜지스터(T)의 게이트와 드레인 간에는 기생 캐패시턴스(Cgd)가 존재하면 액정 표시 장치(1000)에는 킥백 전압(Vkb)이 발생할 수 있다. 킥백 전압(Vkb)는 다음과 같은 식으로 표현될 수 있다.
Figure 112012057108277-pat00001
상기 식에서 Vgh는 게이트 신호가 하이일 때의 전압이고, Vgl은 게이트 신호가 로우일 때의 전압이다.
액정 캐패시터(Clc)는 액정 패널(100)에 포함된 액정층(미도시)의 캐패시턴스 성분이다. 액정 캐패시터(Clc)에 인가되는 전압에 대응하여 액정층의 광 투과율이 제어될 수 있다. 액정 캐패시터(Clc)는 일단이 박막 트랜지스터(T)의 드레인에 연결되고, 타단에는 공통전압(Vcom)이 인가될 수 있다.
스토리지 캐패시터(Cst)는 일단이 박막 트랜지스터(T)의 드레인에 연결되고, 타단에는 공통전압(Vcom)이 인가될 수 있다. 스토리지 캐패시터(Cst)는 박막 트랜지스터(T)가 턴오프된 상태에서 액정 캐패시터(Clc)에 인가된 전압이 유지되는 기간을 향상시킬 수 있다.
다시 도1을 참조하면, 액정 패널(100)은 검출부(110)을 포함한다. 검출부(110)는 액정 패널(100)에 발생하는 킥백 전압(Vkb)을 검출하여, 킥백 전압(Vkb)에 대응되는 킥백 전압 검출 신호(Vkbs)를 출력할 수 있다. 검출부(110)는 공통전압 생성부(210)로부터 기준전압(Vref)를 수신할 수 있으며, 킥백 전압 검출 신호(Vkbs)는 기준전압(Vref)에 킥백 전압(Vkb)에 의한 효과가 반영된 신호일 수 있다. 검출부(110)는 액정 패널(100)의 비표시 영역에 배치될 수 있다.
검출부(110)는 하나 이상의 검출 화소(111)를 포함할 수 있다. 이하 도 3을 참조하여 본 발명의 일 실시예에 따른 검출 화소(111)에 대하여 보다 상세히 설명한다.
도 3은 본 발명의 일 실시예에 따른 검출 화소의 회로도이다. 도 3을 참조하면 검출 화소(111)는 박막 트랜지스터(T), 액정 캐패시터(Clc) 및 스토리지 캐패시터(Cst)를 포함할 수 있다.
검출 화소(111)의 박막 트랜지스터(T)는 도 2에서의 화소의 박막 트랜지스터(T)와 동일한 공정을 통하여 형성될 수 있다. 박막 트랜지스터(T)의 게이트는 제k 게이트 라인(Gk)에 연결되고, 소스에는 기준전압(Vref)이 인가되고, 드레인으로는 킥백 전압 검출 신호(Vkbs)가 출력될 수 있다. 킥백 전압 검출 신호(Vkbs)는 기준전압(Vref)에 킥백 전압(Vkb)에 의한 영향이 반영된 신호일 수 있다.
액정 캐패시터(Clc) 및 스토리지 캐패시터(Cst)의 일단은 박막 트랜지스터(T)의 드레인에 연결되고, 타단에는 공통전압(Vcom)이 인가될 수 있다.
다시 도 1을 참조하면, 공통전압 생성부(210)는 액정 패널(100)에 공통전압(Vcom)을 제공할 수 있다. 공통전압 생성부(210)는 검출부(110)에 기준전압(Vref)을 제공하고, 검출부(110)로부터 킥백 전압 검출 신호(Vkbs)를 수신할 수 있다. 공통전압 생성부(210)는 킥백 전압 검출 신호(Vkbs)로부터 킥백 전압(Vkb)을 감지하고, 킥백 전압(Vkb)에 의한 효과를 보상할 수 있도록 조정된 전압 값을 갖는 공통전압(Vcom)을 생성할 수 있다. 이하 도 4를 참조하여 공통전압 생성부(210)가 공통전압(Vcom)을 조절하는 것에 대하여 보다 상세히 설명한다.
도 4는 본 발명의 일 실시예에 따른 게이트 신호, 액정 전압, 데이터 전압, 제1 공통전압 및 제2 공통전압의 그래프이다.
게이트 신호(Vg)는 박막 트랜지스터(T)를 턴온 또는 턴오프 시키기 위한 신호이다. 예를 들어, 게이트 신호(Vg)가 하이 상태일 때 박막 트랜지스터(T)는 턴온 될 수 있고, 게이트 신호(Vg)가 로우 상태일 때 박막 트랜지스터(T)는 턴오프 될 수 있다. 게이트 신호(Vg)가 하이 상태일 때의 전압은 Vgh일 수 있으며, 게이트 신호(Vg)가 로우 상태일 때의 전압은 Vgl일 수 있다.
게이트 신호(Vg)가 하이 상태를 유지하는 동안, 액정 캐패시터(Clc)가 박막 트랜지스터(T)와 연결되는 일단에 인가되는 전압인 액정 전압(Vlc)은 데이터 라인(D1, D2, ...,Dm)에 인가되는 데이터 신호의 전압인 데이터 전압(Vd)에 의하여 충전된다. 게이트 신호(Vg)가 하이 상태에서 로우 상태로 변화하면, 액정 전압(Vlc)은 킥백 전압(Vkb)만큼 하락할 수 있다.
액정 패널(100)의 성능의 열화 방지를 위하여 액정 패널(100)은 반전 구동할 수 있다. 액정 패널(100)이 반전 구동하면, 매 프레임마다 액정 캐패시터(Clc)의 양단에 인가되는 전압의 극성이 반전되도록, 공통전압(Vcom) 및 데이터 전압(Vd)의 레벨이 스윙할 수 있다. 보정 전의 공통전압인 제1 공통전압(Vcom)이 액정 패널에 제공되는 경우, 킥백 전압(Vkb)에 의하여 동일한 밝기에 대한 데이터 전압(Vd)이 화소에 제공되더라도, 반전 구동에 따라, 연속되는 프레임에서 액정 캐패시터(Clc) 양단의 전압의 절대값의 크기가 달라질 수 있다. 이러한 경우 플리커 현상과 같은 화질의 저하가 나타날 수 있다. 뿐만 아니라, 킥백 전압(Vkb)에 의하여 액정 전압(Vlc)이 원하는 전압값보다 킥백 전압(Vkb)만큼 저하되므로, 액정 패널(100)에 표시되는 화상의 휘도의 재현성이 저하될 수 있다.
공통전압 생성부(210)는 킥백 전압(Vkb)을 검출하여, 킥백 전압(Vkb)이 액정 전압(Vlc)에 미치는 영향을 보상할 수 있도록 조절된 공통전압인 제2 공통전압(Vcom2)을 생성할 수 있다. 예를 들어, 제2 공통전압(Vcom2)은 제1 공통전압(Vcom1)보다 킥백 전압(Vkb)만큼 낮은 전압일 수 있다. 제2 공통전압(Vcom2)이 제1 공통전압(Vcom1)보다 킥백 전압(Vkb)만큼 낮은 전압인 경우, 액정 전압(Vlc)이 킥백 전압(Vkb)에 의하여 하락하더라도, 공통전압(Vcom)도 동일한 크기로 하락하므로, 액정 캐패시터(Clc) 양단의 전압을 원하는 크기로 유지할 수 있다. 따라서, 공통전압 생성부(210)는 킥백 전압(Vkb)이 액정 전압(Vlc)에 미치는 영향을 보상할 수 있도록 공통전압(Vcom)의 값을 조정하여, 플리커 현상과 화상의 휘도 재현성 저하와 같은 킥백 전압(Vkb)에 의한 표시 품질의 저하를 줄일 수 있다.
다시 도 1을 참조하면, 액정 표시 장치는 타이밍 제어부(220), 게이트 구동부(230) 및 데이터 구동부(240)를 더 포함할 수 있다.
타이밍 제어부(220)는 게이트 구동부(230)를 제어하기 위한 게이트 제어 신호(GCS) 및 데이터 구동부(240)를 제어하기 위한 데이터 제어 신호(DCS)를 생성할 수 있다. 타이밍 제어부(220)는 게이트 제어 신호(GCS)및 데이터 제어 신호(DCS)를 통하여 액정 패널(100)이 원하는 화상을 표시하도록, 게이트 구동부(230) 및 데이터 구동부(240)를 제어할 수 있다.
게이트 구동부(230)는 게이트 제어 신호(GCS)를 수신하여 그에 대응되도록 게이트 신호를 생성하고, 게이트 신호를 게이트 라인(G1, G2, ..., Gn)에 인가할 수 있다.
데이터 구동부(240)는 데이터 제어 신호(DCS)를 수신하여 그에 대응되도록 데이터 신호를 생성하고, 데이터 신호를 데이터 라인(D1, D2, ..., Dm)에 인가할 수 있다.
공통전압 생성부(210), 타이밍 제어부(220), 게이트 구동부(230) 및 데이터 구동부(240)는 구동부로 통칭할 수 있다.
도 5는 본 발명의 일 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다. 도 5에서의 검출부와 구동부 간의 배선은 액정 패널(100)에 포함될 수 있다.
액정 패널(100)은 검출 라인(LVkbs)을 포함한다. 검출 라인(LVkbs)에는 킥백 전압 검출 신호(Vkbs)가 인가된다.
검출 라인(LVkbs)의 일측에는 제1 그라운드 패턴(GP1)이 배치된다. 제1 그라운드 패턴(GP1)은 검출 라인(LVkbs)의 일측에 인접하여 검출 라인(LVkbs)을 따라 배치될 수 있다. 도 5에서는 제1 그라운드 패턴(GP1)이 검출부(110) 및 구동부(200)까지 연장된 균일한 폭의 패턴으로 도시되어 있으나, 제1 그라운드 패턴(GP1)의 형상은 반드시 이에 한정되는 것은 아니다. 예를 들어, 제1 그라운드 패턴(GP1)은 일부 영역이 단절된 패턴이거나, 폭이 일정하지 않거나, 검출부(110) 및 구동부(200)까지 연장되지 않을 수도 있다. 액정 표시 장치(1000)는 검출 라인(LVkbs)의 일측에 제1 그라운드 패턴(GP1)을 포함하여 검출 라인(LVkbs)에 미칠 수 있는 외부의 노이즈에 의한 영향을 감소시킴으로써, 공통전압 생성부(210)가 보다 정확하게 킥백 전압(Vkb)을 검출하도록 할 수 있다.
제1 그라운드 패턴(GP1)은 실링 패턴(SP)과 접촉할 수 있다. 도시되지는 않았으나, 제1 그라운드 패턴(GP1) 상부에는 절연층이 배치될 수 있으며, 제1 그라운드 패턴(GP1)과 실링 패턴(SP)이 접촉하는 영역에는 절연층에 개방부가 형성될 수 있다. 이하 도 6을 참조하여 실링 패턴(SP)에 대하여 보다 상세히 설명하도록 한다.
도 6는 본 발명의 일 실시예에 따른 액정 패널의 사시도이다. 도 6을 참조하면 액정 패널(100)은 제1 기판(120), 제2 기판(130), 실링 패턴(SP) 및 제1 기판(120)과 제2 기판(130) 사이에 배치된 액정층(미도시)을 포함할 수 있다.
실링 패턴은 제1 기판(120)과 제2 기판(130)을 접착시킬 수 있으며, 액정층을 제1 기판(120)과 제2 기판(130) 사이에 봉지할 수 있다. 실링 패턴은 제1 기판(120)과 제2 기판(130)이 중첩하는 영역의 테두리를 따라 배치될 수 있다. 실링 패턴(SP)은 도전성이 아닌 물질로 이루어 질 수 있느나, 실링 패턴(SP)의 비도전성은 불완전할 수 있으며, 실링 패턴(SP)을 따라 노이즈가 전달될 수 있다. 따라서, 실링 패턴(SP)을 제1 그라운드 패턴(GP1)과 접촉시키면 실링 패턴(SP)을 통한 노이즈 전달을 감소시켜, 노이즈가 킥백 전압 검출 라인(VLkbs)에 미치는 영향을 감소시킬 수 있다.
다시 도 5를 참조하면, 제1 그라운드 패턴(GP1)의 일부 영역은 실링 패턴(SP)과 평행할 수 있다. 몇몇 실시예에 의하면, 제1 그라운드 패턴(GP1)은 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉할 수 있다. 제1 그라운드 패턴(GP1)이 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉하면, 제1 그라운드 패턴(GP1)과 실링 패턴(SP)의 접촉 면적을 증가시켜 노이즈 차단 효율을 증가시킬 수 있다.
액정 패널(100)은 공통전압 라인(LVcom) 및 기준전압 라인(LVref)을 더 포함할 수 있다. 공통전압 라인(LVcom)에는 공통전압(Vcom)이 인가될 수 있고, 기준전압 라인(LVref)에는 기준전압(Vref)이 인가될 수 있다. 공통전압 라인(LVcom)은 검출 라인(LVkbs)의 일측에 배치될 수 있고, 기준전압 라인(LVref)는 검출 라인(LVkbs)의 타측에 배치될 수 있다. 공통전압 라인(LVcom) 및 검출 라인(LVkbs)의 배치는 실시예들에 따라 변경될 수 있다.
제1 그라운드 패턴(GP1)은 검출 라인(LVkbs)과 공통전압 라인(LVcom) 사이에 배치될 수 있다. 제1 그라운드 패턴(GP1)이 검출 라인(LVkbs)과 공통전압 라인(LVcom) 사이에 배치되면, 공통전압 라인(LVcom)에 존재하는 노이즈가 검출 라인(LVkbs)에 미치는 영향을 감소시킬 수 있다.
몇몇 실시예에 의하면, 공통전압 생성부(210)는 타이밍 제어부(220), 게이트 구동부(230) 및 데이터 구동부(240)와는 구분되는 별도의 소자일 수 있다. 이러한 경우, 도 6에서의 구동부(200)는 공통전압 생성부(210)로 대체될 수 있다.
이하 도 7을 참조하여 본 발명의 다른 실시예에 대하여 설명하도록 한다. 도 7은 본 발명의 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 7을 참조하면, 액정 패널(100)은 검출 라인(LVkbs), 공통전압 라인(LVcom), 기준전압 라인(LVref) 및 제2 그라운드 패턴(GP2)을 포함할 수 있다.
검출 라인(LVkbs), 공통전압 라인(LVcom) 및 기준전압 라인(LVref)은 동일한 명칭을 갖는 도 5에서의 구성과 실질적으로 동일하므로 설명을 생략한다.
제2 그라운드 패턴(GP2)은 검출 라인(LVkbs)의 일측에 인접하여 검출 라인(LVkbs)을 따라 형성되되, 기준전압 라인(LVref)와 검출 라인(LVkbs)의 사이에 배치될 수 있다. 제2 그라운드 패턴(GP2)이 기준전압 라인(LVref)와 검출 라인(LVkbs)의 사이에 배치되면, 기준전압 라인(LVref)으로부터 검출 라인(LVkbs)으로 노이즈가 전달되는 것을 억제할 수 있으며, 검출 라인(LVkbs)에 인가되는 신호가 기준전압 라인(LVref)에 영향을 미치는 것을 억제할 수 있다. 따라서, 구동부(200)에 포함된 공통전압 생성부(210)가 킥백 전압(Vkb)을 보다 정확하게 검출할 수 있도록 할 수 있다.
도 7에서는 제2 그라운드 패턴(GP2)이 검출부(110) 및 구동부(200)까지 연장된 균일한 폭의 패턴으로 도시되어 있으나, 제2 그라운드 패턴(GP2)의 형상은 반드시 이에 한정되는 것은 아니다. 예를 들어, 제2 그라운드 패턴(GP2)은 일부 영역이 단절된 패턴이거나, 폭이 일정하지 않거나, 검출부(110) 및 구동부(200)까지 연장되지 않을 수도 있다.
제2 그라운드 패턴(GP2)은 실링 패턴(SP)과 접촉할 수 있다. 도시되지는 않았으나, 제2 그라운드 패턴(GP2) 상부에는 절연층이 배치될 수 있으며, 제2 그라운드 패턴(GP2)과 실링 패턴(SP)이 접촉하는 영역에는 절연층에 개방부가 형성될 수 있다. 제2 그라운드 패턴(GP2)이 실링 패턴(SP)과 접촉하면 실링 패턴(SP)을 통한 노이즈 전달을 감소시켜, 노이즈가 킥백 전압 검출 라인(VLkbs)에 미치는 영향을 감소시킬 수 있다.
제2 그라운드 패턴(GP2)의 일부 영역은 실링 패턴(SP)과 평행할 수 있다. 몇몇 실시예에 의하면, 제2 그라운드 패턴(GP2)은 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉할 수 있다. 제2 그라운드 패턴(GP2)이 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉하면, 제2 그라운드 패턴(GP2)과 실링 패턴(SP)의 접촉 면적을 증가시켜 노이즈 차단 효율을 증가시킬 수 있다.
이하 도 8을 참조하여 본 발명의 또 다른 실시예에 대하여 보다 상세히 설명하도록 한다. 도 8은 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 8을 참조하면, 액정 패널(100)은 검출 라인(LVkbs), 공통전압 라인(LVcom), 기준전압 라인(LVref), 제1 그라운드 패턴(GP1) 및 제2 그라운드 패턴(GP2)을 포함할 수 있다.
검출 라인(LVkbs), 공통전압 라인(LVcom) 및 기준전압 라인(LVref)은 동일한 명칭을 갖는 도 5에서의 구성과 실질적으로 동일하고, 제2 그라운드 패턴(GP2)은 동일한 명칭을 갖는 도 7에서의 구성과 실질적으로 동일할 수 있다.
검출 라인(LVkbs)의 일측에 제1 그라운드 패턴(GP1)이 배치되고, 타측에 제2 그라운드 패턴(GP2)이 배치되면, 제1 그라운드 패턴(GP1) 및 제2 그라운드 패턴(GP2) 중 하나만이 배치되는 경우보다 더욱 효율적으로 검출 라인(LVkbs)에 노이즈가 유입되는 것을 차단할 수 있다.
제1 그라운드 패턴(GP1) 또는 제2 그라운드 패턴(GP2)는 실링 패턴(SP)과 접촉할 수 있으며, 제1 그라운드 패턴(GP1) 및 제2 그라운드 패턴(GP2) 모두가 실링 패턴(SP)와 접촉할 수도 있다.
제1 그라운드 패턴(GP1)의 일부 영역은 실링 패턴(SP)과 평행할 수 있다. 몇몇 실시예에 의하면, 제1 그라운드 패턴(GP1)은 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉할 수 있다. 제1 그라운드 패턴(GP1)이 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉하면, 제1 그라운드 패턴(GP1)과 실링 패턴(SP)의 접촉 면적을 증가시켜 노이즈 차단 효율을 증가시킬 수 있다.
이하 도 9를 참조하여 본 발명의 또 다른 실시예에 대하여 설명하도록 한다. 도 9는 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 9를 참조하면, 액정 패널(100)은 검출 라인(LVkbs), 공통전압 라인(LVcom), 기준전압 라인(LVref), 제1 그라운드 패턴(GP1) 및 제2 그라운드 패턴(GP2)을 포함할 수 있다.
제2 그라운드 패턴(GP2)의 일부 영역은 실링 패턴(SP)과 평행할 수 있다. 몇몇 실시예에 의하면, 제2 그라운드 패턴(GP2)은 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉할 수 있다. 제2 그라운드 패턴(GP2)이 실링 패턴(SP)과 평행하도록 형성된 영역에서 실링 패턴(SP)과 접촉하면, 제2 그라운드 패턴(GP2)과 실링 패턴(SP)의 접촉 면적을 증가시켜 노이즈 차단 효율을 증가시킬 수 있다.
그 밖의 다른 구성들에 대한 설명은 도 8에서와 실질적으로 동일하다.
이하 도 10을 참조하여 본 발명의 또 다른 실시예에 대하여 설명하도록 한다. 도 10은 본 발명의 또 다른 실시예에 따른 검출부와 구동부 간의 배선을 나타낸 평면도이다.
도 10을 참조하면, 액정 패널(100)은 검출 라인(LVkbs), 공통전압 라인(LVcom), 기준전압 라인(LVref), 제1 그라운드 패턴(GP1), 제2 그라운드 패턴(GP2) 및 제3 그라운드 패턴(GP3)을 포함할 수 있다.
제3 그라운드 패턴(GP3)은 기준전압 라인(LVref)의 제2 그라운드 패턴(GP2)이 배치된 일측에 대향하는 타측에, 기준전압 라인(LVref)에 인접하여, 기준전압 라인(LVref)을 따라 배치될 수 있다. 도 10에서는 제3 그라운드 패턴(GP3)이 검출부(110) 및 구동부(200)까지 연장된 균일한 폭의 패턴으로 도시되어 있으나, 제3 그라운드 패턴(GP3)의 형상은 반드시 이에 한정되는 것은 아니다. 예를 들어, 제3 그라운드 패턴(GP3)은 일부 영역이 단절된 패턴이거나, 폭이 일정하지 않거나, 검출부(110) 및 구동부(200)까지 연장되지 않을 수도 있다. 액정 표시 장치(1000)는 기준전압 라인(LVref)의 타측에 제3 그라운드 패턴(GP3)을 포함하여 기준전압 라인(LVref)에 미칠 수 있는 외부의 노이즈에 의한 영향을 감소시킴으로써, 공통전압 생성부(210)가 보다 정확하게 킥백 전압(Vkb)을 검출하도록 할 수 있다.
제3 그라운드 패턴(GP3)은 실링 패턴(SP)과 접촉할 수 있다. 도시되지는 않았으나, 제3 그라운드 패턴(GP3) 상부에는 절연층이 배치될 수 있으며, 제3 그라운드 패턴(GP3)과 실링 패턴(SP)이 접촉하는 영역에는 절연층에 개방부가 형성될 수 있다. 실링 패턴(SP)을 제3 그라운드 패턴(GP3)과 접촉시키면 실링 패턴(SP)을 통한 노이즈 전달을 감소시켜, 노이즈가 기준전압 라인(VLref)에 미치는 영향을 감소시킬 수 있다.
도 10에서는 제1 그라운드 패턴(GP1)의 실링 패턴(SP)과 평행하게 형성된 영역이 실링 패턴(SP)과 중첩하여 배치된 것에 대하여 개시하고 있으나, 몇몇 실시예에 의하면, 도 9에서와 같이 제2 그라운드 패턴(GP2)의 실링 패턴(SP)과 평행햐게 형성된 영역이 실링 패턴(SP)과 중첩하여 배치될 수도 있다.
그 밖의 구성들에 대한 설명은 도 8 및 도 9에서의 동일한 명칭을 갖는 구성들에 대한 설명과 실질적으로 동일하므로 생략하도록 한다.
이상 첨부된 도면을 참조하여 본 발명의 실시예을 설명하였지만, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명의 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다.
100: 액정 패널 110: 검출부
120: 제1 기판 120: 제2 기판
200: 구동부 210: 공통전압 생성부
220: 타이밍 제어부 230: 게이트 구동부
240: 데이터 구동부 Vcom: 공통전압
Vref: 기준전압 Vkb: 킥백 전압
Vkbs: 킥백 전압 검출 신호 LVcom: 공통전압 라인
LVref: 기준전압 라인 LVkbs: 검출 라인
GP1: 제1 그라운드 패턴 GP2: 제2 그라운드 패턴
GP3: 제3 그라운드 패턴 SP: 실링 패턴

Claims (20)

  1. 킥백 전압 검출 신호를 생성하는 검출부, 상기 킥백 전압 검출 신호가 인가되는 검출라인 및 상기 검출 라인의 일측에 인접하여 상기 검출 라인을 따라 형성된 그라운드 패턴을 포함하는 액정 패널; 및
    상기 검출라인과 연결되고, 상기 킥백 전압 검출 신호에 대응되는 공통전압을 발생하여 공통전압 라인을 통해 상기 액정 패널에 제공하는 공통전압 생성부를 포함하되,
    상기 검출부는 기준전압을 수신하고,
    상기 킥백 전압에 의하여 상기 기준전압이 변경된 값을 상기 킥백 전압 검출 신호로서 출력하되,
    상기 액정 패널은 상기 기준전압이 인가되는 기준전압 라인을 더 포함하고,
    상기 그라운드 패턴은 상기 기준전압 라인과 상기 검출 라인 사이에 배치되는 액정 표시 장치.
  2. 제1 항에 있어서,
    상기 액정 패널은,
    제1 기판;
    상기 제1 기판과 대향하여 배치된 제2 기판;
    제1 기판과 제2 기판 사이에 개재된 액정층; 및
    상기 제1 기판과 제2 기판을 접착시키고 상기 액정층을 봉지하는 실링 패턴을 포함하되,
    상기 그라운드 패턴은 상기 실링 패턴과 접촉하는 액정 표시 장치.
  3. 제2 항에 있어서,
    상기 그라운드 패턴은 상기 실링 패턴과 접촉하는 영역에서 상기 실링 패턴과 평행하게 배치된 액정 표시 장치.
  4. 제2 항에 있어서,
    상기 실링 패턴은 상기 제1 기판과 상기 제2 기판이 중첩하는 영역의 경계를 따라 배치된 액정 표시 장치.
  5. 삭제
  6. 제1 항에 있어서,
    상기 검출부는 검출 화소를 포함하는 액정 표시 장치.
  7. 제6 항에 있어서,
    상기 검출 화소는,
    게이트 라인에 게이트가 연결되고, 소스에 기준전압이 인가되고, 드레인으로 상기 킥백 전압 검출 신호가 출력되는 박막 트랜지스터;
    일단이 상기 드레인과 연결되고, 타단에 상기 공통전압이 인가되는 액정 캐패시터를 포함하는 액정 표시 장치.
  8. 제7 항에 있어서,
    상기 검출 화소는 상기 드레인에 일단이 연결되고, 타단에 상기 공통전압이 인가되는 스토리지 캐패시터를 더 포함하는 액정 표시 장치.
  9. 제6 항에 있어서,
    상기 액정 패널은 표시 영역 및 비표시 영역을 포함하되,
    상기 검출 화소는 상기 비표시 영역에 배치되는 액정 표시 장치.
  10. 킥백 전압 검출 신호를 생성하는 검출부, 상기 킥백 전압 검출 신호가 인가되는 검출 라인, 상기 검출 라인의 일측에 인접하여 상기 검출 라인을 따라 형성된 제1 그라운드 패턴 및 상기 검출 라인의 타측에 인접하여 상기 검출 라인을 따라 형성된 제2 그라운드 패턴을 포함하는 액정 패널; 및
    상기 검출 라인과 연결되고, 상기 킥백 전압 검출 신호에 대응되는 공통전압을 발생하여 공통전압 라인을 통해 상기 액정 패널에 제공하는 공통전압 생성부를 포함하되,
    상기 제1 그라운드 패턴은 상기 검출 라인과 상기 공통전압 라인 사이에 배치되고,
    상기 검출부는 기준전압을 인가받고,
    상기 킥백 전압에 의하여 상기 기준전압이 변경된 값을 상기 킥백 전압 검출 신호로서 출력하되,
    상기 액정 패널은 상기 기준전압이 인가되는 기준전압 라인을 더 포함하고,
    상기 제2 그라운드 패턴은 상기 기준전압 라인과 상기 검출 라인 사이에 배치되는 액정 표시 장치.
  11. 제10 항에 있어서,
    상기 액정 패널은,
    제1 기판;
    상기 제1 기판과 대향하여 배치된 제2 기판;
    제1 기판과 제2 기판 사이에 개재된 액정층; 및
    상기 제1 기판과 제2 기판을 접착시키고 상기 액정층을 봉지하는 실링 패턴을 포함하되,
    상기 제1 그라운드 패턴 또는 상기 제2 그라운드 패턴은 상기 실링 패턴과 접촉하는 액정 표시 장치.
  12. 제11 항에 있어서,
    상기 제1 그라운드 패턴 또는 상기 제2 그라운드 패턴은 일부 영역에서 상기 실링 패턴과 평행하고, 상기 실링 패턴과 평행한 상기 일부 영역에서 상기 실링 패턴과 접촉하는 액정 표시 장치.
  13. 삭제
  14. 삭제
  15. 삭제
  16. 제10 항에 있어서,
    상기 액정 패널은 상기 기준전압 라인에 인접하고, 상기 기준전압 라인을 따라 배치된 제3 그라운드 패턴을 더 포함하되,
    상기 기준전압 라인은 상기 제2 그라운드 패턴과 상기 제3 그라운드 패턴 사이에 배치된 액정 표시 장치.
  17. 제16 항에 있어서,
    상기 액정 패널은,
    제1 기판;
    상기 제1 기판과 대향하여 배치된 제2 기판;
    제1 기판과 제2 기판 사이에 개재된 액정층; 및
    상기 제1 기판과 제2 기판을 접착시키고 상기 액정층을 봉지하는 실링 패턴을 포함하되,
    상기 제3 그라운드 패턴은 상기 실링 패턴과 접촉하는 액정 표시 장치.
  18. 삭제
  19. 제10 항에 있어서,
    상기 검출부는 검출 화소를 포함하되,
    상기 검출 화소는,
    게이트 라인에 게이트가 연결되고, 소스에 기준전압이 인가되고, 드레인에 상기 검출 라인이 연결되는 박막 트랜지스터;
    일단이 상기 드레인과 연결되고, 타단에 상기 공통전압이 인가되는 액정 캐패시터를 포함하는 액정 표시 장치.
  20. 제19 항에 있어서,
    상기 검출 화소는 상기 드레인에 일단이 연결되고, 타단에 상기 공통전압이 인가되는 스토리지 캐패시터를 더 포함하는 액정 표시 장치.
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