KR101513271B1 - 표시장치 - Google Patents

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Abstract

표시장치에서, 데이터 전압을 출력하는 데이터 드라이버는 하나의 칩으로 이루어져 연성회로필름 또는 표시패널에 실장된다. 전압 보상유닛은 표시패널로부터 스토리지 전압을 피드백 받고, 스토리지 전압을 근거로 공통전압을 보상하기 위한 보상 신호를 생성하여 표시패널로 제공한다. 표시패널에는 스토리지 전압을 전압 보상유닛으로 제공하는 피드백 라인을 더 포함하고, 피드백 라인은 표시패널에 구비된 스토리지 라인으로부터 인출되어 전압 보상유닛에 전기적으로 연결된다. 따라서, 공통전압의 리플 성분으로 인한 크로스토크 현상을 제거할 수 있고, 그 결과 표시장치의 표시품질을 개선할 수 있다.

Description

표시장치{DISPLAY DEVICE}
본 발명은 표시장치에 관한 것으로, 더욱 상세하게는 크로스토크(crosstalk) 현상을 개선할 수 있는 표시장치에 관한 것이다.
액정표시장치는 두 기판 사이에 전계를 형성하여, 두 기판 사이에 개재된 액정층을 투과하는 빛의 양을 조절함으로써, 원하는 영상을 표시하는 장치이다.
그러기 위해 액정표시장치의 두 기판 중 하부기판에는 다수의 게이트 라인, 다수의 데이터 라인 및 다수의 화소가 구비되고, 상부기판에는 공통전극이 구비된 다. 다수의 게이트 라인을 순차적으로 구동시켜 해당 게이트 라인에 연결된 다수의 화소에 해당 데이터 라인으로 인가된 데이터 전압을 제공한다.
전계의 방향이 일정하면 액정의 열화가 발생할 수 있으므로, 액정표시장치는 상기 데이터 전압의 극성을 공통전압에 대해서 한 프레임 마다 반전시키는 반전 구동 방식을 채용한다.
반전 구동 방식을 채용하면, 공통 전압과 데이터 전압 사이에 커플링이 발생할 수 있다. 특히, 공통전압은 직류 전압으로 이루어지는데, 데이터 전압이 상승 및 하강하는 지점에서 상기 공통전압에 리플이 발생한다. 상기 공통전압에 발생한 리플은 각 화소의 액정 커패시터에 영향을 주고, 그 결과 액정표시장치에 크로스토크 현상이 발생하여 표시 품질이 저하된다.
따라서, 본 발명의 목적은 공통전압의 리플을 제거하여 크로스토크 현상을 개선하기 위한 표시장치를 제공하는 것이다.
본 발명에 따른 표시장치는 데이터 드라이버, 표시패널, 전압 발생유닛 및 전압 보상유닛을 포함한다. 상기 데이터 드라이버는 하나의 칩으로 이루어져 데이터 전압을 출력한다. 상기 표시패널은 다수의 화소가 구비된 표시영역 및 상기 표시영역으로부터 인출되어 상기 칩으로부터 상기 데이터 전압을 입력받는 신호라인들이 구비된 팬아웃 영역을 포함한다. 상기 전압 발생유닛은 공통전압 및 스토리지 전압을 생성하여 상기 표시패널로 공급하고, 상기 표시패널로부터 상기 스토리지 전압을 피드백 받으며, 피드백된 스토리지 전압을 근거로 상기 공통전압을 보상한다.
상기 표시패널은 상기 스토리지 전압을 상기 전압 보상유닛으로 제공하는 피드백 라인을 더 포함하고, 상기 피드백 라인은 상기 칩을 통과하여 상기 전압 보상유닛에 전기적으로 연결된다.
이와 같은 표시장치에 따르면, 데이터 드라이버가 하나의 칩으로 이루어진 구조에서, 공통전압을 보상하는 전압 보상유닛은 액정표시패널에 구비된 스토리지 라인으로부터 스토리지 전압을 피드백 받아서 상기 공통전압을 보상할 수 있는 보상 신호를 생성한다.
따라서, 공통전압의 리플로 인한 크로스토크 현상을 제거할 수 있고, 그 결과 표시장치의 표시품질을 개선할 수 있다.
이하, 첨부한 도면들을 참조하여 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다.
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 평면도이다.
도 1을 참조하면, 본 발명에 따른 액정표시장치(400)는 영상을 표시하는 액정표시패널(100), 상기 액정표시패널(100)에 인접한 인쇄회로기판(200) 및 상기 액정표시패널(100)과 상기 인쇄회로기판(200)을 전기적으로 연결시키는 연성회로필름(300)을 포함한다.
상기 액정표시패널(100)은 어레이 기판(110), 상기 어레이 기판(110)과 마주하는 컬러필터기판(120) 및 상기 어레이 기판(110)과 상기 컬러필터기판(120)과의 사이에 개재된 액정층(미도시)으로 이루어진다. 상기 어레이 기판(110)은 영상을 표시하는 표시영역(DA) 및 상기 표시영역(DA)을 둘러싼 주변영역(PA)으로 구분된다.
상기 어레이 기판(110)의 표시영역(DA)에는 다수의 화소가 매트릭스 형태로 구비된다. 구체적으로, 상기 표시영역(DA)에는 다수의 게이트 라인(GL1~GLn), 다수 의 데이터 라인(DL1~DLm) 및 다수의 스토리지 라인(SL1~SLn)이 구비된다. 상기 다수의 게이트 라인(GL1~GLn)은 제1 방향(D1)으로 연장되고, 서로 일정 간격으로 배열된다. 상기 다수의 데이터 라인(DL1~DLm)은 상기 제1 방향(D1)과 직교하는 제2 방향(D2)으로 연장되고 서로 일정 간격으로 배열된다. 상기 다수의 데이터 라인(DL1~DLm)과 상기 다수의 게이트 라인(GL1~GLn)은 서로 다른 층 상에 구비되어 서로 절연되게 교차한다. 상기 다수의 스토리지 라인(SL1~SLn)은 상기 게이트 라인들(GL1~GLn)과 동일한 층 상에 구비되고, 상기 제1 방향(D1)으로 연장되며 서로 일정 간격으로 배열된다. 각 스토리지 라인은 서로 인접하는 두 개의 게이트 라인 사이에 구비된다.
상기 게이트 라인들(GL1~GLn) 및 데이터 라인들(DL1~DLm)에 의해서 상기 표시영역(DA)에는 다수의 화소영역이 정의된다. 각 화소영역에는 하나의 화소가 배치되고, 각 화소는 박막 트랜지스터(111), 액정 커패시터(Clc)의 제1 전극인 화소전극 및 스토리지 커패시터(Cst)를 포함한다. 상기 스토리지 라인들(SL1~SLn)에는 스토리지 전압(Vst)이 인가되고, 상기 스토리지 라인들(SL1~SLn)은 각 화소의 화소전극과 오버랩되어 상기 스토리지 커패시터(Cst)를 형성한다.
상기 주변영역(PA)에는 상기 스토리지 라인들(SL1~SLn)을 연결하는 제1 및 제2 연결라인(CL1, CL2)이 구비된다. 상기 제1 연결라인(CL1)은 상기 스토리지 라인들(SL1~SLn)의 제1 단부를 연결하고, 상기 제2 연결라인(CL2)은 상기 스토리지 라인들(SL1~SLn)의 제2 단부를 연결한다. 상기 제1 및 제2 연결라인(CL1, CL2)은 외부로부터 스토리지 전압(Vst)을 입력받아서 상기 스토리지 라인들(SL1~SLn)로 공 급한다.
도면에 도시하지는 않았지만, 상기 컬러필터기판(120)은 컬러필터 및 공통전극을 포함한다. 상기 컬러필터는 레드, 그린 및 블루 색화소를 포함하고, 상기 공통전극은 상기 컬러필터기판(120) 전면에 형성되고, 화소전극과 마주하여 상기 액정 커패시터(Clc)를 형성한다. 상기 공통전극에는 공통전압(Vcom)이 인가된다.
상기 공통전극에 상기 공통전압(Vcom)을 인가하기 위하여 상기 어레이 기판(110)에는 외부로부터 공통전압(Vcom)을 입력받는 제1 및 제2 공통전압라인(VL1, VL2)이 구비된다. 상기 제1 공통전압라인(VL1)은 제1 숏 포인트(SP1)에서 상기 공통전극과 전기적으로 연결되고, 상기 제2 공통전압라인(VL2)은 제2 숏 포인트(SP2)에서 상기 공통전극과 전기적으로 연결된다.
도면에 도시하지는 않았지만, 상기 제1 및 제2 숏 포인트(SP1, SP2)에는 도전 스페이서가 구비된다. 구체적으로, 상기 도전 스페이서는 상기 제1 공통전압 라인(VL1)과 상기 공통전극 사이 및 상기 제2 공통전압 라인(VL2)과 상기 공통전극 사이에 개재되어 서로 전기적으로 연결시킨다. 따라서, 상기 제1 및 제2 공통전압 라인(VL1, VL2)으로 인가된 상기 공통전압(Vcom)은 상기 도전 스페이서를 경유하여 상기 공통전극으로 인가될 수 있다.
본 발명의 일 예로, 상기 액정표시패널(100)은 상기 제2 방향(D2)보다 상기 제1 방향(D1)으로 긴 직사각형 구조로 이루어지고, 상기 다수의 게이트 라인(GL1~GLn)의 개수는 상기 다수의 데이터 라인(DL1~DLm)의 개수보다 많다. 여기서, 상기 각 화소는 상기 제1 방향(D1)으로 긴 구조로 이루어진다.
상기 액정표시장치(400)는 게이트 드라이버(150) 및 데이터 드라이버(350)를 더 포함한다. 상기 게이트 드라이버(150)는 다수의 아몰퍼스 실리콘 트랜지스터로 이루어져, 상기 어레이 기판(110) 상에 박막 공정을 통해서 직접적으로 형성된다. 상기 게이트 드라이버(150)는 상기 액정표시패널(100)의 단변에 인접하여 구비되어 상기 다수의 게이트 라인(GL1~GLn)과 전기적으로 연결된다. 따라서, 상기 게이트 드라이터(150)는 상기 다수의 게이트 라인(GL1~GLn)으로 게이트 신호를 순차적으로 인가하여 상기 액정표시패널(100)의 단변을 따라서 다수의 화소행을 순차적으로 스캔한다.
상기 데이터 드라이버(350)는 하나의 칩으로 이루어지고, 상기 연성회로필름(300) 상에 실장된다. 상기 데이터 드라이버(350, 이하 드라이버 IC)는 상기 액정표시패널(100)의 장변에 인접하여 구비되고, 상기 다수의 데이터 라인(DL1~DLm)과 전기적으로 연결되어 데이터 신호를 제공한다.
상기 액정표시패널(100)의 장변에 인접하여 상기 인쇄회로기판(200)이 배치되고, 상기 인쇄회로기판(200)은 상기 연성회로필름(300)을 통해 상기 액정표시패널(100)에 전기적으로 연결된다. 구체적으로, 상기 연성회로필름(200)의 제1 단부는 상기 액정표시패널(100)의 주변영역(PA)에 부착되고, 상기 제1 단부와 반대하는 제2 단부는 상기 인쇄회로기판(200) 측에 부착된다. 따라서, 상기 인쇄회로기판(200)으로부터 출력된 신호들은 상기 연성회로기판(300)을 통해서 상기 드라이버 IC(350)로 공급되거나 상기 액정표시패널(100) 상의 상기 게이트 드라이버(150)로 공급된다.
한편, 상기 주변영역(PA)에는 상기 연성회로필름(300)으로부터 분기되어 상기 표시영역(DA)으로 확장되는 상기 데이터 라인들(DL1~DLm)이 구비되는 팬아웃 영역(FA)이 정의된다. 상기 제1 및 제2 연결라인(CL1, CL2)은 상기 팬아웃 영역(FA)의 좌/우 외측에 각각 구비되고, 상기 제1 및 제2 공통전압라인(VL1, VL2)은 상기 팬아웃 영역(FA)의 외측에서 상기 제1 및 제2 연결라인(CL1, CL2)에 각각 인접하여 구비된다. 여기서, 상기 제1 및 제2 연결라인(CL1, CL2)은 상기 제1 및 제2 공통전압라인(VL1, VL2)와 전기적으로 절연된다.
상기 액정표시장치(400)는 상기 스토리지 전압(Vst) 및 상기 공통전압(Vcom)을 발생하는 전압 발생유닛(210) 및 상기 공통전압(Vcom)을 보상하기 위한 보상신호를 발생하는 전압 보상유닛(220)을 더 포함한다. 상기 전압 발생유닛(210) 및 상기 전압 보상유닛(220)은 상기 인쇄회로기판(200)에 구비된다.
상기 전압 발생유닛(210)으로부터 출력된 상기 스토리지 전압(Vst)은 상기 연성회로필름(300)을 경유하여 상기 액정표시패널(100)에 구비된 상기 제1 및 제2 연결라인(CL1, CL2)으로 공급되고, 상기 공통전압(Vcom)은 상기 연성회로필름(300)을 경유하여 상기 액정표시패널(100)에 구비된 상기 제1 및 제2 공통전압라인(VL1, VL2)으로 공급된다. 본 발명의 일 예로, 상기 스토리지 전압(Vst) 및 상기 공통전압(Vcom)은 직류전압으로 이루어지고, 서로 다른 전압레벨을 갖는다. 그러나, 상기 스토리지 전압(Vst) 및 상기 공통전압(Vcom)은 서로 동일한 전압레벨을 가질 수 있다.
상기 전압 보상유닛(220)은 상기 액정표시패널(100)로부터 상기 스토리지 전압(Vst)을 입력받아서 상기 스토리지 전압(Vst)에 포함된 리플 성분을 추출하고, 상기 리플 성분과 반대의 위상을 갖는 보상신호(CS)를 상기 액정표시패널(100)로 제공한다.
상기 보상신호(CS)는 상기 제1 및 제2 공통전압라인(VL1, VL2)으로 인가될 수 있고, 상기 제1 및 제2 연결라인(CL1, CL2)으로도 인가될 수 있다. 여기서, 상기 스토리지 전압(Vst)의 리플 성분과 상기 공통전압(Vcom)의 리플 성분은 서로 유사한 형태로 발생된다. 따라서, 상기 스토리지 전압(Vst)의 리플 성분과 반전된 위상을 갖는 상기 보상신호(CS)는 상기 액정표시패널(100)의 상기 공통전압(Vcom) 및 스토리지 전압(Vst)에서 발생하는 리플 성분을 제거할 수 있다. 따라서, 상기 전압 보상유닛(220)은 상기 액정표시패널(100)의 상기 공통전압(Vcom) 및 스토리지 전압(Vst)을 보상할 수 있다.
상기 액정표시패널(100)은 상기 스토리지 라인들(SL1~SLn)로 인가되는 스토리지 전압(Vst)을 상기 전압 보상유닛(220)으로 피드백시키기 위한 피드백 라인(FL)을 더 구비한다.
상기 피드백 라인(FL)은 상기 다수의 스토리지 라인(SL1~SLn) 중 상기 연성회로필름(300)과 가장 인접하는 제1 스토리지 라인(SL1)으로부터 분기된다. 상기 제1 스토리지 라인(SL1)으로부터 분기된 상기 피드백 라인(FL)은 상기 팬아웃 영역(FA)을 통과하고, 상기 연성회로필름(300)을 경유하여 상기 인쇄회로기판(200)에 구비된 전압 보상유닛(220)까지 연장된다. 따라서, 상기 피드백 라인(FL)은 상기 액정표시패널(100)의 스토리지 전압(Vst)을 상기 전압 보상유닛(220)으로 공급할 수 있다.
도 2는 도 1에 도시된 피드백 라인의 경로를 확대하여 나타낸 확대도이고, 도 3은 도 2에 도시된 절단선 Ⅰ-Ⅰ`에 따라 절단한 단면도이다.
도 2 및 도 3을 참조하면, 피드백 라인(FL)은 제1 스토리지 라인(SL1)으로부터 분기되고, 상기 팬아웃 영역(FA)을 통과한다. 여기서, 상기 제1 스토리지 라인(SL1)은 게이트 라인들과 동일한 물질로 이루어져 어레이 기판(110)의 베이스 기판(112) 상에 구비된다. 상기 피드백 라인(FL)은 상기 제1 스토리지 라인(SL1)과 동일한 물질로 이루어져 상기 베이스 기판(112) 상에 구비된다.
도면에 도시하지는 않았지만, 상기 피드백 라인(FL)의 진행 경로에 게이트 라인(제1 게이트 라인(GL1))이 형성된 경우, 상기 제1 게이트 라인(GL1)과 상기 피드백 라인(FL)의 전기적으로 연결을 방지하기 위하여 브릿지 구조를 채용할 수 있다. 상기 브릿지 구조에서, 상기 피드백 라인(FL)이 상기 제1 게이트 라인(GL1)이 형성된 영역에서 분리되고, 분리된 상기 피드백 라인(FL)은 상기 제1 게이트 라인(GL1)과 다른층에 형성된 브릿지 전극을 통해서 전기적으로 연결될 수 있다.
한편, 상기 팬아웃 영역(FA)에는 다수의 데이터 라인(DL1~DLm)이 구비된다. 상기 다수의 데이터 라인(DL1~DLm)은 상기 피드백 라인(FL)을 커버하는 절연막(113) 상에 구비된다. 따라서, 상기 피드백 라인(FL)과 상기 다수의 데이터 라인(DL1~DLm)은 상기 절연막(113)에 의해서 전기적으로 절연될 수 있다. 도면부호 114는 다수의 데이터 라인(DL1~DLm)을 보호하는 보호막이다.
도 2 및 도 3에서는 상기 피드백 라인(FL)이 상기 제1 스토리지 라인(SL1) 과 동일한 물질로 이루어져 상기 베이스 기판(112) 상에 구비된 구조를 제시하였다. 그러나, 상기 피드백 라인(FL)은 상기 데이터 라인들(DL1~DLm)과 동일한 물질로 이루어져 상기 절연막(113) 상에 형성될 수도 있다.
상기 피드백 라인(FL)은 연성회로필름(300) 상에서 상기 인쇄회로기판(200) 측으로 연장된다. 상기 연성회로필름(300)에는 상기 드라이버 IC(350)가 실장되는 IC 실장영역이 제공된다. 상기 피드백 라인(FL)은 상기 IC 실장영역을 통과한다. 상기 드라이버 IC(350)의 하부면에는 다수의 입/출력 단자(351)가 제공된다. 여기서, 상기 피드백 라인(FL)이 통과하는 경로에 대응하여 상기 IC 실장영역에는 상기 다수의 입/출력 단자(351)가 형성되지 않는 블랭크 영역(355)이 형성된다. 따라서, 상기 다수의 입/출력 단자(351)와 상기 피드백 라인(FL)이 전기적으로 쇼트되는 것을 방지할 수 있다.
상기 피드백 라인(FL)은 상기 연성회로필름(300)을 경유하여 상기 인쇄회로기판(200) 측으로 연장되어 상기 인쇄회로기판(200) 상에 구비된 전압 보상유닛(220)과 전기적으로 연결된다. 따라서, 상기 전압 보상유닛(220)은 상기 액정표시패널(100)의 스토리지 전압(Vst)을 입력받을 수 있고, 상기 스토리지 전압(Vst)을 근거로 보상 신호(CS)를 생성할 수 있다. 상기 전압 보상유닛(220)에 대해서는 이후 도 6 및 도 7을 참조하여 구체적으로 설명하기로 한다.
도 4는 본 발명의 다른 실시예에 따른 액정표시장치의 평면도이고, 도 5는 도 4에 도시된 드라이버 IC의 블럭도이다. 단, 도 4에 도시된 구성요소 중 도 1에 도시된 구성요소와 동일한 구성요소에 대해서는 동일한 참조부호를 병기하고, 그에 대한 구체적인 설명은 생략한다.
도 4를 참조하면, 본 발명의 다른 실시예에 따른 액정표시장치(410)에서 데이터 드라이버는 하나의 드라이버 IC로 이루어지고, 액정표시패널(100)의 주변영역(PA) 상에 실장된다.
상기 드라이버 IC(170)와 상기 표시영역(DA) 사이에는 팬아웃 영역(FA)이 제공되고, 상기 표시영역(DA)으로부터 인출된 피드백 라인(FL)은 상기 팬아웃 영역(FA) 및 상기 드라이버 IC(170)를 관통한 후 연성회로필름(300)을 경유하여 인쇄회로기판(200) 측으로 연장된다. 따라서, 상기 표시영역(DA)에서 제1 스토리지 라인(SL1)으로부터 분기된 상기 피드백 라인(FL)은 상기 인쇄회로기판(200) 상에 구비된 전압 보상유닛(220)으로 스토리지 전압(Vst)을 제공할 수 있다.
도 5에 도시된 바와 같이, 상기 드라이버 IC(170)는 상기 연성회로필름(300, 도 4에 도시됨)과 인접하여 구비된 입력부(171), 상기 액정표시패널(100)의 표시영역(DA)에 인접하여 구비된 출력부(172) 및 상기 입력부(171)와 출력부(172) 사이에 구비된 중심 블록(173)을 포함한다. 상기 중심 블록(173)은 수신부(173a), 타이밍 컨트롤러(173b), 및 데이터 드라이버(173c)를 포함한다.
상기 입력부(171)는 상기 드라이버 IC(170)의 하부면에 서로 소정 간격으로 이격하여 배치된 다수의 입력단자(171a)를 포함하고, 상기 출력부(172)는 상기 드라이버 IC(170)의 하부면에 서로 소정 간격으로 이격하여 배치된 다수의 출력단자(172a)를 포함한다. 본 발명의 일 예로, 상기 드라이버 IC(170)는 직사각형 형상으로 이루어지고, 일측 장변에 인접하여 상기 다수의 입력단자(171a)가 구비되고, 나머지 장변에 인접하여 상기 다수의 출력단자(172a)가 구비된다.
상기 출력부(172)는 두 개의 그룹(172b, 172c)으로 분할되고, 두 그룹 사이의 영역에는 제1 피드백 단자(172d)가 구비된다. 또한, 상기 입력부(171)는 세 개의 그룹(171b, 171c, 171d)으로 분할되고, 서로 인접하는 두 그룹 사이의 영역들에는 제2 및 제3 피드백 단자(171e, 171f)가 각각 구비된다. 일반적으로, 상기 드라이버 IC(170)로 입력되는 신호보다 출력되는 신호의 개수가 많기 때문에, 상기 입력단자(171a)보다 상기 출력단자(172a)의 개수가 많다. 따라서, 상기 출력부(172) 측에는 하나의 피드백 단자(172d)만이 구비되지만, 상기 입력부(171) 측에는 두 개의 피드백 단자(171e, 171f)가 구비될 수 있다.
상기 제1 피드백 단자(172d)는 상기 액정표시패널(100)의 상기 표시영역(DA)으로부터 연장된 상기 피드백 라인(FL)과 전기적으로 연결되고, 상기 제2 및 제3 피드백 단자(171e, 171f)는 상기 액정표시패널(100) 상에서 상기 연성회로필름(300) 측으로 연장되는 상기 피드백 라인(FL)과 전기적으로 연결된다.
상기 드라이어 IC(170)에는 상기 제1 피드백 단자(172d)를 상기 제2 및 제3 피드백 단자(171e, 171f)에 전기적으로 연결시키는 제1 및 제2 서브 피드백 라인(SFL1, SFL2)이 내장된다. 본 발명의 일 예로, 상기 제2 및 제3 피드백 단자(171e, 171f)로부터 각각 연장된 상기 제1 및 제2 서브 피드백 라인(SFL1, SFL2)은 상기 중심 블록(173)을 사이에 두고, 상기 중심 블록(173)의 주변부에 나란하게 구비되고, 상기 출력부(172) 측에서 결합되어 상기 제1 피드백 단자(172d)에 공통으로 연결된다. 따라서, 상기 제1 및 제2 서브 피드백 라인(SFL1, SFL2)이 상기 중 심 블록(173)과 오버랩되지 않도록 함으로써, 상기 중심 블록(173)이 상기 피드백 라인(FL)을 통해 전송되는 스토리지 전압(Vst)의 리플에 영향을 받는 것을 방지할 수 있다.
이처럼, 드라이버 IC(170)가 상기 액정표시패널(100) 상에 실장되는 경우 상기 피드백 라인(FL)을 상기 드라이버 IC(170)의 내부를 관통하도록 형성함으로써, 상기 드라이버 IC(170)가 실장된 영역을 통과하도록 상기 액정표시패널(100) 상에 구비되는 각종 배선들과 상기 피드백 라인(SL)이 쇼트되는 것을 방지할 수 있다.
한편, 도 5에서 상기 수신부(173a)는 외부 장치로부터 저전압 차동 신호(Low Voltage Differencial Signal: LVDS) 인터페이스 방식으로 각종 신호들을 입력받아서 상기 타이밍 컨트롤러(173b)로 제공한다.
상기 타이밍 컨트롤러(173b)는 게이트측 제어신호, 데이터측 제어신호 및 영상 데이터(미도시)를 출력한다. 상기 데이터 드라이버(173c)는 상기 타이밍 컨트롤러(173b)로부터 데이터측 제어신호 및 영상 데이터를 입력받아서 데이터 신호들을 출력한다. 출력된 상기 데이터 신호들은 상기 출력부(172)로 제공되고, 상기 출력부(172)를 통해서 데이터 라인들로 제공된다. 또한, 상기 타이밍 컨트롤러(173b)로부터 출력된 상기 게이트측 제어신호는 상기 출력부(172)를 통해서 게이트 드라이버(150, 도 4에 도시됨)로 제공된다.
도 6은 도 1에 도시된 전압 보상유닛의 회로도이고, 도 7은 액정표시패널 상의 공통전압 및 스토리지 전압, 보상신호의 파형도이다.
도 6 및 도 7을 참조하면, 전압 보상유닛(220)은 연산 증폭기(221), 커패시터(C1), 제1 및 제2 저항(R1, R2)을 포함한다.
상기 연산 증폭기(221)는 반전 입력단자(-), 비반전 입력단자(+) 및 보상신호(CS)를 출력하는 출력단자를 구비한다. 상기 반전 입력단자(-)에는 상기 제1 저항(R1)이 연결되고, 상기 반전 입력단자(-)와 상기 출력단자 사이에는 상기 제2 저항(R2)이 연결된다. 상기 액정표시패널(100)로부터 스토리지 전압(Vst)을 입력받는 상기 전압 보상유닛(220)의 입력단자와 상기 제1 저항(R1) 사이에는 커패시터(C1)가 연결되고, 상기 비반전 입력단자(+)에는 기준 전압(Vref)이 공급된다.
상기 액정표시패널(100)로부터 리플 성분을 포함하는 스토리지 전압(Vst)이 입력되면, 상기 커패시터(C1)와 상기 제1 저항(R1)에 의해서 상기 스토리지 전압(Vst)의 DC 성분이 제거되어 리플 성분만이 상기 연산 증폭기(221)의 상기 반전 입력단자(-)로 공급된다. 상기 연산 증폭기(221)는 상기 리플 성분을 상기 기준 전압(Vref)과 비교하여 상기 리플 성분과 반전된 위상을 갖는 보상 신호(CS)를 출력한다.
도 7에 도시된 바와 같이 액정표시패널(100)의 스토리지 전압(Vst)과 공통전압(Vcom)은 서로 유사한 형태의 리플 성분을 포함하고, 상기 전압 보상유닛(220)으로부터 출력된 상기 보상신호(CS)는 상기 리플 성분과 반전된 위상을 갖는다. 따라서, 상기 보상신호(CS)가 상기 액정표시패널(100)로 제공되면, 상기 보상신호(CS)에 의해서 상기 공통전압(Vcom)과 상기 스토리지 전압(Vst)의 리플 성분이 제거된다. 이로써, 상기 공통전압(Vcom)과 상기 스토리지 전압(Vst)을 보상할 수 있고, 그 결과 크로스토크 현상을 개선할 수 있다.
도 8은 본 발명의 또 다른 실시예에 따른 액정표시장치의 평면도이고, 도 9는 도 8에 도시된 공통전압 보상회로의 회로도이다. 단, 도 8에 도시된 구성요소 중 도 1에 도시된 구성요소와 동일한 구성요소에 대해서는 동일한 참조부호를 병기하고, 그에 대한 상세한 설명은 생략한다.
도 8을 참조하면, 어레이 기판(110)의 표시영역(DA)에는 다수의 게이트 라인(GL1~GLn) 및 다수의 데이터 라인(DL1~DLm)이 구비된다. 상기 다수의 게이트 라인(GL1~GLn)은 상기 제1 방향(D1)으로 평행하게 연장되고, 서로 일정 간격으로 배열된다. 상기 다수의 데이터 라인(DL1~DLm)은 제1 방향(D1)과 직교하는 제2 방향(D2)으로 평행하게 연장되고, 서로 일정 간격으로 배열된다. 상기 다수의 데이터 라인(DL1~DLm)과 상기 다수의 게이트 라인(GL1~GLn)은 서로 다른 층 상에 구비되어 서로 절연되게 교차한다.
본 발명의 일 예로, 상기 액정표시패널(100)은 상기 제1 방향(D1)보다 상기 제2 방향(D2)으로 긴 직사각형 구조로 이루어지고, 상기 다수의 게이트 라인(GL1~GLn)의 개수는 상기 다수의 데이터 라인(DL1~DLm)의 개수보다 많다. 즉, 상기 액정표시패널(100)이 1280×800의 해상도를 갖는다면, 상기 다수의 게이트 라인(GL1~GLn)의 개수는 1280×3이며, 상기 다수의 데이터 라인(DL1~DLm)의 개수는 800이다.
게이트 드라이버(150)는 상기 액정표시패널(100)의 장변에 인접하는 상기 블랙 매트릭스 영역(BA)에 구비되며, 상기 다수의 게이트 라인(GL1~GLn)의 일단부 에 연결된다. 따라서, 상기 게이트 드라이버(150)는 상기 다수의 게이트 라인(GL1~GLn)으로 게이트 신호를 순차적으로 인가하여 상기 액정표시패널(100)의 장변을 따라서 한 화소열 단위로 순차적으로 스캔한다.
데이터 드라이버는 원-칩(이하, 드라이버 IC(360))으로 이루어지고, 상기 연성회로필름(300) 상에 실장된다. 상기 드라이버 IC(360)는 상기 액정표시패널(100)의 단변에 인접하여 구비되고, 상기 다수의 데이터 라인(DL1~DLm)과 전기적으로 연결되어 상기 다수의 데이터 라인(DL1~DLm)으로 데이터 신호를 제공한다.
상기 액정표시패널(100)의 단변에 인접하여 상기 인쇄회로기판(200)이 배치되고, 상기 인쇄회로기판(200)은 상기 연성회로필름(300)을 통해 상기 액정표시패널(100)에 전기적으로 연결된다. 구체적으로, 상기 연성회로필름(300)의 제1 단부는 상기 액정표시패널(100)의 주변영역(PA)에 부착되고, 상기 제1 단부와 반대하는 제2 단부는 상기 인쇄회로기판(200) 측에 부착된다. 따라서, 상기 인쇄회로기판(200)으로부터 출력된 신호들은 상기 연성회로기판(300)을 통해서 상기 드라이버 IC(360)로 공급되거나 상기 액정표시패널(100) 상의 상기 게이트 드라이버(150)로 공급된다.
액정표시장치(430)는 액정표시패널(100)로 인가되는 공통전압을 보상하기 위한 공통전압 보상회로(230), 상기 액정표시패널(100)로 상기 공통전압(Vcom)을 인가하는 제1 및 제2 공통전압라인(CL1, CL2), 상기 액정표시패널(100)로부터 패널 공통전압(Vf)을 피드백 받기 위한 피드백 라인(FL)을 더 구비한다.
상기 공통전압 보상회로(230)는 인쇄회로기판(200) 상에 구비되고, 상기 액 정표시패널(100)로부터 패널 공통전압(Vf)을 피드백 받아서 보상된 공통전압(Vcom)을 출력하여 다시 상기 액정표시패널(100)로 인가한다.
도 9에 도시된 바와 같이, 상기 공통전압 보상회로(230)는 오피-엠프, 제1 및 제2 저항(R1, R2)을 포함한다. 상기 오피-엠프의 비반전 단자(+)에는 기 설정된 기준전압(Vref)이 인가되고, 상기 오피-엠프의 반전 단자(-)와 출력 단자 사이에는 상기 제1 저항(R1)이 연결된다. 상기 제2 저항(R2)은 상기 오피-엠프의 반전 단자(-)와 상기 패널 공통전압(Vf)이 피드백되는 피드백 단자 사이에 연결된다.
상기 공통전압 보상회로(230)로부터 출력된 상기 보상된 공통전압(Vcom)은 다음 <수학식>을 만족한다.
<수학식>
Figure 112008075582717-pat00001
<수학식>에 나타난 바와 같이, 상기 보상된 공통전압(Vcom)은 상기 제1 및 제2 저항(R1, R2)의 비율에 의해서 조절될 수 있다.
한편, 상기 액정표시패널(100)의 컬러필터기판(120)에는 공통전극(미도시)이 형성된다. 상기 공통전극은 상기 액정표시패널(100)의 블랙 매트릭스 영역(BA)에 형성된 제1 및 제2 숏 포인트(SP1, SP2)에서 상기 제1 및 제2 공통전압라인(CL1, CL2)과 각각 전기적으로 연결되어 상기 보상된 공통전압(Vcom)을 입력받는다. 도면에 도시하지는 않았지만, 상기 제1 및 제2 숏 포인트(SP1, SP2)에는 제1 및 제2 도전성 스페이서(미도시)가 각각 구비되어 상기 공통전극을 상기 제1 및 제 2 공통전압라인(CL1, CL2)에 전기적으로 연결시킨다.
본 발명의 일 실시예로, 상기 제1 숏 포인트(SP1)는 제1 게이트 라인(GL1)과 제1 데이터 라인(DL1)이 교차하는 지점에 인접하여 구비되고, 상기 제2 숏 포인트(SP2)는 제1 게이트 라인(GL1)과 제m 데이터 라인(DLm)이 교차하는 지점에 인접하여 구비된다.
상기 피드백 라인(FL)은 상기 액정표시패널(100)의 다수의 스토리지 라인(SL1~SLn) 중 첫번째 스토리지 라인(SL1)에 연결되어 스토리지 전압을 공급받고, 상기 스토리지 전압을 상기 공통전압 보상회로(230)로 제공한다. 상기 피드백 라인(FL)은 연성회로필름(300) 및 드라이버 IC(360)를 경유하여 상기 인쇄회로기판(200)에 구비된 상기 공통전압 보상회로(230)의 피드백 단자(Vf)에 전기적으로 연결된다.
도 10은 도 8에 도시된 액정표시장치의 구동회로를 나타낸 블럭도이다.
도 10을 참조하면, 액정표시장치(400)의 구동회로는 타이밍 컨트롤러(310), 프레임 메모리(320), 게이트 드라이버(150) 및 드라이버 IC(360)를 포함한다.
상기 타이밍 컨트롤러(310)는 외부 장치로부터 데이터 인에이블 신호(DE), 수직 및 수평 동기신호(Vsync, Hsync), 메인 클록 신호(MCLK) 및 제1 영상 데이터(RGB-data)를 입력받는다. 상기 타이밍 컨트롤러(310)는 외부 장치로부터 입력받은 상기 제1 영상 데이터(RGB-data)를 순차적으로 프레임 메모리(320)에 저장한다. 상기 타이밍 컨트롤러(310)에는 상기 프레임 메모리(320)에 저장된 제1 영상 데이터(RGB-data)를 독출하여 제2 영상 데이터(R'G'B'-data)로 변환하는 데이터 변환 부(315)가 내장된다. 상기 데이터 변환부(315)로부터 출력된 상기 제2 영상 데이터(R'G'B'-data)는 상기 드라이버 IC(210)로 공급된다.
도 11은 제1 영상 데이터의 입력 순서를 나타낸 도면이고, 도 12는 제2 영상 데이터의 입력 순서를 나타낸 도면이다. 단, 도 11 및 도 12에서는 액정표시패널(100)이 1280×800의 해상도를 갖는다고 가정한다.
도 11을 참조하면, 제1 영상 데이터(RGB-data)는 화소행 단위로 순차적으로 입력되어 이루어진 데이터 그룹이다. 여기서, 화소행은 제2 방향(D2)으로 배열된 화소들의 그룹으로 정의된다.
구체적으로, 상기 제1 영상 데이터(RGB-data)는 첫번째 화소행인 R(1,1), G(1,1), B(1,1), R(2,1), G(2,1), B(2,1),...R(1280,1), G(1280,1), B(1280,1)으로부터 시작해서 제2 방향(D2)으로 순차적으로 증가하면서 마지막 화소행인 R(1,800), G(1,800), B(1,800), R(2,800), G(2,800), B(2,800),...R(1280,800), G(1280,800), B(1280,800)까지의 데이터 그룹으로 이루어진다.
도 12에 도시된 바와 같이, 상기 데이터 변환부(315)에 의해서 변환된 상기 제2 영상 데이터(R'G'B'-data)는 화소열 단위로 순차적으로 형성된 데이터 그룹이다. 여기서, 화소열은 제1 방향(D1)으로 배열된 화소들의 그룹으로 정의된다.
구체적으로, 상기 제2 영상 데이터(R'G'B'-data)는 첫번째 화소열인 R(1,1), R(1,2), R(1,3), R(1,4), R(1,5), R(1,6),...R(1,798), R(1,799), B(1,800)으로부터 시작해서 제1 방향(D1)으로 순차적으로 증가하면서 마지막 화소열인 B(1280,1), B(1280,2), B(1280,3), B(1280,4), B(1280,5), B(1280,6),...B(1280,798), B(1280,799), B(1280,800)까지의 데이터 그룹으로 이루어진다.
도 8에 도시된 바와 같이, 상기 게이트 드라이버(150)가 상기 액정표시패널(100)의 장변 측에 배치되고, 드라이버 IC(360)가 상기 액정표시패널(100)의 단변 측에 배치되므로, 상기 액정표시패널(100)의 스캔 방향은 제2 방향(D2)으로 진행된다. 따라서, 상기 타이밍 컨트롤러(310)는 외부 장치로부터 제공된 제1 영상 데이터(RGB-data)를 상기 스캔 방향(D2)에 맞는 제2 영상 데이터(R'G'B'-data)로 변환하여 상기 드라이버 IC(360)로 공급하는 것이다.
다시 도 10을 참조하면, 상기 타이밍 컨트롤러(310)는 데이터 인에이블 신호(DE), 메인 클록 신호(MCLK), 수직 및 수평 동기신호(Vsync, Hsync)를 이용하여 데이터측 제어신호 및 게이트측 제어신호를 생성하고 각각 드라이버 IC(360)와 게이트 드라이버(150)로 출력한다.
상기 드라이버 IC(360)는 상기 타이밍 컨트롤러(310)로부터 제공된 상기 데이터측 제어신호 및 제2 영상 데이터(R'G'B'-data)에 응답하여 다수의 데이터 신호를 다수의 데이터 라인(DL1~DLm)으로 출력한다. 여기서, 상기 데이터측 제어신호는 수평개시신호(STH), 반전신호(REV) 및 출력개시신호(TP)를 포함한다. 상기 수평개시신호(STH)는 드라이버 IC(360)의 동작을 개시하는 신호이고, 상기 반전신호(REV)는 상기 데이터 신호들의 극성을 반전시키는 신호이며, 상기 출력개시신호(TP)는 상기 드라이버 IC(260)로부터 상기 데이터 신호들이 출력되는 시점을 결정하는 신호이다.
상기 게이트 드라이버(150)는 상기 타이밍 컨트롤러(310)로부터 제공된 게이트측 제어신호에 응답하여 다수의 게이트 신호를 순차적으로 다수의 게이트 라인(GL1~GLn)에 출력한다. 상기 게이트측 제어신호는 수직개시신호(STV), 제1 및 제2 클럭신호(CKV, CKVB)를 포함한다. 상기 수직개시신호(STV)는 상기 게이트 드라이버(150)의 동작을 개시하는 신호이고, 상기 제1 및 제2 클럭신호(CKV, CKVB)는 상기 게이트 드라이버(150)로부터 상기 게이트 신호들(GS1~GSn)이 순차적으로 출력되는 시기를 결정하는 신호이다.
도 13은 본 발명의 다른 실시예에 따른 드라이버 IC의 블럭도이다.
도 13을 참조하면, 드라이버 IC(360)에는 수신부(362), 타이밍 컨트롤러(310), 및 데이터 드라이버(363)가 내장되고, 상기 드라이버 IC(360)의 외측면에는 입력단자들로 이루어진 입력부(361) 및 출력단자들로 이루어진 출력부(364)가 구비된다. 본 발명의 일 예로, 상기 드라이버 IC(360)는 직사각형 형상으로 이루어지고, 일측 장변에 인접하여 상기 입력부(361)가 구비되고, 나머지 장변에 인접하여 상기 출력부(364)가 구비된다.
상기 입력부(361)의 중앙에는 제1 더미 단자(366)가 구비되고, 상기 출력부(364)의 중앙에는 제2 더미 단자(367)가 구비된다. 상기 제1 및 제2 더미 단자(366, 367)는 상기 드라이버 IC(360)의 외측에 구비되고 분리된 피드백 라인(FL)과 전기적으로 연결된다. 또한, 상기 제1 및 제2 더미 단자(366, 367)는 상기 드라이버 IC(360)의 내부에 제공된 내부 배선(368)을 통해서 전기적으로 연결된다. 따라서, 분리된 피드백 라인(FL)은 제1 더미 단자(366), 제2 더미 단자(367) 및 내부 배선(368)을 통해서 전기적으로 연결된다.
상기 입력부(361)와 상기 출력부(364) 사이에는 상기 수신부(362), 타이밍 컨트롤러(310) 및 데이터 드라이버(363)가 배치된다.
상기 수신부(362)는 외부 장치로부터 저전압 차동 신호(Low Voltage Differencial Signal: LVDS) 인터페이스 방식으로 각종 신호들을 입력받아서 상기 타이밍 컨트롤러(310)로 제공한다. 도 10에 도시된 바와 같이, 상기 타이밍 컨트롤러(310)로 공급되는 신호들은 제1 영상 데이터(RGB-data), 데이터 인에이블 신호(DE), 메인 클록 신호(MCLK), 수직 및 수평 동기신호(Vsync, Hsync)를 포함할 수 있다.
상기 타이밍 컨트롤러(310)는 게이트측 제어신호, 데이터측 제어신호 및 제2 영상 데이터(R'G'B'-data, 도 10에 도시됨)를 출력한다. 상기 데이터 드라이버(363)는 상기 타이밍 컨트롤러(310)로부터 데이터측 제어신호 및 제2 영상 데이터(R'G'B'-data)를 입력받아서 데이터 신호들을 출력한다. 출력된 상기 데이터 신호들은 상기 출력부(364)로 제공되고, 상기 출력부(364)를 통해서 데이터 라인들로 제공된다. 또한, 상기 타이밍 컨트롤러(310)로부터 출력된 상기 게이트측 제어신호는 상기 출력부(214)를 통해서 게이트 드라이버(150, 도 9에 도시됨)로 제공된다.
도면에 도시하지는 않았지만, 도 10에 도시된 프레임 메모리(320)도 상기 드라이버 IC(360)에 내장될 수 있다.
이처럼, 수신부(362), 타이밍 컨트롤러(310), 프레임 메모리(320) 등과 같은 회로들이 상기 드라이버 IC(360)에 내장됨으로써, 액정표시장치(430)의 부품 수 를 감소시킬 수 있다.
도 8에서는 드라이버 IC(360)가 연성회로필름(200) 상에 구비된 구조를 도시하였으나, 상기 드라이버 IC(360)는 상기 액정표시패널(100)의 주변영역(PA) 상에 실장될 수 있다.
이상 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 평면도이다.
도 2는 도 1에 도시된 피드백 라인의 경로를 확대하여 나타낸 확대도이다.
도 3은 도 2에 도시된 절단선 Ⅰ-Ⅰ`에 따라 절단한 단면도이다.
도 4는 본 발명의 다른 실시예에 따른 액정표시장치의 평면도이다.
도 5는 도 4에 도시된 드라이버 IC의 블럭도이다.
도 6은 도 1에 도시된 전압 보상유닛의 회로도이다.
도 7은 액정표시패널 상의 공통전압 및 스토리지 전압, 보상신호의 파형도이다.
도 8은 본 발명의 또 다른 실시예에 따른 액정표시장치의 평면도이다.
도 9는 도 8에 도시된 공통전압 보상회로의 회로도이다.
도 10은 도 8에 도시된 액정표시장치의 구동회로를 나타낸 블럭도이다.
도 11은 제1 영상 데이터의 입력 순서를 나타낸 도면이다.
도 12는 제2 영상 데이터의 입력 순서를 나타낸 도면이다.
도 13은 본 발명의 다른 실시예에 따른 드라이버 IC의 블럭도이다.
*도면의 주요 부분에 대한 부호의 설명*
100 : 액정표시패널 150 : 게이트 드라이버
200 : 인쇄회로기판 210 : 전압 발생유닛
220 : 전압 보상유닛 300 : 연성회로필름
350, 170 : 데이터 드라이버 400 : 액정표시장치

Claims (19)

  1. 하나의 칩으로 이루어져 데이터 신호들을 출력하는 데이터 드라이버;
    게이트 신호를 순차적으로 출력하는 게이트 드라이버;
    상기 데이터 신호들을 입력받는 다수의 데이터 라인, 상기 게이트 신호를 순차적으로 입력받는 다수의 게이트 라인 및 상기 데이터 라인들과 상기 게이트 라인들에 연결된 다수의 화소를 구비하여 영상을 표시하는 표시패널;
    공통전압 및 스토리지 전압을 생성하고, 공통 전압 라인 및 복수의 스토리지 라인들을 통해 상기 공통 전압 및 상기 스토리지 전압을 각각 상기 표시패널로 공급하는 전압 발생유닛;
    상기 표시패널로부터 상기 스토리지 전압을 피드백 받고, 피드백된 스토리지 전압을 근거로 상기 공통전압을 보상하기 위한 보상 신호를 출력하는 전압 보상유닛; 및
    상기 표시 패널로부터의 상기 스토리지 전압을 상기 전압 보상유닛으로 제공하는 피드백 라인을 포함하고,
    상기 피드백 라인은 상기 데이터 드라이버를 통과하여 상기 전압 보상유닛에 전기적으로 연결되는 것을 특징으로 하는 표시장치.
  2. 제1항에 있어서, 상기 전압 발생유닛 및 상기 전압 보상유닛이 구비되는 인쇄회로기판; 및
    상기 인쇄회로기판과 상기 표시패널에 전기적으로 연결하는 연성회로필름을 더 포함하는 것을 특징으로 하는 표시장치.
  3. 제2항에 있어서, 상기 피드백 라인은 상기 연성회로필름을 경유하여 상기 인쇄회로기판으로 연장되어 상기 전압 보상유닛에 전기적으로 연결되는 것을 특징으로 하는 표시장치.
  4. 제3항에 있어서, 상기 칩은 상기 연성회로필름 상에 실장되고,
    상기 피드백 라인은 상기 연성회로필름 상에서 상기 칩과 오버랩되는 것을 특징으로 하는 표시장치.
  5. 제3항에 있어서, 상기 칩은 상기 표시패널 상에 실장되고,
    상기 피드백 라인은 상기 표시패널 상에서 상기 칩과 오버랩되는 것을 특징으로 하는 표시장치.
  6. 제1항에 있어서, 상기 칩의 하부면에는 상기 피드백 라인의 경로에 대응하여 블랭크 영역이 제공되고,
    상기 칩은 상기 블랭크 영역을 제외한 나머지 영역에 구비된 다수의 단자를 포함하는 것을 특징으로 하는 표시장치.
  7. 제1항에 있어서, 상기 칩은,
    상기 피드백 라인에 전기적으로 연결되는 제1 및 제2 더미 단자; 및
    상기 칩 내부에 구비되어 상기 제1 및 제2 더미 단자를 전기적으로 연결시키 는 내부 배선을 포함하는 것을 특징으로 하는 표시장치.
  8. 제1항에 있어서, 상기 게이트 라인들은 제1 방향으로 연장되고, 상기 데이터 라인들은 상기 제1 방향과 직교하는 제2 방향으로 연장되며,
    상기 표시패널은 상기 제2 방향보다 상기 제1 방향으로 긴 구조로 이루어지고, 상기 게이트 라인들은 상기 데이터 라인들보다 많은 개수로 이루어진 것을 특징으로 하는 표시장치.
  9. 제8항에 있어서, 상기 게이트 드라이버는 상기 표시패널의 단변에 인접하여 상기 표시패널 상에 직접적으로 형성되는 다수의 아몰퍼스 실리콘 타입 트랜지스터로 이루어져 상기 단변을 따라 화소행 단위로 순차적으로 스캔하고,
    상기 칩은 상기 표시패널의 장변에 인접하여 구비되고, 상기 게이트 신호에 의해서 스캔된 화소행에 상기 데이터 신호를 출력하는 것을 특징으로 하는 표시장치.
  10. 제9항에 있어서, 각 화소는 상기 제2 방향보다 상기 제1 방향으로 긴 구조를 갖는 것을 특징으로 하는 표시장치.
  11. 제1항에 있어서, 상기 게이트 라인들은 제1 방향으로 연장되고, 상기 데이터 라인들은 상기 제1 방향과 직교하는 제2 방향으로 연장되며,
    상기 표시패널은 상기 제1 방향보다 상기 제2 방향으로 긴 구조로 이루어지고, 상기 게이트 라인들은 상기 데이터 라인들보다 많은 개수로 이루어진 것을 특징으로 하는 표시장치.
  12. 제11항에 있어서, 상기 게이트 드라이버는 상기 표시패널의 장변에 인접하여 상기 표시패널 상에 직접적으로 형성되는 다수의 아몰퍼스 실리콘 타입 트랜지스터로 이루어져 상기 장변을 따라 화소열 단위로 순차적으로 스캔하고,
    상기 칩은 상기 표시패널의 단변에 인접하여 구비되고, 상기 게이트 신호에 의해서 스캔된 화소열에 상기 데이터 신호를 출력하는 것을 특징으로 하는 표시장치.
  13. 제12항에 있어서, 각 화소는 상기 제2 방향보다 상기 제1 방향으로 긴 구조를 갖는 것을 특징으로 하는 표시장치.
  14. 제12항에 있어서, 상기 게이트 드라이버 및 상기 데이터 드라이버의 구동을 제어하는 타이밍 컨트롤러를 더 포함하고,
    상기 타이밍 컨트롤러에는 외부로부터 화소행 단위로 순차적으로 입력된 제1 영상 데이터를 화소열 단위의 제2 영상 데이터로 변환하여 상기 데이터 드라이버로 순차적으로 공급하는 데이터 변환부가 내장되는 것을 특징으로 하는 표시장치.
  15. 제1항에 있어서, 상기 표시패널은,
    상기 전압 발생유닛으로부터 상기 공통 전압을 입력받는 하나 이상의 공통전압라인;
    상기 공통전압라인을 통해 상기 공통 전압을 입력받는 공통전극; 및
    상기 전압 발생유닛으로부터 상기 스토리지 전압을 입력받는 다수의 스토리지 전압라인을 더 포함하고,
    상기 피드백 라인은 상기 다수의 스토리지 라인 중 어느 하나와 전기적으로 연결되는 것을 특징으로 하는 표시장치.
  16. 제15항에 있어서, 상기 피드백 라인은 상기 스토리지 라인들 중 상기 칩에 가장 인접한 하나의 스토리지 라인으로부터 분기된 것을 특징으로 하는 표시장치.
  17. 제15항에 있어서, 상기 전압 보상유닛으로부터 출력된 상기 보상 신호는 상기 공통전압라인 및 상기 다수의 스토리지 라인으로 인가되는 것을 특징으로 하는 표시장치.
  18. 제1항에 있어서, 상기 스토리지 전압 및 상기 공통 전압은 직류 전압이고,
    상기 보상 신호는 상기 스토리지 전압의 리플 성분과 반전된 위상을 갖는 것을 특징으로 하는 표시장치.
  19. 제18항에 있어서, 상기 전압 보상유닛은,
    상기 스토리지 전압을 입력받는 커패시터;
    상기 커패시터에 연결된 제1 저항;
    상기 제1 저항과 연결되는 반전 입력단자, 기준 전압을 입력받는 비반전 입력단자 및 상기 보상신호를 출력하는 출력단자를 구비하는 연산 증폭기; 및
    상기 반전 입력단자와 상기 출력단자 사이에 연결된 제2 저항을 포함하는 것을 특징으로 하는 표시장치.
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