KR100912594B1 - Printed circuit board embedded with passive component chip and manufacturing method thereof - Google Patents
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Abstract
본 발명은 인쇄 회로 기판 제조 기술에 관한 것으로, 특히 캐패시터 또는 인덕터와 같은 수동 소자 칩을 인쇄 회로 기판 내부에 내장하는 기판 제조 기술에 관한 것이다. 본 발명은 내층 코어의 회로에 캐비티를 가공하여 캐비티 내부에 수동 소자 칩을 삽입하여 내장함으로써 보드의 두께가 증가하더라도 전원 공급을 위한 배선 길이가 길어지는 문제를 해결할 수 있다. 그 결과, 본 발명은 인쇄 회로 기판에서 디바이스의 동작이 고속화되는 것을 가능하게 한다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a printed circuit board manufacturing technology, and more particularly, to a board manufacturing technology in which a passive element chip such as a capacitor or an inductor is embedded inside a printed circuit board. The present invention can solve the problem of lengthening the wiring length for power supply by increasing the thickness of the board by processing the cavity in the circuit of the inner layer core and inserting the passive element chip into the cavity. As a result, the present invention makes it possible to speed up the operation of the device in a printed circuit board.
인쇄회로기판, 수동소자, 내장형 기판. Printed circuit board, passive element, embedded board.
Description
본 발명은 인쇄 회로 기판 제조 기술에 관한 것으로, 특히 캐패시터 또는 인덕터와 같은 수동 소자 칩을 인쇄 회로 기판 내부에 내장(embed)하는 기판 제조 기술에 관한 것이다.BACKGROUND OF THE
인쇄 회로 기판에는 상당수의 저항, 인덕터 또는 캐패시터와 같은 수동 소자가 실장되어 회로를 구성하게 된다. 통상적으로 인쇄 회로 기판에 수동 소자를 구현하기 위해서는 기판의 외층에 칩 형태의 수동 소자를 표면 실장(surface mount; SMT)하는 방식으로 구현하고 있다. 그런데, 최근들어 전자 제품이 소형화, 경량화되어 감에 따라 기판의 밀도를 증대시키고 소형화하기 위하여 수동 소자를 기판에 내장하는 기술이 적용되고 있다. 흔히, 저항 또는 캐패시터를 기판 내부에 내장하기 위하여, 필름 또는 카본 페이스트, 기타 유전체를 사용하여 기판을 적층하는 단계에서 수동 소자를 패턴 제작하여 성형하는 공법을 사용하고 있다. A printed circuit board contains a large number of passive elements such as resistors, inductors or capacitors to form a circuit. In general, in order to implement a passive element on a printed circuit board, a chip-type passive element is surface mounted (SMT) on an outer layer of the substrate. However, in recent years, as electronic products become smaller and lighter, techniques for embedding passive elements in a substrate have been applied in order to increase and decrease the density of the substrate. In general, in order to embed a resistor or a capacitor inside the substrate, a method of patterning and molding passive elements is used in the step of laminating the substrate using a film, carbon paste, or other dielectric.
이와 같은, 수동 소자 내장형 인쇄 회로 기판 제조 기술은 내장된 저항 또는 캐패시터의 공차 제어가 용이하지 않고 허용 오차내 튜닝이 쉽지 않은 단점이 있다. 더욱이, 종래 기술에 따라 수동 소자 칩을 기판의 표면에 실장하는 경우 소자 사이의 배선 거리가 길어져서, 특히 테스트 보드의 두께가 증가사는 경우 전원 공급 문제가 발생하게 되고, 배선 거리 증가로 인하여 기생 인덕턴스와 같은 기생 성분이 발생하는 기술적 문제가 대두된다.Such a passive element-embedded printed circuit board manufacturing technology has a disadvantage in that tolerance control of an embedded resistor or capacitor is not easy and tuning within a tolerance is not easy. Furthermore, when the passive element chip is mounted on the surface of the substrate according to the prior art, the wiring distance between the elements becomes long, and in particular, when the thickness of the test board is increased, a power supply problem occurs, and the parasitic inductance is increased due to the increased wiring distance. There is a technical problem that occurs such as parasitic components.
따라서, 본 발명의 목적은 저항, 캐패시터, 또는 인덕터를 포함한 수동 소자를 칩 형태로 실장하되, 기판의 내부에 내장함으로써 공차 발생을 차단하고 기생 성분 발생을 최소화할 수 있는 인쇄 회로 기판 제조 기술을 제공하는데 있다.Accordingly, an object of the present invention is to provide a printed circuit board manufacturing technology capable of mounting a passive element including a resistor, a capacitor, or an inductor in the form of a chip, and blocking tolerances and minimizing parasitic component generation by embedding it inside the substrate. It is.
상기 목적을 달성하기 위하여, 인쇄 회로 기판을 제조하는 방법에 있어서, (a) 복수의 절연층과 동박 회로층으로 구성된 내층 코어의 표면의 선정된 부위에 동박층이 나타날 때까지 절연층을 레이저 드릴 가공 제거함으로써 캐비티를 형성하는 단계; (b) 상기 단계 (a)에서 형성된 캐비티의 내부 노출 동박면에 비전도성 페이스트 또는 비전도성 테이프를 포함한 선정된 절연 물질을 형성하는 단계; (c) 수동 소자 칩을 상기 캐비티에 실장하는 단계; 및 (d) 상기 내층 회로에 프리프레그와 외층 회로를 적층하고 상기 캐비티에 삽입 실장된 캐패시터 전극에 전원 공급을 위해 레이저 비아홀을 형성하고 동도금을 진행하여 전원 공급선을 형성하는 단계를 포함하는 제조 방법을 제공한다.In order to achieve the above object, in the method of manufacturing a printed circuit board, (a) laser drilling the insulating layer until the copper foil layer appears on the selected portion of the surface of the inner layer core composed of a plurality of insulating layers and copper foil circuit layer. Forming a cavity by processing removal; (b) forming a selected insulating material comprising a non-conductive paste or non-conductive tape on the inner exposed copper foil surface of the cavity formed in step (a); (c) mounting a passive element chip in the cavity; And (d) stacking a prepreg and an outer layer circuit on the inner layer circuit, forming a laser via hole for supplying power to a capacitor electrode inserted into the cavity, and performing copper plating to form a power supply line. to provide.
본 발명은 내층 회로에 캐비티(cavity)를 가공하여 수동 소자 칩을 실장하고 외층을 적층한 후 레이저 비아 홀을 가공하여 전원 공급선을 확보함을 특징으로 하며, 칩 사이즈가 비교적 작은 0402(4mm × 2mm) 경우에는 제1 실시예를 적용하고 칩 사이즈가 0603(6mm ×3mm) 또는 1005(10mm × 5mm)인 경우에는 제2 실시예를 적용하는 것이 바람직하다.The present invention is characterized by securing a power supply line by processing a laser via hole after mounting a passive element chip by processing a cavity in an inner layer circuit, stacking an outer layer, and processing a laser via hole, and having a relatively small chip size of 0402 (4 mm × 2 mm). In this case, it is preferable to apply the first embodiment and to apply the second embodiment when the chip size is 0603 (6 mm x 3 mm) or 1005 (10 mm x 5 mm).
본 발명은 내층 코어의 회로에 캐비티를 가공하여 캐비티 내부에 수동 소자 칩을 삽입하여 내장함으로써 보드의 두께가 증가하더라도 전원 공급을 위한 배선 길이가 길어지는 문제를 해결할 수 있다. 그 결과, 본 발명은 인쇄 회로 기판에서 디바이스의 동작이 고속화되는 것을 가능하게 한다.The present invention can solve the problem of lengthening the wiring length for power supply by increasing the thickness of the board by processing the cavity in the circuit of the inner layer core and inserting the passive element chip into the cavity. As a result, the present invention makes it possible to speed up the operation of the device in a printed circuit board.
이하에서는, 본 발명에 따른 수동 소자 칩 내장 인쇄 회로 기판의 제조 공법을 첨부 도면을 참조하여 상세히 설명하기로 한다. 또한, 아래의 상세한 설명에서는 캐패시터 칩을 일 실시예로서 설명하지만 저항 또는 인덕터 칩으로의 확장 적용이 가능하다.Hereinafter, a manufacturing method of a printed circuit board with a passive element chip according to the present invention will be described in detail with reference to the accompanying drawings. In addition, in the following detailed description, the capacitor chip is described as an embodiment, but an extension to a resistor or an inductor chip is possible.
도1a 내지 도1d는 본 발명의 제1 실시예에 따라 캐패시터 칩을 기판에 내장하는 공법을 나타낸 도면이다.1A to 1D are views illustrating a method of embedding a capacitor chip in a substrate according to the first embodiment of the present invention.
도1a를 참조하면, L1, L2, L3, L4, L5의 도전 동박층과 층간 절연층으로 구성된 내층 코어의 일 표면에 캐비티(cavity)를 가공 형성한다. 이때에, 캐비티는 레이저 드릴 가공을 통해 처리할 수 있으며, 형성할 캐비티 속에 장방형의 수동 소 자 칩이 삽입 내장될 것이므로 가공할 캐비티의 지름은 칩의 대각선 사이즈에 꼭 맞도록 가공하는 것이 바람직하다. 본 발명에 따라 내층 회로에 형성되는 캐비티의 형상에 대한 설명은 도2를 참조하여 이후에 상술하기로 한다.Referring to FIG. 1A, a cavity is formed on one surface of an inner core composed of a conductive copper foil layer of L1, L2, L3, L4, and L5 and an interlayer insulating layer. At this time, the cavity can be processed by laser drilling, and since the rectangular passive element chip will be inserted into the cavity to be formed, the diameter of the cavity to be processed is preferably processed to fit the diagonal size of the chip. Description of the shape of the cavity formed in the inner layer circuit according to the present invention will be described later with reference to FIG.
다시 도1a를 참조하면, 본 발명의 제1 실시예는 캐비티(100)가 내층의 동박 L4 위에 만들어지는 것을 특징으로 한다. 즉, 내층 회로의 일측 표면에서 레이저 빔을 조사할 때에 반대 측에는 L4 동박층이 있어서 캐비티가 L4층과 L5층 사이에만 형성된다. 일단 캐비티(100)가 형성되면 수동 소자 칩을 캐비티(100) 속에 삽입 내장한다. 본 발명의 양호한 실시예에 따라, 수동 소자 칩을 내장하기 전에 노출된 캐비티의 내부 동박 표면(L4)에 비전도성 테이프를 부착하거나 또는 비전도성 페이스트를 도포할 수 있다.Referring back to FIG. 1A, a first embodiment of the present invention is characterized in that the
도1b는 본 발명의 제1 실시예에 따라 캐패시터 칩을 캐비티에 삽입 실장한 모습을 나타낸 도면이다. 도1b를 참조하면, 캐비티의 내측 동박면(L4층) 위에 절연층(110)을 형성하고 그 위에 캐패시터 칩(200)을 삽입 내장하고 있다. 여기서, 절연층(110)은 앞서 언급한 비전도성 테이프 또는 비전도성 페이스트일 수 있다. FIG. 1B is a view showing a capacitor chip inserted into a cavity according to the first embodiment of the present invention. Referring to FIG. 1B, an
도1c는 본 발명의 제1 실시예에 따라 캐비티에 캐패시터 칩을 삽입 실장한 내층 회로에 외층을 적층한 모습을 나타낸 도면이다. 도1c를 참조하면, 캐비티에 캐패시터 칩(200)이 삽입 실장된 내층 회로(L1 ~ L5)에 프리프레그(210)와 외층 회로(L6)를 적층한다. 이어서, 외층 L6을 패터닝하여 캐패시터 칩(200)에 전원 공급선을 형성한다. FIG. 1C is a view showing a state in which an outer layer is stacked on an inner layer circuit in which a capacitor chip is inserted and mounted in a cavity according to the first embodiment of the present invention. Referring to FIG. 1C, the
도1d는 본 발명의 제1 실시예에 따라 캐비티에 삽입 실장된 캐피시터 칩의 전극에 전원 공급선을 형성한 모습을 나타낸 도면이다. 도1d를 참조하면, 적층이 완료되면 레이저 드릴을 이용해서 캐패시터 칩(200)의 적극 부위로 프리프레그 층에 홀(220, 230)을 형성한다. 이어서, 동도금을 진행하면 L6층의 동박과 캐패시터 칩의 전극은 레이저 비아 홀(LVH)의 벽면에 형성된 동도금을 통해 서로 통전된다. 1D is a view showing a state in which a power supply line is formed on an electrode of a capacitor chip inserted into a cavity according to a first embodiment of the present invention. Referring to FIG. 1D, when lamination is completed,
도2는 본 발명의 제1 실시예에 따라 내층 회로에 형성한 캐비티의 단면 모양을 나타낸 도면이다. 본 발명의 양호한 실시예에 따라 0402 규격 제품을 적용하는 경우 가로 세로 길이가 4mm × 2mm의 장방형 칩이 실장되므로 칩의 대각선 길이는 약 4.5mm가 되어 캐비티의 지름은 약 1.1φ 정도 되는 것이 바람직하다. 2 is a view showing a cross-sectional shape of a cavity formed in the inner layer circuit according to the first embodiment of the present invention. In the case of applying the 0402 standard product according to a preferred embodiment of the present invention, since a rectangular chip having a width and length of 4 mm × 2 mm is mounted, the diagonal length of the chip is about 4.5 mm, and the diameter of the cavity is about 1.1 φ. .
이때에, 더욱 바람직하게는 캐패시터 칩을 캐비티 내부에 타이트하게 움직임 없이 견고히 실장하기 위하여 메인 홀(50) 드릴 가공 외에 추가로 모서리 홀(55)을 형성하는 것이 바람직하다. 즉, 1.1φ 직경의 캐비티 공간 가공을 위한 메인 홀(50)을 형성하고, 장방형의 칩이 고정될 모서리 홀(55)을 0.25φ 크기로 메인 홀(50)의 원주 상에 추가로 형성할 수 있다.At this time, it is more preferable to form
도3a 내지 도3d는 본 발명의 제2 실시예에 따라 캐패시터 칩을 기판에 내장하는 공법을 나타낸 도면이다. 본 발명의 제2 실시예는 내층 회로에 형성되는 캐비티의 양면 모두에 동박층이 존재하지 않는 경우의 공법이다. 3A to 3D are views showing a method of embedding a capacitor chip in a substrate according to the second embodiment of the present invention. The second embodiment of the present invention is a method in the case where the copper foil layer does not exist on both sides of the cavity formed in the inner layer circuit.
도3a를 참조하면, 내층 회로에 레이저 드릴을 이용해서 캐비티(320)를 형성한다. 이때에, 본 발명의 제2 실시예는 캐비티(320)의 양면에 어느 쪽에도 동박층이 없다. 이어서, 본 발명의 제2 실시예는 형성된 캐비티(320)의 일 측면에 비전도성 테이프(330)를 부착하여 캐비티의 한 면을 마감하는 것을 특징으로 한다. Referring to FIG. 3A, a
즉, 도3b를 참조하면, 캐비티(320)의 일 측면, 즉 L4층에 비전도성 테이프(330)를 부분적으로 부착한다. 이어서, 캐패시터 칩을 캐비티(320)에 삽입 실장한 후 외층을 적층하고 레이저 비아 홀(LVH)을 형성하여 전원을 공급하는 것은 전술한 제1 실시예와 동일하다. 본 발명의 제2 실시예는 칩 사이즈가 0603(6㎜ × 3㎜) 및 1005 규격(10㎜ × 5㎜)에 적용될 수 있다.That is, referring to FIG. 3B, the
전술한 내용은 후술할 발명의 특허 청구 범위를 더욱 잘 이해할 수 있도록 본 발명의 특징과 기술적 장점을 다소 폭넓게 개선하였다. 본 발명의 특허 청구 범위를 구성하는 부가적인 특징과 장점들이 이하에서 상술될 것이다. 개시된 본 발명의 개념과 특정 실시예는 본 발명과 유사 목적을 수행하기 위한 다른 구조의 설계나 수정의 기본으로서 즉시 사용될 수 있음이 당해 기술 분야의 숙련된 사람들에 의해 인식되어야 한다. The foregoing has somewhat broadly improved the features and technical advantages of the present invention to better understand the claims that follow. Additional features and advantages that make up the claims of the present invention will be described below. It should be appreciated by those skilled in the art that the conception and specific embodiments of the invention disclosed may be readily used as a basis for designing or modifying other structures for carrying out similar purposes to the invention.
또한, 본 발명에서 개시된 발명 개념과 실시예가 본 발명의 동일 목적을 수행하기 위하여 다른 구조로 수정하거나 설계하기 위한 기초로서 당해 기술 분야의 숙련된 사람들에 의해 사용될 수 있을 것이다. 또한, 당해 기술 분야의 숙련된 사람에 의한 그와 같은 수정 또는 변경된 등가 구조는 특허 청구 범위에서 기술한 발명의 사상이나 범위를 벗어나지 않는 한도 내에서 다양한 진화, 치환 및 변경이 가능하다. In addition, the inventive concepts and embodiments disclosed herein may be used by those skilled in the art as a basis for modifying or designing other structures for carrying out the same purposes of the present invention. In addition, such modifications or altered equivalent structures by those skilled in the art may be variously evolved, substituted and changed without departing from the spirit or scope of the invention described in the claims.
본 발명은 카본 페이스트 또는 필름을 기판에 내장(embed)하여 저항체 또는 캐패시터를 형성하는 것이 아니라, 칩 형태로 제작된 수동 소자 부품을 기판 내부 의 캐비티 속에 직접 실실장하고 외층을 적층하게 되므로, 공차 발생을 원천 차단하면서도 배선 길이로 인한 기생 인덕턴스 발생을 현저히 감소시킬 수 있다. 본 발명에서 제안하는 기술은 저항, 캐패시터, 인덕터를 포함한 수동 소자 칩에 광범위하게 적용될 수 있다.The present invention does not form a resistor or a capacitor by embedding a carbon paste or film in a substrate, but directly mounts a passive element component manufactured in the form of a chip in a cavity inside the substrate and stacks an outer layer. It can significantly reduce the parasitic inductance caused by the wire length while blocking the source. The technique proposed in the present invention can be widely applied to passive device chips including resistors, capacitors, and inductors.
도1a 내지 도1d는 본 발명의 제1 실시예에 따라 캐패시터 칩을 기판에 내장하는 공법을 나타낸 도면.1A to 1D are views showing a method of embedding a capacitor chip in a substrate according to the first embodiment of the present invention.
도2는 본 발명의 제1 실시예에 따라 내층 회로에 형성한 캐비티의 단면 모양을 나타낸 도면.2 is a cross-sectional view of the cavity formed in the inner layer circuit according to the first embodiment of the present invention;
도3a 내지 도3d는 본 발명의 제2 실시예에 따라 캐패시터 칩을 기판에 내장하는 공법을 나타낸 도면.3A to 3D show a method of embedding a capacitor chip in a substrate according to a second embodiment of the present invention.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
50: 메인 홀 50: main hall
55: 모서리 홀 55: corner hole
100, 320: 캐비티100, 320: cavity
110: 절연층 110: insulation layer
200: 캐패시터 칩 200: capacitor chip
210: 프리프레그 210: prepreg
330: 비전도성 테이프 330: non-conductive tape
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