KR100793087B1 - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 리셋 기간에서 스캔 전극(Y)으로 공급되는 리셋 펄스를 개선한 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것으로, 스캔 전극(Y)으로 제 1 리셋 펄스와 제 2 리셋 펄스를 공급함으로써, 패턴의 영상이 일정시간 이상 동일한 화면상에 표시되더라도 잔상의 발생을 방지하는 효과가 있다.
이러한 본 발명의 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널과, 프레임의 복수의 서브필드 중 적어도 어느 하나의 서브필드의 초기화를 위한 리셋 기간에서는 제 1 전압부터 제 2 전압까지 제 1 기울기로 점진적으로 상승한 이후 제 2 전압부터 제 1 전압까지 제 2 기울기로 하강하는 제 1 리셋 펄스와, 제 1 전압부터 제 3 전압까지 급격히 상승한 이후에 제 3 전압부터 제 4 전압까지 제 3 기울기로 점진적으로 상승하는 제 2 리셋 펄스를 스캔 전극으로 공급하는 구동부를 포함하는 것이 바람직하다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
도 1은 본 발명의 플라즈마 디스플레이 장치를 설명하기 위한 도.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 일례에 대해 설명하기 위한 도.
도 3은 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 상세히 설명하기 위한 도.
도 4는 제 1 리셋 펄스 및 제 2 리셋 펄스에 대해 보다 상세히 설명하기 위한 도.
도 5는 제 1 리셋 펄스의 하강 기울기에 대해 설명하기 위한 도.
도 6a 내지 도 6b는 본 발명의 플라즈마 디스플레이 장치의 구동부를 구현한 일례를 설명하기 위한 도.
도 7a 내지 도 7b는 스캔 기준 전압 공급 제어부의 동작을 설명하기 위한 도.
도 8은 본 발명의 플라즈마 디스플레이 장치의 구동부의 동작의 일례를 설명하기 위한 도.
도 9는 프레임의 복수의 서브필드 중 소정의 서브필드에서만 제 1 리셋 펄스와 제 2 리셋 펄스를 사용하는 방법의 일례를 설명하기 위한 도.
도 10은 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급되는 서브필드 중 적어도 하나 이상에서 제 1 리셋 펄스가 공급되기 이전에 전압이 점진적으로 하강하는 하강 파형이 스캔 전극(Y)으로 공급되는 방법의 일례를 설명하기 위한 도.
<도면의 주요 부분에 대한 부호의 설명>
100 : 플라즈마 디스플레이 패널 101 : 구동부
본 발명은 플라즈마 디스플레이 장치에 관한 것으로, 보다 상세하게는 리셋 기간에서 스캔 전극(Y)으로 공급되는 리셋 펄스를 개선한 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
일반적으로 플라즈마 디스플레이 장치는 복수의 전극들이 형성된 플라즈마 디스플레이 패널과 이러한 플라즈마 디스플레이 패널의 전극을 구동시키기 위한 구동부를 포함하여 이루어진다.
여기서, 플라즈마 디스플레이 패널은 전면 패널과 후면 패널 사이에 형성된 격벽이 방전 셀을 이루는 것으로, 방전 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 소량의 크세논(Xe)을 함유하는 방전 가스가 충진되어 있다. 이러한 방전 셀 들은 화상을 표시하기 위한 복수개의 픽셀(Pixel)을 이루는 것이다. 예컨대 적색(Red, R), 녹색(Green, G), 청색(Blue, B) 방전 셀이 모여 하 나의 픽셀을 이루는 것이다.
그리고 이러한 플라즈마 디스플레이 패널은 고주파 전압에 의해 방전이 될 때, 방전 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 영상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
이러한 플라즈마 디스플레이 패널에는 방전을 발생시키기 위한 구동 전압이 공급되고, 이러한 구동 전압에 의해 리셋 방전, 어드레스 방전, 서스테인 방전 등의 방전이 발생함으로써, 영상이 표시된다.
종래의 플라즈마 디스플레이 장치에서는 동일한 패턴(Pattern)의 영상이 일정시간 이상 표시되는 경우 방전 셀 내의 벽 전하(Wall Charge)의 분포가 고착될 수 있다.
예를 들어, 특정한 윈도우(Window) 패턴의 영상이 일정시간 이상동안 화면상에 표시되는 경우 방전 셀 내에서의 벽 전하들의 분포는 이러한 특정한 윈도우 패턴에 대응되게 유지 및 고착 된다.
이러한 경우에, 화면상에 윈도우 패턴의 영상이 아닌 다른 영상을 표시하게 되면 이전의 윈도우 패턴의 영상이 화면상에서 지워지지 않고 그대로 남아 있게 됨으로써, 잔상이 발생하는 문제점이 있다.
상술한 문제점을 해결하기 위한 본 발명의 플라즈마 디스플레이 장치는 특정한 패턴의 영상이 일정시간 이상 동일한 화면상에 표시되더라도 잔상의 발생을 방지할 수 있는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.
상술한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 서로 나란한 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널과, 프레임의 복수의 서브필드 중 적어도 어느 하나의 서브필드의 초기화를 위한 리셋 기간에서는 제 1 전압부터 제 2 전압까지 제 1 기울기로 점진적으로 상승한 이후 제 2 전압부터 제 1 전압까지 제 2 기울기로 하강하는 제 1 리셋 펄스와, 제 1 전압부터 제 3 전압까지 급격히 상승한 이후에 제 3 전압부터 제 4 전압까지 제 3 기울기로 점진적으로 상승하는 제 2 리셋 펄스를 스캔 전극으로 공급하는 구동부를 포함하는 것이 바람직하다.
여기서, 상기 구동부는 스캔 전극에 제 1 리셋 펄스와 제 2 리셋 펄스를 공급하는 동안 상기 서스테인 전극에는 상기 리셋 기간 이후의 어드레스 기간에서 서스테인 전극으로 공급되는 제 2 서스테인 바이어스 전압보다 낮은 제 1 서스테인 바이어스 전압을 공급하는 것을 특징으로 한다.
또한, 상기 제 1 서스테인 바이어스 전압은 그라운드 레벨(GND)의 전압과 대략 동일한 것을 특징으로 한다.
또한, 상기 제 1 기울기와 제 3 기울기는 대략 동일한 것을 특징으로 한다.
또한, 제 2 전압은 제 3 전압보다 더 크거나 대략 동일한 것을 특징으로 한다.
또한, 제 4 전압은 상기 제 2 전압의 1배 초과 3배 이하인 것을 특징으로 한 다.
또한, 제 2 기울기는 상기 리셋 기간 이후의 서스테인 기간에서 상기 스캔 전극 및/또는 서스테인 전극으로 공급되는 서스테인 펄스의 전압 회수 기간의 기울기와 대략 동일한 것을 특징으로 한다.
또한, 상기 프레임의 복수의 서브필드 중 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되는 서브필드는 계조 가중치가 가장 낮은 서브필드부터 계조 가중치가 증가하는 순서로 소정 서브필드까지인 것을 특징으로 한다.
또한, 상기 구동부는 상기 제 1 리셋 펄스와 제 2 리셋 펄스를 공급하는 서브필드 중 적어도 어느 하나의 서브필드에서는 상기 제 1 리셋 펄스를 공급하기 이전에 상기 스캔 전극으로 전압이 점진적으로 하강하는 하강 파형을 공급하는 것을 특징으로 한다.
또한, 상기 구동부는 상기 스캔 전극에 하강 파형을 공급하는 동안 상기 서스테인 전극에는 상기 리셋 기간 이후의 어드레스 기간에서 서스테인 전극으로 공급되는 제 2 서스테인 바이어스 전압보다 높은 제 3 서스테인 바이어스 전압을 공급하는 것을 특징으로 한다.
또한, 상기 제 3 서스테인 바이어스 전압은 상기 어드레스 기간 이후의 서스테인 기간에서 상기 스캔 전극 및/또는 서스테인 전극으로 공급되는 서스테인 펄스의 전압(Vs)과 대략 동일한 것을 특징으로 한다.
이하 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.
도 1은 본 발명의 플라즈마 디스플레이 장치를 설명하기 위한 도면이다.
도 1을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(101)를 포함한다.
여기, 도 1에서는 구동부(101)를 하나인 것으로 도시하고 있지만, 플라즈마 디스플레이 패널(100)에 형성되는 전극에 따라 복수개로 분할될 수도 있다. 예를 들면, 플라즈마 디스플레이 패널(100)에 어드레스 전극(X), 스캔 전극(Y), 서스테인 전극(Z)이 형성되는 경우에, 구동부(101)는 도시하지는 않았지만 데이터 구동부, 스캔 구동부, 서스테인 구동부로 분할될 수 있는 것이다.
여기서, 플라즈마 디스플레이 패널의 일례를 첨부된 도 2a 내지 도 2b를 결부하여 살펴보면 다음과 같다.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 일례에 대해 설명하기 위한 도면이다.
먼저, 도 2a를 살펴보면 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시 면인 전면 기판(201)에 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성된 전면 패널(200) 및 배면을 이루는 후면 기판(211) 상에 전술한 스캔 전극(202)과 서스테인 전극(203)과 교차되도록 어드레스 전극(213, X)이 형성된 후면 패널(210)이 일정거리를 사이에 두고 나란하게 결합된다.
전면 패널(200)은 방전 공간, 즉 방전 셀(Cell)에서 상호 방전시키고 방전 셀의 발광을 유지하기 위한 스캔 전극(202)과 서스테인 전극(203)이 포함된다.
스캔 전극(202)과 서스테인 전극(203)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체 층(204)에 의해 덮혀지고, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성된다.
이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성된다.
후면 패널(210)은 복수개의 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(또는 웰 타입)의 격벽(212)을 포함한다. 또한, 데이터 펄스를 공급하기 위한 다수의 어드레스 전극(213)이 배치된다.
여기서, 격벽에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214), 바람직하게는 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성된다.
그리고 어드레스 전극(213)과 형광체 층(214) 사이에는 어드레스 전극(213)을 절연시키기 위한 하부 유전체 층(215)이 형성된다.
여기서, 스캔 전극(202)과 서스테인 전극(203)은 전도성 금속 재질로 이루어지는 것이 바람직하다. 예를 들면, 은(Ag) 재질 또는 인듐틴옥사이드(Indium Tin Oxide : ITO) 재질로 이루질 수 있다.
특히, 광 투과율 및 전기 전도도를 고려하여 스캔 전극(202)과 서스테인 전극(203)을 은 재질의 버스 전극과 ITO 재질의 투명 전극을 포함하도록 형성하는 것이 바람직하다. 이에 대해 보다 상세히 살펴보면 다음 도 2b와 같다.
여기, 도 2b에서는 도 2a의 영역 A에서와 같이 전면 기판(201)과 상부 유전체 층(204) 사이에 스캔 전극(202)과 서스테인 전극(203)이 형성된 것으로 설명하 기로 한다.
도 2b를 살펴보면, 본 발명의 플라즈마 디스플레이 패널의 스캔 전극(202)과 서스테인 전극(203)은 면 방전을 발생시키기 위해 형성되는 것으로서, 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율의 확보를 위해 투명한 ITO 물질로 형성된 투명 전극(202a, 203a)과 불투명 금속재질로 제작된 버스 전극(202b, 203b)을 포함하여 이루어지는 것이 바람직하다.
이와 같이, 스캔 전극(202)과 서스테인 전극(203)이 투명 전극(202a, 203a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.
아울러, 스캔 전극(202)과 서스테인 전극(203)이 버스 전극(202b, 203b)을 포함하도록 하는 이유는, 스캔 전극(202)과 서스테인 전극(203)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상하기 위해서이다.
여기 도 2a 내지 도 2b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2a 내지 도 2b의 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 상부 유전체 층(204) 및 하부 유전체 층(215)이 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(204) 및 하부 유전체 층(215) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
즉, 본 발명의 플라즈마 디스플레이 장치에 적용될 수 있는 플라즈마 디스플레이 패널은 스캔 전극(202)과 서스테인 전극(203)이 형성된 것이고, 그 이외의 조건은 무방한 것이다.
다음, 도 2a 내지 도 2b에 대한 설명을 마무리 하고, 다시 도 1에 대해 설명하기로 한다.
도 1의 부호 101의 구동부는 프레임의 복수의 서브필드 중 적어도 어느 하나의 서브필드의 초기화를 위한 리셋 기간에서는 제 1 전압(V1)부터 제 2 전압(V2)까지 제 1 기울기로 점진적으로 상승한 이후 제 2 전압(V2)부터 제 1 전압(V1)까지 제 2 기울기로 하강하는 제 1 리셋 펄스와, 제 1 전압(V1)부터 제 3 전압(V3)까지 급격히 상승한 이후에 제 3 전압(V3)부터 제 4 전압(V4)까지 제 3 기울기로 점진적으로 상승하는 제 2 리셋 펄스를 스캔 전극(Y)으로 공급한다.
아울러, 구동부(101)는 플라즈마 디스플레이 패널(100)의 어드레스 전극(X)으로 데이터 전압(Vd)의 데이터 펄스를 공급할 수 있다.
또한, 스캔 전극(Y)으로는 부극성 스캔 펄스를 공급하고, 또한 서스테인 전압(Vs)의 서스테인 펄스를 공급하는 것이 바람직하다.
또한, 구동부(101)는 서스테인 전극(Z)으로 서스테인 바이어스 전압(Vz) 및 서스테인 펄스를 공급하는 것이 바람직하다.
이러한, 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 첨부된 도 3을 결부하여 살펴보면 다음과 같다.
도 3은 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 상세히 설명하 기 위한 도면이다.
도 3을 살펴보면, 본 발명의 플라즈마 디스플레이 장치가 한 서브필드 내에서의 사용하는 구동 파형이 나타나 있다.
리셋 기간에서는 스캔 전극(Y)에 제 1 리셋 펄스와 제 2 리셋 펄스가 공급된다.
이러한, 제 1 리셋 펄스와 제 2 리셋 펄스에 의해 방전 셀 내에는 약한 암방전(Dark Discharge)이 발생한다. 이러한 암방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓인 후, 이러한 벽 전하의 일부가 소거되어 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다. 즉, 방전 셀 들 내의 벽 전하의 분포를 고르게 하기 위한 초기화가 이루어진다.
또한, 리셋 기간에서 제 1 리셋 펄스와 제 2 리셋 펄스를 스캔 전극(Y)에 공급하게 되면 잔상의 발생을 방지하게 된다.
보다 상세히 설명하면, 플라즈마 디스플레이 장치에서는 동일한 패턴(Pattern)의 영상이 일정시간 이상 표시되는 경우 방전 셀 내의 벽 전하(Wall Charge)의 분포가 고착될 수 있다.
예를 들어, 특정한 윈도우(Window) 패턴의 영상이 일정시간 이상동안 화면상에 표시되는 경우 방전 셀 내에서의 벽 전하들의 분포는 이러한 특정한 윈도우 패턴에 대응되게 유지 및 고착된다.
이러한 경우에, 제 1 리셋 펄스와 제 2 리셋 펄스가 순차적으로 공급되면 먼 저 공급되는 제 1 리셋 펄스는 방전 셀 내에서 유지 및 고착된 벽 전하의 분포를 흔들어 준다. 그리고 이후 공급되는 제 2 리셋 펄스는 제 1 리셋 펄스에 의해 유지 및 고착 상태가 풀린 벽 전하의 분포를 방전 셀들간에 고르게 한다.
이에 따라, 특정 패턴의 영상을 일정시간 이상 연속적으로 표시한 이후에 화면상에 다른 영상을 표시하더라도, 이전의 특정 패턴의 영상이 화면상에서 지워지지 않고 그래도 남아 있게 되어 발생하는 잔상을 제거할 수 있게 된다.
이러한 리셋 기간에서는 스캔 전극(Y)에 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되는 동안 서스테인 전극(Z)에는 리셋 기간 이후의 어드레스 기간에서 서스테인 전극(Z)으로 공급되는 제 2 서스테인 바이어스 전압(Vz2)보다 낮은 제 1 서스테인 바이어스 전압(Vz1)이 공급된다.
이와 같이, 스캔 전극(Y)에 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되는 동안 서스테인 전극(Z)에는 상대적으로 낮은 전압 레벨(Level)을 갖는 제 1 서스테인 바이어스 전압(Vz1)을 공급하는 이유는, 스캔 전극(Y)과 서스테인 전극(Z) 간에 리셋 방전이 효과적으로 발생하도록 스캔 전극(Y)과 서스테인 전극(Z) 간의 전압차이를 제공하기 위해서이다.
여기서, 이러한 제 1 서스테인 바이어스 전압(Vz1)은 그라운드 레벨(GND)의 전압과 대략 동일한 것이 바림작하다.
이러한, 제 1 리셋 펄스 및 제 2 리셋 펄스에 대해서는 이후의 도 4 내지 도 5를 통해 보다 상세히 설명하기로 한다.
이러한, 리셋 기간 이후의 어드레스 기간에서는 스캔 기준 전압(Vsc) 및 이 러한 스캔 기준 전압(Vsc)으로부터 하강하는 부극성 스캔 펄스(Scan)의 전압(-Vy)이 스캔 전극(Y)에 공급될 수 있다.
아울러, 부극성 스캔 펄스의 전압(-Vy)이 스캔 전극(Y)으로 공급될 때, 이에 대응되게 어드레스 전극(X)에는 데이터 펄스의 전압(Vd)이 공급될 수 있다.
아울러, 어드레스 기간에서 서스테인 전극(Z)의 간섭으로 인한 오방전의 발생을 방지하기 위해 서스테인 전극(Z)에는 제 1 서스테인 바이어스 전압(Vz1)보다는 높은 제 2 서스테인 바이어스 전압(Vz2)이 공급되는 것이 바람직하다.
이러한, 어드레스 기간에서는 부극성 스캔 펄스의 전압(-Vy)과 데이터 펄스의 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 펄스의 전압(Vd)이 공급되는 방전 셀 내에는 어드레스 방전이 발생된다.
이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 서스테인 펄스의 서스테인 전압(Vs)이 공급될 때 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.
이러한, 어드레스 기간 이후의 서스테인 기간에서는 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 서스테인 펄스(SUS)가 공급될 수 있다.
이에 따라, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 펄스(SUS)의 서스테인 전압(Vs)이 더해지면서 매 서스테인 펄스(SUS)가 인가될 때 마다 스캔 전극(Y)과 서스테인 전극(Z) 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이에 따라, 플라즈마 디스플레이 패널 상에 소정의 영상이 구현되는 것이다.
여기서, 앞서 설명한 리셋 기간에서 스캔 전극(Y)으로 공급되는 제 1 리셋 펄스 및 제 2 리셋 펄스에 대해 보다 상세히 살펴보면 다음과 같다.
도 4는 제 1 리셋 펄스 및 제 2 리셋 펄스에 대해 보다 상세히 설명하기 위한 도면이다.
도 4를 살펴보면, 제 1 리셋 펄스는 제 1 전압(V1)부터 제 2 전압(V2)까지 전압이 제 1 기울기로 점진적으로 상승한 이후에 다시 제 2 전압(V2)부터 제 1 전압(V1)까지 제 2 기울기로 점진적으로 하강한다.
그리고, 제 2 리셋 펄스는 제 1 전압(V1)부터 제 3 전압(V3)까지 전압이 급격히 상승한 이후에 다시 제 3 전압(V3)부터 제 4 전압(V4)까지 전압이 제 3 기울기로 점진적으로 상승한다.
이러한, 제 2 리셋 펄스는 제 4 전압(V4)까지 점진적으로 상승한 이후에 다시 제 1 전압(V1)까지 하강한 이후에 전압이 소정의 기울기로 점진적으로 하강하는 것이 바람직하다.
여기서, 제 1 리셋 펄스의 제 1 기울기와 제 2 리셋 펄스의 제 3 기울기는 대략 동일한 것이 바람직하다. 이와 같이, 제 1 기울기와 제 3 기울기를 동일하게 설정하는 이유는 제 1 기울기와 제 3 기울기를 서로 다르게 하는 경우에는 제 1 기울기를 발생시키는 회로와 제 3 기울기를 발생시키는 회로를 각각 따로 구비해야 하고, 이에 따라 제조 단가가 상승하기 때문이다.
따라서 제 1 기울기와 제 3 기울기를 동일한 회로를 이용하여 발생시킴으로 써 제조 단가의 상승을 억제할 수 있다.
아울러, 제 2 전압(V2)은 제 3 전압(V3) 보다 더 크거나 대략 동일한 것이 바람직하다. 이와 같이 제 2 전압(V2)을 제 3 전압(V3)보다 더 크거나 대략 동일하게 하는 이유는 제 1 리셋 펄스에 의한 1차적인 초기화의 효율을 높이고, 아울러 제 2 리셋 펄스에 의해 발생하는 암방전의 크기가 과도하게 커지는 것을 방지하기 위해서이다.
예를 들어, 제 1 리셋 펄스의 제 2 전압(V2)의 크기가 제 2 리셋 펄스의 제 3 전압(V3)보다 작게 되면 제 1 리셋 펄스에 의해 발생하는 암방전의 크기가 과도하게 작아져서 방전 셀 내에 벽 전하를 충분하게 쌓을 수가 없게 된다. 또는, 제 2 리셋 펄스의 전압이 점진적으로 상승하기도 전에 제 2 리셋 펄스에 의한 강한 방전이 발생하게 되어 콘트라스트 특성이 저하된다. 따라서 제 2 전압(V2)을 제 3 전압(V3) 보다 더 크거나 대략 동일하게 하는 것이다.
또한, 제 2 리셋 펄스의 제 4 전압(V3)은 제 2 전압(V2)의 1배 초과 3배 이하인 것이 바람직하다. 이와 같이, 제 4 전압(V4)을 제 2 전압(V2)의 1배 초과 3배 이하로 설정하는 이유는 방전 셀 내에 충분한 양의 벽 전하를 균일하게 쌓기 위해서이다.
예를 들어, 제 4 전압(V4)이 제 2 전압(V2)의 1배 이하인 경우에는 리셋 방전의 세기가 과도하게 약해져서 각각의 방전 셀 내에 충분한 양의 벽 전하들이 쌓이지 못하거나 또는 방전 셀 간에 쌓이는 벽 전하의 양의 차이가 심화되고, 반면에 제 4 전압(V4)이 제 2 전압(V2)의 3배를 초과하는 경우에는 리셋 방전의 세기가 과 도하게 증가하고 이에 따라 콘트라스트(Contrast) 특성이 악화되기 때문이다.
한편, 제 1 리셋 펄스는 제 2 전압(V2)까지 점진적으로 상승한 이후에 다시 제 2 전압(V2)부터 제 1 전압(V1)까지 하강할 시에 제 2 기울기로 하강하는 것이 바람직하다. 이에 대해 첨부된 도 5를 참조하여 살펴보면 다음과 같다.
도 5는 제 1 리셋 펄스의 하강 기울기에 대해 설명하기 위한 도면이다.
도 5를 살펴보면, (a)에는 제 1 리셋 펄스와 제 2 리셋 펄스를 나타내었고, (b)에서는 화상을 표시하기 위한 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 공급되는 서스테인 펄스가 나타나 있다.
(a)를 살펴보면, 제 1 리셋 펄스는 제 2 전압(V2)까지 점진적으로 상승한 이후에 다시 제 2 전압(V2)부터 제 1 전압(V1)까지 하강할 시에 d1기간 동안 소정의 기울기를 가지고 하강한다. 즉, 제 2 기울기로 하강한다.
이러한, 제 2 기울기는 (b)에서와 같이 리셋 기간 이후의 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 공급되는 서스테인 펄스의 전압 회수 기간(d2)의 기울기와 대략 동일하다.
이와 같이, 제 1 리셋 펄스의 제 2 기울기를 서스테인 펄스의 전압 회수 기간(d2)에서의 기울기와 동일하게 하는 이유는 제 2 기울기와 서스테인 펄스의 에너지 회수 기간(d2)의 기울기를 동일한 회로를 사용하여 발생시키기 때문이다. 이는 도 6a 이후의 설명을 통해 보다 명확히 될 것이다.
이상에서 설명한 제 1 리셋 펄스와 제 2 리셋 펄스를 공급하기 위한 본 발명의 플라즈마 디스플레이 장치의 구동부를 구현한 일례에 대해 살펴보면 다음과 같 다.
도 6a 내지 도 6b는 본 발명의 플라즈마 디스플레이 장치의 구동부를 구현한 일례를 설명하기 위한 도면이다.
먼저, 도 6a를 살펴보면 본 발명의 플라즈마 디스플레이 장치의 구동부는 스캔 드라이브 집적회로부(Scan Drive Integrated Circuit : 670)와, 스캔 기준 전압 공급 제어부(640)와, 스캔 및 하강 램프 공통 공급 제어부(650) 및 에너지 회수 회로부(600)를 포함한다.
그리고, 이러한 본 발명의 플라즈마 디스플레이 장치의 구동부에는 서스테인 전압 공급 제어부(610)와, 기저 전압 공급 제어부(620) 및 상승 램프 공급 제어부(630)가 더 포함되는 것이 바람직하다.
스캔 드라이브 집적회로부(670)는 스캔 탑(Top) 스위치부(S9)와 스캔 바텀(Bottom) 스위치부(S10)를 포함하고, 이러한 스캔 탑 스위치부(S9)와 스캔 바텀 스위치부(S10)를 이용하여 자신에게 공급되는 전압을 미리 정해진 스위칭 동작을 통해 플라즈마 디스플레이 패널의 스캔 전극(Y)에 공급한다.
여기서, 스캔 드라이브 집적회로부(670)는 스캔 탑 스위치부(S9)와 스캔 바텀 스위치부(S10)의 사이에서 스캔 전극(Y)과 접속된다.
스캔 기준 전압 공급 제어부(640)는 스캔 드라이브 집적회로부(670)로 스캔 기준 전압(Vsc)의 공급을 제어한다.
이러한 스캔 기준 전압 공급 제어부(640)는 저항부(641)와 역전류 방지부(642)를 포함한다.
여기서, 저항부(641)는 스캔 드라이브 집적회로부(670)로 공급되는 스캔 기준 전압(Vsc)에 발생하는 노이즈(Noise)를 저감시키기 위해 설치된다.
역전류 방지부(642)는 스캔 드라이브 집적회로부(670)로부터 스캔 기준 전압(Vsc)을 공급하는 스캔 기준 전압원으로 흐르는 역전류를 방지하기 위해 배치된다.
이러한, 저항부(641)와 역전류 방지부(642)는 스캔 드라이브 집적회로부(670)와 스캔 기준 전압원의 사이에서 직렬 배치되는 것이 바람직하다.
여기서, 더욱 바람직하게는 역전류 방지부(642)는 역전류 방지용 다이오드부(D3)를 포함하고, 이러한 역전류 방지용 다이오드부(D3)의 애노드(Anode)는 스캔 기준 전압원의 방향이고, 캐소드(Cathode)는 스캔 드라이브 집적회로부(670)의 방향으로 배치된다.
또한, 스캔 기준 전압 공급 제어부(640)에는 역전류 방지부(642) 및 저항부(641) 이외에 흔들림 방지부(644)와 전류 패스부(643)를 더 포함하는 것이 바람직하다.
여기서, 흔들림 방지부(644)는 흔들림 방지용 캐패시터부(C2)를 포함하고, 이러한 흔들림 방지용 캐패시터부(C2)를 이용하여 스캔 전극(Y)으로 공급되는 스캔 기준 전압(Vsc)의 흔들림을 저감시킨다.
이러한 흔들림 방지용 캐패시터부(C2)는 그 일단이 전류 패스부(643)의 전류 패스용 다이오드부(D4) 및 저항부(641)와 공통 접속되고, 타단은 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10)와 스캔 및 하강 램프 공통 공급 제어부(650)와 공통 접속된다.
전류 패스부(643)는 저항부(641)와 병렬 배치되는 전류 패스용 다이오드부(D4)를 포함하고, 이러한 전류 패스용 다이오드부(D4)를 이용하여 스캔 드라이브 집적회로부(670)로부터 흔들림 방지부(644)로 흐르는 전류를 패스(Pass) 시킨다.
이러한, 전류 패스용 다이오드부(D4)의 캐소드는 흔들림 방지용 캐패시터부(C2)의 방향이고, 애노드는 스캔 드라이브 집적회로부(670)의 스캔 탑 스위치(S9)의 방향인 것이 바람직하다.
여기서, 이러한 스캔 기준 전압 공급 제어부(640)의 동작을 첨부된 도 7a 내지 도 7b를 결부하여 상세히 살펴보면 다음과 같다.
도 7a 내지 도 7b는 스캔 기준 전압 공급 제어부의 동작을 설명하기 위한 도면이다.
먼저, 도 7a를 살펴보면 플라즈마 디스플레이 패널의 스캔 전극(Y)으로 스캔 기준 전압이 공급되는 경우에는 스캔 기준 전압원으로부터 스캔 기준 전압이 역전류 방지용 다이오드부(D3)와 저항부(641)와 스캔 탑 스위치부(S9)를 경유하여 스캔 전극(Y)으로 공급된다.
이러한 경우에는 전류 패스용 다이오드부(D4)의 캐소드가 스캔 기준 전압원의 방향으로 배치되기 때문에 스캔 기준 전압(Vsc)이 전류 패스용 다이오드(D4)를 경유하지 못한다.
이에 따라 노이즈가 저감된 스캔 기준 전압(Vsc)이 스캔 전극(Y)으로 공급되는 것이다.
다음, 도 7b를 살펴보면 스캔 전극(Y)으로 스캔 기준 전압(Vsc)의 공급이 차 단되는 시점, 즉 스캔 탑 스위치부(S9)가 오프 되는 시점부터 스캔 바텀 스위치부(S10)가 온 되는 시점까지의 기간에서 스캔 전극(Y)의 전압이 스캔 탑 스위치부(S9)와 전류 패스용 다이오드부(D4)를 경유하여 흔들림 방지용 캐패시터부(C2)로 공급되어 흔들림 방지용 캐패시터부(C2)가 충전된다.
이때는 역전류 방지용 다이오드부(D3)의 캐소드가 스캔 탑 스위치부(S9)의 방향으로 배치되기 때문에 스캔 전극(Y)으로부터 빠져나오는 전압이 스캔 기준 전압원방향으로 흐르지 못하게 된다.
결국, 스캔 탑 스위치부(S9)가 오프 되는 시점부터 스캔 바텀 스위치부(S10)가 온 되는 시점까지의 기간에서 스캔 전극(Y)으로부터 빠져나오는 전압이 흔들림 방지용 캐패시터부(C2)로 안정적으로 충전됨에 따라, 본 발명의 플라즈마 디스플레이 장치의 스캔 구동부의 동작을 안정시키고, 또한 에너지 효율을 향상시키게 된다.
이러한 도 7a 내지 도 7b에 대한 설명을 마무리하고 다시 도 6a 내지 도 6b에 대해 설명하기로 한다.
도 6a에서 에너지 회수 회로부(600)는 미리 저장된 전압을 에너지 공급 경로를 통해 스캔 전극(Y)으로 공급하고, 스캔 전극(Y)의 무효 에너지를 에너지 회수 경로를 통해 회수한다.
이러한, 에너지 회수 회로부(600)에 대해 보다 상세히 살펴보면 다음과 같다.
에너지 회수 회로부(600)는 전압 저장용 캐패시터부(C1)와 에너지 공급 제어 용 스위치부(S1)와 에너지 회수 제어용 스위칭부(S2) 및 제 1, 2 인덕터부(L1, L2)를 포함한다. 여기서 역전류 차단용 제 1, 2 다이오드부(D1, D2)를 더 포함할 수 있다.
여기서, 전압 저장용 캐패시터부(C1)에는 스캔 전극(Y)으로 공급될 전압이 미리 저장되고, 이렇게 저장된 전압은 에너지 공급 제어용 스위치부(S1)가 온 되는 경우에, 에너지 공급 제어용 스위치부(S1)와 제 1 다이오드부(D1)와 제 1 인덕터부(L1)를 경유하여 스캔 전극(Y)으로 공급된다. 이와 같이, 에너지 공급 제어용 스위치부(S1)와 제 1 다이오드부(D1)와 제 1 인덕터부(L1)를 경유하는 경로를 에너지 공급 경로라 한다.
또한, 에너지 회수 제어용 스위치부(S2)가 온 되는 경우에, 스캔 전극(Y)의 무효 에너지가 제 2 인덕터부(L2)와 제 2 다이오드부(D2)와 에너지 회수 제어용 스위치부(S2)를 경유하여 전압 저장용 캐패시터부(C1)로 회수된다. 이와 같이, 제 2 인덕터부(L2)와 제 2 다이오드부(D2)와 에너지 회수 제어용 스위치부(S2)를 경유하는 경로를 에너지 회수 경로라 한다.
이와 같이, 에너지 공급 경로와 에너지 회수 경로에 각각 서로 다른 인덕터부를 배치한 이유는 에너지 회수 회로부(600)에서 발생하는 열의 양을 줄이기 위해서이다.
보다 상세히 설명하면, 에너지의 공급 시에는 전압 저장용 캐패시터부(C1)에 저장된 전압이 제 1 인덕터부(L1)를 경유하여 스캔 전극(Y)으로 공급되기 때문에, 제 1 인덕터부(L1)에 편중되어 열이 발생한다.
반면에, 에너지 회수 시에는 스캔 전극(Y)의 무효 전압이 제 2 인덕터부(L2)를 경유하여 전압 저장용 캐패시터부(C1)로 회수되기 때문에, 제 2 인덕터부(L2)에 편중되어 열이 발생한다.
이와 같이, 에너지 공급 시와 에너지 회수 시로 열이 분산되면 하나의 인덕터부로 에너지 회수 및 에너지 공급 과정을 수행하는 경우에 비해 발생하는 전체 열이 감소되고, 이에 따라 에너지 회수 회로부의 열적 손상을 억제하고, 구동 안정성을 향상시킬 수 있게 된다.
한편, 스캔 및 하강 램프 공통 공급 제어부(650)는 스캔 드라이브 집적회로부(670)로 부극성 스캔 전압(-Vy) 및 하강 램프 파형의 공급을 제어한다.
이러한, 스캔 및 하강 램프 공통 공급 제어부(650)는 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)와, 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)의 게이트(Gate) 단자에 접속되는 제 2 가변 저항부(VR2)를 포함한다.
바람직하게는, 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)의 소스(Source) 단자는 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치(S10)와 접속되고, 드레인(Drain) 단자는 부극성 스캔 전압을 발생시키는 부극성 스캔 전압원과 접속된다.
여기서 더욱 바람직하게는, 스캔 및 하강 램프 공통 공급 제어부(650)에 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8) 외에 전압 안정용 캐패시터부(C3)가 더 포함된다.
이러한, 전압 안정용 캐패시터부(C3)는 그 일단이 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)와 부극성 스캔 전압(-Vy)을 공급하는 부극성 스캔 전압원(-Vy)과 공통 접속되고, 일단은 기저 전압 공급 제어부(620)와 서스테인 전압 공급 제어부(610)와 상승 램프 공급 제어부(630)와 블로킹부(660)와 에너지 회수 회로부(600)와 공통 접속된다.
이러한 전압 안정용 캐패시터부(C3)는 부극성 스캔 전압원(-Vy)으로부터 공급되는 부극성 스캔 전압(-Vy)을 저장함으로써, 스캔 및 하강 램프 공통 공급 제어부(650)가 안정적으로 하강 램프 또는 부극성 스캔 전압(-Vy)을 스캔 전극(Y)으로 공급할 수 있게 한다.
이러한, 스캔 및 하강 램프 공통 공급 제어부(650)에서는 부극성 스캔 전압(-Vy)을 공급하기 위한 스위칭 제어 신호와, 하강 램프 펄스(Ramp-Down)의 전압을 공급하기 위한 스위칭 제어 신호가 모두 필요하다.
이와 같이, 부극성 스캔 전압(-Vy)을 공급하기 위한 스위칭 제어 신호와, 하강 램프 펄스(Ramp-Down)의 전압을 공급하기 위한 스위칭 제어 신호를 고려한 스캔 및 하강 램프 공통 공급 제어부(650)의 구성을 도 6b에 나타내었다.
도 6b를 살펴보면, 스캔 및 하강 램프 공통 공급 제어부(650)는 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)의 게이트 단자에 하강 램프 공급용 제어 신호 입력단(①)과 부극성 스캔 전압(-Vy) 공급용 제어 신호 입력단(②)이 접속된다.
여기서, 하강 램프 공급용 제어 신호 입력단(①)에는 제 2 가변 저항부(VR2)가 배치되고, 부극성 스캔 전압(-Vy) 공급용 제어 신호 입력단(②)에는 가변 저항 부가 배치되지 않는다.
하강 램프 공급 시에는 하강 램프 공급용 제어 신호 입력단(①)으로 하강 램프 공급 제어 신호가 입력되고, 이에 따라 제 2 가변 저항부(VR2)에 의해 전압이 점진적으로 하강하는 하강 램프가 스캔 전극(Y)으로 공급되는 것이다. 보다 상세하게는, 이러한 하강 램프 공급 제어용 스위치(S8)가 온(On) 되고 하강 램프 공급용 제어 신호 입력단(①)으로 하강 램프 공급 제어 신호가 입력되는 경우에 하강 램프 공급 제어용 스위치(S8)의 채널(Channel) 폭이 제 2 가변 저항부(VR2)에 의해 조절되면서 전압이 점진적으로 하강하는 하강 램프가 발생되고, 이러한 하강 램프가 스캔 전극(Y)으로 공급되는 것이다.
부극성 스캔 전압(-Vy)의 공급 시에는 부극성 스캔 전압(-Vy) 공급용 제어 신호 입력단(②)으로 부극성 스캔 전압(-Vy) 공급 제어 신호가 입력되고, 이에 따라 부극성 스캔 전압(-Vy)이 스캔 전극(Y)으로 공급되는 것이다.
한편, 도 6a의 부호 610의 서스테인 전압 공급 제어부는 서스테인 전압 공급 제어용 스위치부(S3)를 포함하고, 이러한 서스테인 전압 공급 제어용 스위치부(S3)를 이용하여 스캔 전극(Y)으로의 서스테인 전압(Vs)의 공급을 제어한다.
기저 전압 공급 제어부(620)는 기저 전압 공급 제어용 스위치부(S4)를 포함하고, 이러한 기저 전압 공급 제어용 스위치부(S4)를 이용하여 스캔 전극(Y)으로의 기저 전압(GND)의 공급을 제어한다.
상승 램프 공급 제어부(630)는 상승 램프 공급 제어용 스위치부(S5)와 이러한 상승 램프 공급 제어용 스위치부(S5)의 게이트 단자에 접속되는 제 1 가변 저항 부(VR1)를 포함하고, 이러한 상승 램프 공급 제어용 스위치부(S5)와 제 1 가변 저항부(VR1)를 이용하여 스캔 전극(Y)으로의 상승 램프 전압의 공급을 제어한다.
여기서, 기저 전압 공급 제어부(620)와 스캔 및 하강 램프 공통 공급 제어부(650)의 사이에는 블로킹부(660)가 더 포함되는 것이 더욱 바람직하다.
이러한 블로킹부(660)는 블로킹 스위치부(S7)를 포함하고, 이러한 블로킹 스위치부(S7)를 이용하여 스캔 및 하강 램프 공통 공급 제어부(650)로부터 기저 전압 공급 제어부(620)를 거쳐 접지(GND)로 흐르는 역전류를 막는다.
여기서, 서스테인 전압 공급 제어부(610)의 일단은 서스테인 전압(Vs)을 발생시키는 서스테인 전압원 및 상승 램프 공급 제어부(630)의 일단과 공통 접속되고, 타단은 상승 램프 공급 제어부(630)의 타단과 기저 전압 공급 제어부(620)의 일단 및 에너지 회수 회로부(600)의 일단과 공통 접속된다. 아울러 에너지 회수 회로부(600)의 타단 및 기저 전압 공급 제어부(620)의 타단은 접지(GND)된다.
한편, 이상에서는 본 발명의 플라즈마 디스플레이 장치의 구동부에 사용되는 스위칭 소자들이 전계 효과 트랜지스터(Field Effect Transistor : FET)인 경우만을 도시하고 설명하였지만, 절연 게이트 양극성 트랜지스터(Insulated Gate Bipolar Transistor : IGBT) 등의 다른 트랜지스터도 적용 가능한 것이다.
이상에서 설명한 본 발명의 플라즈마 디스플레이 장치의 구동부의 동작을 첨부된 도 8을 결부하여 살펴보면 다음과 같다.
도 8은 본 발명의 플라즈마 디스플레이 장치의 구동부의 동작의 일례를 설명하기 위한 도면이다.
도 8을 참조하면, 먼저, 도 6a의 기저 전압 공급 제어부(620)의 기저 전압 공급 제어용 스위치(S4), 블로킹부(660)의 블로킹 스위치부(S7) 및 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10)가 온 되면, 플라즈마 디스플레이 패널의 스캔 전극(Y)으로 기저 전압이 공급된다. 그러면, 도 8의 d1기간의 이전과 같이 스캔 전극(Y)의 전압이 기저 레벨(GND)의 전압이 된다.
이후, d1기간에서는 블로킹부(660)의 블로킹 스위치부(S7)가 온 된 상태에서, 상승 램프 공급 제어부(630)의 상승 램프 공급 제어용 스위치부(S5)가 온 되면, 상승 램프 공급 제어용 스위치(S5)의 채널(Channel) 폭이 제 1 가변 저항부(VR1)에 의해 조절되면서 전압이 점진적으로 상승하는 상승 파형이 발생되고, 이러한 상승 파형이 스캔 전극(Y)으로 공급된다. 그러면 도 8의 d1기간에서와 같이 스캔 전극(Y)의 전압이 제 1 전압(V1)부터 제 2 전압(V2)까지 점진적으로 상승하게 된다.
여기서, d1기간에서의 최대 전압은 서스테인 전압원이 공급하는 서스테인 전압(Vs)으로서, 제 2 전압(V2)의 전압의 최고 값이 또한 서스테인 전압(Vs)인 것이다.
이후, d2기간에서는 블로킹부(660)의 블로킹 스위치부(S7)와 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10)가 온 된 상태에서, 상승 램프 공급 제어부(630)의 상승 램프 공급 제어용 스위치부(S5)가 오프 된다. 그리고, 에너지 회수 회로부(600)의 에너지 회수 제어용 스위칭부(S2)가 온 된다.
그러면, 스캔 전극(Y)의 무효 전압 성분이 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10), 블로킹부(660)의 블로킹 스위치부(S7), 제 2 인덕터부(L2), 제 2 다이오드부(D2), 에너지 회수 제어용 스위칭부(S2)를 거쳐 전압 저장용 캐패시터부(C1)에 저장되며 아울러, 스캔 전극(Y)의 전압이 제 2 전압(V2)으로부터 제 1 전압(V1)까지 제 2 기울기로 하강하게 되는 것이다.
이와 같은 d2기간에서의 동작은 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)에 서스테인 펄스를 공급하기 위한 동작과 대략 동일하다. 보다 자세히 표현하면, 이러한 d2기간에서의 동작은 앞서 설명한 도 5에서의 (b)의 서스테인 펄스의 전압 회수 기간(d2)에서의 동작과 동일한 것이다.
이에 따라, 제 1 리셋 펄스의 제 2 기울기가 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 공급되는 서스테인 펄스의 전압 회수 기간(d2)의 기울기와 대략 동일하게 되는 것이다.
이러한 과정을 통해 앞서 설명한 d1, d2기간에서 제 1 리셋 펄스가 공급되는 것이다.
다음, d3기간에서는 기저 전압 공급 제어부(620)가 온 된다. 그러면, 스캔 전극(Y)의 전압이 기저 전압(GND)으로 설정된다.
다음, d4기간에서는 블로킹부(660)의 블로킹 스위치부(S7)와 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10)와 에너지 회수 회로부(600)의 에너지 회수 제어용 스위칭부(S2)와 기저 전압 공급 제어부(620)가 오프 된다. 그리고, 스캔 드라이브 집적회로부(670)의 스캔 탑 스위치부(S9)가 온 된다.
그러면, 스캔 기준 전압원으로부터 공급되는 스캔 기준 전압(Vsc)이 스캔 기 준 전압 공급 제어부(640)를 통해 스캔 전극(Y)으로 공급된다. 이에 따라 스캔 전극(Y)의 전압이 스캔 기준 전압(Vsc)까지 급격히 상승하게 된다. 이에 따라 제 2 리셋 펄스의 제 3 전압(V3)은 스캔 기준 전압(Vsc)과 동일한 전압인 것이다.
이후, 블로킹부(660)의 블로킹 스위치부(S7)와 상승 램프 공급 제어부(630)의 상승 램프 공급 제어용 스위치부(S5)와 스캔 드라이브 집적회로부(670)의 스캔 바텀 스위치부(S10)가 온 되면, 상승 램프 공급 제어용 스위치(S5)의 채널(Channel) 폭이 제 1 가변 저항부(VR1)에 의해 조절되면서 전압이 점진적으로 상승하는 상승 파형이 발생되고, 이러한 상승 파형이 스캔 전극(Y)으로 공급된다. 그러면 도 8의 d4기간에서와 같이 스캔 전극(Y)의 전압이 제 3 전압(V3)부터 제 4 전압(V4)까지 점진적으로 상승하게 된다.
여기서, d4기간에서의 최대 전압은 서스테인 전압원이 공급하는 서스테인 전압(Vs)과 스캔 기준 전압원이 공급하는 스캔 기준 전압(Vsc)의 합이다.
이후, d5기간에서는 스캔 드라이브 집적회로부(670)의 스캔 탑 스위치부(S9)와 블로킹부(660)의 블로킹 스위치부(S7) 및 상승 램프 공급 제어부(630)의 상승 램프 공급 제어용 스위치부(S5)가 오프 되고, 스캔 드라이브 집적회로부(670)의 바텀 스위치부(S10)와 스캔 및 하강 램프 공통 공급 제어부(650)의 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)가 온 되거나 온 상태를 유지한다.
그러면, 플라즈마 디스플레이 패널의 스캔 전극(Y)으로 전압이 점진적으로 하강하게 된다.
여기 d5기간은 앞서 설명한 도 6b에서와 같이, 스캔 및 하강 램프 공통 공급 제어부(650)의 스캔 및 하강 램프 공통 공급 제어용 스위치부(S8)의 게이트 단자에 접속된 하강 램프 공급용 제어 신호 입력단(①)으로 하강 램프 공급 제어 신호가 입력되는 경우이다.
여기 d5기간에서 스캔 전극(Y)의 전압은 최저 부극성 스캔 전압(-Vy)까지 하강할 수 있다.
이상에서 설명한 방법으로 스캔 전극(Y)으로 제 1 리셋 펄스와 제 2 리셋 펄스를 공급할 수 있다.
한편, 이상에서 설명한 제 1 리셋 펄스와 제 2 리셋 펄스는 프레임의 모든 서브필드의 리셋 기간에서 스캔 전극(Y)으로 공급되는 것이 바람직한데, 이와는 다르게 프레임의 복수의 서브필드 중 소정의 서브필드에서만 리셋 기간에서 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되는 것도 가능한 것이다. 이에 대해 첨부된 도 9를 참조하여 살펴보면 다음과 같다.
도 9는 프레임의 복수의 서브필드 중 소정의 서브필드에서만 제 1 리셋 펄스와 제 2 리셋 펄스를 사용하는 방법의 일례를 설명하기 위한 도면이다.
도 9를 살펴보면, 하나의 프레임이 총 12개의 서브필드를 포함하는 경우, 이러한 12개의 서브필드 중에서 제 1, 2, 3, 4, 5, 6, 7, 8, 9 서브필드에서는 리셋 기간에 스캔 전극(Y)으로 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되고, 제 10, 11, 12 서브필드에서는 리셋 기간에 스캔 전극(Y)으로 제 3 리셋 펄스 하나만을 공급한다. 여기서 제 3 리셋 펄스는 제 2 리셋 펄스와 대략 동일한 파형이다.
다르게 설명하면, 프레임의 복수의 서브필드 중 계조 가중치가 가장 낮은 서 브필드부터 계조 가중치가 증가하는 순서로 소정 서브필드까지에서 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급된다.
이와 같이, 제 1 리셋 펄스와 제 2 리셋 펄스를 계조 가중치가 상대적으로 낮은 서브필드에서 사용하는 이유는, 계조 가중치가 상대적으로 낮은 서브필드에서는 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 공급되는 서스테인 펄스의 개수가 상대적으로 적기 때문에 그 다음 서브필드에서 방전이 불안정해질 가능성이 계조 가중치가 높은 서브필드에 비해 상대적으로 크기 때문이다.
이러한, 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급되는 서브필드 중 적어도 하나 이상에서는 제 1 리셋 펄스가 공급되기 이전에 전압이 점진적으로 하강하는 하강 파형을 스캔 전극(Y)으로 공급하는 것이 바람직하다.
이에 대해 첨부된 도 10을 참조하여 살펴보면 다음과 같다.
도 10은 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급되는 서브필드 중 적어도 하나 이상에서 제 1 리셋 펄스가 공급되기 이전에 전압이 점진적으로 하강하는 하강 파형이 스캔 전극(Y)으로 공급되는 방법의 일례를 설명하기 위한 도면이다.
도 10을 살펴보면, 영역 B에서와 같이 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급되는 서브필드 중 적어도 어느 하나의 서브필드에서는 제 1 리셋 펄스가 공급되기 이전에 스캔 전극(Y)으로 전압이 점진적으로 하강하는 하강 파형이 공급된다.
그리고 스캔 전극(Y)에 하강 파형이 공급되는 동안 서스테인 전극(Z)에는 리 셋 기간 이후의 어드레스 기간에서 서스테인 전극(Z)으로 공급되는 제 2 서스테인 바이어스 전압(Vz2)보다 높은 제 3 서스테인 바이어스 전압(Vz3)이 공급된다.
이에 따라, 방전 셀 내에서 스캔 전극(Y) 상에는 정극성의 벽 전하들이 쌓이고, 서스테인 전극(Z) 상에는 부극성의 벽 전하들이 쌓게 된다.
이와 같은 벽 전하의 분포 상태에서 제 1 리셋 펄스와 제 2 리셋 펄스가 스캔 전극(Y)으로 공급되면 리셋 방전이 더욱 용이하게 발생할 수 있고 이에 따라 초기화를 더욱 효과적으로 수행할 수 있다.
아울러, 이와 같은 벽 전하의 분포 상태에서는 제 1 리셋 펄스와 제 2 리셋 펄스의 전압을 더 낮추어도 리셋 방전을 발생시켜 초기화를 수행할 수 있다.
여기서, 제 3 서스테인 바이어스 전압(Vz3)은 어드레스 기간 이후의 서스테인 기간에서 스캔 전극(Y) 및/또는 서스테인 전극(Z)으로 공급되는 서스테인 펄스의 전압(Vs)과 대략 동일한 것이 바람직하다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서 상세히 설명한 본 발명의 디스플레이 장치는 스캔 전극(Y)으로 제 1 리셋 펄스와 제 2 리셋 펄스를 공급함으로써, 패턴의 영상이 일정시간 이상 동일한 화면상에 표시되더라도 잔상의 발생을 방지하는 효과가 있다.

Claims (11)

  1. 서로 나란한 스캔 전극과 서스테인 전극이 형성된 플라즈마 디스플레이 패널과,
    프레임의 복수의 서브필드 중 적어도 어느 하나의 서브필드의 초기화를 위한 리셋 기간에서는 제 1 전압부터 제 2 전압까지 제 1 기울기로 점진적으로 상승한 이후 상기 제 2 전압부터 제 1 전압까지 제 2 기울기로 하강하는 제 1 리셋 펄스와, 상기 제 1 전압부터 제 3 전압까지 급격히 상승한 이후에 제 3 전압부터 제 4 전압까지 제 3 기울기로 점진적으로 상승하는 제 2 리셋 펄스를 상기 스캔 전극으로 공급하는 구동부
    를 포함하는 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 구동부는
    상기 스캔 전극에 제 1 리셋 펄스와 제 2 리셋 펄스를 공급하는 동안 상기 서스테인 전극에는 상기 리셋 기간 이후의 어드레스 기간에서 서스테인 전극으로 공급되는 제 2 서스테인 바이어스 전압보다 낮은 제 1 서스테인 바이어스 전압을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제 2 항에 있어서,
    상기 제 1 서스테인 바이어스 전압은 그라운드 레벨(GND)의 전압과 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제 1 항에 있어서,
    상기 제 1 기울기와 제 3 기울기는 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 제 1 항에 있어서,
    상기 제 2 전압은 제 3 전압보다 더 크거나 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 제 1 항에 있어서,
    상기 제 4 전압은 상기 제 2 전압의 1배 초과 3배 이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  7. 제 1 항에 있어서,
    상기 제 2 기울기는
    상기 리셋 기간 이후의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 펄스의 전압 회수 기간의 기울기와 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  8. 제 1 항에 있어서,
    상기 프레임의 복수의 서브필드 중 제 1 리셋 펄스와 제 2 리셋 펄스가 공급되는 서브필드는
    계조 가중치가 가장 낮은 서브필드부터 계조 가중치가 증가하는 순서로 소정 서브필드까지인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  9. 제 1 항에 있어서,
    상기 구동부는
    상기 제 1 리셋 펄스와 제 2 리셋 펄스를 공급하는 서브필드 중 적어도 어느 하나의 서브필드에서는
    상기 제 1 리셋 펄스를 공급하기 이전에 상기 스캔 전극으로 전압이 점진적으로 하강하는 하강 파형을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  10. 제 9 항에 있어서,
    상기 구동부는
    상기 스캔 전극에 하강 파형을 공급하는 동안 상기 서스테인 전극에는 상기 리셋 기간 이후의 어드레스 기간에서 서스테인 전극으로 공급되는 제 2 서스테인 바이어스 전압보다 높은 제 3 서스테인 바이어스 전압을 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  11. 제 10 항에 있어서,
    상기 제 3 서스테인 바이어스 전압은
    상기 어드레스 기간 이후의 서스테인 기간에서 상기 스캔 전극 또는 서스테인 전극으로 공급되는 서스테인 펄스의 전압(Vs)과 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
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