KR100690557B1 - 시스템 온 칩 디자인을 위한 컴포넌트로서의 독립프로세서 서브시스템 - Google Patents
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Abstract
Description
Claims (30)
- 통신 버스 장치를 포함하는 시스템 온 칩(System-On-Chip; SoC) 집적 회로(Integrated Circuit; IC)에서의 사용을 위한 마이크로프로세서 서브시스템(microprocessors subsystem)으로서,단일 프로세서 코어 어셈블리(single processor core assembly)로 형성되어, 일정한 프로세싱 기능을 구현하기 위한 작업들을 수행할 수 있는 둘 이상의 마이크로프로세서 장치들;상기 단일 프로세서 코어 어셈블리 내의 데이터 및 명령어들 중의 적어도 하나를 저장하기 위하여, 상기 서브시스템에서 상기 둘 이상의 마이크로프로세서 장치들과 연관된 저장 장치; 및상기 단일 프로세서 코어 어셈블리에 존재하며, 상기 둘 이상의 마이크로프로세서 장치들과 상기 SoC IC 통신 버스 장치 사이에서의 통신을 가능하게 하기 위한 상호 접속 수단(interconnect means) - 상기 상호 접속 수단에 의해 상기 단일 프로세서 코어 어셈블리가 상기 SoC IC의 컴포넌트들과 통신할 수 있음 -을 포함하는 마이크로프로세서 서브시스템.
- 제1항에 있어서, 상기 단일 프로세서 코어 어셈블리의 상기 둘 이상의 마이크로프로세서 장치들은 프로그램 제어 하에서 동작하여, 특정 세트의 기능들을 가능하게 하는 마이크로프로세서 서브시스템.
- 청구항 3은(는) 설정등록료 납부시 포기되었습니다.제1항에 있어서, 상기 상호 접속 수단은 파이버 채널 스위치(switch fabric)를 포함하는 마이크로프로세서 서브시스템.
- 청구항 4은(는) 설정등록료 납부시 포기되었습니다.제1항에 있어서, 상기 상호 접속 수단은 통신 버스(communication bus)를 포함하는 마이크로프로세서 서브시스템.
- 청구항 5은(는) 설정등록료 납부시 포기되었습니다.제2항에 있어서, 상기 SoC IC는 네트워크 프로세서 어셈블리인 마이크로프로세서 서브시스템 - 상기 마이크로프로세서 서브시스템은 패킷 통신 프로세싱 기능을 구현함 -.
- 청구항 6은(는) 설정등록료 납부시 포기되었습니다.제5항에 있어서, 상기 단일 프로세서 코어 어셈블리는파이버 채널(Fibre Channel), Gb 이더넷(Ethernet), 인피니밴드(Infiniband)를 포함하는 군으로부터 하나 이상을 포함하는 네트워크 통신 프로토콜에 따라 통신을 수신할 수 있는 하나 이상의 인터페이스 장치를 더 포함하는 마이크로프로세서 서브시스템.
- 청구항 7은(는) 설정등록료 납부시 포기되었습니다.제6항에 있어서, 상기 네트워크 프로세서 어셈블리는 DSP, 보조프로세서(coprocessor), 혼성 ASIC(Hybrid ASIC) 또는 다른 네트워크 프로세싱 구성(arrangement) 중의 하나로 구성되고, 상기 네트워크 프로세싱 어셈블리는네트워크 프로세싱 장치 및상기 네트워크 프로세싱 어셈블리의 컴포넌트들을 상기 네트워크 프로세싱 장치와 상호 접속시키기 위한 고속 로컬 버스 수단(high-speed local bus means)을 포함하는 마이크로프로세서 서브시스템.
- 청구항 8은(는) 설정등록료 납부시 포기되었습니다.제7항에 있어서, 상기 네트워크 프로세서 어셈블리의 컴포넌트들은 SRAM, DDR 제어기, PCI-X 브릿지(bridge), 직접 메모리 액세스(DMA) 장치, DMA 제어기, 하나 이상의 I/O 인터페이스 장치를 통해 외부 컴포넌트들과 인터페이스하기 위한 온-칩 주변 버스(On-chip Peripheral Bus; OPB) 및 이더넷 LAN 시스템으로의 데이터 링크 계층 인터페이스를 제공하기 위해 사용되는 MAC(Medium Access Control) 프로토콜 장치를 포함하는 군으로부터 선택된 하나 이상을 포함하는 마이크로프로세서 서브시스템.
- 제1항에 있어서, 상기 단일 프로세서 코어 어셈블리는 상기 마이크로프로세서 서브시스템 및 상기 SoC IC의 상기 통신 버스 장치 사이의 데이터 플로우를 가능하게 하기 위한 프로그래머블 프로세서 로컬 버스 브릿지 장치(programmable processor local bus bridge device)를 더 포함하는 마이크로프로세서 서브시스템.
- 청구항 10은(는) 설정등록료 납부시 포기되었습니다.제9항에 있어서, 상기 프로그래머블 프로세서 로컬 버스 브릿지 장치는 상기 단일 프로세서 코어 어셈블리를 구현하는 상기 SoC IC 장치를 통해 통신하는 두 개 의 통신 시스템들 사이의 신호화 프로토콜들(signaling protocols) 및 통신 신호들(communications signals)을 사용 가능하게 하는 마이크로프로세서 서브시스템.
- 청구항 11은(는) 설정등록료 납부시 포기되었습니다.제1항에 있어서, 상기 상호 접속 수단은 둘 이상의 마이크로프로세서 장치들에 대응하는 독립 스레드 군들(independent thread groups)을 함께 결합시키기 위한 크로스바 스위치(crossbar switch)를 포함하는 마이크로프로세서 서브시스템.
- 청구항 12은(는) 설정등록료 납부시 포기되었습니다.제1항에 있어서, 상기 서브시스템에서 상기 둘 이상의 마이크로프로세서 장치들과 연관된 상기 로컬 메모리 저장 장치는 로컬 SRAM 메모리, 메모리 캐시 및 서브 프로세서들을 함께 접속시키는 I 캐시 중의 하나 이상을 포함하는 마이크로프로세서 서브시스템.
- 청구항 13은(는) 설정등록료 납부시 포기되었습니다.제8항에 있어서, 상기 단일 프로세서 코어 어셈블리의 상기 둘 이상의 마이크로프로세서 장치들은 하나 이상의 네트워크 프로토콜 통신의 프로세싱을 처리하기 위하여 상기 SoC IC의 통신 버스 장치를 폴링(polling)하기 위한 수단을 포함하는 마이크로프로세서 서브시스템.
- 시스템-온-칩(SoC) 집적 회로(IC) 네트워크 프로세서로서,복수의 네트워크 프로세서 컴포넌트들 중에서 SoC 네트워크 프로세서 기능들을 제어하기 위한 네트워크 프로세서 코어(network processor core); 및상기 SoC 네트워크 프로세서 컴포넌트들 간의 통신을 가능하게 하도록 하기 위한 SoC 로컬 시스템 버스 장치를 포함하고,하나의 SoC 네트워크 프로세서 컴포넌트는 독립적인 멀티프로세서 서브시스템 코어를 포함하고,상기 독립적인 멀티프로세서 서브시스템 코어는i) 일정한 기능을 구현하는 적어도 하나의 마이크로프로세서ii) 데이터 및 명령어들 중의 적어도 하나를 저장하기 위한 적어도 하나의 메모리 저장 장치; 및iii) 둘 이상의 마이크로프로세서 장치들과 상기 SoC IC 로컬 시스템 버스 장치 간의 고속 통신을 가능하게 하기 위한 상호 접속 수단을 포함하며,상기 멀티프로세서 서브시스템 코어는 멀티-스레딩 네트워크 프로세싱 기능(multi-threading network processing capability)을 제공하는 프로세서.
- 제14항에 있어서, 상기 단일 SoC 멀티프로세서 서브시스템 코어는 파이버 채널, Gb 이더넷, 인피니밴드를 포함하는 군으로부터 하나 이상을 포함하는 네트워크 통신 프로토콜에 따라 통신을 수신할 수 있는 하나 이상의 인터페이스 장치를 더 포함하는 SoC IC 네트워크 프로세서.
- 청구항 16은(는) 설정등록료 납부시 포기되었습니다.제15항에 있어서, DSP, 보조프로세서, 혼성 ASIC 또는 다른 네트워크 프로세싱 구성 중의 하나로 구성되고, 상기 SoC 로컬 시스템 버스 장치는 상기 SoC 네트워크 프로세서 컴포넌트들을 상기 네트워크 프로세싱 코어와 상호 접속시키기 위한 고속 로컬 버스 수단인 SoC IC 네트워크 프로세서.
- 청구항 17은(는) 설정등록료 납부시 포기되었습니다.제16항에 있어서, 상기 네트워크 프로세서 컴포넌트들은 SRAM, DDR 제어기, PCI-X 브릿지, 직접 메모리 액세스(DMA) 장치, DMA 제어기, 하나 이상의 I/O 인터페이스 장치를 통해 외부 컴포넌트들과 인터페이스하기 위한 온-칩 주변 버스(On-chip Peripheral Bus; OPB) 및 이더넷 LAN 시스템으로의 데이터 링크 계층 인터페이스를 제공하기 위해 사용되는 MAC 프로토콜 장치를 포함하는 군으로부터 선택된 하나 이상을 포함하는 SoC IC 네트워크 프로세서.
- 제14항에 있어서, 상기 멀티프로세서 서브시스템 코어는 상기 마이크로프로세서 서브시스템 및 상기 SoC 로컬 시스템 버스 장치 사이의 데이터 플로우를 가능하게 하기 위한 프로그래머블 프로세서 로컬 버스 브릿지 장치를 더 포함하는 SoC IC 네트워크 프로세서.
- 청구항 19은(는) 설정등록료 납부시 포기되었습니다.제18항에 있어서, 상기 프로그래머블 프로세서 로컬 버스 브릿지 장치는 상기 단일 멀티프로세서 서브시스템 코어를 구현하는 상기 SoC IC 장치를 통해 통신하는 두 개의 통신 시스템들 간의 신호화 프로토콜들 및 통신 신호들을 사용 가능하게 하는 SoC IC 네트워크 프로세서.
- 청구항 20은(는) 설정등록료 납부시 포기되었습니다.제14항에 있어서, 상기 단일 멀티프로세서 서브시스템 코어의 상기 상호 접속 수단은 둘 이상의 마이크로프로세서 장치들에 대응하는 독립 스레드 군들을 함께 결합시키기 위한 크로스바 스위치를 포함하는 SoC IC 네트워크 프로세서.
- 제14항에 있어서, 상기 서브 시스템에서 상기 둘 이상의 마이크로프로세서 장치들과 연관된 상기 적어도 하나의 메모리 저장 장치는 로컬 SRAM 메모리, 메모리 캐시 및 상기 마이크로프로세서 장치들을 함께 접속시키기 위한 I 캐시 중의 하나 이상을 포함하는 SoC IC 네트워크 프로세서.
- 청구항 22은(는) 설정등록료 납부시 포기되었습니다.제21항에 있어서, 상기 단일 멀티프로세서 서브시스템 코어는 하나 이상의 네트워크 프로토콜 통신의 프로세싱을 처리하기 위하여 상기 SoC IC의 로컬 시스템 버스 장치를 폴링하기 위한 수단을 포함하는 SoC IC 네트워크 프로세서.
- 시스템-온-칩 프로세서 집적 회로로서,복수의 SoC 컴포넌트 장치들 중에서 SoC 프로세싱 기능들을 제어하기 위한 프로세서 코어; 및상기 SoC 컴포넌트 장치들 중에서 통신을 가능하게 하기 위한 SoC 로컬 시스템 버스 장치를 포함하고,하나의 SoC 컴포넌트 장치는 단일 독립 멀티프로세서 서브시스템 코어를 포함하고,상기 단일 독립 멀티프로세서 서브시스템 코어는각각의 다중 프로세서(multiple processor)가 프로세서 클러스터(processor cluster)를 형성하도록 로컬 메모리를 자신과 연관시키는, 복수의 다중 프로세서들; 및상기 SoC IC 내에서 각각의 프로세서 클러스터를 접속시키는 파이버 채널 스위치 수단을 포함하며,상기 단일 SoC 멀티프로세서 서브시스템 코어는 멀티스레딩 작업 프로세싱을 수행할 수 있는 집적 회로.
- 제23항에 있어서, 복수의 다중 프로세서들을 포함하는 상기 독립 멀티프로세서 서브시스템 코어는 기능적인 SoC 컴포넌트로서의 사용을 위해 소정의 기능 세트를 구현하고, 상기 SoC IC 내에서 각각의 프로세서 클러스터를 접속시키는 상기 파이버 채널 스위치는 상기 코어 내의 상기 기능에 의해 요구되는 프로세싱을 위한 데이터 트래픽 플로우(data traffic flow)를 가능하게 하는 SoC 프로세서 집적 회로(IC).
- 청구항 25은(는) 설정등록료 납부시 포기되었습니다.제23항에 있어서, 상기 파이버 채널 스위치 수단은 상기 코어 내의 상기 기능에 의해 요구되는 프로세싱을 위한 명령어 트래픽 및 데이터 트래픽의 통신을 더 가능하게 하는 SoC 프로세서 집적 회로.
- 제23항에 있어서, 상기 파이버 채널 스위치 수단은 상기 멀티프로세서 서브시스템 코어 내에서 셀 방식(cellular fashion)으로 독립 스레드 군들을 조직(organizing)하는 크로스바 스위치(crossbar switch)를 포함하는 SoC 프로세서 집적 회로.
- 청구항 27은(는) 설정등록료 납부시 포기되었습니다.제26항에 있어서, 상기 복수의 다중 프로세서들의 각각은 로컬 SRAM 메모리, ALU(Arithmetic Logic Unit) 또는 FPU(Floating Point Unit) 중의 하나와 그에 대응되는 데이터 캐시, 및 프로세서 스레드 그룹들을 함께 접속시키기 위한 I 캐시(Instruction Cache)를 포함하는 SoC 프로세서 집적 회로.
- 청구항 28은(는) 설정등록료 납부시 포기되었습니다.제26항에 있어서, 상기 단일 독립 멀티프로세서 서브시스템 코어는 마이크로프로세서, DSP, 보조프로세서, 혼성 ASIC 또는 다른 네트워크 프로세싱 구성 중의 하나를 포함하는 SoC 구현으로 기능하는 SoC 프로세서 집적 회로.
- 청구항 29은(는) 설정등록료 납부시 포기되었습니다.제26항에 있어서, 상기 프로세서 클러스터의 상기 연관된 로컬 메모리는 로컬 SRAM 또는 온-칩 DRAM을 포함하는 SoC 프로세서 집적 회로.
- 청구항 30은(는) 설정등록료 납부시 포기되었습니다.제26항에 있어서,버스 및 I/O 매체 접속들을 감독하기 위한 소프트웨어 폴링 접속 수단(software polling connection means)을 더 포함하고,상기 폴링 접속 수단은 하나 이상의 네트워크 프로토콜을 처리하기 위하여 상기 SoC 로컬 시스템 버스 장치를 폴링하는 SoC 프로세서 집적 회로.
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