KR100227425B1 - 1픽셀 오차를 제거한 이중화면 표시장치 - Google Patents

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Abstract

1픽셀 오차를 제거한 이중화면 표시장치에 관한 것으로, 특히 화면속에 또하나의 작은 화면을 표시할 때 각 주사선의 트리거 시점을 일치시켜 작은 화면의 세로변이 고르게 보이도록 하는 1픽셀 오차를 제거한 표시장치에 관한 것이다.
영상신호에서 수평동기신호를 분리하여 그 수평동기신호의 하강엣지에서 영상신호의 발생싯점까지의 40클록신호를 이용하여 동기 카운터로 카운트하여 그 값이 비교부에 래치된 값과 동일한 경우에 40클록신호를 4 분주한 10

Description

1픽셀 오차를 제거한 이중화면 표시장치
본 발명은 1픽셀 오차를 제거한 표시장치에 관한 것으로, 특히 화면속에 또하나의 작은 화면을 표시할 때 각 주사선의 트리거 시점을 일치시켜 작은 화면의 세로변이 고르게 보이도록 하는 1픽셀 오차를 제거한 표시장치에 관한 것이다.
일반적으로, 하나의 화면을 모니터에 표시하면서 다른 화면을 그 화면속에 겹쳐서 표시하는 때에 제1도에 도시된 바와 같이 화면(10)속에 겹쳐서 보이는화면(11)의 세로변이 거칠게 보인다. 그 이유를 동기신호와 영상신호의 A/D변환 시점의 시간관계를 보이는 타이밍 차트를 도시한 제2도(a)-제2(e)와 종래의 이중화면 표시장치의 구성을 보이는 블록도를 도시한 제3도를 참고로 하여 설명하면 다음과 같다.
입력되는 영상신호(a)를 입력받는 동기분리부(39)는 수평동기신호(b)를 분리하여 멀티바이브레이터(38)에 출력한다. 수평동기신호(b)의 하강엣지에서 멀티바이브레이터(38)는 "1"신호(c)를 출력하여 동기카운터(37)를 인에이블시킨다. 상기 동기카운터(37)에서 출력되는 카운트 데이타는 래치부(40)에서 출력되는 데이타와 비교되어 동일한 데이타가 될 경우에 수평픽셀 카운터(33)로 인에이블신호(d)를 출력하여 카운트 데이타를 출력하게 한다. 수평픽셀 카운터(33)는 소정숫자까지 카운트완료하면 다시 처음부터 카운트하는 링카운터와 같은 카운터로서 프레임 메모리에 어드레스(A0-A7)를 출력하여 데이타가 저장되는 어드레스를 지정해 준다.
상기와 같이 지정된 어드레스에 A/D변환부(34)에서 출력되는 디지털 데이타가 저장된다. 이렇게 저장된 영상 디지털 데이탈르 동기픽셀 카운터(33)가 수평공기신호를 512개 카운트 완료하여 완료 카운트 데이타(A8)(수평블랭크 신호(H-BLANK)를 출력하면 앤드게이트(U1)는 수직 블랭크 신호 발생부(41)에서 출력되는 수직블랭크신호(V-BLANK)와 그 신호를 앤드하여 D/A변환부(35)를 인에이블시켜 프레임 메모리(32)에 저장된 영상 데이타를 읽어들여 컴퓨터의 모니터에 표시한다.
상기와 같이 종래의 이중화면 표시장치는 수평동기신호의 하강엣지에서 영상신호가 발생하는 싯점까지 동기 카운터로 카운트하여 그 카운트 데이타가 래치부에서 래치한 데이타와 동일할 때, 프레임 메모리로 메모리 어드레스를 출력하여 프레임 메모리에 영상데이타를 저장하고 그 저장된 영상 데이타를 다시 읽어들여 D/A변환하여 영상신호로서 출력하게 된다.
그런데 A/D변환 동작은 10기준 클록신호에 의해 동작하므로 제4(a)도 및(제4(b)에 도시된 바와 같이 10기준 클록신호(제4(b))도의 펄스(P2)와 펄스(P3)사이에서 수평동기신호(제4(a)도)의 하강엣지가 발생하는 경우 다음 펄스의 상승엣지에서 프레임 메모리의 어드레스가 발생하고 A/D변환 동작이 이루어진다. 따라서 수평동기신호의 하강엣지와 기준클록의 상승엣지 사이의 시간간격(t0)에 따라 수평동기신호의 하강엣지에서 영상신호가 발생하는 싯점까지 시간을 카운트하는 카운트 시작싯점이 각 수평주사선마다 틀리게 되어 화면속의 화면의 세로변이 거칠게 된다.
본 발명은 상기와 같은 문제점을 해결하기 위한 것으로, 본 발명의 목적은 수평동기신호의 하강엣지에서 영상신호가 발생하는 시점까지 시간을 40클록신호로 카운트하여 A/D변환 시점을 검출하여 화면속의 화면의 세로변을 고르게 표시하도록 하는 1픽셀 오차를 제거한 표시장치를 제공하는 것이다.
상기의 목적을 달성하기 위하여 본 발명에 의한 장치는 색부반송파 주파수의 수십배의 속도로 기준 클록신호를 발생시키는 기준 클록발생부와, 상기 기준 클록 발생부에서 출력되는 기준 클록신호를 소정 분주비로 분주하여 출력하는 클록 카운터와, 영상신호를 입력받아 상기 크록 카운터에서 출력되는 클록신호를 A/D변환 시작신호로 하여 디지털 데이타로 변환하는 A/D 변환부와, 상기 클록카운트에서 출력되는 클록신호를 카운트하여 어드레스 데이타를 출력하는 수평픽셀 카운터와, 상기 A/D 변환부에서 출력되는 디지털 데이타를 입력받아 상기 수평픽셀 카운터로 부터 입력되는 어드레스에 데이타를 저장하는 프레임 메모리부와, 상기 영상신호를 입력받아 동기신호를 분리하는 동기분리부와, 상기 동기분리부에서 출력되는 수평동기 신호에 의해 카운트 인에이블신호를 발생시키는 카운트 인에이블신호 발생부와, 상기 카운트 인에이블신호 발생부에서 출력되는 카운트 인에이블신호를 입력받아 카운트를 시작하는 동기 카운터와, 컴퓨터에서 출력되는 데이타를 래치하는 래치부와, 상기 동기 카운터에서 출력되는 카운트 데이타와 상기 래치부에서 출력되는 래치데이타가 일치하는 때에 상기 클록카운터를 클리어 하는 신호를 출력하는 비교부와, 영상신호에서 수직블랭크 신호를 분리하여 출력하는 수직 블랭크 신호 발생부와, 상기 수직 블랭크 신호 발생부에서 출력되는 수직 블랭크 신호와 상기 수평 픽셀 카운터에서 출력되는 수직블랭크 신호를 앤드연산하여 출력하는 앤드 게이트와, 상기 앤드 게이트에서 출력되는 신호를 입력받아 상기 프레임 메모리에서 데이타를 읽어들여 아날로그 영상신호를 출력하는 D/A 변환부와, 상기 래치부에서 상기 수평동기신호로부터 영상신호의 발생싯점까지의 카운트 데이타를 출력하고, 상기 프레임 메모리에 저장된 데이타를 상기 D/A 변환부를 거쳐 읽어들여 모니터에 표시하는 컴퓨터로 구성된다.
제1도는 하나의 화면을 모니터에 표시하면서 다른 화면을 겹쳐서 표시한 화면의 일실시예이다.
제2(a)-제2(e)도는 동기신호와 영상신호의 A/D변환 시점의 시간관계를 보이는 타이밍차트이다.
제3도는 종래의 이중화면 표시장치의 구성을 보이는 블록이다.
제4(a)도 제4(b)도는 10기준 클록신호와 수평동기신호의 발생을 보이는 타이밍 차트이다.
제5도는 본 발명에 의한 1 픽셀 오차를 제거한 이중화면 표시장치의 구성을 보이는 블록도이다.
제6도는 수평동기 신호의 하강엣지에서 10클록신호와 40클록신호의 시간 관계를 보이는 타이밍 차트이다.
* 도면의 주요부분에 대한 부호의 설명
51 : 기준클록 발생부 52 : 클록 카운터
53 : 동기분리부 54 : A/D변환부
55 : 수평픽셀 카운터 56 : 카운트 인에이블 신호 발생부
57 : 프레임 메모리 58 : D/A 변환부
59 : 동기 카운터 60 : 래치부
61 : 비교부 62 : 수직블랭크 신호 발생부
이하 본 발명을 도면을 참조하여 상세히 설명한다.
제5도에 본 발명에 의한 표시장치의 구성을 보이는 블록도가 도시된다. 본 발명에 의한 장치는 색부반송파 주파수의 수십배의 속도로 기준 클록신호를 발생시키는 기준 클록발생부(51)와, 상기 기준 클록 발생부(51)에서 출력되는 기준 클록신호를 소정 분주비로 분주하여 출력하는 클록 카운터(52)와, 영상신호를 입력받아 상기 클록 카운터(52)에서 출력되는 클록신호를 A/D변환 시작신호로 하여 디지털 데이타로 변환하는 A/D 변환부(54)와, 상기 클록카운터(52)에서 출력되는 클록신호를 카운트하여 어드레스 데이타를 출력하는 수평픽셀 카운터(55)와, 상기 A/D 변환부(54)에서 출력되는 디지털 데이타를 입력받아 상기 수평픽셀 카운터(55)로부터 입력되는 어드레스에 데이타를 저장하는 프레임 메모리부(57)와, 상기 영상신호를 입력받아 동기신호를 분리하는 동기분리부(53)와, 상기 동기분리부(53)에서 출력되는 수평동기 신호에 의해 카운트 인에이블신호를 발생시키는 카운트 인에이블신호 발생부(56)와, 상기 카운트 인에이블신호 발생부(56)에서 출력되는 카운트 인에이블신호를 입력받아 카운트를 시작하는 동기 카운터(59)와, 컴퓨터에서 출력되는 데이타를 래치하는 래치부(60)와, 상기 동기 카운터(59)에서 출력되는 카운트 데이타와 상기 래치부(60)에서 출력되는 래치 데이타가 일치하는 때에 상기 클록카운터(52)를 클리어 하는 신호를 출력하는 비교부(61)와, 영상신호에서 수직블랭크 신호를 분리하여 출력하는 수직 블랭크 신호 발생부(62)와, 상기 수직 블랭크 신호 발생부(62)에서 출력되는 수직 블랭크 신호와 상기 수평 픽셀 카운터(55)에서 출력되는 수평블랭크 신호를 앤드연산하여 출력하는 앤드 게이트(U2)와, 상기 앤드 게이트(U2)에서 출력되는 신호를 입력받아 상기 프레임 메모리(57)에서 데이타를 읽어들여 아날로그 영상신호를 출력하는 D/A 변환부(58)와, 상기 래치부(60)에서 상기 수평동기신호로부터 영상신호의 발생싯점까지의 카운트 데이타를 출력하고, 상기 프레임 메모리(57)에서 저장된 데이타를 상기 D/A 변환부(58)를 거쳐 읽어들여 모니터(도시생략)에 표시하는 컴퓨터(도시생략)로 구성된다.
이하 본 발명의 작용, 효과를 설명한다.
외부 신호원(예; 텔레비젼의 영상신호를 출력하는 인쇄회로기판등)으로 부터 영상신호가 A/D 변환부(54)에서 기준클록 발생부(51)에서 출력되는 예를들어 40기준 클록신호(CLK1)는 클록 카운터(52)에서 4 분주되어 10클록신호(CLK2)로 A/D 변환부(54)와 수평픽셀 카운터(55)에 입력된다. A/D 변환부(54)는 클록신호(CLK2)를 A/D 변환 시작신호로서 입력받아 10의 속도로 영상신호를 A/D 변환하여 디지털 데이타로 변환하여 프레임 메모리(57)에 출력한다. 또한 수평픽셀 카운터(55)는 클록 카운터(52)에서 출력되는 클록신호(CLK2)를 카운트하여 그 카운트 데이타를 메모리부(25)의 저장 어드레스 프레임 메모리(57)에 출력한다.
이때 동기분리부(53)에서 출력되는 수평동기신호는 카운트인에블 신호 발생부(56)를 동작시켜 인에이블신호를 동기 카운터(59)에 출력한다. 인에이블신호를 입력받은 동기 카운터(59)는 40기준클록신호를 카운트하여 카운트 데이타를 출력하며, 래치부(60)는 컴퓨터에서 입력되는 래치 데이타를 비교부(61)로 출력한다. 비교부(61)는 동기카운터(59)가 출력하는 카운트 데이타와 래치된 데이타가 일치할 때 인에이블 신호를 클록카운터(52)에 출력하여 클록카운터(52)에서 출력되는 10클록신호(CLK2)가 A/D 변환부(54)와 수평픽셀 카운터(55)에 입력된다. 10클록신호(CLK2)의 입력에 의해 A/D 변환부(54)는 A/D 변환을 시작하고 수평픽셀 카운터(55)는 카운트 데이타를 프레임 메모리(57)에 저장 어드레스 출력하여 A/D 변환된 디지털 데이타가 그 어드레스에 저장하도록 한다.
한편 수직 블랭크신호 발생부(62)는 영상신호에서 수직블랭크 신호를 분리하여 수직 블랭크신호(V-BLANK)를 앤드 게이트(U2)로 출력한다. 앤드 게이트(U2)는 수평픽셀 카운터(55)가 출력하는 수평 픽셀 카운트 완료신호(A8)와 수직 블랭크 신호(V-BLANK)를 앤드하여 그 출력신호로 D/A 변환부(58)를 동작시키고, 프레임 메모리(57)를 읽기모드로 전환하여 수평픽셀 카운터(55)에서 출력되는 어드레스의 데이타를 프레임 메모리(57)로 부터 읽어들여 D/A 변환부(58)로 입력되게 한다. D/A변환부(58)는 프레임메모리(57)에서 출력되는 디지탈 데이타를 아날로그 영상신호로 변환하여 컴퓨터로 출력하여 그 모니터에 표시되게 하여 화면 속의 화면을 표시한다.
제6도에 수평동기 신호의 하강엣지에서 10클록신호와 40클록신호의 시간관계를 보이는 타이밍 차트가 도시된다.
도시된 바와 같이 40기준 클록신호(a)로 수평동기 신호의 하강엣지에서 카운트함으로써 10클록신호(b)로 카운트할 때에 최대 4 배까지 빠르게 카운트를 시작할 수 있다. 즉 수평동기 신호의 하강엣지에서 동기카운터(59)가 카운트하는 시간이 10클록신호를 사용할 때 걸리는 시간(t0)보다 40클록신호를 사용할 때 걸리는 시간(t1)이 더 짧게 된다.
이상 설명한 바와 같이 본 발명에 의하면 수평동기신호의 하강엣지에서 영상신호가 발생하는 싯점까지 카운트하기 위하여 사용되는 동기 카운트를 40클록신호로 카운트함으로써 10클록신호로 카운트할 때보다 최대 4 배 빨리 카운트싯점을 당길수 있게 되어 화면속의 화면이 세로변이 고르게 표시되어 화면의 정밀도를 더 높게 할 수 있다.

Claims (3)

  1. 이중화면 표시장치에 있어서, 색부반송파 주파수의 수십배의 속도로 기준 클록신호를 발생시키는 기준 클록발생부와, 상기 기준 클록 발생부에서 출력되는 기준 클록신호를 소정 분주비로 분주하여 출력하는 클록 카운터와, 영상신호를 입력받아 상기 클록 카운터에서 출력되는 클록신호를 A/D변환 시작신호로 하여 디지탈 데이타로 변환하는 A/D 변환부와, 상기 클록카운트에서 출력되는 클록신호를 카운트하여 어드레스 데이타를 출력하는 수평픽셀 카운터와, 상기 A/D 변환부에서 출력되는 디지털 데이타를 입력받아 상기 수평픽셀 카운터로 부터 입력되는 어드레스에 데이타를 저장하는 프레임 메모리부와, 상기 영상신호를 입력받아 동기신호를 분리하는 동기분리부와, 상기 동기분리부에서 출력되는 수평동기 신호에 의해 카운트 인에이블신호를 발생시키는 카운트 인에이블신호 발생부와, 상기 카운트 인에이블신호 발생부에서 출력되는 카운트 인에이블신호를 입력받아 카운트를 시작하는 동기 카운터와, 컴퓨터에서 출력되는 데이타를 래치하는 래치부와, 상기 동기 카운터에서 출력되는 카운트 데이타와 상기 래치부에서 출력되는 래치 데이타가 일치하는 때에 상기 클록카운터를 클리어 하는 신호를 출력하는 비교부와, 영상신호에서 수직블랭크 신호를 분리하여 출력하는 수직 블랭크 신호 발생부와, 상기 수직 블랭크 신호 발생부에서 출력되는 수직 블랭크 신호와 상기 수평 픽셀 카운터에서 출력되는 수직블랭크 신호를 앤드연산하여 출력하는 앤드 게이트와, 상기 앤드 게이트에서 출력되는 신호를 입력받아 상기 프레임 메모리에서 데이타를 읽어들여 아날로그 영상신호를 출력하는 D/A 변환부와, 상기 래치부에서 상기 수평동기신호로 부터 영상신호의 발생싯점까지의 카운트 데이타를 출력하고, 상기 프레임 메모리에 저장된 데이타를 상기 D/A 변환부를 거쳐 읽어들여 모니터에 표시하는 컴퓨터로 구성되는 것을 특징으로 하는 1픽셀 오차를 제거한 이중화면 표시장치.
  2. 제1항에 있어서, 상기 동기 카운터는 상기 기준클록 발생부에서 출력되는 기준클록을 카운트하는 것을 특징으로 하는 1픽셀 오차를 제거한 이중화면 표시장치.
  3. 제1항에 있어서, 상기 프레임 메모리는 상기 앤드 게이트에서 출력되는 신호에 의해 읽기 및 쓰기모드로 선택되는 것을 특징으로 하는 1픽셀 오차를 제거한 이중화면 표시장치.
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USD886633S1 (en) 2018-05-18 2020-06-09 HCT Group Holdings Limited Cosmetic dispenser with cap
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