JPS6457536U - - Google Patents
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- Publication number
- JPS6457536U JPS6457536U JP15063187U JP15063187U JPS6457536U JP S6457536 U JPS6457536 U JP S6457536U JP 15063187 U JP15063187 U JP 15063187U JP 15063187 U JP15063187 U JP 15063187U JP S6457536 U JPS6457536 U JP S6457536U
- Authority
- JP
- Japan
- Prior art keywords
- memory
- unit
- valid
- signal
- reset
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Description
第１図は、この考案の実施例を示す図、第２図
はこの考案の動作タイミングを説明するための図
、第３図は従来の装置を説明するための図である
。 図において１は中央処理部、２はメモリ部、３
はメモリ選択信号、４はメモリ有効信号、５はシ
フトクロツク、６はリセツト信号、７はメモリア
ドレス、８はメモリ有効信号出力回路、９はメモ
リ選択回路、１０はメモリ領域情報、１１は比較
回路である。なお、図中、同一符号は同一、又は
相当部分を示す。
はこの考案の動作タイミングを説明するための図
、第３図は従来の装置を説明するための図である
。 図において１は中央処理部、２はメモリ部、３
はメモリ選択信号、４はメモリ有効信号、５はシ
フトクロツク、６はリセツト信号、７はメモリア
ドレス、８はメモリ有効信号出力回路、９はメモ
リ選択回路、１０はメモリ領域情報、１１は比較
回路である。なお、図中、同一符号は同一、又は
相当部分を示す。
Claims (1)
- 中央処理部と複数のメモリ部から成る電子計算
機において、中央処理部にどのメモリ部を有効と
するかを選択するために、リセツト信号とメモリ
選択信号とシフトクロツクを出力するメモリ選択
回路を持ち、メモリ部に自メモリ部が有効である
ことを示すために、中央処理部から出力されるリ
セツト信号によりリセツトされ、メモリ選択信号
または、他のメモリ部のメモリ有効信号をシフト
クロツクにより取り込み自メモリ部のメモリ有効
信号を出力するメモリ有効信号出力回路を持つこ
とを特徴とする電子計算機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15063187U JPS6457536U (ja) | 1987-10-01 | 1987-10-01 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15063187U JPS6457536U (ja) | 1987-10-01 | 1987-10-01 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6457536U true JPS6457536U (ja) | 1989-04-10 |
Family
ID=31423947
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15063187U Pending JPS6457536U (ja) | 1987-10-01 | 1987-10-01 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6457536U (ja) |
-
1987
- 1987-10-01 JP JP15063187U patent/JPS6457536U/ja active Pending
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