JPH0210633U - - Google Patents
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- Publication number
- JPH0210633U JPH0210633U JP8893588U JP8893588U JPH0210633U JP H0210633 U JPH0210633 U JP H0210633U JP 8893588 U JP8893588 U JP 8893588U JP 8893588 U JP8893588 U JP 8893588U JP H0210633 U JPH0210633 U JP H0210633U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- signal
- delay
- signal delay
- delay circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Pulse Circuits (AREA)
Description
第１図はこの考案の一実施例による信号遅延回
路のブロツク図、第２図はこの考案の他の実施例
を示す信号遅延回路のブロツク図、第３図は従来
の信号遅延回路のブロツク図である。 図において、１は入力信号、２は基準クロツク
、１０は遅延信号、１１は遅延量設定回路、１２
は遅延量設定信号、１３は計数回路、１４はアド
レス信号、１５は記憶回路、１６は読み出し信号
、１７はラツチ回路を示す。なお、図中、同一符
号は同一、又は相当部分を示す。
路のブロツク図、第２図はこの考案の他の実施例
を示す信号遅延回路のブロツク図、第３図は従来
の信号遅延回路のブロツク図である。 図において、１は入力信号、２は基準クロツク
、１０は遅延信号、１１は遅延量設定回路、１２
は遅延量設定信号、１３は計数回路、１４はアド
レス信号、１５は記憶回路、１６は読み出し信号
、１７はラツチ回路を示す。なお、図中、同一符
号は同一、又は相当部分を示す。
Claims (1)
- 信号遅延回路の計数回路で遅延量を設定すると
共に、記憶回路とラツチ回路を用い一定時間後に
再生させるようにしたことを特徴とする信号遅延
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8893588U JPH0210633U (ja) | 1988-07-04 | 1988-07-04 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8893588U JPH0210633U (ja) | 1988-07-04 | 1988-07-04 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0210633U true JPH0210633U (ja) | 1990-01-23 |
Family
ID=31313492
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8893588U Pending JPH0210633U (ja) | 1988-07-04 | 1988-07-04 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0210633U (ja) |
-
1988
- 1988-07-04 JP JP8893588U patent/JPH0210633U/ja active Pending
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