JPS6333868A - Mis型電界効果トランジスタの製造方法 - Google Patents
Mis型電界効果トランジスタの製造方法Info
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- JPS6333868A JPS6333868A JP17821786A JP17821786A JPS6333868A JP S6333868 A JPS6333868 A JP S6333868A JP 17821786 A JP17821786 A JP 17821786A JP 17821786 A JP17821786 A JP 17821786A JP S6333868 A JPS6333868 A JP S6333868A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、MIS型電界効果トランジスタの製造方法に
関し、特にホットキャリヤによる素子性能の劣化の少な
いMIS型電界効果トランジスタの製造方法に関する。
関し、特にホットキャリヤによる素子性能の劣化の少な
いMIS型電界効果トランジスタの製造方法に関する。
ホットキャリアによる素子性能の劣化の少ないMIS型
電界効果トランジスタとしては、例えばソース・ドレイ
ン領域のゲート電極近傍で不純物濃度が低くなったLD
D構造が提案されている。
電界効果トランジスタとしては、例えばソース・ドレイ
ン領域のゲート電極近傍で不純物濃度が低くなったLD
D構造が提案されている。
従来、LDD構造を得るためには、ゲート電極形成後、
ソース・ドレイン領域に低濃度のリンのイオン注入を行
い、その後イオン注入のマスクをゲート電極側壁に自己
整合的に形成し、高濃度のヒ素をイオン注入する方法が
用いられている。
ソース・ドレイン領域に低濃度のリンのイオン注入を行
い、その後イオン注入のマスクをゲート電極側壁に自己
整合的に形成し、高濃度のヒ素をイオン注入する方法が
用いられている。
しかしながら、上述した従来の製造方法では、ソ
ゲート電極形成後状−スおよびドレインを形成するたあ
たシ、2度のイオン注入を行う工程と、イオン注入のマ
スクをゲート電極側壁に自己整合的に形成する工程とを
必要とするため、製造方法が複雑になシかつ、ウェハ面
内およびウェア1間のパラツギが大きくなるという欠点
がある。
たシ、2度のイオン注入を行う工程と、イオン注入のマ
スクをゲート電極側壁に自己整合的に形成する工程とを
必要とするため、製造方法が複雑になシかつ、ウェハ面
内およびウェア1間のパラツギが大きくなるという欠点
がある。
本発明は、MIS型電界効果トランジスタのJ−ス・ド
レインの不純物拡散領域を第1の導電型のシリコン単結
晶基板の一主面に形成する堀たシ、ゲート電極となる導
電性薄膜を含む1層以上の薄膜を被着する工程と、この
薄膜を7オトレジストによるパターニング後テーパーエ
ツチングする工程と、絶縁性の薄膜を被着する工程と、
逆導電型の不純物イオンを絶縁性の薄膜およびゲート電
極部薄膜のテーパーの一部を透過し、ソース・ドレイン
形成領域のシリコン基板中に到達するエネルギーでイオ
ン注入する工程を有している。
レインの不純物拡散領域を第1の導電型のシリコン単結
晶基板の一主面に形成する堀たシ、ゲート電極となる導
電性薄膜を含む1層以上の薄膜を被着する工程と、この
薄膜を7オトレジストによるパターニング後テーパーエ
ツチングする工程と、絶縁性の薄膜を被着する工程と、
逆導電型の不純物イオンを絶縁性の薄膜およびゲート電
極部薄膜のテーパーの一部を透過し、ソース・ドレイン
形成領域のシリコン基板中に到達するエネルギーでイオ
ン注入する工程を有している。
このように、本発明によれば、ゲート電極をテーパーエ
ツチングし、その上に被着した絶縁性薄膜およびゲート
電極部薄膜のテーパーの一部を透過するエネルギーで不
純物のイオン注入を行うことによシ、1度のイオン注入
工程で、ゲート電極の隣接する部分が低不純物濃度とな
ったソースおよびドレイン領域を設けることができる。
ツチングし、その上に被着した絶縁性薄膜およびゲート
電極部薄膜のテーパーの一部を透過するエネルギーで不
純物のイオン注入を行うことによシ、1度のイオン注入
工程で、ゲート電極の隣接する部分が低不純物濃度とな
ったソースおよびドレイン領域を設けることができる。
次に、本発明について図面を参照して説明する。
第1図(Q〜(Φは本発明の一実施例を工程順に示した
縦断面図である。P型シリコン単結晶基板1上の素子領
域上にゲート酸化膜2を形成し、ゲート電極として例え
ば多結晶シリコン薄膜3をaoooXの膜厚で被着し、
フォトレジストによるマスクを用いてテーパーエツチン
グを行いゲート電極4f!c形成する。その後、絶縁膜
として例えば酸化膜5をxoooX程度被着し、酸化膜
5とゲート電極4のテーパーの一部を透過するエネルギ
ーでリンのイオン注入6を行う。以下、層間絶縁膜を被
着し、通常の製造方法により、MIS型電界効果トラン
ジスタを得ることができる。
縦断面図である。P型シリコン単結晶基板1上の素子領
域上にゲート酸化膜2を形成し、ゲート電極として例え
ば多結晶シリコン薄膜3をaoooXの膜厚で被着し、
フォトレジストによるマスクを用いてテーパーエツチン
グを行いゲート電極4f!c形成する。その後、絶縁膜
として例えば酸化膜5をxoooX程度被着し、酸化膜
5とゲート電極4のテーパーの一部を透過するエネルギ
ーでリンのイオン注入6を行う。以下、層間絶縁膜を被
着し、通常の製造方法により、MIS型電界効果トラン
ジスタを得ることができる。
この実施例において、酸化膜5は、接合深さが深くなシ
すぎない様にしてゲート電極4のテーパーの一部を不純
物イオンが透過する様に設けである。これにより、ゲー
ト電極4の近傍では不純物濃度が低くなったソース・ド
レイン領域を一度で得ることができ、このリンの低濃度
領域でホットキャリヤ効果1に緩和することができる。
すぎない様にしてゲート電極4のテーパーの一部を不純
物イオンが透過する様に設けである。これにより、ゲー
ト電極4の近傍では不純物濃度が低くなったソース・ド
レイン領域を一度で得ることができ、このリンの低濃度
領域でホットキャリヤ効果1に緩和することができる。
〔実施例2〕
第2図(a)〜(ψは本発明の第2の実施例を工程順に
示した縦断面図である。本実施例では、ゲート電極とし
て金橋シリサイド8と多結晶シリコン3との2層で構成
されている。金属シリサイド8を所定形状にエツチング
後、多結晶シリコン3?テーパーエツチングし、絶縁膜
5を被覆後、絶縁膜5と多結晶シリコン3のテーパーの
一部を透過するエネルギーで不純物濃度となったソース
・ドレイン領域を得ることができる。
示した縦断面図である。本実施例では、ゲート電極とし
て金橋シリサイド8と多結晶シリコン3との2層で構成
されている。金属シリサイド8を所定形状にエツチング
後、多結晶シリコン3?テーパーエツチングし、絶縁膜
5を被覆後、絶縁膜5と多結晶シリコン3のテーパーの
一部を透過するエネルギーで不純物濃度となったソース
・ドレイン領域を得ることができる。
以上説明したように、本発明は、MIS型電界効果トラ
ンジスタにおけるソース・ドレインの形成にあたり、ゲ
ート電極となる薄膜をテーパーエツチングし、その後絶
縁性#腹を被着し、絶縁性薄膜およびゲート電極のテー
パーの一部を透過するエネルギーで不純物イオンの注入
を行うことによシ、プロセスが単純で制御性が良く、ホ
ットキャリアによる素子性能の劣化の少ないMIS型電
界効果トランジスタを製造できる。
ンジスタにおけるソース・ドレインの形成にあたり、ゲ
ート電極となる薄膜をテーパーエツチングし、その後絶
縁性#腹を被着し、絶縁性薄膜およびゲート電極のテー
パーの一部を透過するエネルギーで不純物イオンの注入
を行うことによシ、プロセスが単純で制御性が良く、ホ
ットキャリアによる素子性能の劣化の少ないMIS型電
界効果トランジスタを製造できる。
第1図(a)〜(ψは本発明の第1の実施例を工程順に
示した縦断面図、第2図(a)〜(Φは本発明の第2の
実施例を工程順に示した縦断面図である。 1・・・・・・P型シリコン単結晶基板、2・・・・・
・ゲート酸化膜、3・・・・・・多結晶シリコン薄膜、
4・・・・・・ゲート電極、4・・・・・・酸化膜、6
・・・・・・リンのイオン注入、7・・・・・・不純物
拡散領域、8・・・・・・金属シリサイド薄膜。 第 1 ワ 、、lQリイに551人 第2 図
示した縦断面図、第2図(a)〜(Φは本発明の第2の
実施例を工程順に示した縦断面図である。 1・・・・・・P型シリコン単結晶基板、2・・・・・
・ゲート酸化膜、3・・・・・・多結晶シリコン薄膜、
4・・・・・・ゲート電極、4・・・・・・酸化膜、6
・・・・・・リンのイオン注入、7・・・・・・不純物
拡散領域、8・・・・・・金属シリサイド薄膜。 第 1 ワ 、、lQリイに551人 第2 図
Claims (1)
- (1)MIS型電界効果トランジスタのソースおよびド
レインの不純拡散領域を一の導電型のシリコン単結晶基
板の一主面に形成するにあたり、ゲート電極となる薄膜
を被着する工程と、前記薄膜をテーパーエッチングによ
ってゲート電極形状に形成する工程と、逆導電型の不純
物イオンを前記ゲート電極部のテーパーの一部を透過し
ソース・ドレイン領域のシリコン基板中に到達するエネ
ルギーでイオン注入する工程とを有することを特徴とす
るMIS型電界効果トランジスタの製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17821786A JPS6333868A (ja) | 1986-07-28 | 1986-07-28 | Mis型電界効果トランジスタの製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17821786A JPS6333868A (ja) | 1986-07-28 | 1986-07-28 | Mis型電界効果トランジスタの製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6333868A true JPS6333868A (ja) | 1988-02-13 |
Family
ID=16044631
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17821786A Pending JPS6333868A (ja) | 1986-07-28 | 1986-07-28 | Mis型電界効果トランジスタの製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6333868A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04158861A (ja) * | 1990-10-22 | 1992-06-01 | Mikio Fukunaga | 脊椎加圧装置 |
JP2010232635A (ja) * | 2009-03-27 | 2010-10-14 | Samsung Mobile Display Co Ltd | 薄膜トランジスタ及びその製造方法、並びにそれを含む有機電界発光表示装置 |
US8409887B2 (en) | 2009-03-03 | 2013-04-02 | Samsung Display Co., Ltd. | Organic light emitting diode display device and method of fabricating the same |
US8546248B2 (en) | 2009-03-05 | 2013-10-01 | Samsung Display Co., Ltd. | Method of forming polycrystalline silicon layer and atomic layer deposition apparatus used for the same |
US8890165B2 (en) | 2009-11-13 | 2014-11-18 | Samsung Display Co., Ltd. | Method of forming polycrystalline silicon layer, thin film transistor, organic light emitting diode display device having the same, and methods of fabricating the same |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5816566A (ja) * | 1981-07-22 | 1983-01-31 | Hitachi Ltd | 半導体装置およびその製造方法 |
-
1986
- 1986-07-28 JP JP17821786A patent/JPS6333868A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5816566A (ja) * | 1981-07-22 | 1983-01-31 | Hitachi Ltd | 半導体装置およびその製造方法 |
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04158861A (ja) * | 1990-10-22 | 1992-06-01 | Mikio Fukunaga | 脊椎加圧装置 |
JPH0553502B2 (ja) * | 1990-10-22 | 1993-08-10 | Mikio Fukunaga | |
US8409887B2 (en) | 2009-03-03 | 2013-04-02 | Samsung Display Co., Ltd. | Organic light emitting diode display device and method of fabricating the same |
US9035311B2 (en) | 2009-03-03 | 2015-05-19 | Samsung Display Co., Ltd. | Organic light emitting diode display device and method of fabricating the same |
US8546248B2 (en) | 2009-03-05 | 2013-10-01 | Samsung Display Co., Ltd. | Method of forming polycrystalline silicon layer and atomic layer deposition apparatus used for the same |
JP2010232635A (ja) * | 2009-03-27 | 2010-10-14 | Samsung Mobile Display Co Ltd | 薄膜トランジスタ及びその製造方法、並びにそれを含む有機電界発光表示装置 |
US9117798B2 (en) | 2009-03-27 | 2015-08-25 | Samsung Display Co., Ltd. | Thin film transistor, method of fabricating the same and organic light emitting diode display device including the same |
US8890165B2 (en) | 2009-11-13 | 2014-11-18 | Samsung Display Co., Ltd. | Method of forming polycrystalline silicon layer, thin film transistor, organic light emitting diode display device having the same, and methods of fabricating the same |
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