JPS63279343A - メモリユニット接続検出装置 - Google Patents
メモリユニット接続検出装置Info
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- JPS63279343A JPS63279343A JP62115657A JP11565787A JPS63279343A JP S63279343 A JPS63279343 A JP S63279343A JP 62115657 A JP62115657 A JP 62115657A JP 11565787 A JP11565787 A JP 11565787A JP S63279343 A JPS63279343 A JP S63279343A
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- 238000001514 detection method Methods 0.000 claims description 7
- 238000003780 insertion Methods 0.000 description 7
- 230000037431 insertion Effects 0.000 description 7
- 238000000034 method Methods 0.000 description 6
- 238000010586 diagram Methods 0.000 description 4
- 230000006378 damage Effects 0.000 description 3
- 239000013256 coordination polymer Substances 0.000 description 2
- 238000000605 extraction Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
Landscapes
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はメモリユニット接続装置に関し、特に、端末装
置に挿抜自在に接続され、読み出し又は書き込みを行う
データファイル用カードの接続状態を定期的に検出し、
必要に応じてシステム全体を保全するメモリユニット接
続検出装置に係る。
置に挿抜自在に接続され、読み出し又は書き込みを行う
データファイル用カードの接続状態を定期的に検出し、
必要に応じてシステム全体を保全するメモリユニット接
続検出装置に係る。
メモリカードは従来からデータファイルとして使用され
ることが多いが、このメモリカードは端末装置に接続さ
れてデータの読み出し及び書き込みが行われる。ところ
で、このメモリカードは端末装置に挿抜自在に接続され
ており、読み出しや、書き込みが行われている最中にも
挿し入れ、抜き出しができる。
ることが多いが、このメモリカードは端末装置に接続さ
れてデータの読み出し及び書き込みが行われる。ところ
で、このメモリカードは端末装置に挿抜自在に接続され
ており、読み出しや、書き込みが行われている最中にも
挿し入れ、抜き出しができる。
このようにメモリカードは端末装置に対して、挿抜自在
であるため、メモリカードの読み出し又は書き込み中に
、誤って端末装置から抜かれると、メモリカード内のデ
ータ操作が途中で終了してしまうこととなる。このため
、このような状態でその後のプログラムが実行されてし
まうと、データが破壊されたり、プログラムの暴走が起
こるという問題点があった。
であるため、メモリカードの読み出し又は書き込み中に
、誤って端末装置から抜かれると、メモリカード内のデ
ータ操作が途中で終了してしまうこととなる。このため
、このような状態でその後のプログラムが実行されてし
まうと、データが破壊されたり、プログラムの暴走が起
こるという問題点があった。
本発明は上記実情に鑑み、その問題点を一掃すべく創案
されたものであって、メモリカードの読み出し、あるい
は書き込みが行われている最中に誤ってメモリカードが
挿し入れ、又は抜き出しされても、データの破壊や、プ
ログラムの暴走を防止することができる接続検出装置を
提供しようとするものである。
されたものであって、メモリカードの読み出し、あるい
は書き込みが行われている最中に誤ってメモリカードが
挿し入れ、又は抜き出しされても、データの破壊や、プ
ログラムの暴走を防止することができる接続検出装置を
提供しようとするものである。
C問題点を解決するための手段〕
本発明は上記目的を達成するために、データファイル用
カードが端末装置に挿抜自在に接続され、データの読み
出し又は書き込みを行うメモリユニット接続装置におい
て、前記カードの特定番地にカードの有無を確認するた
めのデータを書き込む、とともに、このデータを定期的
に調べ初期状態と変化があったときには初期状態と一致
するまで他の処理を中止する制御手段を設けて構成した
。
カードが端末装置に挿抜自在に接続され、データの読み
出し又は書き込みを行うメモリユニット接続装置におい
て、前記カードの特定番地にカードの有無を確認するた
めのデータを書き込む、とともに、このデータを定期的
に調べ初期状態と変化があったときには初期状態と一致
するまで他の処理を中止する制御手段を設けて構成した
。
本発明の構成によれば、カードに書き込まれたカードの
有無を確認するためのデータは、制御手段が定期的に調
べ、初期状態と変化があったときには、システム全体を
スタンバイ状態にする。
有無を確認するためのデータは、制御手段が定期的に調
べ、初期状態と変化があったときには、システム全体を
スタンバイ状態にする。
本発明の構成を図面に示された一実施例に基づいて説明
する。
する。
第1図はメモリユニット接続検出装置の全体構成を示す
回路図、第2図はメモリカードとカードコネクタとの接
続関係を示す説明図、第3図はメモリカードの挿抜状態
を検出する手順を示すフローチャートである。
回路図、第2図はメモリカードとカードコネクタとの接
続関係を示す説明図、第3図はメモリカードの挿抜状態
を検出する手順を示すフローチャートである。
メモリカード1は縁部に複数の接続ピン1aを1列状に
備えている。このメモリカード1は後述する端末装置2
のカードコネクタ3に挿入されて接続される。すなわち
、カードコネクタ3は縁部に複数の接続ピン3aを1列
状に備えており、カードコネクタ3にメモリカード1が
挿入された状態で、接続ピン1a、3a同士が対応して
接続される。接続ピンlaと接続ピン4aには、それぞ
れ両端に電源用ピン(vCC)、接地用ピン(GND)
が備えられる。また、上記メモリカード1の特定の番地
1bには「カード有り」のデータICが書き込まれてい
る。このため、メモリカードlの番地1bの「カード有
り」のデータICをチェックすれば、メモリカード1が
端末装置2に接続されているか否かを確認することがで
きる。
備えている。このメモリカード1は後述する端末装置2
のカードコネクタ3に挿入されて接続される。すなわち
、カードコネクタ3は縁部に複数の接続ピン3aを1列
状に備えており、カードコネクタ3にメモリカード1が
挿入された状態で、接続ピン1a、3a同士が対応して
接続される。接続ピンlaと接続ピン4aには、それぞ
れ両端に電源用ピン(vCC)、接地用ピン(GND)
が備えられる。また、上記メモリカード1の特定の番地
1bには「カード有り」のデータICが書き込まれてい
る。このため、メモリカードlの番地1bの「カード有
り」のデータICをチェックすれば、メモリカード1が
端末装置2に接続されているか否かを確認することがで
きる。
上記メモリカード1が接続される端末装置2はメモリカ
ードlからデータを読み出したり、メモ、リカード1か
らデータを書き込む等種々の機能を備えている。この端
末装置2は、メモリカードlを挿抜自在に接続するカー
ドコネクタ3と、端末装置2全体の動作を制御するCP
U4と、カードコネクタ3とCPU4との間に介設され
、メモリカード1がカードコネクタ3に接続されている
が否か、すなわち、挿抜状態を確認するための信号を一
時的に保持するラッチ回路5と、データをストアするた
めのRAM6と、所要のプログラムがストアされたRO
M7と、人出刃装置8とから構成される。また、9はタ
イマーであり、このタイマー9は一定の周期でメモリカ
ードlがカードコネクタ3に接続されているが否かを検
出することを指示する信号をCPU4に出力するように
なっている。
ードlからデータを読み出したり、メモ、リカード1か
らデータを書き込む等種々の機能を備えている。この端
末装置2は、メモリカードlを挿抜自在に接続するカー
ドコネクタ3と、端末装置2全体の動作を制御するCP
U4と、カードコネクタ3とCPU4との間に介設され
、メモリカード1がカードコネクタ3に接続されている
が否か、すなわち、挿抜状態を確認するための信号を一
時的に保持するラッチ回路5と、データをストアするた
めのRAM6と、所要のプログラムがストアされたRO
M7と、人出刃装置8とから構成される。また、9はタ
イマーであり、このタイマー9は一定の周期でメモリカ
ードlがカードコネクタ3に接続されているが否かを検
出することを指示する信号をCPU4に出力するように
なっている。
上記CPU4とカードコネクタ3との間には、CPU4
とカードコネクタ3との間でデータを授受するためのデ
ータバス等が配設されている。また、カードコネクタ3
にメモリカード1が挿抜されたときに出力される信号は
ラッチ回路5に保持されると同時にCPU4に対しても
伝送される。
とカードコネクタ3との間でデータを授受するためのデ
ータバス等が配設されている。また、カードコネクタ3
にメモリカード1が挿抜されたときに出力される信号は
ラッチ回路5に保持されると同時にCPU4に対しても
伝送される。
次に上記構成からなる接続検出装置の作用を説明する。
CPU4はタイマーpからパルスが入力されると、これ
に対してCPU4はメモリカード1のデータ1cを読み
出すとともに、う・/子回路5にメモリカード1のデー
タ1cがラッチされる。次いで、CPU4にタイマー9
から定期的にパルスガ入力されると、これに対してCP
U4はメモリカード1から読み出したデータと、ラッチ
回路5のランチ内容とを入力し、両者を比較する。この
比較の際には、メモリカード1が挿入されていない状態
では両内容はともに「カード無し」であり、逆に、メモ
リカード1が挿入されている状態では両内容はともに「
カード有り」である。そして、カードコネクタ3に挿入
されていたメモリカードlが何らかの事情で抜き出され
ると、ラッチ回路5の内容は「カード有りJ、CPU4
で読み出した内容は「データ無し」であり、逆に、カー
ドコネクタ3にメモリカード1を挿入すると、ランチ回
路5の内容は「データ無しJ、CPU4で読みだしたデ
ータは「カード有り」である。そして、この比較によっ
て、メモリカード1からの信号状態が「カード有り」か
ら「データ無し」に変化した場合、又は、「データ無し
」から「カード有り」に変化した場合には、CPU4は
スタンバイ状態、すなわち、レリース端子のように、プ
ログラムの実行中の処理は保持したままでプログラムの
実行を中止した状態になる。
に対してCPU4はメモリカード1のデータ1cを読み
出すとともに、う・/子回路5にメモリカード1のデー
タ1cがラッチされる。次いで、CPU4にタイマー9
から定期的にパルスガ入力されると、これに対してCP
U4はメモリカード1から読み出したデータと、ラッチ
回路5のランチ内容とを入力し、両者を比較する。この
比較の際には、メモリカード1が挿入されていない状態
では両内容はともに「カード無し」であり、逆に、メモ
リカード1が挿入されている状態では両内容はともに「
カード有り」である。そして、カードコネクタ3に挿入
されていたメモリカードlが何らかの事情で抜き出され
ると、ラッチ回路5の内容は「カード有りJ、CPU4
で読み出した内容は「データ無し」であり、逆に、カー
ドコネクタ3にメモリカード1を挿入すると、ランチ回
路5の内容は「データ無しJ、CPU4で読みだしたデ
ータは「カード有り」である。そして、この比較によっ
て、メモリカード1からの信号状態が「カード有り」か
ら「データ無し」に変化した場合、又は、「データ無し
」から「カード有り」に変化した場合には、CPU4は
スタンバイ状態、すなわち、レリース端子のように、プ
ログラムの実行中の処理は保持したままでプログラムの
実行を中止した状態になる。
このようにして、端末装置2におけるメモリカードlの
挿抜状態を検出することができ、メモリカード1からの
データに変化があったと゛きには、CPU4はスタンバ
イ状態となるので、データ破壊やプログラムの暴走とい
うような事故を防止することができる。
挿抜状態を検出することができ、メモリカード1からの
データに変化があったと゛きには、CPU4はスタンバ
イ状態となるので、データ破壊やプログラムの暴走とい
うような事故を防止することができる。
前記したメモリカード1の挿抜検出の手順を第3図(A
)、(B)のフローチャートを基にして説明する。第3
図(A)はCPU4におけるメインルーチンを示すが、
まず、メモリカード1の挿抜状態、すなわち、初期状態
を検出しく5TEP■)、その後割り込みを受け(ST
EP■)、端末装置2において必要な処理を行い(ST
EP■)、適当な周期で5TEP■に戻りメモリカード
lの挿抜状態を再び確認する(STEP■)。5TEP
■では、第3図(B)で示すサブルーチンが実行される
。サブルーチンでは、まず、メモリカード1からのデー
タの内容(「カード有り」又は「データ無し」)をチェ
ックしく5TEP■)、その結果と前回チェックしたデ
ータの初期状態と ゛を比較する(STEP■)
。そして、5TEP■で初期状態と変化があった場合に
は、CPU5をスタンバイ状態に保持するようにする。
)、(B)のフローチャートを基にして説明する。第3
図(A)はCPU4におけるメインルーチンを示すが、
まず、メモリカード1の挿抜状態、すなわち、初期状態
を検出しく5TEP■)、その後割り込みを受け(ST
EP■)、端末装置2において必要な処理を行い(ST
EP■)、適当な周期で5TEP■に戻りメモリカード
lの挿抜状態を再び確認する(STEP■)。5TEP
■では、第3図(B)で示すサブルーチンが実行される
。サブルーチンでは、まず、メモリカード1からのデー
タの内容(「カード有り」又は「データ無し」)をチェ
ックしく5TEP■)、その結果と前回チェックしたデ
ータの初期状態と ゛を比較する(STEP■)
。そして、5TEP■で初期状態と変化があった場合に
は、CPU5をスタンバイ状態に保持するようにする。
5TEP■でデータに変化がなかった場合には、再び、
第3図(A)のメインルーチンに戻り、その後の所要の
処理が継続され、以上の手順が反復される。
第3図(A)のメインルーチンに戻り、その後の所要の
処理が継続され、以上の手順が反復される。
なお、本発明のメモリユニット接続検出装置は、ハード
構成によっても、あるいはソフト的にも実現できること
は勿論である。
構成によっても、あるいはソフト的にも実現できること
は勿論である。
以上の説明から明らかなように、本発明によれば、カー
ドの特定番地に書き込んだデータのチェックによりカー
ドの挿抜状態が確認でき、これにより初期状態と変化が
あった場合には、システム全体がスタンバイ状態になる
ので、カードの読み出し又は書き込み中に誤ってカード
が挿抜されてもデータの破壊やプログラムの暴走を未然
に防止できシステム全体を保全することができる。
ドの特定番地に書き込んだデータのチェックによりカー
ドの挿抜状態が確認でき、これにより初期状態と変化が
あった場合には、システム全体がスタンバイ状態になる
ので、カードの読み出し又は書き込み中に誤ってカード
が挿抜されてもデータの破壊やプログラムの暴走を未然
に防止できシステム全体を保全することができる。
図面は本発明に関するメモリユニット接続検出装置の一
実施例を示し、第1図は全体構成を示す回路図、第2図
はメモリカードとカードコネクタとの接続関係を示す説
明図、第3図はメモリカードの挿抜状態を検出する手順
を示すフローチャートである。 (主要部分を示す図面の簡単な説明) 1・・メモリカード 1a・・接続ピン1b・・特
定番地
実施例を示し、第1図は全体構成を示す回路図、第2図
はメモリカードとカードコネクタとの接続関係を示す説
明図、第3図はメモリカードの挿抜状態を検出する手順
を示すフローチャートである。 (主要部分を示す図面の簡単な説明) 1・・メモリカード 1a・・接続ピン1b・・特
定番地
Claims (1)
- データファイル用カードが端末装置に挿抜自在に接続さ
れ、データの読み出し又は書き込みを行うメモリユニッ
ト接続装置において、前記カードの特定番地にカードの
有無を確認するためのデータを書き込むとともに、この
データを定期的に調べ初期状態と変化があったときには
システム全体をスタンバイ状態にする制御手段を設けた
ことを特徴とするメモリユニット接続検出装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62115657A JPS63279343A (ja) | 1987-05-12 | 1987-05-12 | メモリユニット接続検出装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62115657A JPS63279343A (ja) | 1987-05-12 | 1987-05-12 | メモリユニット接続検出装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63279343A true JPS63279343A (ja) | 1988-11-16 |
Family
ID=14668070
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62115657A Pending JPS63279343A (ja) | 1987-05-12 | 1987-05-12 | メモリユニット接続検出装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63279343A (ja) |
-
1987
- 1987-05-12 JP JP62115657A patent/JPS63279343A/ja active Pending
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