JPS6312291B2 - - Google Patents
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- JPS6312291B2 JPS6312291B2 JP57232803A JP23280382A JPS6312291B2 JP S6312291 B2 JPS6312291 B2 JP S6312291B2 JP 57232803 A JP57232803 A JP 57232803A JP 23280382 A JP23280382 A JP 23280382A JP S6312291 B2 JPS6312291 B2 JP S6312291B2
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Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、ダイレクトメモリアクセス方式を
用いた漢字プリンタ等の印字制御方式に関する。DETAILED DESCRIPTION OF THE INVENTION [Technical Field of the Invention] The present invention relates to a printing control method for a Kanji printer or the like using a direct memory access method.
近年、漢字プリンタ等の印字制御は、マイクロ
プロセサ（以下CPUと称する）を使用したプロ
グラム制御方式により行なわれている。この印字
制御の中では、特に印字データの出力制御、即ち
例えばワイヤドツトピン方式における印字ヘツド
のピンを駆動するための印字データの出力制御が
重要である。
In recent years, printing control of Kanji printers and the like has been performed by a program control method using a microprocessor (hereinafter referred to as CPU). In this print control, output control of print data, ie, output control of print data for driving the pins of a print head in, for example, a wire dot pin system, is particularly important.
従来、例えば24ピンの漢字プリンタでは、１列
の印字に対して３バイトの印字データ（以下ピン
データと称す）の出力が必要となる。この場合、
漢字１文字を24×24ドツトマトリクスとすると、
例えば処理速度100cps等の高速プリンタでは、
2400Hzの間隔で、３バイトのピンデータを出力す
る必要がある。このような高速の処理速度（１バ
イト当り約140μsとなる）では、CPUよりピンデ
ータをセツトし印字中である場合、CPUが他の
データ処理を行なうことは不可能である。 Conventionally, for example, in a 24-pin Kanji printer, it is necessary to output 3 bytes of print data (hereinafter referred to as pin data) for one line of printing. in this case,
Assuming that one kanji character is a 24×24 dot matrix,
For example, in a high-speed printer with a processing speed of 100 cps,
It is necessary to output 3 bytes of pin data at 2400Hz intervals. At such a high processing speed (approximately 140 μs per byte), when the CPU is setting pin data and printing is in progress, it is impossible for the CPU to process other data.
このような対策として、従来では高速プリント
の場合、ピンデータのセツトをダイレクトメモリ
アクセスコントローラ（以下DMAコントローラ
と称する）が使用されて行なわれる。即ち、プリ
ントラインバツフアに印字に必要なドツトイメー
ジを編集して格納し、このプリントラインバツフ
アから出力ポートにドツトイメージであるピンデ
ータをセツトする方式である。このようなDMA
コントローラによる制御方式は、通常の場合、プ
リントラインバツフアであるメモリのアクセスを
アドレスのインクリメントまたはデクリメントの
順で行なつて、データを転送することになる。そ
して、例えばシリアルドツトプリンタの場合に
は、スループツトの向上等の理由により、通常双
方向アクセスの最短距離の印字が行なわれる。 As a countermeasure for this, conventionally, in the case of high-speed printing, a direct memory access controller (hereinafter referred to as a DMA controller) is used to set pin data. That is, in this method, dot images necessary for printing are edited and stored in a print line buffer, and pin data, which is a dot image, is set from the print line buffer to an output port. DMA like this
Normally, the control method by the controller transfers data by accessing the memory, which is a print line buffer, in the order of incrementing or decrementing the address. For example, in the case of a serial dot printer, printing is normally performed at the shortest distance in bidirectional access for reasons such as improving throughput.
しかしながら、上記のような従来の方式では、
DMAコントローラのインクリメント、デクリメ
ントのみのアクセスでプリントラインバツフアか
ら３バイトのピンデータを、出力ポートにセツト
する場合、印字方向の異なる仕様で印字ヘツドの
各ピンに対応する配列にセツトすることは不可能
である。即ち、例えば第１図に示すようにプリン
トラインバツフア２１の各アドレスに、１行分の
ドツトイメージが編集されて格納されているとす
る。いま、仮にDMAコントローラが、アクセス
方向ａ（即ちアドレスのインクリメント）でプリ
ントラインバツフア２１からデータを読出して、
出力ポートにセツトすると、第２図Ａに示すよう
なプリントが行なわれる。一方、アクセス方向ｂ
（即ちアドレスのデクリメント）でプリントライ
ンバツフア２１がアクセスされた場合、第２図Ｂ
に示すようにプリントされ、第２図Ａに示すよう
な印字方向とは異なる例えば位置の反転したプリ
ントを行なうことは不可能である。 However, in the conventional method as mentioned above,
When setting 3 bytes of pin data from the print line buffer to the output port using only increment and decrement access from the DMA controller, it is not possible to set it in an array corresponding to each pin of the print head with different print direction specifications. It is possible. That is, assume that one line of dot images is edited and stored at each address of the print line buffer 21, as shown in FIG. 1, for example. Now, suppose that the DMA controller reads data from the print line buffer 21 in the access direction a (that is, incrementing the address),
When set to the output port, printing as shown in FIG. 2A is performed. On the other hand, access direction b
When the print line buffer 21 is accessed with (i.e., address decrement),
It is impossible to print in a direction different from the printing direction as shown in FIG. 2A, for example, with the position reversed.
このような問題点を解決するために、ホストシ
ステムから受信したキヤラクタコードを、プリン
タ内蔵のキヤラクタ・ジエネレータによりアクセ
スし、プリントラインバツフアに１行分のイメー
ジパターン（文字パターン）を作成する場合、予
め印字方向を決定してから行なう方式がある。し
かしながら、高速プリンタは、通常複数のプリン
トラインバツフアを有しており、上記のような方
式では非常に複雑な処理が必要となる欠点があつ
た。 To solve this problem, the character code received from the host system is accessed by the printer's built-in character generator to create a one-line image pattern (character pattern) in the print line buffer. There is a method in which printing is performed after determining the printing direction in advance. However, high-speed printers usually have a plurality of print line buffers, and the above-mentioned method has the drawback of requiring very complicated processing.
この発明は上記の事情に鑑みてなされたもの
で、高速のシリアルドツト漢字プリンタ等におい
て、印字方向の異なる印字動作の場合でも、
DMA方式による高速の印字処理を実現し、しか
も簡単な構成で確実な印字制御を行なうことがで
きる印字制御方式を提供することを目的とする。
This invention was made in view of the above circumstances, and even in the case of printing operations in different printing directions in high-speed serial dot kanji printers, etc.,
It is an object of the present invention to provide a printing control method that can realize high-speed printing processing using a DMA method and also perform reliable printing control with a simple configuration.
この発明は、DMAコントローラを使用したド
ツトプリンタ等において、印字ヘツドのピンデー
タを出力する複数の出力ポートを設ける。この複
数の出力ポートに対して、DMAコントローラの
制御によりプリントラインバツフアから上記ピン
データを転送する場合、印字方向の指定信号に基
づいて各出力ポートのアドレスがアドレス設定手
段により設定される。これにより、印字方向に応
じた出力ポートから上記ピンデータが出力され、
確実で処理速度の高い印字動作が行なわれること
になる。
The present invention provides a plurality of output ports for outputting print head pin data in a dot printer or the like using a DMA controller. When the pin data is transferred from the print line buffer to the plurality of output ports under the control of the DMA controller, the address of each output port is set by the address setting means based on the print direction designation signal. As a result, the above pin data is output from the output port according to the printing direction,
Printing operations can be performed reliably and at high processing speed.
以下図面を参照してこの発明の一実施例につい
て説明する。第３図はこの発明に係る印字制御方
式の構成を示すものである。図中、３１はマイク
ロプロセツサ（CPU）で、プログラムメモリ
（以下ROMと称する）３２に格納されたプログ
ラムに基づいて、プリンタ全体の制御を行なう。
３３はインターフエース回路で、外部システムか
ら送られるプリントデータをCPU３１の制御に
より受信し、データバス（双方向性バス）３４を
介してメモリ（以下RAMと称する）３５に格納
する。このRAM３５は、１行単位のドツトイメ
ージを格納するプリントラインバツフアとして使
用される。DMAコントローラ３６は、RAM３
５から複数の出力ポート３７ａ〜３７ｃへのデー
タ転送を制御する。この複数の出力ポート３７ａ
〜３７ｃは、例えば24ピンの印字ヘツドに対し
て、各ピンに対応するピンデータを出力する。３
８はアドレスカウンタ（例えば３進カウンタ）
で、DMAコントローラ３６から与えられる書込
みパルス信号を、プログラムド入出力ポート
（以下PIOと称する）３９からの印字方向を指示
する信号Ｐに基づいてカウントし、各出力ポート
３７ａ〜３７ｃを選択するアドレス信号A0，A1
を出力する。PIO３９は、各ビツト単位でプログ
ラム可能な入出力ポートで、例えばフリツプフロ
ツプからなる。セレクタ４０は、アドレスカウン
タ３８から与えられるアドレス信号A0，A1によ
り指定される各出力ポート３７ａ〜３７ｃに上記
パルス信号に同期したタイミング信号T1〜
T3を出力するように動作する。
An embodiment of the present invention will be described below with reference to the drawings. FIG. 3 shows the configuration of the printing control system according to the present invention. In the figure, a microprocessor (CPU) 31 controls the entire printer based on a program stored in a program memory (hereinafter referred to as ROM) 32.
An interface circuit 33 receives print data sent from an external system under the control of the CPU 31 and stores it in a memory (hereinafter referred to as RAM) 35 via a data bus (bidirectional bus) 34. This RAM 35 is used as a print line buffer for storing dot images on a line-by-line basis. The DMA controller 36 uses the RAM 3
5 to a plurality of output ports 37a to 37c. These multiple output ports 37a
37c outputs pin data corresponding to each pin, for example, to a 24-pin print head. 3
8 is an address counter (for example, a ternary counter)
The write pulse signals given from the DMA controller 36 are counted based on the signal P instructing the printing direction from the programmed input/output port (hereinafter referred to as PIO) 39, and the address for selecting each output port 37a to 37c is determined. Signal A 0 , A 1
Output. PIO 39 is an input/output port that can be programmed in units of bits, and is composed of, for example, a flip-flop. The selector 40 sends timing signals T 1 to T 1 to each output port 37 a to 37 c specified by the address signals A 0 and A 1 provided from the address counter 38 in synchronization with the pulse signal.
Operates to output T 3 .
このような構成において、その動作を説明す
る。外部システム（コンピユータシステム）から
送信されるプリント動作に必要な各種コマンド、
キヤラクタコード等は、インターフエース回路３
３で受信され、さらにバス３４を介してRAM３
５に格納される。CPU３１は、ターミネートコ
ードである例えばキヤリツジリターン信号（CR
信号）を受信すると、印字編集を行なう。即ち、
CPU３１は、受信キヤラクタコード（文字コー
ド）により、ROM３２に予め内蔵したキヤラク
タパターンをアクセスし、１行分の印字文字に相
当するドツトイメージをプリントラインバツフア
であるRAM３５に格納する。この場合、印字方
向は指定されない。 The operation of this configuration will be explained. Various commands required for printing operations sent from an external system (computer system),
The character code etc. is the interface circuit 3.
3 and further transmitted via bus 34 to RAM3.
It is stored in 5. The CPU 31 outputs a termination code such as a carriage return signal (CR).
When a signal is received, print editing is performed. That is,
The CPU 31 accesses a character pattern previously stored in the ROM 32 based on the received character code, and stores a dot image corresponding to one line of printed characters in the RAM 35, which is a print line buffer. In this case, the printing direction is not specified.
印字開始時になると、CPU３１は、印字方向
（例えば左右いずれかの方向）を判断しその指定
信号をPIO３９に出力する。また、DMAコント
ローラ３６にデータ転送用の各種パラメータをセ
ツトし、イネーブル状態とする。PIO３９は、上
記CPU３１の指定信号に応じて信号Ｐのレベル、
例えば右方向の場合には「１」、左方向の場合に
は「０」を設定する。そして、DMAコントロー
ラ３６は、プリンタのメカニズムとのタイミング
を取るためのタイミング信号φがレデイ（RDY）
信号として与えられると、RAM３５から所定の
バイト数のデータであるドツトイメージが各出力
ポート３７ａ〜３７ｃに出力するように制御を開
始する。この場合、DMAコントローラ３６は、
各出力ポート３７ａ〜３７ｃへデータを転送する
タイミングに同期した書込みパルス信号をア
ドレスカウンタ３８およびセレクタ４０に出力す
る。アドレスカウンタ３８は、印字方向の指定信
号Ｐに基づいて、パルス信号をインクリメン
トまたはデクリメントを行なうようにカウントす
る。 When it is time to start printing, the CPU 31 determines the printing direction (for example, left or right direction) and outputs the designation signal to the PIO 39. Also, various parameters for data transfer are set in the DMA controller 36, and the controller is enabled. The PIO39 adjusts the level of the signal P according to the designated signal of the CPU31.
For example, "1" is set for the right direction, and "0" is set for the left direction. Then, the DMA controller 36 outputs a ready (RDY) timing signal φ for timing with the printer mechanism.
When given as a signal, control is started so that a dot image, which is a predetermined number of bytes of data, is output from the RAM 35 to each output port 37a to 37c. In this case, the DMA controller 36
A write pulse signal synchronized with the timing of transferring data to each output port 37a to 37c is output to address counter 38 and selector 40. The address counter 38 increments or decrements the pulse signal based on the print direction designation signal P.
アドレスカウンタ３８は、例えば３進カウンタ
でカウント値（２ビツト）であるアドレス信号
A1，A2をセレクタ４０に出力する。セレクタ４
０は、アドレス信号A1，A2により出力ポート３
７ａ〜３７ｃの中からそのアドレスの出力ポート
を選択し、選択された出力のポートのクロツク端
子CKにタイミング信号T1〜T3をそれぞれ出力す
る。これにより、各出力ポート３７ａ〜３７ｃ
は、セレクタ４０からのタイミング信号T1〜T3
に同期して、例えば３７ａ，３７ｂ，３７ｃの順
で１バイト毎のドツトイメージをラツチする。こ
の各出力ポート３７ａ〜３７ｃは、例えば24ピン
の印字ヘツドに対して８ビツト毎のピンデータを
出力する。そして、１行分の印字が終了すると、
新たに印字方向の指定信号Ｐが出力され、再度
DMAコントローラ３６の制御で印字が開始され
ることになる。ここで、上記のように１行分の印
字中において、CPU３１は次行の印字編集を行
なうことになる。 The address counter 38 is, for example, a ternary counter and receives an address signal which is a count value (2 bits).
A 1 and A 2 are output to the selector 40. selector 4
0 is output port 3 by address signals A 1 and A 2
The output port corresponding to the address is selected from 7a to 37c, and timing signals T1 to T3 are outputted to the clock terminal CK of the selected output port, respectively. As a result, each output port 37a to 37c
are the timing signals T 1 to T 3 from the selector 40
In synchronization with, for example, 1-byte dot images are latched in the order of 37a, 37b, and 37c. Each of the output ports 37a to 37c outputs pin data of every 8 bits to, for example, a 24-pin print head. Then, when one line of printing is finished,
A new print direction designation signal P is output, and the
Printing is started under the control of the DMA controller 36. Here, while printing one line as described above, the CPU 31 edits the print of the next line.
このようにして、DMAコントローラ３６の制
御により、印字ヘツドに対してピンデータが送ら
れて、確実な印字動作が行なわれることになる。
そして、この発明では、ピンデータを出力するた
めの複数の出力ポート３７ａ〜３７ｃを設け、印
字方向を指定する信号Ｐに基づいた順序で各出力
ポート３７ａ〜３７ｃからピンデータを出力する
ように制御する。これにより、DMAコントロー
ラ３６の制御で印字方向の異なる印字動作を確実
に行なうことができる。また、CPU３１はDMA
コントローラ３６の制御での印字中に、次行の印
字編集を印字方向の決定を必要とすることなく行
なうことができる。そのため、DMA方式による
高速の印字処理を行なうことができる。 In this manner, pin data is sent to the print head under the control of the DMA controller 36, thereby ensuring a reliable printing operation.
In the present invention, a plurality of output ports 37a to 37c are provided for outputting pin data, and the pin data is controlled to be output from each output port 37a to 37c in an order based on a signal P specifying the printing direction. do. Thereby, printing operations in different printing directions can be reliably performed under the control of the DMA controller 36. In addition, CPU31 is DMA
During printing under the control of the controller 36, the printing of the next line can be edited without the need to determine the printing direction. Therefore, high-speed printing processing using the DMA method can be performed.
以上詳述したようにこの発明によれば、ドツト
漢字プリンタ等において、印字方向の異なる印字
動作に必要な印字データの出力制御を、DMA方
式を使用した簡単な構成でかつ高速に行なうこと
ができる。したがつて、DMA方式を使用した高
速の印字処理において、印字方向を可変できる双
方向の印字制御を簡単な構成でかつ高速に行なう
ことができるものである。
As detailed above, according to the present invention, it is possible to control the output of print data necessary for printing operations in different printing directions in a dot kanji printer, etc., with a simple configuration using the DMA method and at high speed. . Therefore, in high-speed printing processing using the DMA method, bidirectional printing control that can vary the printing direction can be performed with a simple configuration and at high speed.
第１図は従来のプリントラインバツフアの構成
を示す図、第２図Ａ，Ｂは従来のプリンタの印字
動作を説明するための図、第３図はこの発明の一
実施例に係る印字制御方式の構成を示すブロツク
図である。
３１……マイクロプロセツサ（CPU）、３５…
…メモリ（RAM）、３６……DMAコントロー
ラ、３７ａ〜３７ｃ……出力ポート、３８……ア
ドレスカウンタ、３９……プログラムド入出力ポ
ート、４０……セレクタ。
FIG. 1 is a diagram showing the configuration of a conventional print line buffer, FIGS. 2A and B are diagrams for explaining the printing operation of a conventional printer, and FIG. 3 is a print control according to an embodiment of the present invention. FIG. 2 is a block diagram showing the configuration of the system. 31...Microprocessor (CPU), 35...
...Memory (RAM), 36...DMA controller, 37a to 37c...Output port, 38...Address counter, 39...Programmed input/output port, 40...Selector.
Claims (1)
リントラインバツフアから前記ドツトイメージデ
ータを読出し、印字データとして印字ヘツドへ転
送するためのダイレクトメモリアクセス手段を備
えた印字装置において、 前記ダイレクトメモリアクセス手段により前記
プリントラインバツフアから読出し転送された前
記ドツトイメージデータをラツチし前記印字ベツ
ドへ印字データとして出力する複数の出力ポート
と、前記印字ヘツドの印字方向に応じて前記複数
の出力ポートのうちから１つの出力ポートを順次
選択しこの選択した出力ポートに前記プリントラ
インバツフアから読出したドツトイメージデータ
をラツチさせるラツチ制御手段とを具備したこと
を特徴とする印字制御方式。[Scope of Claims] 1. A printing device equipped with direct memory access means for reading dot image data from a print line buffer storing one line of dot image data and transferring it to a print head as print data, a plurality of output ports for latching the dot image data read and transferred from the print line buffer by the direct memory access means and outputting it to the print bed as print data; A printing control system comprising: latch control means for sequentially selecting one output port from among the output ports and causing the selected output port to latch dot image data read from the print line buffer.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23280382A JPS59119440A (en) | 1982-12-25 | 1982-12-25 | Print control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23280382A JPS59119440A (en) | 1982-12-25 | 1982-12-25 | Print control system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59119440A JPS59119440A (en) | 1984-07-10 |
| JPS6312291B2 true JPS6312291B2 (en) | 1988-03-18 |
Family
ID=16945005
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23280382A Granted JPS59119440A (en) | 1982-12-25 | 1982-12-25 | Print control system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59119440A (en) |
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