JPS6270993A - デ−タを記憶し処理するための携帯可能なデ−タ担体 - Google Patents

デ−タを記憶し処理するための携帯可能なデ−タ担体

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JPS6270993A
JPS6270993A JP61212862A JP21286286A JPS6270993A JP S6270993 A JPS6270993 A JP S6270993A JP 61212862 A JP61212862 A JP 61212862A JP 21286286 A JP21286286 A JP 21286286A JP S6270993 A JPS6270993 A JP S6270993A
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carrier
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CII HONEYWELL BULL CII HB
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CII HONEYWELL BULL <CII HB>
CII HONEYWELL BULL CII HB
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明は、操作が容易でしがも持運びが容易である秘
密データまたは秘密を要しないデータのための新規なデ
ータ担体に関ｒる。
磁気カードの形態にあるとか、あるいはまた集積回路を
内蔵したカードの形態であるとか、既に多数のＭ３密デ
ータ担体の実施例が知られている。
この種のデータ担体は精巧なものであるが、その主たる
欠陥は担体が意図されている用途によって決定される単
一の機能を逐行する決まった構成の特殊な電子回路を使
用しなければなら／′ 、・′−ヲ ／″ ないという点にある。データへのアクセスは一般に担体
の所有者だけにしか知られていないデータ担体に記憶さ
れているキーによって得られる。このようにしてデータ
担体自体に安全手段が設けられて、それによって不正な
キーを使用してのデータ担体へのアクセスは阻止される
。
しかしながらこのような安全手段を従来より知られてい
る秘密データ用担体内に組込むことはデータ担体とそれ
に接続される処理装置上の間で用いられるキーが正しい
か不正ｆｊものであるか否かに応じて異なった対話がな
されることを意味する。したがって詐欺を動こうとする
者が賢ければ、データ担体の内容を処理装置に接続して
いるデータ線路から傍受して該データ担体へのアクセス
を許容するキーを発見するこ七は完全に可能である。
この発明の第１の目的は、電子的構成がプログラム可能
であり、しかも特殊な電子的構成を用いずに多数の機能
を遂行するこさができるデータ担体を提供することにあ
る。
この発明の第２の目的は、一般的性質の情報および秘密
情報を記憶しており、しかもデータ担体内に記憶されて
いるデータの内部処理およびデータ担体に接続された処
理装置とのデータ交換の外部処理のための処理部材を備
えておって、処理装置との外部的なデータ交換はキーが
正しいものであれ不正のものであれ、異常事態または不
正な使用の場合に不変な状態に留まるようにしたデータ
担体を提供することにある。
より正確に述べると、本発明によるデータ担体は、゛眠
気的にプログラム可能なユ出し専用メモリヲ備えたマイ
クロプロセッサを有する電子装置と組合わされた小さな
寸法の携帯用物品によって形成されるものであって、上
記メモリは次のような３個の領域を有している。即ち、
データ担体の回路による内部的な読出しおよび書込みだ
けが許される秘密領域；あらゆる読出しおよび書込み動
作が許される作業領域；および、データ担体の内部また
は外部に設けられた電子装置により指令された読出し動
作だけが許される読出し領域である。そして、このメモ
リは、上記秘密領域内にキーの使用を要求する秘密デー
タへのアクセスを表示するアクセス領域と誤り領域とを
有しており、マイクロプログラムはデータ担体にアクセ
スが要求される都度上記領域の各々にそれぞれ１ビツト
を記憶できるようにされていることを特長とするもので
ある。
この発明の装置によれば、装置自体によって確認される
秘密コードが該装置に与えられたときに、メモリの予め
定められた領域における読出しおよび書込み機能の実行
が可能となる。
実行されるべき動作は、各用途に対して特定されている
マイクロプロセッサのメモリに記憶されたマイクロプロ
グラムによって内部的にかつ連続的にモニタされかつ処
理される。この内部処理によれば不正使用を試みようと
する者がデータ担体を使用するのに必要な情報の性質を
窃取する機会は完全に無くなる。
この発明による携帯可能なデータ担体は特に次のような
用途に用いることができる。即ち変動する勘定データの
記憶や処理、秘密または制限された情報正こ対するアク
セスの制御、処理の内部的分類またはいろいろな処理が
可能なようにした携帯用の秘密にされるファイルまたは
秘密にされないファイルの作成等である。
この発明の特徴や利点は、添付図面を参照しての以下の
詳細な説明から一層明瞭になろう。
第１図は、この発明による電子回路の第１の具体例を示
す。マイクロプロセッサ１は、アースと端子７との間に
接続されていて外部電源から調整された電圧を受ける。
ＰＲＯＭ型のプログラム可能な読出し専用メモリ２は、
アースと端子８との間に接続されている。
この構成によれば、端子７が一定の゛電位にある間に、
ｒＪ：込み電圧を端子８に印加して、マイクロプロセッ
サに給電することができる。メモリは、４０９６ビツト
と８１９２ビツトとの間の容量とすることができ、そし
てこの容１号は意図する用途にとって十分である。しか
しながら、この容量は、この発明を制限するものではな
い。
端子５は、装置内の各種の内部要素を外部要素と同期さ
せる働きをする。これに印加される電圧は、パルス電圧
であってその周波数は０．５ないし５メガヘルツのオー
ダとすることができる。
端子６は、入力データおよび出力データに対する唯一の
アクセス手段であり、マイクロプロセッサは、転送方向
に依存してデータを直列化したり並列化したりすること
により対話を司る。
マイクロプロセッサ１は、アドレス毒腺６およびデータ
母線４を介してメモリ２を完全に制御する。
読出し要求が端子６からマイクロプロセッサに達すると
上述のチェック後にアクセスが許される。読出し相にお
いては、アドレスは母線６から供給されて、データは母
線４に読出される。
書込み要求が端子６から装置に達すると、チェックの後
にアクセスが許される。アドレスは母線３から与えられ
、データは母線４から書込まれる。書込み指令は、端子
８の書込み電圧と同時に、線路１０を介してメモリ２に
伝送される。
耳２図は、電子回路の第２の具体例を示す。
マイクロプロセッサ１は、不捉発性の読出し専用メモリ
２を内蔵している。このメモリ２は２個の領域２０およ
び２１に分けられている。
領域２０は、マイクロプロセッサのための動作プログラ
ムを記憶している。・領域２１は、データの記憶のため
に用いられる。
この具体例においては、ｉ：ｊ、　諒電圧はクロックし
ｆ圧５と同様にマイクロプロセッサに供給される。
先に述べた母線６および４は、この例では内部母線にさ
れており、第２図には示されていない。
第３図は、この発明によるデータ担体の一具体例を示す
ｔａＥ’？面図である。ポリ塩化ビニルからなるシート
Ｃ２に形成された開口内には、これもポリ塩化ビニルか
らなる別異の２枚のシート材Ｃ１，Ｃ５が嵌着されてお
り、これらのシート材Ｃ１およびＣ３は上記開口の全領
域を占め、そして該開口の周辺に形成された段部に取り
付けられている。
段部によって形成された突出部と２枚のシート材Ｃ１と
０３との間に画定された空間内にはエポキシ樹、詣層Ｃ
４が配置されており、このエポキシ樹脂層Ｃ４には２個
の半導体モジュールのための２個の開口が形成されてい
る。これらの半導体モジュールの中で、一方のモジュー
ルはマイクロプロセッサ・モジュールＣ７でアリ、他方
のモジュールはプログラム可能な読出し専用メモリＣ８
である。
エポキシ樹脂には導電性のワイヤ０９　、　Ｃ！１０お
よび０１１が施されており、導体Ｌ１ないしＬ４によっ
て上記２個の半導体モジュールに接続されている。導体
Ｌ１ないしＬ４の一端部はポリ塩化ビニルシート材Ｃ１
によって保持されており、また、導体Ｌ１ないしＬ４が
出ている面と反対側のモジュールの面はポリ塩化ビニル
シート材Ｃ３に圧接されている。データ担体さ外部演算
装置との間の接続の一具体例は、他に提案されている。
第４Ａ図は、この発明によるデータ担体のデータ内容の
組織図である。データ担体をあらゆるイ１類の使用に適
合させるようにするために、マイクロプロセッサのメモ
リには２種類の組織が設けられている。
第１の組織は、メモリの物理的組繊を表わすものであっ
て、これはマイクロプロセッサだけにしか知らされない
ものである。
第２の組織は、メモリの論理的組織を表わすものであっ
て、これはデータ担体が用いられる時の使用条件を満た
すものである。
マイクロプロセッサは、これら２穆類の組、′哉を相関
させる役目を有している。
通常の動作においては、物理的メモリは６個の部分から
なっている。
部分０は、アドレスＡＤＯで始まり、アドレスＡＤＴ−
１で終るものである。この部分０はメモリの秘密部分を
表わすものであって、外部からの読出しおよび啓込みは
禁止され、内部的な読出しおよび書込みだけが許される
ものである。
部分１は、アドレスＡＤＴで始まり、アドレスＡＤＬ−
１で終るものである。この部分１はマイクロプロセッサ
のための作業メモリとしての働きをするものであって、
あらゆる内部的なまたは外部からの読出しおよび書込み
動作が許されるものである。
部分２は、アドレスＡＤＬで始まり、アドレスＡＤＦで
終るものである。メモリのこの部分２においては、外部
からのおよび内部的な書込みは禁止されるが、内部的な
または外部からの読出しは許されるものである。
論理的メモリは、開設メモリと利用メモリに分けられる
。
データ担体は、それが発行された時点において、該担体
の識別を可能にする情報を記憶していなければならない
。この情報は、開設メモリに記憶されている。この開設
メモリはアドレスＡＤＦで始まるものであり、データ担
体の製造者およびその連呑号の識別を可能にする被数の
領域と、開設メモリの内容を有効化し該開設メモリの書
込みを許容する領域ＬＯＯＫＦとに分けられている。領
域ＬＯＯＫＦは、例えば２ビツト・サイズのものにする
ことができ、次のコードを用いることができる。ＬＯＣ
！ＫＦ＝１１であるときには開設領域における読取りお
よび書込みが可能であり、これに対して、ＬＯＣＫＦ≠
１１であるときには開設領域の内容が有効化されて書込
み動作が禁止される。
利用メモリはデータ担体の使用者によって用いられるも
のである。たゾし、どのような使用がなされる１こして
も、このメモリ自体は、２個の部分に分けられており、
その中の一方の部分は定義メモリと称され、他方の部分
は適用メモリと称される。これらの領域の大きさは、意
図される使用によって左右されるものであることは、言
うまでもない。定義メモリはアドレスＡＤＯで始まるも
のであり、次の領域を含んでいる。
すなわち、定義メモリの外部からのアクセスを禁止して
その内容を有効化する多ビツト領域ＬＯＯＫ　；データ
担体の性質ζこよって定まる長さを有しデータ担体の動
作を許容するのに必要なパラメータを記憶している領域
ＰＡＲＡＭ　；および、勘定記録手段、食事チケット、
電子的封止手段、ホテルやファイルシステムへの容認キ
ーなどとして用いることができるデータ担体の機能を定
義する領域ｐｙｐＥを含んでいる。
適用メモリは、残余の領域から構成されている。この適
用メモリは共用メモリとして使用することができるけれ
ども、物理的メモリの種々な部分に対するアクセスを規
制する条件は守らねばならない。従ってこの発明のデー
タ担体が適用される用途が何であれ、秘密データは常に
部分０に位置しており、読出されるデータだけが部分２
に位置している。そして、データ担体の通常の動作にお
いて記憶されるべきデータは部分１に位置することにな
る。適用メモリに記憶される論理データｌこ用いられる
フォーマ・ントは、任意のもので良いことは言うまでも
ない。
次に、論理メモリの破壊の一例について、第４Ｂ図を参
照しながら基本的な使用に関連して説明する。
まず、データ担体へのアクセスのためには、少なくとも
２個のキーが必要であるものとする。
対象が銀行業務であるとしたときには、キー闇１で銀行
が識別され、そして、キーＮｏ、　２で顧客が識別され
る。このとき、定義メモリには、データ担体の貸借用途
を指定するコードを記憶するための領域が含まれること
になる。領域ＰＡＲＡＭには、２ビツトのＬ　ＯＯＫ領
域が含まれている。ＬＯＣ！に＝１１　　であるときに
は、キー阻１が存在すると、７７このみ、メモリのあら
ゆる部分へのアクセスが許される。ＬＯＣＫ≠１１．で
あるときには、物理的メモリの部分ｏ４よび部分２の内
容が有効化される。キー阻２が存在しないときには、部
分０へのアクセスおよび部分２への書込みが禁止される
。カードによるクレジットを与えるためにはキーＭ１が
必要とされる。
ＬＯＣ！に≠１１　であるときには、定義メモリの内容
が有効化される。
領域ＬＰは２ビツトからなるものである。
ＬＰ＝１１であるときには、読出しが保護されるこさは
なく、部分１および２からの読出しがキーなしで許され
る。
Ｌｐ≠１１であるときには、読出しは保顧されることに
なり、部分１および２からの読出しのためにはキーが必
要とされる。多くの銀行業務においては、これが普通で
ある。
領域ｇｐは２ビツトからなるものである。
ＫＰ＝１１であるときには、書込みは保護されない。こ
のときには、メモリは保護されていない記憶手段として
用いられることｌこなる。このことは、例えば、データ
担体がインプリント（ｉｍｐｒｉｎｔ　）される以前に
はメモリがブランクにされている状態に対応する。
Ｆ、ｐ≠１１であるときには、物理的メモリの部分１に
書込みを行うためにはキーが必要とされる。
適用メモリは、識別メモリおよび貸借メモリからなるも
のである。識別メモリ内のデータは、部分Ｏおよび２に
分けられている。部分りにおいては・識別メモリは、本
質的に誤りメモリおよびアクセスメモリからなっている
。誤りメモリは、データ担体が間違ったキーで用いられ
る度毎に誤りビットを記憶する。誤りビットは、ある所
定のアドレスから出発して逐次大きくなるアドレスに記
録される。溢れ領域ＤＥＢＥが書込まれると、データ担
体は無効にされる。
アクセスメモリは、データ担体の５光取りが保護されて
いる場合（ＬＰ≠１１）のみ存在する。そしてこれが銀
行業務に用いる場合の大多数の例である。正しいキーに
よる各紐取り動作において、マイクロプロセッサはアク
セスビットを逐次書込む。アクセスビットは、ある所定
のアドレスから書込まれていく。領域ＤＥＢＡＣに達す
るとデータ担体は無効にされ、尻取りは行われない。
識別メモリは、更に次のような領域を含んでいる。すな
わち、カードが満杯であって、書込みが不可能であるこ
とを表示する「満杯」領域；銀行のキーおよび顧客のキ
ーに対するコードを記憶する「キー」領域（例えば、銀
行にはキー／Ｉ６１が割り当てられ、顧客にはキー應２
が割り当てられる。）；キー／１６１の有効性を判定す
る領域ＴＡＬＣｉ　（ＶＡＬ　０１≠１１であればキー
は有効）；およびキー鷹２の有効性の判定を行なう領域
ＶＡＬＣ２（ＶＡＬＯ２Ｓ　１１ならばキーは有効）を
含んでいる。
ＬＯＣ！に≠１１であるときには、データ担体の購買能
力を、特にいかなる形式のクレジットでも、増大させる
ような情報の書込みだけが、キー１ｆ６１で許される。
これに対して、キー腐２は、借方操作の有効化（保護さ
れた読出しまたは書込み）のために、データ担体の所有
者によって使用される。
物理的メモリの部分２の識別メモリは、アドレスが減少
する方向において定義メモリのすぐ前からで始まる。こ
の可変長の領域は、データの永久的な記憶を可能にする
。この領域には、次の領域が含まれている。すなわち、
作業領域の開始アドレスを有するポインタＡＤＴと読出
し領域のアドレスを有するポインタＡＤＬを記憶するア
ドレス領域：銀行の識別表示およびデータ担体の発行日
を表わす領域Ｒより　：データ担体の所有者の名称を表
わす領域；Ｎビットの「合計」領域；および、上記合計
領域と関連してデータ担体の初期合計を既知にする単位
領域「Ｕｌ」を含んでいる。
例えば、単位領域が５００フランを表示しているものと
すると、データ担体が記憶することができる初期合計は
（２ｎ−１）Ｘ５００　フランである。
貸借メモリは、アドレスＡＤＴとＡＤＩ、との間で物理
的メモリの部分１の作業領域内に位置している。借方は
、アドレスが大きくなる方向において、アドレスＡＤＴ
から出発して記録される。
貸方は、アドレスＡＤＬから出発して、アドレスが減少
する方向に記録される。このようにして借方および貸方
は互いに向い合って進み、次第にメモリを満たしていく
。
第５図は、第１図および第２図に示した回路の詳細図で
ある。この第５図において、入力データまたは出力デー
タは、データ担体の端子６に２進形態で現われる。入力
データは、ゲート２５を通ってシフト・レジスタ２４に
記憶される。ゲート２５は、該ゲート２５を論理制御装
置１６に接続する線路６６からの信号によって制御され
る。出力データは、これも論理制御装置１６への接続線
路３６の信号によって制御されるゲート２６を通ってデ
ータ担体から出力される。レジスタ２４に記憶されたデ
ータは、次いで、演算論理装置２３で行なわれる演算の
ための第１の演算数として用いられる。なお、演算論理
装置２３は、論理制御装置１６により発生される制御信
号で線路３７を介して制御されるものである。第２の演
算数は、アドレス・セレクタ２２によってアドレス指定
されるレジスタ・バンク１９のレジスタ段Ａ、Ｂ、Ｃ，
Ｄの中の１つに記憶されている。このアドレス°セレク
タ２２は、線路２９を介して論理制御装置１６により制
御されるものである。演算論理装置２３によって行われ
た演算の結果は、レジスタバンク１９のレジスタ段Ａに
、または、ゲート２６を介してデータ担体の端子６に伝
送される。また、レジスタ段Ａ、Ｂ、Ｃ，Ｄは、接続線
路４６による論理制御袋ｆａ、　１６の制御の下に、線
路４１を介してデータおよびアドレス母線３４から置数
することもできる。そして、母線３４は、二方向接続線
路６６によってシフトレジスタ２４にも接続されており
、このことから、シフトレジスタ２４は並列人力／出力
部で書込みや読出しをすることができる。論理制御装置
１６は、アドレス拳セレクタ１３によってアドレス指定
されたマイクロ命令をＲＯＭ型の制御メモリ２０に再伝
送し、このマイクロ命令は接続線路４８を介してレジス
タ１４に読出される。
メモリ２１は、不揮発性のメモリである。このメモリ２
１は、線路６を介して母線３４から置数されるアドレス
・レジスタ１１によってアドレス指定される。アドレス
−レジスタ１１は、メモリ２１内のデータ語を指定する
ものである。
アドレス・レジスタ１１は、論理制御装置１６とアドレ
ス・レジスタ１１との間の接続線路３８を伝送される制
御信号によって制御される。このアドレス会レジスタ１
１に記憶されているアドレスは、論理制御装置１６の制
御下でデータ担体の端子５に伝送されるクロック信号に
よって、自動的ｌこ増減することができる。メモリ２１
から読出されたデータは、線路４２を使用する論理制御
装置１６の制御の下に、レジスタ１２を通して母線３４
に伝送される。なお。
第５図をこ示されている要素の個々のものについては当
業者にとって周知のものであるから、これについての詳
細な説明は省略する。
意図される用途に対して、第５図に示されている装置の
機能は次のように要約することができる。
所与のアドレスから出発して許された領域におけるメモ
リ２１のｊ頃次の読出しおよび書込みをする； 適用メモリの秘密領域に８込まれているデータ担体の外
部からアクセスすることができない語と比較することに
よって可能化キーを求めチェックする； 読出しおよび書込みの許可または禁止をする：メモリへ
の書込みの系統的な自己チェックをする； アクセスの誤りおよび（または）アクセスの成功を内部
的に記憶するように指令する；誤りの数が部分Ｏに設定
された数になったときに、それ以前に可能であった機能
を不能にすること。
第６図および第７図は、メモリ読出しモードにおける動
作を図解するものである。第６図において、零リセツト
信号ＲＡＺで論理制御装置１６が初期条件設定され、該
論理制御装置はＩ１０線路を経てメツセージのレジスタ
Ｔへの転送を可能にするものである。
読出し指令は、演算コードＣ０ＤＯＦおよびアドレスピ
ッ１−ＡＤに先行する信号５ＹＮＯの形態にある。用い
られるコードは、各用途に応じて決定しなければならな
いことは言うまでもない。
ｃｏｎｏｐ指令およびアドレスは処理装置によって受は
入れられ、該処理装置は、語Ｃ０ＤＯＦおよびビットＬ
Ｐを試験することによって、読出し動作が含まれている
か否か、そして読出し動作が保護されているか、あるい
は簡単に許可されるかどうかを判定する。第６図におい
て、メツセージＣ０ＤＯＰ十ＡＤはステップ５０１で受
は入れられ、試験はステップ５０２および５０４で行な
われる。その動作が保護されていない読出し動作である
ときには、第５図のレジスタ１１には、ステップ５１０
において、工／○線路から（：！０ＤＯＰの伝送に続く
アドレス語が入力され、次いで、ステップ５１１におい
て、読出しアドレスが実際に許可されたメモリ領域内に
あるか否かについて検査が行なわれる。特に、制御メモ
リ２０に記録されているマイクロプログラム、により、
受信したアドレス語がアドレスＡＤＴよりも高位である
か否かがチェックされる。その理由は、外部的な読み出
しは、物理的メモリの部分１および２においてだけ許さ
れるものであるからである。
アドレスがアドレスＡＤＴよりも高位であるときには、
データがメモリ２１から読出されてレジスタ１２に入力
され、母線３４を介して出力線路工１０　に伝送される
。そして、アドレス・レジスタの内容は、ステップ５１
０において、マイクロプログラムによりコー１．４　Ｃ
０ＤＯｒ’の内容ｉ′Ｃ依存して１単位だけ増減される
。アドレスＡＤがアドレスＡＤＴ　（部分Ｏ内のアドレ
ス）よりも下位であるときには、アドレス・レジスタ１
１は、その内容が値ＡＤＴに達するまで１単位ずつ増分
される。このようにして、部分０を除くメモリ全体は、
増大または減少するアドレス方向において、データ担体
に接続された装置によって読出される。
読出しが保護されているときには、［ｃＯＤＯＰＪおよ
びＬＰビットについて行なわれる試験は一致しなければ
ならない。このときには、ステップ５０５でキーを得る
ことが必要である。２個のキーが必要とされるときには
、読取り動作が行なわれるときに用いなければならない
キーの型がＣ０ＤＯＦコードの内容によって特定される
。
工１０線路から受は入れられたキーは、そこで識別メモ
リに記憶されている２個のキーの中の１個と比較される
。こＮで一致が生じたときには、伝送されたキーは正し
いものとされ、このために、１個のビットがアクセスメ
モリに記録される（ステップ５０７）。このビットの書
込みに対するチェックが、後続のステップ５０８で行な
われる。そして、このビットが書込まれなかったときに
は、ステップ５０７に戻ることが必要である。その書込
みが実際上行なわれたときには、直ちに、データ担体が
依然有効であるか否かを検査するために、ＤＥＢＡ（１
！、誤りおよび全領域に対する試験がステップ５０９で
行なわれる。データ担体が有効でないときには、例えば
コード「０００」が線路Ｉ１０に沿って伝送される。
担体がマイクロプログラムによって容認されたときには
、アドレスＡＤがアドレス・レジスタ１１に送られて、
ステップ５１０ないし５１６が実行される。
工１０綜路から受は入れられたキーがステップ５０６で
正しくないと判定されたときには、誤りビットが誤りメ
モリに記憶される（ステップ５１４）。誤りビットが書
込まれると、記録されている誤りの数が誤りの許容数Ｎ
よりも大きいか否かに関してステップ５１５で試験が行
なわれる。この誤りの数がＮよりも小さいときには、メ
ツセージ「ＦＦＦ　ｊが線路工１０に沿って伝送され、
他方大きい場合には、メツセージ「０００」が線路Ｉ１
０を介して伝送されてデータ担体は無効にされる。
上に述べたデータ担体の読出し過程の説明から明らかな
ように、用いられるアクセスキーが正しいか正しくない
かに関係なく、使用者はデータ担体の動作における変更
を知ることはできない。これに加えて、２つの可能性（
キーが正しいかまたはキーが正しくない）のうちのいず
れにおいても、誤りビットのアクセスビットをメモリに
書込めば、その結果として、データ担体は常に同じ大き
さの電流を消費することになり、このことから、カード
に流れる電流の強さをモニタしようと試みる不法者は、
用いているキーが正しいか正しくないかに関係なく、常
に一定の電流消費しか知ることができない。
第８図および第９図は、メモリの書込みモードにおける
データ担体の動作を図解するものである。第８図のフロ
ーチャートにおいて、零リセツト信号ＲＡＺで論理制御
装置１６が初期条件設定され、工１０線路に存在するデ
ータがレジスタ２４に転送される。書込み指令は％書込
みが保護されているときには、データ・アドレス・ビッ
トＡＤおよびキーによって後続される演算コード「Ｃ０
ＤＯＰ　Ｊに先行する信号５ＩＮＯの形態にある。次い
で、信号ｖｐが伝送されて、データ担体のメモリ２１に
データを沓込むことが可能にされる。腺路工１０を介し
て伝送されたデータが実際にデータ担体に記録されたこ
とを使用者が確認できるようにするために、メモリ屹書
込まれたデータは再び読出されて、線路工１０を介して
使用者に再伝送される。コード「０ＯＤＯＰＪは各用例
に対して特定化されていることは言うまでもない。第９
図のフロチャートにおいて、キーによって後続されるこ
ともあり、後続されないこともあるアドレスＡＤおよび
指令Ｃ０ＤＯＦが、ステップ７０２および７０３で行な
われる試験により、データ担体によって認識される。
ステップ７０４では、データ担体の有効性に関する試験
が、領域ＤＥＢＥ　、　ＤＥＢＡＯおよび「全」領域に
対して行なわれる。データ担体が有効であるものと判定
されると、ステップ７０５でデータが取込まれる。
曹込みが保護されているときには、キーを用いることが
必要であり、ステップ７０７でキーに対する試琺が行わ
れる。キーが誤っているときには、誤りビットが誤りメ
モリに書込まれ（ステップ７０８　）、それに続いて、
誤り領域が溢れ状態にあるか否かについて、ステップ７
０９で試験が行なわれる。溢れ状態にあるときには、デ
ータ担体は線路工１０にコード「００ｏ」を送ってカー
ドが有効でないことを表示する（ステップ７１０）。溢
れ状態にないときには、データ担体は線路工／○にコー
ドＦＦＦを送り（ステップ７１１）、データが書込まれ
なかったことを表示する。
キーが正しい場合には、有効化ビットがステップ７１２
で記憶され、受信されたアドレスがステップ７１３でア
ドレス・レジスタ１１に入力される。そこで受信された
アドレスが物理的メモリの許容された限界内に在るか否
か、言換えるならば、アドレスＡＤＬとＡＤＴとの間に
在るか否かを確かめるための検査がステップ７１４で行
なわれる。上記限界内に無いときには、コードＦＦＦが
線路工１０に送られてデータがメモリに記録されなかっ
たことを表示する。アドレスが許容されるものであると
きには、綜路工１０に沿って受は入れられたデータはレ
ジスタ１２に伝送されて、メモリの部分１に書込まれる
（ステップ７１５）。ステップ７１６．７しおよび７１
８では、データがメモリに実際に８込まれたか否かにつ
いての試験が行なわれる。データがステップ７１９で書
込まれた後に、有効化ビットがメモリに書込まれ、しか
る後に、書込まれたデータが再び線路工１０に沿って送
られる。
以上、この発明の主たる特長について図面に示す具体例
を参照し説明したが、当業者には明らかなように、この
発明の範囲を逸脱することなしに数多の変形や変更が可
能であることは言うまでもないであろう。
【図面の簡単な説明】
第１図およびｘ２図はそれぞれこの発明によるデータ担
体の電子回路の具体的な例示図、第３図はこの発明によ
るデータ担体の横断面図、第４Ａ図および第４Ｂ図はこ
の発明のデータ担体のデータ内容の１つの組織図、第５
図は第１図および第２図に示した回路の詳雑な回路図、
第６図および第７図はメモリ読出しモードにおけるデー
タ担体の動作の例示図、第８図および第９図はメモリ書
込みモードにおける動作の例示図である。 １・・マイクロプロセッサ、２・・読出し専用メモリ、
３，４・・母線、５，６，７．８・・端子、９・・アー
ス、Ｃ！１　、Ｃ！２．Ｃ３・・シート、Ｃ４・・エポ
キシ樹脂層、Ｃ７・・マイクロプロセッサ・モジュール
、Ｃ８・・メモリ・モジュール、Ｃ！９．Ｃ１０，Ｃ１
１−・ワイヤ、Ｌｊ　、Ｌ２．Ｌ３．Ｌ４・・導体、２
５．２６・・ゲート、２４・・シフト−レジスタ、１６
・・論理制御装置、１１・・アドレス拳レジスタ、１９
・・レジスタバンク、２３・・演算論理装置、２１・・
メモリ、２０・・制御メモリ。 特許出願人代理人　　曽　我　道　照 第５図 ＶＤ 舅６図 第７図 第９図 ｐ

Claims (1)

  1. 【特許請求の範囲】 （１）プログラム可能な読出し専用メモリ（２１）を含
    んでいるデータを記憶し処理するための携帯可能なデー
    タ担体であって、前記担体に対する外部的な装置による
    アクセスが禁止されており、前記担体に対する内部的な
    回路による読出しおよび書込みは許容されている第１の
    ゾーンを有しており、前記内部的な回路はマイクロプロ
    セッサにおいて実現されており、前記マイクロプロセッ
    サはアドレス−データ母線（３４）を通じて前記プログ
    ラム可能な読出し専用メモリ動作的に関連されており、
    前記マイクロプロセッサは、制御装置、演算装置、前記
    プログラム可能な読出し専用メモリ（２１）における読
    出しおよび書込みのための手段、前記メモリ内で書込ま
    れるべき外部的なデータを受入れるための手段、および
    、前記メモリから読出されたデータを外部に伝送するた
    めの手段、並びに、その内容で前記マイクロプロセッサ
    の動作を制御する第２のメモリが含まれている、データ
    を記憶し処理するための携帯可能なデータ担体。 （２）外部的なデータは直列的に受入れられ、伝送され
    るものであり、前記メモリに書込まれるべき外部的なデ
    ータを受入れるための手段、および、メモリから読出さ
    れたデータを外部に伝送するための手段には、その入力
    部においては、ゲート（２５）および直列化された情報
    を並列情報に変換するための手段が含まれており、また
    、その出力部においては、ゲート（２６）が含まれてお
    り、前記ゲート（２５、２６）は、前記マイクロプロセ
    ッサの制御装置（１６）により線路（３６）上を伝送さ
    れる信号によって制御されている特許請求の範囲第１項
    記載のデータを記憶し処理するための携帯可能なデータ
    担体。 （３）直列化された情報を並列情報に変換するための前
    記手段は、また、並列の双方向性接続部（３３）により
    、アドレス−データ母線（３４）にも接続されている特
    許請求の範囲第２項記載のデータを記憶し処理するため
    の携帯可能なデータ担体。 （４）前記ゲート（２５、２６）は、同一の端末に接続
    されている特許請求の範囲第３項のデータを記憶し処理
    するための携帯可能なデータ担体。 （５）直列化された情報を並列情報に変換させるための
    前記手段は、シフト・レジスタ（２４）である、特許請
    求の範囲第４項記載のデータを記憶し処理するための携
    帯可能なデータ担体。 （６）前記メモリにおける読出しおよび書込みのための
    前記手段には、アドレス・レジスタ （１１）およびデータ・レジスタ（１２）が含まれてお
    り、その一方は前記メモリに、その他方はアドレス−デ
    ータ母線（３４）に接続されており、前記アドレスおよ
    びデータ・レジスタ（１１、１２）は、それぞれに、制
    御装置（１６）により接続部（３８、４２）を通じて制
    御されている特許請求の範囲１項または３項記載のデー
    タを記憶し 処理するための携帯可能なデータ担体。 （７）前記プログラム可能な読出し専用メモリは第１の
    チップにおいて実現され、別異の装置は第２のチップに
    おいて実現される特許請求の範囲第６項記載のデータを
    記憶し処理するための携帯可能なデータ担体。 （８）第１のゾーンおよび少なくとも第２のゾーンを有
    する不揮発性メモリ（２１）を含んでいる、データを記
    憶し処理するための携帯可能なデータ担体であって、前
    記第１のゾーンは前記担体に対する外部的な装置により
    、または、前記担体に対する内部的な回路により前記メ
    モリに対してアクセスすることの可能性を規定するもの
    であり、前記内部的な回路はマイクロプロセッサからな
    り、前記マイクロプロセッサはアドレス−データ母線（
    ３４）を通じて前記不揮発性メモリと動作的に関連され
    ており、第２のメモリ（２０）の内容によって前記マイ
    クロプロセッサの動作を制御するようにされる、データ
    を記憶し処理するための携帯可能なデータ担体。 ９）前記不揮発性メモリ（２１）の前記第１のゾーンに
    はロック・ゾーンが含まれており、該ロック・ゾーンの
    内容は、キーが存在しないとき、前記担体に対する外部
    的な装置によるメモリのいずれの部分にも、書込みのた
    めのアクセスを禁止するものである特許請求の範囲第８
    項記載のデータを記憶し処理するための携帯可能なデー
    タ担体。 １０）第１のゾーンにはＬＰゾーンが含まれており、該
    ＬＰゾーンの内容は、キーが存在しないとき読出しを禁
    止することができるものである特許請求の範囲第９項記
    載のデータを記憶し処理するための携帯可能なデータ担
    体。 １１）前記第１のゾーンにはＥＰゾーンが含まれており
    、該ＥＰゾーンの内容は、キーが存在しないとき、書込
    みを禁止することができるものである特許請求の範囲第
    １０項記載のデータを記憶し処理するための携帯可能な
    データ担体。 （１２）前記第２のゾーンには前記データ担体の機能を
    規定する形式のゾーンが含まれている特許請求の範囲第
    ８項記載のデータを記憶し処理するための携帯可能なデ
    ータ担体。 （１３）前記第２のゾーンには可変長のメモリ同定ゾー
    ンが含まれており、該メモリ同定ゾーンには作業ゾーン
    の開始アドレスを含むポインタＡＤＴおよび読出しゾー
    ンのアドレスを含むポインタＡＤＬを含んでいるアドレ
    ス・ゾーンが含まれている特許請求の範囲第１２項記載
    のデータを記憶し処理するための携帯可能なデータ担体
    。
JP61212862A 1977-08-26 1986-09-11 デ−タを記憶し処理するための携帯可能なデ−タ担体 Granted JPS6270993A (ja)

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