JPS6186847A - 自動車用制御装置のcpu暴走防止装置 - Google Patents
自動車用制御装置のcpu暴走防止装置Info
- Publication number
- JPS6186847A JPS6186847A JP59206382A JP20638284A JPS6186847A JP S6186847 A JPS6186847 A JP S6186847A JP 59206382 A JP59206382 A JP 59206382A JP 20638284 A JP20638284 A JP 20638284A JP S6186847 A JPS6186847 A JP S6186847A
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- signal
- run
- run signal
- runaway
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は複数のCPUを用いた自動車用制御装置におけ
るCPU暴走防止装置に関する。
るCPU暴走防止装置に関する。
〈従来の技術〉
例えば、自動車のエンジン制御等にマイクロコンピュー
タが用いられるようになって以来、多くの機能の集約化
及び高度化の要求が強くなってきている。かかる対策と
して複数のCPUを設けて機能を分担させることにより
、個々のcPUの制御の簡略化、効率化及び実行時間の
短縮化等を図るようにしたものが提案されている(特開
昭59−108847号公報)。
タが用いられるようになって以来、多くの機能の集約化
及び高度化の要求が強くなってきている。かかる対策と
して複数のCPUを設けて機能を分担させることにより
、個々のcPUの制御の簡略化、効率化及び実行時間の
短縮化等を図るようにしたものが提案されている(特開
昭59−108847号公報)。
ところで、かかる自動車用制御装置では、安全対策とし
て通常CPUの暴走を防止する装置が設けられており、
従来では通常第4図に示すようにコントロールユニット
5内の各CPU1.2毎に暴走監視回路3.4を設ける
ようにしている。即ち、各CPU1.2の出力ボートか
らそれぞれ対応する各監視回路3,4にプログラムラン
信号(以下1”RUN信号)を出力し、前記各P’−R
UN信号の有無によってそれぞれの監視回路3.4が対
応するCPUI、2の異常を検出し、異常時にCPUI
、2にリセット信号を出力するようにしている。
て通常CPUの暴走を防止する装置が設けられており、
従来では通常第4図に示すようにコントロールユニット
5内の各CPU1.2毎に暴走監視回路3.4を設ける
ようにしている。即ち、各CPU1.2の出力ボートか
らそれぞれ対応する各監視回路3,4にプログラムラン
信号(以下1”RUN信号)を出力し、前記各P’−R
UN信号の有無によってそれぞれの監視回路3.4が対
応するCPUI、2の異常を検出し、異常時にCPUI
、2にリセット信号を出力するようにしている。
〈発明が解決しようとする問題点〉
しかしながら、従来のように各CPU毎に暴走゛監視回
路を設ける構成では、コスト及び実装スペース等の点で
不利である。
路を設ける構成では、コスト及び実装スペース等の点で
不利である。
本発明は上記の問題点を解決することを目的としてなさ
れたもので、単一のCPU暴走監視回路で複数のCPU
の暴走を防止するようにした。
れたもので、単一のCPU暴走監視回路で複数のCPU
の暴走を防止するようにした。
く問題点を解決するための手段〉
このため本発明では第1図に示すように、一方のCPU
から出力される第1P−RUN信号を他方のCPUに入
力し、他方のCPUから出力される第2P−RUN信号
を単一のCPU暴走監視回路に入力する構成とし、前記
他方のCPUに、第1P−RUN信号の異常・正常を判
定する判定手段と、該判定手段が異常判定したときに第
2P−RUN信号の発生を停止させる停止手段とを設け
ると共に、前記暴走監視回路のリセット信号を各CPU
に出力するよう構成した。
から出力される第1P−RUN信号を他方のCPUに入
力し、他方のCPUから出力される第2P−RUN信号
を単一のCPU暴走監視回路に入力する構成とし、前記
他方のCPUに、第1P−RUN信号の異常・正常を判
定する判定手段と、該判定手段が異常判定したときに第
2P−RUN信号の発生を停止させる停止手段とを設け
ると共に、前記暴走監視回路のリセット信号を各CPU
に出力するよう構成した。
く作用)
これにより、一方のCPUが異常状態であってそのP−
RUN信号(第1P−RUN信号)が異常のとき又は他
方のCPU自体が異常状態のときには、CPU暴走監視
回路へ他方のCPUのP’−RUN信号(第2P−RU
N信号)が入力されず、単一のCPU暴走監視回路によ
って各CPUがリセットされる。
RUN信号(第1P−RUN信号)が異常のとき又は他
方のCPU自体が異常状態のときには、CPU暴走監視
回路へ他方のCPUのP’−RUN信号(第2P−RU
N信号)が入力されず、単一のCPU暴走監視回路によ
って各CPUがリセットされる。
〈実施例〉
以下本発明の実施例を図面に基づいて説明する。
第2図は本発明のハードウェア構成の一例を示す。
図において、コントロールユニット11には2つの第1
及び第2 CP U12.13が設けられている。
及び第2 CP U12.13が設けられている。
各CPU12,13はそれぞれの制御処理プログラムに
従って各自に分担された制御を行う機能を有することは
従来と同様である。
従って各自に分担された制御を行う機能を有することは
従来と同様である。
そして、本実施例では、第1CPU12の出力ポートか
ら出力される第1P−RUN信号信号箱2CPU13の
入力ポートに人力し、第2CPU13の出力ポートから
出力される第2P−RUN信号信号光一のCPU暴走監
視回路14に入力している。
ら出力される第1P−RUN信号信号箱2CPU13の
入力ポートに人力し、第2CPU13の出力ポートから
出力される第2P−RUN信号信号光一のCPU暴走監
視回路14に入力している。
そして、前記第2CPtJ13には、第1P−RtJN
信号Aの正常・異常を判定する第1P−RUN信号判定
手段と、該判定手段が異常判定したとき当該判定手段か
らの信号に基づいて第2 CP U13の出力する第2
P−RUN信号信号光止させる第2P−RUN信号停止
手段が設けられている。また、前記CPU暴走監視回路
14には、第2P−RUN信号状態に基づいてCPUの
異常検出を行うcpU異常検出回路と、該検出回路から
の異常検出信号を受けて各CPU12,13のRESE
T端子へリセット信号を出力するりセント回路とを設け
ている。
信号Aの正常・異常を判定する第1P−RUN信号判定
手段と、該判定手段が異常判定したとき当該判定手段か
らの信号に基づいて第2 CP U13の出力する第2
P−RUN信号信号光止させる第2P−RUN信号停止
手段が設けられている。また、前記CPU暴走監視回路
14には、第2P−RUN信号状態に基づいてCPUの
異常検出を行うcpU異常検出回路と、該検出回路から
の異常検出信号を受けて各CPU12,13のRESE
T端子へリセット信号を出力するりセント回路とを設け
ている。
次に作用を第3図のフローチャートに基づいて説明する
。
。
これは第2CPU13のフローチャートであり、まず、
SLでイニシャライズを行う。次に82で第1CPU1
’2からの第1 P−RUN信号信号有無、即ち正常か
異常かを判定する。ここで、第1CPU12が正常に動
作して第1P−RUN信号信号有定結果が正常であれば
、S3へ進み第2 P−RUN信号信号光生し、更にS
4で第2CPU13に分担された制御処理プログラムを
実行するが、第2CPU13に異常が発生してプログラ
ムが実行されないと第2P−RUN信号信号光止される
。すると、CPU暴走監視回路14のCPU異常検出回
路はこれに基づいてリセット回路に異常検出信号を出力
し、リセット回路から第1及び第20P 012゜13
にそれぞれリセット信号を入力して各CP U12゜1
3をリセットする。
SLでイニシャライズを行う。次に82で第1CPU1
’2からの第1 P−RUN信号信号有無、即ち正常か
異常かを判定する。ここで、第1CPU12が正常に動
作して第1P−RUN信号信号有定結果が正常であれば
、S3へ進み第2 P−RUN信号信号光生し、更にS
4で第2CPU13に分担された制御処理プログラムを
実行するが、第2CPU13に異常が発生してプログラ
ムが実行されないと第2P−RUN信号信号光止される
。すると、CPU暴走監視回路14のCPU異常検出回
路はこれに基づいてリセット回路に異常検出信号を出力
し、リセット回路から第1及び第20P 012゜13
にそれぞれリセット信号を入力して各CP U12゜1
3をリセットする。
一方、S2の判定で第1 P−RUN信号信号有常のと
きは、第2CPU13の正常・異常に関係なく第2P−
RUN信号信号光生しない。このため、リセット回路か
らのリセット信号によって各CP012、13はリセッ
トされる。
きは、第2CPU13の正常・異常に関係なく第2P−
RUN信号信号光生しない。このため、リセット回路か
らのリセット信号によって各CP012、13はリセッ
トされる。
このようにすれば、複数のCPU12,13を1つの監
視回路14によって監視することかでき、しかもCPU
の暴走を防止できるので、コントロールユニットの小型
化及びコスト低減を図ることができる。
視回路14によって監視することかでき、しかもCPU
の暴走を防止できるので、コントロールユニットの小型
化及びコスト低減を図ることができる。
〈発明の効果〉
以上述べたように本発明によれば、複数のCPUを備え
た自動車用制御装置において、一方のCpuのP−RU
N信号を他方のCPUに入力し、他方のCPUのP−R
UN信号を単一のCPU暴走監視回路へ入力する構成と
し、監視回路に入力するP’−RUN信号の有無で複数
のCPUの異常検出を行いリセフトするようにしたので
、CPU暴走監視回路をCPUO数だけ設ける必要がな
(1つだけでよく、コントロールユニットの小型化及び
コスト低減を図ることができる。
た自動車用制御装置において、一方のCpuのP−RU
N信号を他方のCPUに入力し、他方のCPUのP−R
UN信号を単一のCPU暴走監視回路へ入力する構成と
し、監視回路に入力するP’−RUN信号の有無で複数
のCPUの異常検出を行いリセフトするようにしたので
、CPU暴走監視回路をCPUO数だけ設ける必要がな
(1つだけでよく、コントロールユニットの小型化及び
コスト低減を図ることができる。
第1図は本発明の詳細な説明するブロック図、第2図は
本発明の一実施例のハードウェア構成図、第3図は同上
実施例のフローチャート、第4図は従来例のハードウェ
ア構成図である。 11・・・コントロールユニノI−12・・・第1 C
PU13・・・第2CPU 14・・・CPU暴走
監視回路A・・・第1 P−RTJN信号 B・・・
第2P−RUN信号 特許出願人 日本電子機器株式会社 代理人 弁理士 笹 島 冨二雄 第1図 第2図
本発明の一実施例のハードウェア構成図、第3図は同上
実施例のフローチャート、第4図は従来例のハードウェ
ア構成図である。 11・・・コントロールユニノI−12・・・第1 C
PU13・・・第2CPU 14・・・CPU暴走
監視回路A・・・第1 P−RTJN信号 B・・・
第2P−RUN信号 特許出願人 日本電子機器株式会社 代理人 弁理士 笹 島 冨二雄 第1図 第2図
Claims (1)
- 複数のCPUを備え、CPUからのプログラムラン信
号に基づいてCPUの異常を検出し異常時にCPUをリ
セットするCPU暴走監視回路を有する自動車用制御装
置において、一方のCPUから出力される第1プログラ
ムラン信号を他方のCPUに入力し、他方のCPUから
出力される第2プログラムラン信号を単一のCPU暴走
監視回路に入力する構成とし、前記他方のCPUに、第
1プログラムラン信号の異常・正常を判定する判定手段
と、該判定手段が異常判定したときに第2プログラムラ
ン信号の発生を停止させる停止手段とを設けると共に、
前記暴走監視回路のリセット信号を各CPUに出力する
構成としたことを特徴とする自動車用制御装置のCPU
暴走防止装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59206382A JPS6186847A (ja) | 1984-10-03 | 1984-10-03 | 自動車用制御装置のcpu暴走防止装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59206382A JPS6186847A (ja) | 1984-10-03 | 1984-10-03 | 自動車用制御装置のcpu暴走防止装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6186847A true JPS6186847A (ja) | 1986-05-02 |
Family
ID=16522412
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59206382A Pending JPS6186847A (ja) | 1984-10-03 | 1984-10-03 | 自動車用制御装置のcpu暴走防止装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6186847A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62223180A (ja) * | 1986-03-07 | 1987-10-01 | イ−・アイ・デユポン・デ・ニモアス・アンド・カンパニ− | 除草性ピリジンスルホンアミド |
JPH0644102A (ja) * | 1991-04-16 | 1994-02-18 | Nec Corp | 複数プロセッサシステム |
-
1984
- 1984-10-03 JP JP59206382A patent/JPS6186847A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62223180A (ja) * | 1986-03-07 | 1987-10-01 | イ−・アイ・デユポン・デ・ニモアス・アンド・カンパニ− | 除草性ピリジンスルホンアミド |
JPH0644102A (ja) * | 1991-04-16 | 1994-02-18 | Nec Corp | 複数プロセッサシステム |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5638510A (en) | Multiplexed system with watch dog timers | |
JPS6186847A (ja) | 自動車用制御装置のcpu暴走防止装置 | |
JPH06324721A (ja) | 接続ユニット脱落検知方法 | |
JP4820679B2 (ja) | 車両用電子制御装置 | |
JPH02206806A (ja) | 複数のプロセッサユニットを有する制御システム | |
JPH0544570A (ja) | エンジン制御装置の暴走監視装置 | |
JPH01310422A (ja) | マイクロコンピュータのリセット回路 | |
JPH0395636A (ja) | フェイルセーフ回路の診断方式 | |
JPH06305376A (ja) | 車輌用制御装置 | |
JPS6249468A (ja) | 車両用制御装置のcpu暴走防止装置 | |
JPH02281343A (ja) | Cpu動作の監視方式 | |
US20230134320A1 (en) | Information processing device, vehicle, and information processing method | |
JP7070206B2 (ja) | 車載制御装置 | |
JP3182373B2 (ja) | マイクロコンピュータ装置 | |
JP2914837B2 (ja) | 異常診断機能付制御装置 | |
JPH08328885A (ja) | マイクロコンピュータの故障検出方法 | |
JPH0552945U (ja) | 暴走監視装置 | |
JPS63208949A (ja) | フエイルセ−フシステム | |
JPH01134632A (ja) | 計算機の異常検出回路 | |
JPH0612293A (ja) | マイクロコンピュータの暴走防止方法 | |
JPH03222020A (ja) | マルチマイクロプロセッサシステムのリセット方式 | |
JPH08123704A (ja) | 制御装置 | |
JPH05324407A (ja) | Cpu監視方式 | |
JPH0264702A (ja) | 複数のデータ処理装置を用いた制御装置における出力同期方法 | |
JPH0293738A (ja) | 割込み処理方式 |