JPS61264931A - デイジタルデ−タ多重伝送装置 - Google Patents
デイジタルデ−タ多重伝送装置Info
- Publication number
- JPS61264931A JPS61264931A JP10723185A JP10723185A JPS61264931A JP S61264931 A JPS61264931 A JP S61264931A JP 10723185 A JP10723185 A JP 10723185A JP 10723185 A JP10723185 A JP 10723185A JP S61264931 A JPS61264931 A JP S61264931A
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- JP
- Japan
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- line
- data
- interface circuit
- terminal
- circuit
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- Pending
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は複数の電話器やデータ端末等のディジタルデ
ータを多重化し、日本電信電話会社等が提供する複数の
高速ディジタル回線を通じて伝送することを可能にする
ディジタルデータ多重伝送装置に関するものである。
ータを多重化し、日本電信電話会社等が提供する複数の
高速ディジタル回線を通じて伝送することを可能にする
ディジタルデータ多重伝送装置に関するものである。
第5図は従来のディジタルデータ多重伝送装置の構成を
示すブロック図であυ、また、第6図は従来のディジタ
ルデータ多重伝送装置によって複数の高速ディジタル回
線に接続する場合の例を示すブロック図である。
示すブロック図であυ、また、第6図は従来のディジタ
ルデータ多重伝送装置によって複数の高速ディジタル回
線に接続する場合の例を示すブロック図である。
第5図において、1はデータ端末、2は電話器、で、こ
れらが端末インタフェース回路11,124’介して多
重化回路3に接続される。4は多重化制御回路、5は回
線インタフェース回路、6はディジタルデータ多重伝送
装置の全体ブロック、7は高速ディジタル回線の加入者
側の終端装置としてのデータ回線終端装置(以下DSU
という)である。
れらが端末インタフェース回路11,124’介して多
重化回路3に接続される。4は多重化制御回路、5は回
線インタフェース回路、6はディジタルデータ多重伝送
装置の全体ブロック、7は高速ディジタル回線の加入者
側の終端装置としてのデータ回線終端装置(以下DSU
という)である。
次に動作について説明する。データ端末1あるいは電話
器2からの信号は、端末インタフェース回路11.12
において7オーマント変換あるいはアナログ/ディジタ
ル変換等の処理を受けた後、多重化回路3に入力され、
多重化制御回路4の制御のもとに所定の伝送レートをも
つ信号に多重化され、回線インタフェース回路5におい
てフレーム同期用ビットやサービスビットが付加され、
X符号変換された後に高速ディジタル回線のDSU 7
に出力される。逆に、DSU7から送られてきた信号は
、回線インタフェース回路5において、X符号がユニポ
ーラ符号に変換され、タイミング抽出、フレーム周期が
とられた後、ユーザが使用できるチャネルの信号が多重
化回路3に導かれて、多重化制御回路4の制御のもとに
多重信号が分離され、各々の端末インタフェース回路1
1.12等に入力される。データ端末1が接続される端
末インタフェース回路11では、速度変換やフォーマッ
ト変換等の処理の後、所定のデータ形式でデータ端末I
Kデータが受信される。また、電話器2が接続される端
末インタフェース回路12では、速度変換やディジタル
/アナログ変換等の処理の後、アナログ音声信号として
電話器に受信される。
器2からの信号は、端末インタフェース回路11.12
において7オーマント変換あるいはアナログ/ディジタ
ル変換等の処理を受けた後、多重化回路3に入力され、
多重化制御回路4の制御のもとに所定の伝送レートをも
つ信号に多重化され、回線インタフェース回路5におい
てフレーム同期用ビットやサービスビットが付加され、
X符号変換された後に高速ディジタル回線のDSU 7
に出力される。逆に、DSU7から送られてきた信号は
、回線インタフェース回路5において、X符号がユニポ
ーラ符号に変換され、タイミング抽出、フレーム周期が
とられた後、ユーザが使用できるチャネルの信号が多重
化回路3に導かれて、多重化制御回路4の制御のもとに
多重信号が分離され、各々の端末インタフェース回路1
1.12等に入力される。データ端末1が接続される端
末インタフェース回路11では、速度変換やフォーマッ
ト変換等の処理の後、所定のデータ形式でデータ端末I
Kデータが受信される。また、電話器2が接続される端
末インタフェース回路12では、速度変換やディジタル
/アナログ変換等の処理の後、アナログ音声信号として
電話器に受信される。
端末装置には、データ端末や電話器の他にもデータモデ
ムやPBX (構内網ディジタル変換機)、テレビ会議
装置、LAN (Local Area Networ
k )なども端末インタフェース回路11を取替えるだ
けで接続可能な構成がとられる。なお、ここでは、多重
化機能と多重分離機能とを有する処理回路3を便宜上、
単に多重化回路と呼んでおシ、同様に多重化制御と多重
分離制御の機能をもつ制御回路4を単に多重化制御回路
と呼んでおシ、以下の頁においても同様の表現をする。
ムやPBX (構内網ディジタル変換機)、テレビ会議
装置、LAN (Local Area Networ
k )なども端末インタフェース回路11を取替えるだ
けで接続可能な構成がとられる。なお、ここでは、多重
化機能と多重分離機能とを有する処理回路3を便宜上、
単に多重化回路と呼んでおシ、同様に多重化制御と多重
分離制御の機能をもつ制御回路4を単に多重化制御回路
と呼んでおシ、以下の頁においても同様の表現をする。
従来のディジタルデータ多重伝送装N6は、以上のよう
に構成されているので、これを複数の高速ディジタル回
線と接続する場合には、第6図にその一例を示すように
、高速ディジタル回線のDSU 7 a −7bと同じ
台数のディジタルデータ多重伝送装置6as6bが必要
になるとともに、ディジタルデータ多重伝送装置i6a
に収容されたデータ端末1aや電話器2aは、ディジタ
ルデータ多重伝送装置6bにつながるDSU 7 bに
は接続できない。同様にして、データ端末1bや電話器
2bはディジタルデータ多重伝送装置6aにつながるD
SU 7 aには接続できないという問題点があった0
また、DSU 7 aからの信号をディジタルデータ多
重伝送装置6 a e 6 bを経由してDSU 7
bに中継転送する場合には、同種の端末インタフェース
回路どうしを結線8によって折返しで接続することにな
り、経済的でないなどの問題点があった。この発明は上
記のような問題点を解消するためになされたもので、1
台のディジタルデータ多重伝送装置で、複数の高速ディ
ジタル回線に接続できるとともに、端末を異なる高速デ
ィジタル回線に接続するように回線設定変更ができ、ま
た、複数の高速ディジタル回線間での信号中継を端末信
号にまで変換することなくディジタルデータの多重化レ
ベルで実現できるディジタルデータ多重伝送装置を得る
ことを目的とする0 〔問題点を解決するための手段〕 この発明にかかるディジタルデータ多重伝送装置は、端
末等からのデータと高速ディジタル回線からのデータを
多重化して時間スイッチに入力し、タイムスロット入れ
換え操作を行なってから端末等または高速ディジタル回
線にデータを送出するように構成したものである。
に構成されているので、これを複数の高速ディジタル回
線と接続する場合には、第6図にその一例を示すように
、高速ディジタル回線のDSU 7 a −7bと同じ
台数のディジタルデータ多重伝送装置6as6bが必要
になるとともに、ディジタルデータ多重伝送装置i6a
に収容されたデータ端末1aや電話器2aは、ディジタ
ルデータ多重伝送装置6bにつながるDSU 7 bに
は接続できない。同様にして、データ端末1bや電話器
2bはディジタルデータ多重伝送装置6aにつながるD
SU 7 aには接続できないという問題点があった0
また、DSU 7 aからの信号をディジタルデータ多
重伝送装置6 a e 6 bを経由してDSU 7
bに中継転送する場合には、同種の端末インタフェース
回路どうしを結線8によって折返しで接続することにな
り、経済的でないなどの問題点があった。この発明は上
記のような問題点を解消するためになされたもので、1
台のディジタルデータ多重伝送装置で、複数の高速ディ
ジタル回線に接続できるとともに、端末を異なる高速デ
ィジタル回線に接続するように回線設定変更ができ、ま
た、複数の高速ディジタル回線間での信号中継を端末信
号にまで変換することなくディジタルデータの多重化レ
ベルで実現できるディジタルデータ多重伝送装置を得る
ことを目的とする0 〔問題点を解決するための手段〕 この発明にかかるディジタルデータ多重伝送装置は、端
末等からのデータと高速ディジタル回線からのデータを
多重化して時間スイッチに入力し、タイムスロット入れ
換え操作を行なってから端末等または高速ディジタル回
線にデータを送出するように構成したものである。
この発明における時間スイッチは多重回路によって多重
されたデータのタイムスロット入れ換え操作を行なって
おり、タイムスロット入れ換え操作の設定を変更するこ
とによシ、任意の端末等を任意の高速ディジタル回線に
接続することを可能にする。
されたデータのタイムスロット入れ換え操作を行なって
おり、タイムスロット入れ換え操作の設定を変更するこ
とによシ、任意の端末等を任意の高速ディジタル回線に
接続することを可能にする。
以下、この発明の一実施例を図について説明する。第1
図において、11,12.・・・19は端末等のデータ
のフレーム位相同期、ビット位相同期等を行ない多重回
路8に信号11ae12a・・・19aを送出し、逆に
信号11b 、12b・・・19bを受信して端末等に
送出する端末インタフェース回路である。51.52・
・・59は高速ディジタル回線のデータの符号変換、フ
レーム位相同期、ビット位相同期等を行ない、多重回路
8に信号51a、52a−59aを送出し、逆に信号5
1b。
図において、11,12.・・・19は端末等のデータ
のフレーム位相同期、ビット位相同期等を行ない多重回
路8に信号11ae12a・・・19aを送出し、逆に
信号11b 、12b・・・19bを受信して端末等に
送出する端末インタフェース回路である。51.52・
・・59は高速ディジタル回線のデータの符号変換、フ
レーム位相同期、ビット位相同期等を行ない、多重回路
8に信号51a、52a−59aを送出し、逆に信号5
1b。
52b・・・59bを受信し、符号変換等を行なって高
速ディジタル回線に送出する回線インタフェース回路で
ある。8は多重回路であシ、信号11a *12a・・
・19a r 51ap52a・・・59aを1本の信
号8a上に多重化して時間スイッチ9に出力する。時間
スイッチ9は時間スイッチ制御回路90の設定値に従っ
て、信号8aのタイムスロット入れ換え操作をして信号
9aを出力する。この時間スイッチ9のタイムスロット
入れ換え操作により、任意の端末インタフェース回路を
任意の回線インタフェース回路に接続することが可能に
なる。10は分離回路であり、信号9aを信号11b
、12b・・・19bおよび信号51b 、52b・・
・59bに分離する。時間スイッチ9はダブルバックア
メモリとアドレスコントロールメモリを用いる方法等で
実現できる。
速ディジタル回線に送出する回線インタフェース回路で
ある。8は多重回路であシ、信号11a *12a・・
・19a r 51ap52a・・・59aを1本の信
号8a上に多重化して時間スイッチ9に出力する。時間
スイッチ9は時間スイッチ制御回路90の設定値に従っ
て、信号8aのタイムスロット入れ換え操作をして信号
9aを出力する。この時間スイッチ9のタイムスロット
入れ換え操作により、任意の端末インタフェース回路を
任意の回線インタフェース回路に接続することが可能に
なる。10は分離回路であり、信号9aを信号11b
、12b・・・19bおよび信号51b 、52b・・
・59bに分離する。時間スイッチ9はダブルバックア
メモリとアドレスコントロールメモリを用いる方法等で
実現できる。
つぎに動作を説明する。なお、説明を分かシ易くするた
めに端末インタフェース回路および回線インタフェース
回路がとも供に2個ある第2図を用いて説明する。また
、日本電信電話会社は高速ディジタル伝送サービスにお
いて高速ディジタル回線の回線インタフェース速度と回
線の速度クラスを第1表のように設定してサービスを行
なっているが、ここでは端末インタフェース回路11と
回線インタフェース回路51を回線速度1536kb/
sで回線設定し、同様に端末インタフェース回路12と
回線インターフェース回路52を回線速度1536kb
/sで回線設定する場合について説明する。
めに端末インタフェース回路および回線インタフェース
回路がとも供に2個ある第2図を用いて説明する。また
、日本電信電話会社は高速ディジタル伝送サービスにお
いて高速ディジタル回線の回線インタフェース速度と回
線の速度クラスを第1表のように設定してサービスを行
なっているが、ここでは端末インタフェース回路11と
回線インタフェース回路51を回線速度1536kb/
sで回線設定し、同様に端末インタフェース回路12と
回線インターフェース回路52を回線速度1536kb
/sで回線設定する場合について説明する。
第1表
いま、端末インタフェース回路11が送出する信号11
a上のデータ列をA1端末インタフェース回路12が送
出する信号12a上のデータ列をB。
a上のデータ列をA1端末インタフェース回路12が送
出する信号12a上のデータ列をB。
回線インタフェース回路51が送出する信号51a上の
データ列をC1回線インタフェース回路52が送出する
信号52a上のデータ列をDとした場合には、上記のよ
うに回線接続を行なうことによシ、例えば信号flbが
データ列C1信号12bがデータ列り1信号51bがデ
ータ列A1信号52bがデータ列BKなるようにする。
データ列をC1回線インタフェース回路52が送出する
信号52a上のデータ列をDとした場合には、上記のよ
うに回線接続を行なうことによシ、例えば信号flbが
データ列C1信号12bがデータ列り1信号51bがデ
ータ列A1信号52bがデータ列BKなるようにする。
例えば、第3図は信号11a t12a 551a t
52a +11b +12b +51b +52b上の
データ列の関係を示す。回線速度1536 kb/sの
データ列の1フレーム中のビット数は第1表より192
ビツトである。つぎに各データ列の多重分離関係を第4
図に示す。i4図において、信号11a e12a p
51a 552aの信号8aへの多重化は、各信号11
a *12a e51a a52aのIIに多重化する
方法をとっており、また信号9aから信号11b 、1
2b 、51b 、52b ヘの分離は、信号11b
、12b 、51b 、52bの順に分離を行なう方法
をとっている。このように多重分離方法を設定すると、
時間スイッチ9は信号列8aを信号列9aのようにタイ
ムスロット入れ換え操作を行なうことができ、所望の回
線設定を実現できる。この場合、時間スイッチ9はts
as(kb/s) X4= 5x44(kb/s)で動
作している。また回線設定を変更する場合は、時間スイ
ッチ制御回路90によυ、タイムスロット入れ換え操作
を変更するだけで実現できる。
52a +11b +12b +51b +52b上の
データ列の関係を示す。回線速度1536 kb/sの
データ列の1フレーム中のビット数は第1表より192
ビツトである。つぎに各データ列の多重分離関係を第4
図に示す。i4図において、信号11a e12a p
51a 552aの信号8aへの多重化は、各信号11
a *12a e51a a52aのIIに多重化する
方法をとっており、また信号9aから信号11b 、1
2b 、51b 、52b ヘの分離は、信号11b
、12b 、51b 、52bの順に分離を行なう方法
をとっている。このように多重分離方法を設定すると、
時間スイッチ9は信号列8aを信号列9aのようにタイ
ムスロット入れ換え操作を行なうことができ、所望の回
線設定を実現できる。この場合、時間スイッチ9はts
as(kb/s) X4= 5x44(kb/s)で動
作している。また回線設定を変更する場合は、時間スイ
ッチ制御回路90によυ、タイムスロット入れ換え操作
を変更するだけで実現できる。
また、回線の接続は、端末インタフェース回路11.1
2と回線インタフェース51.52回路の接続だけでな
く、端末インタフェース回路11.12と他の端末イン
タフェース回路の接続および回線インタフェース回路と
他の回線インタフェース回路の接続もタイムスロット入
れ換え操作を変更するだけで実現できる。回線インタフ
ェース回路を他の回線インタフェース回路に接続できる
ことにより、高速ディジタル回線間での信号中継を端末
信号にまで変換することなくディジタルデータの多重化
レベルで実現できる。
2と回線インタフェース51.52回路の接続だけでな
く、端末インタフェース回路11.12と他の端末イン
タフェース回路の接続および回線インタフェース回路と
他の回線インタフェース回路の接続もタイムスロット入
れ換え操作を変更するだけで実現できる。回線インタフ
ェース回路を他の回線インタフェース回路に接続できる
ことにより、高速ディジタル回線間での信号中継を端末
信号にまで変換することなくディジタルデータの多重化
レベルで実現できる。
なお以上の実施例では端末インタフェース回路11.1
2、回線インタフェース回路51.52が供に2ケであ
る第2図を用いて説明したが、端末インタフェース数、
回線インタフェース数が増加した場合は多重回路8、分
離回路10において多重分離するデータの信号線数が増
加するので、動作速度を上げ、また時間スイッチ9の動
作速度を上げることにより対応できる。
2、回線インタフェース回路51.52が供に2ケであ
る第2図を用いて説明したが、端末インタフェース数、
回線インタフェース数が増加した場合は多重回路8、分
離回路10において多重分離するデータの信号線数が増
加するので、動作速度を上げ、また時間スイッチ9の動
作速度を上げることにより対応できる。
また、本発明によれば、例えば端末インタフェース回路
11を回線速度1536 kb/sのフレームの前半を
用いて回線インタフェース回路51と回線速度768
kb/aで接続し、フレームの後半を用いて回線インタ
フェース回路52と回線速度768匝4で接続するよう
に、1つの端末インタフェース回路を複数の回線インタ
フェース回路に接続することや、逆に1つの回線インタ
フェース回路を複数の端末インタフェース回路に接続す
ることがタイムスロット入れ換え操作によシ可能である
。さらに、回線インタフェース回路を他の回線インタフ
ェース回路と接続し、さらに端末インタフェース回路に
も接続することもタイムスロット入れ換え操作により可
能である。
11を回線速度1536 kb/sのフレームの前半を
用いて回線インタフェース回路51と回線速度768
kb/aで接続し、フレームの後半を用いて回線インタ
フェース回路52と回線速度768匝4で接続するよう
に、1つの端末インタフェース回路を複数の回線インタ
フェース回路に接続することや、逆に1つの回線インタ
フェース回路を複数の端末インタフェース回路に接続す
ることがタイムスロット入れ換え操作によシ可能である
。さらに、回線インタフェース回路を他の回線インタフ
ェース回路と接続し、さらに端末インタフェース回路に
も接続することもタイムスロット入れ換え操作により可
能である。
以上のようにこの発明によれば、端末等からのデータと
高速ディジタル回線からのデータを多重化して時間スイ
ッチに入力し、タイムスロット入れ換え操作を行なって
から端末等または高速ディジタル回線にデータを送出す
るようにしたので、1台のディジタルデータ多重伝送装
置で複数の高速ディジタル回線と複数の端末等を収容し
任意の高速ディジタル回線と任意の端末等の間を回線接
続することが可能となシ、また、高速ディジタル回線間
での信号中継を端末信号にまで変換することなく、ディ
ジタルデータの多重化レベルで実現できる効果がある。
高速ディジタル回線からのデータを多重化して時間スイ
ッチに入力し、タイムスロット入れ換え操作を行なって
から端末等または高速ディジタル回線にデータを送出す
るようにしたので、1台のディジタルデータ多重伝送装
置で複数の高速ディジタル回線と複数の端末等を収容し
任意の高速ディジタル回線と任意の端末等の間を回線接
続することが可能となシ、また、高速ディジタル回線間
での信号中継を端末信号にまで変換することなく、ディ
ジタルデータの多重化レベルで実現できる効果がある。
第1図はこの発明の一実施例によるディジタルデータ多
重伝送装置を示すブロック図、第2図は構成を簡素化し
た同様のディジタルデータ多重伝送装置のブロック図、
第3図および第4図は第2図の回路各部のデータの多重
化および分離化した信号のタイミング図、第5図は従来
のディジタルデータ多重伝送装置のブロック図、第6図
は同じく2つのディジタルデータ多重伝送装置の接続例
を示すブロック図である。 8は多重化回路、9は時間スイッチ、90は時間スイッ
チ制御回路、10は分離回路、11〜19は端末インタ
フェース回路、51〜59は回線インタフェース回路。 なお、図中、同一符号は同一または相当部分を示す。
重伝送装置を示すブロック図、第2図は構成を簡素化し
た同様のディジタルデータ多重伝送装置のブロック図、
第3図および第4図は第2図の回路各部のデータの多重
化および分離化した信号のタイミング図、第5図は従来
のディジタルデータ多重伝送装置のブロック図、第6図
は同じく2つのディジタルデータ多重伝送装置の接続例
を示すブロック図である。 8は多重化回路、9は時間スイッチ、90は時間スイッ
チ制御回路、10は分離回路、11〜19は端末インタ
フェース回路、51〜59は回線インタフェース回路。 なお、図中、同一符号は同一または相当部分を示す。
Claims (1)
- 端末等からのデータフレーム位相同期やビット位相同期
などを行ったデータを送出する端末インタフェース回路
と、高速ディジタル回線からのデータの符号変換やフレ
ーム位相同期あるいはビット位相同期等を行なったデー
タを送出する回線インタフェース回路と、上記端末イン
タフェース回路および上記回線インタフェース回路がそ
れぞれ送出するデータを多重化して一本の信号線上に多
重化する多重化回路と、この多重化回路において多重化
した信号を時間スイッチ制御信号によってタイムスロッ
ト入れ換え操作する時間スイッチと、この時間スイッチ
によってタイムスロット入れ換え操作したデータを分離
して、上記端末インタフェース回路および回線インタフ
ェース回路にそれぞれ送出する分離回路とを備えたディ
ジタルデータ多重伝送装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10723185A JPS61264931A (ja) | 1985-05-20 | 1985-05-20 | デイジタルデ−タ多重伝送装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10723185A JPS61264931A (ja) | 1985-05-20 | 1985-05-20 | デイジタルデ−タ多重伝送装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61264931A true JPS61264931A (ja) | 1986-11-22 |
Family
ID=14453812
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10723185A Pending JPS61264931A (ja) | 1985-05-20 | 1985-05-20 | デイジタルデ−タ多重伝送装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61264931A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014107809A (ja) * | 2012-11-29 | 2014-06-09 | Mitsubishi Electric Corp | 多重化装置 |
-
1985
- 1985-05-20 JP JP10723185A patent/JPS61264931A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2014107809A (ja) * | 2012-11-29 | 2014-06-09 | Mitsubishi Electric Corp | 多重化装置 |
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