JPS61198087A - Photoelectric switch - Google Patents
Photoelectric switchInfo
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- JPS61198087A JPS61198087A JP60037391A JP3739185A JPS61198087A JP S61198087 A JPS61198087 A JP S61198087A JP 60037391 A JP60037391 A JP 60037391A JP 3739185 A JP3739185 A JP 3739185A JP S61198087 A JPS61198087 A JP S61198087A
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- light
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Abstract
Description
【発明の詳細な説明】
[産業上の利用分野]
この発明はパルス変調光形の光電スイッチ、即ちパルス
光を投射し、このパルスに同期した受光信号を取出して
検出動作する光電スイッチに関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a pulse modulated light type photoelectric switch, that is, a photoelectric switch that projects pulsed light and performs a detection operation by extracting a light reception signal synchronized with the pulse.
[従来の技術]
従来、この種の光電スイッチは、同期検波方式のパルス
変調型光電スイッチが主流である。この方式は、パルス
により発光素子を駆動すると同時に、このパルス発生時
にのみ受光信号を通過させるゲートによりノイズ成分を
除去し、ノイズの少なくなった受光信号を積分回路を通
して判定するものであって、雑音に強いとされてきた。[Prior Art] Conventionally, pulse modulation type photoelectric switches using a synchronous detection method have been mainstream as this type of photoelectric switches. In this method, a light emitting element is driven by a pulse, and at the same time, noise components are removed using a gate that allows the light reception signal to pass only when this pulse is generated.The light reception signal with less noise is then passed through an integrating circuit and judged. It has been said to be strong.
しかしながら、高速応答性が求められてくると、上述の
ような従来の方式では充分な積分定数がとれなくなる為
、耐ノイズ性に優れた光電スイッチが得られないという
欠点があった。However, when high-speed response is required, the conventional method described above cannot provide a sufficient integral constant, and therefore has the disadvantage that a photoelectric switch with excellent noise resistance cannot be obtained.
[発明の目的]
この目的は以上のような問題を解消し、高速応答ができ
、かつノイズに強い光電スイッチを提供することにある
。[Object of the Invention] The object of the invention is to solve the above-mentioned problems and provide a photoelectric switch that is capable of high-speed response and is resistant to noise.
[発明の要点コ
この発明は投光パルスの直前における受光信号を検出す
る手段を設け、投光パルスの直前に受光信号が検出され
た場合は、次の投光パルスの結果得られた受光信号に対
して計数(積分)動作を禁止する様にすることにより、
受光素子にノイズが入っている時の誤動作を減少させる
ことに特徴を有する。[Key Points of the Invention] This invention provides means for detecting a light receiving signal immediately before a light emitting pulse, and when a light receiving signal is detected immediately before a light emitting pulse, the light receiving signal obtained as a result of the next light emitting pulse is detected. By prohibiting counting (integration) operation for
It is characterized by reducing malfunctions when noise is present in the light receiving element.
即ち、投光パルス直前にノイズがあるときは投光パルス
時にもノイズが入っている可能性が大きいのでこのとき
の受光信号を無視することによって誤動作を減少させる
。That is, if there is noise just before the light projection pulse, there is a high possibility that noise will also be present during the light projection pulse, so malfunctions can be reduced by ignoring the light reception signal at this time.
[発明の実施例]
第1図はこの発明の実施例を示すものであって1発振回
路1の出力をT型フリップフロップ21.22および2
3に順次入力して分周する。これらのT型フリップフロ
ップからの出力をAND回路24.25および26を介
してそれぞれ投光素子としてのLED3、受光信号記憶
用のフリップフロップ(FF)4のリセット入力および
カウンタ5の計数又はクリヤ用ゲート入力に供給する。[Embodiment of the Invention] FIG. 1 shows an embodiment of the invention, in which the output of one oscillation circuit 1 is connected to T-type flip-flops 21, 22 and 2.
3 in sequence and divide the frequency. The outputs from these T-type flip-flops are passed through AND circuits 24, 25 and 26 to the LED 3 as a light emitting element, the reset input of the flip-flop (FF) 4 for storing received light signals, and the counter 5 for counting or clearing. Supplies gate input.
これらAND回路24.25および26の出力タイミン
グと発振回路lの出力タイミングとの関係を第2図(a
):発振回路、 (c) :AND回路、(d) :A
ND回路24および(e) :AND回路26に示す、
LED 3に投光 入力が与えられるのに先立ち、F
F4はAN口回路25の出力によりリセットされる。The relationship between the output timings of these AND circuits 24, 25 and 26 and the output timing of the oscillation circuit l is shown in FIG.
): Oscillator circuit, (c): AND circuit, (d): A
ND circuit 24 and (e): Shown in AND circuit 26,
Before input is applied to LED 3, F
F4 is reset by the output of the AN port circuit 25.
LED 3からの投光パルスがフォトトランジスタ等か
らなる受光素子6に入射し、受光素千日の出力が交流増
幅回路7で増幅され、該回路7の交流出力成分がコンパ
レータ8により所定の値と比較され、この所定の値を越
えたかどうかで受光信号の有無を弁別する。A light emitting pulse from the LED 3 enters a light receiving element 6 made of a phototransistor or the like, the output of the light receiving element is amplified by an AC amplifier circuit 7, and the AC output component of the circuit 7 is set to a predetermined value by a comparator 8. The presence or absence of the received light signal is determined based on whether the predetermined value is exceeded.
AN11回路41は受光信号の為のゲートであって、投
光パルスの発生と同時に発生する。従って投光パルスの
発生期間中にコンパレータ8に受光出力信号があるとF
F4がセットされる。The AN11 circuit 41 is a gate for a light reception signal, and is generated simultaneously with the generation of a light projection pulse. Therefore, if there is a light reception output signal in the comparator 8 during the period when the light emission pulse is generated, F
F4 is set.
FF4の出力はAND回路91および92を介して検出
信号記憶用のFF9に供給されると共にFF9の出力と
共に排他論理和回路10(以下EX−ORIQとする)
を介 してカウンタの計数入力ゲート用AND回路51
に供給される。また、EX−ORIOの出力は論理反転
回路INVIOIを介してクリヤ入カゲート用AND回
路52に入力される。The output of FF4 is supplied to FF9 for storing the detection signal via AND circuits 91 and 92, and together with the output of FF9, an exclusive OR circuit 10 (hereinafter referred to as EX-ORIQ)
AND circuit 51 for the counting input gate of the counter via
is supplied to Further, the output of EX-ORIO is input to the clear input gate AND circuit 52 via the logic inversion circuit INVIOI.
第2図(cl)および(e)に示すように投光パルス期
間終了後、AND回路の出力にパルスが発生すると、受
光信号記憶用FF4の出力と検出出力信号記憶用のFF
9の出力とが一致している場合、カウンタ5のクリヤ入
力ゲート52が開いているので、カウンタ5はクリヤさ
れる。 FF4の出力とFF9の出力とが不一致の場合
は、計数入力ゲート51が開いており、カウンタ5は1
カウント計数する。従ってカウンタ5は、受光出力信号
と検出出力信号とが異るタイミングで発生している場合
に、受光出力信号の連続数を計数する。As shown in FIGS. 2(cl) and (e), when a pulse is generated at the output of the AND circuit after the light emitting pulse period ends, the output of FF4 for storing the light reception signal and the FF for storing the detection output signal
If the output of counter 9 matches the output of counter 5, the clear input gate 52 of counter 5 is open, so counter 5 is cleared. If the output of FF4 and the output of FF9 do not match, the counting input gate 51 is open and the counter 5 is 1.
Count the count. Therefore, the counter 5 counts the number of consecutive light reception output signals when the light reception output signal and the detection output signal are generated at different timings.
カウンタ5の出力は、AND回路θlおよび32のゲー
トとなっており、AND回路91および92の出力はそ
れぞれ検出信号記憶用FF1llのセット入力およびリ
セット入力となっている。従ってカウンタ5の計数が所
定値に達すると、その出力によりAND回路9Iおよび
92を通じてFF4の記憶状態がFF9に転送され、充
電スイッチとしての判定結果が更新される。The output of the counter 5 serves as the gates of the AND circuits θl and 32, and the outputs of the AND circuits 91 and 92 serve as the set input and reset input of the detection signal storage FF 1ll, respectively. Therefore, when the count of the counter 5 reaches a predetermined value, the memory state of the FF4 is transferred to the FF9 through the AND circuits 9I and 92 based on its output, and the determination result as a charging switch is updated.
AND回路27は、投光直前のタイミングクロックを取
出す回路であって、その出力は第2図(b)に示すよう
なタイミングで発生し、しかもコンパレータ8の出力と
共にAND回路121に入力される。 AND回路12
1の出力はFF12のセット入力になっており、AND
回路25の出力はFF12のリセット入力になっており
、FF12の出力QはAND回路51および52の入力
となっている。The AND circuit 27 is a circuit that takes out the timing clock immediately before light projection, and its output is generated at the timing shown in FIG. AND circuit 12
The output of 1 is the set input of FF12, and
The output of the circuit 25 serves as a reset input for the FF 12, and the output Q of the FF 12 serves as an input for the AND circuits 51 and 52.
このような構成において、通常はAND回路27のゲー
トが開いている間、即ち投光前に受光信号は入らないの
で、FF12はAND回路25によりリセット状態とな
っている。このため上述の通常動作が行われる。In such a configuration, the FF 12 is reset by the AND circuit 25 because normally no light reception signal is received while the gate of the AND circuit 27 is open, that is, before light is emitted. Therefore, the above-mentioned normal operation is performed.
一方、ノイズが多く、第2図(b)およびCf’)に示
すように投光直前であってAND回路27が開いている
聞(第2図(b))に受光出力(第2図(f))が発生
すると、AND回路121が開いて第2図(g)に示す
ようにFF12がセットされる。FF12がセットされ
るとANII @路51および52は禁止状態となり。On the other hand, there is a lot of noise, and as shown in FIG. 2(b) and Cf', the received light output (see FIG. When f)) occurs, the AND circuit 121 is opened and the FF 12 is set as shown in FIG. 2(g). When FF12 is set, ANII signals 51 and 52 are inhibited.
ANfl 回路26が開イテモ(llN I、でモ)
、 AND回路51または52は開かないので、カウン
タ5が計数又はクリヤされない、 FF12は次の投光
パルスに先立ちAND回路25の出力でリセットされる
。したがって、この様にしてノイズの発生の多いときに
カウンタ5の動作を一時的に停止させることにより、ノ
イズによる誤動作を防止することができる。ANfl circuit 26 is open (llN I, demo)
, AND circuit 51 or 52 is not opened, so counter 5 is not counted or cleared. FF 12 is reset by the output of AND circuit 25 prior to the next light emission pulse. Therefore, by temporarily stopping the operation of the counter 5 when a large amount of noise is generated in this manner, malfunctions due to noise can be prevented.
又、通常の動作の応答速度は維持することができる。Further, the response speed of normal operation can be maintained.
[発明の効果]
以上説明したようにこの発明によれば、投光パルス直前
に受光信号があった場合に、次の投光時の受光信号につ
いて計数動作を行わない様にしたので、受光タイミング
に応じて開くゲートに入ってくるノイズによる影響を避
けることができ、したがって、高速かつ耐ノイズ性に優
れた光電スイッチが得られる。[Effects of the Invention] As explained above, according to the present invention, when there is a light reception signal immediately before the light emission pulse, the counting operation is not performed for the light reception signal at the time of the next light emission, so that the light reception timing can be adjusted. It is possible to avoid the influence of noise that enters the gate that opens in response to the noise, and therefore a photoelectric switch with high speed and excellent noise resistance can be obtained.
第1図はこの発明の実施例を示す回路図、第2図は第1
図における各部の波形を示すタイミングチャートである
。
l・・・発振回路、
21.22.23・・・分周回路、
24〜27・・・AND回路。
3・・・投光用LEII、
4・・・フリップフロップ、
41・・・AND回路、
5・・・カウンタ回路、
6・・・フォトトランジスタ、
7・・・増幅回路、
8・・・コンパレータ、
9・・・フリップフロップ。
91.92・・・AND回路、
10・・・排他論理和回路(EX−OR) 。
101 ・−・イア/< −タ(INV) 。
11・・・検出出力、
12・・・フリップフロップ、
121・・・AND回路、
(a)・・・発振回路出力波形、
(b)・・・AND回路27出力波形、(C)・・・A
N11回路25出力波形、(d)・・・AND回路24
出力波形、(e)・・・AND回路2B出力波形、(f
)・・・増幅回路7出力波形、
(g)・・・FF12出力Q波形。Fig. 1 is a circuit diagram showing an embodiment of the present invention, and Fig. 2 is a circuit diagram showing an embodiment of the present invention.
3 is a timing chart showing waveforms of various parts in the figure. l... Oscillation circuit, 21.22.23... Frequency dividing circuit, 24-27... AND circuit. 3...LEII for light emission, 4...Flip-flop, 41...AND circuit, 5...Counter circuit, 6...Phototransistor, 7...Amplification circuit, 8...Comparator, 9...Flip-flop. 91.92...AND circuit, 10...Exclusive OR circuit (EX-OR). 101 ・-・ia/<-ta (INV). 11...Detection output, 12...Flip-flop, 121...AND circuit, (a)...Oscillation circuit output waveform, (b)...AND circuit 27 output waveform, (C)... A
N11 circuit 25 output waveform, (d)...AND circuit 24
Output waveform, (e)...AND circuit 2B output waveform, (f
)...Amplifier circuit 7 output waveform, (g)...FF12 output Q waveform.
Claims (1)
させる分周回路と、 該分周回路によって得られたタイミングクロックに応じ
てパルス発光する発光素子と、 該発光素子からの光を受けて受光パルス信号を発生する
受光素子と、 前記タイミングクロックに応答して開いて前記受光素子
からの受光パルス信号を通過させるゲート回路と、 該ゲート回路を通過した受光パルス信号を計数し当該受
光パルス数が所定値に達したとき受光判定出力を発生す
る計数回路と、 前記タイミングクロックの発生前の期間に前記受光素子
から受光信号が発生したときに前記計数回路における次
の計数を禁止する手段を具えたことを特徴とする光電ス
イッチ。[Claims] An oscillator circuit, a frequency divider circuit that divides the output of the oscillation circuit to generate a timing clock, and a light emitting element that emits pulsed light in accordance with the timing clock obtained by the frequency divider circuit. a light-receiving element that receives light from the light-emitting element and generates a light-receiving pulse signal; a gate circuit that opens in response to the timing clock and allows the light-receiving pulse signal from the light-receiving element to pass; and the light that has passed through the gate circuit. a counting circuit that counts pulse signals and generates a light reception determination output when the number of light reception pulses reaches a predetermined value; A photoelectric switch characterized by comprising means for prohibiting the next count.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60037391A JPS61198087A (en) | 1985-02-28 | 1985-02-28 | Photoelectric switch |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60037391A JPS61198087A (en) | 1985-02-28 | 1985-02-28 | Photoelectric switch |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61198087A true JPS61198087A (en) | 1986-09-02 |
Family
ID=12496226
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60037391A Pending JPS61198087A (en) | 1985-02-28 | 1985-02-28 | Photoelectric switch |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61198087A (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57136178A (en) * | 1981-02-17 | 1982-08-23 | Omron Tateisi Electronics Co | Photoelectric switch |
JPS5873888A (en) * | 1982-09-18 | 1983-05-04 | Omron Tateisi Electronics Co | Photoelectric switch |
-
1985
- 1985-02-28 JP JP60037391A patent/JPS61198087A/en active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS57136178A (en) * | 1981-02-17 | 1982-08-23 | Omron Tateisi Electronics Co | Photoelectric switch |
JPS5873888A (en) * | 1982-09-18 | 1983-05-04 | Omron Tateisi Electronics Co | Photoelectric switch |
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