JPS61173679A - トランジスタインバ−タの制御回路 - Google Patents
トランジスタインバ−タの制御回路Info
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- JPS61173679A JPS61173679A JP60012261A JP1226185A JPS61173679A JP S61173679 A JPS61173679 A JP S61173679A JP 60012261 A JP60012261 A JP 60012261A JP 1226185 A JP1226185 A JP 1226185A JP S61173679 A JPS61173679 A JP S61173679A
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- Japan
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- transistor
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- power
- inverter
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of ac power input into dc power output; Conversion of dc power input into ac power output
- H02M7/42—Conversion of dc power input into ac power output without possibility of reversal
- H02M7/44—Conversion of dc power input into ac power output without possibility of reversal by static converters
- H02M7/48—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/53—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal
- H02M7/537—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters
- H02M7/5387—Conversion of dc power input into ac power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a triode or transistor type requiring continuous application of a control signal using semiconductor devices only, e.g. single switched pulse inverters in a bridge configuration
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はトランジスタインバータの負荷電流を担うトラ
ンジスタのベースドライブ用制御回路に関するものであ
る。
ンジスタのベースドライブ用制御回路に関するものであ
る。
一般的にトランジスタインバータは運転中のみベース電
流を流し、運転休止中は流さない。従って、ベース電源
からみると負荷変動が大きい。
流を流し、運転休止中は流さない。従って、ベース電源
からみると負荷変動が大きい。
ところで、負荷変動補正のない簡易形のチッッハ一式安
定化電源でトランジスタインバータノベースドライブす
る場合、この負荷変動により安定化電源全体のレギュレ
ーションが悪くなり、かつベース電源以外の制御電源巻
線にも影響を及ばす。
定化電源でトランジスタインバータノベースドライブす
る場合、この負荷変動により安定化電源全体のレギュレ
ーションが悪くなり、かつベース電源以外の制御電源巻
線にも影響を及ばす。
従って、ベース電源の負荷変動を抑えるか：、確実に負
荷変動補正をかけた高価で複雑な安定化電源を用いるか
のいずれたが要求される。
荷変動補正をかけた高価で複雑な安定化電源を用いるか
のいずれたが要求される。
従来のトランジスタインバータの運転、停止切替り時の
ベース電源における負荷変動を少なくする手段として■
安定化電源出力にダミー抵抗器を接続し、トランジスタ
インバータの運転、停止いずれの場合にもある一定のダ
ミー電流を流してベース電源のレギュレーションを良く
する。＠第２図に示すような直流電源Ｐと直交電力変換
用パワートランジスタ５ＩＳＳ２・・・・Ｓ６及び負荷
りからなる主回路構成において、例えば第３図に示すグ
ラフのように１８００導通形制御にて各パワートランジ
スタＳ１、Ｓ２・・・・・・Ｓ６の出力電圧の波形を示
すと、運転モード期間Ａ１は図示の斜線で示す期間のみ
各パワートランジスタ５ＩＳ２・・・・・・Ｓ６が導通
して負荷りに各相間電圧ｕ−ｖ、ｖ−ｗＳｗ−ｕを供給
する。
ベース電源における負荷変動を少なくする手段として■
安定化電源出力にダミー抵抗器を接続し、トランジスタ
インバータの運転、停止いずれの場合にもある一定のダ
ミー電流を流してベース電源のレギュレーションを良く
する。＠第２図に示すような直流電源Ｐと直交電力変換
用パワートランジスタ５ＩＳＳ２・・・・Ｓ６及び負荷
りからなる主回路構成において、例えば第３図に示すグ
ラフのように１８００導通形制御にて各パワートランジ
スタＳ１、Ｓ２・・・・・・Ｓ６の出力電圧の波形を示
すと、運転モード期間Ａ１は図示の斜線で示す期間のみ
各パワートランジスタ５ＩＳ２・・・・・・Ｓ６が導通
して負荷りに各相間電圧ｕ−ｖ、ｖ−ｗＳｗ−ｕを供給
する。
一方、トランジスタインバータの運転休止モード期間Ａ
２では直流電源Ｐの十極に接続される側のパフ−トラン
−ジスタＳ１（、Ｓｇ＊Ｓｓ；の全部又は一部（第３図
では全部流す場合を示す）のベース電流を流し、トラン
ジスタインバータの運転中と運転休止中のベース電源の
負荷を等測的にしてベース電源のレギュレーションの教
養をはかっている。
２では直流電源Ｐの十極に接続される側のパフ−トラン
−ジスタＳ１（、Ｓｇ＊Ｓｓ；の全部又は一部（第３図
では全部流す場合を示す）のベース電流を流し、トラン
ジスタインバータの運転中と運転休止中のベース電源の
負荷を等測的にしてベース電源のレギュレーションの教
養をはかっている。
上記ダミー電流を流し続ける■の手段はベース抵抗とは
別にダミー抵抗を設ける必要があり、容量が大となるに
つれてこのダミー抵抗器の外形も必然的に大形化し、ベ
ース制御回路の小形化傾向に適合しにくくなる。
別にダミー抵抗を設ける必要があり、容量が大となるに
つれてこのダミー抵抗器の外形も必然的に大形化し、ベ
ース制御回路の小形化傾向に適合しにくくなる。
一方、直流電源Ｐの正および負に接続される３個ずつの
トランジスタいずれかを全部あるいは一部を導通させる
＠の手段はインバータ運転停止中にも電源の同一極性に
連らなる３個のパワートランジスタのベース電流を流し
絖けているため、ノイズなどに起因して対極のパワート
ランジスタが誤動作した場合、電源短絡、あるいは停止
中のモータが動作するなど重大な弊害を起すおそれがあ
ることに加えてベースドライブ回路が複雑化する欠点が
ありだ〇 本発明の目的はトランジスタインバータノ運転休止中に
おいて、電源の負極側に接続されるパワートランジスタ
のうち、少なくとも一個に対するベース電源の負荷径路
をパワートランジスタのベース回路を経ないバイパス径
路を設けることにより簡易形ベースドライブ用安定化電
源でも安定な動作を得ることにある。
トランジスタいずれかを全部あるいは一部を導通させる
＠の手段はインバータ運転停止中にも電源の同一極性に
連らなる３個のパワートランジスタのベース電流を流し
絖けているため、ノイズなどに起因して対極のパワート
ランジスタが誤動作した場合、電源短絡、あるいは停止
中のモータが動作するなど重大な弊害を起すおそれがあ
ることに加えてベースドライブ回路が複雑化する欠点が
ありだ〇 本発明の目的はトランジスタインバータノ運転休止中に
おいて、電源の負極側に接続されるパワートランジスタ
のうち、少なくとも一個に対するベース電源の負荷径路
をパワートランジスタのベース回路を経ないバイパス径
路を設けることにより簡易形ベースドライブ用安定化電
源でも安定な動作を得ることにある。
以下、第１図に示す具体的回路図を基に本発明の詳細な
説明する。同第１図において、１はベースコントロール
回路で、運転指令Ｘを入力して定められた順序に従って
各パワートランジスタＳｌ〜Ｓ６を導通制御させるべく
動作する。２は制御電源である。８１〜Ｂ６はベースド
ライブ回路で、それぞ４れ各パワートランジスタ５１〜
Ｓ６の動作指令を供給するものであり、発光ダイオード
及びホトトランジスタを含み、互に絶縁状態を維持しつ
つ分離された回路間の信号の伝達作用を担う。そして、
上記各ベースドライブ回路Ｂ１−８６の発光ダイオード
の入力権に対してはそれぞれ制御電源２の十極が各調整
抵抗Ｒ１１−Ｒｔａを介して接続され、当該各ベースド
ライブ回路Ｂｌ−Ｂ６の各発光ダイオードの出力極はベ
ースコントロール回路１に導びかれる。
説明する。同第１図において、１はベースコントロール
回路で、運転指令Ｘを入力して定められた順序に従って
各パワートランジスタＳｌ〜Ｓ６を導通制御させるべく
動作する。２は制御電源である。８１〜Ｂ６はベースド
ライブ回路で、それぞ４れ各パワートランジスタ５１〜
Ｓ６の動作指令を供給するものであり、発光ダイオード
及びホトトランジスタを含み、互に絶縁状態を維持しつ
つ分離された回路間の信号の伝達作用を担う。そして、
上記各ベースドライブ回路Ｂ１−８６の発光ダイオード
の入力権に対してはそれぞれ制御電源２の十極が各調整
抵抗Ｒ１１−Ｒｔａを介して接続され、当該各ベースド
ライブ回路Ｂｌ−Ｂ６の各発光ダイオードの出力極はベ
ースコントロール回路１に導びかれる。
Ｕｌ〜Ｕ３はそれぞれ電源Ｐの十極側に接続される各パ
ワートランジスタ５ＩＰ−５ｓ用ベース電源で、総て同
一構成をなし、ベース電源Ｕｌについて具体的に説明す
ると、ダイオードＤｌｌ、コンデンサＣ１、トランスＴ
１、ダイオードＤｌｌを図示の通りに接続して構成され
、ダイオードＤＩ＋のカソードはペースドライブ回路Ｂ
１の出力トランジスタのコレクタヘダイオードＤＩＤの
アノードはパワートランジスタＳ１のエミツタに接続さ
れる。Ｕ４は同じくベース電源で、上記ベース電源Ｕ１
〜Ｕ３と均等な構成をなし、ダイオードＤＩ４、コンデ
ンサＣ４、トランスＴ４、ダイオードＤ４０を図示の通
りの接続によって構成される。そして、このベース電源
Ｕ４はパワートランジスタ５４〜Ｓ６のエミッタが共通
に電源Ｐのｅ極に接続されることに関連して、各パワー
トランジスタ５４〜Ｓ６に対し共用可能で、図示の接読
状態をなす。Ｒ２１、Ｒ２２、・・・・・Ｒ２６はベー
ス抵抗で、それぞれベースドライブ回路Ｂｘ〜Ｂ６と各
パワートランジスタ５ｌ−５６トの間に図示の通りに接
続される。ＩＣは否定論理回路で、運転指令Ｘの否定出
力を得、当該否定論理回路ＩＣの出力が制御用トランジ
スタ５１Ｇのベースに、ベース抵抗Ｒ３１を介して接続
される。そして、この第１の制御用トランジスタ５１０
０ベースエミツタ間には抵抗Ｒ３２が接続され、エミッ
タは接地される。３はホトカップラで、その発光ダイオ
ード３ａの入力極には抵抗Ｒ１７を介して制御電源２が
、出力極にはベースコントロール回路１からの出力端子
が各独立のダイオードＤ２１、Ｂ２２、Ｂ２３を図示の
極性に介して接続され、これと同時に各ダイオードＤ２
１、Ｂ２２、Ｂ２３の各カソードは上記制御用トランジ
スタＳ１０のコレクタに接続される。Ｓｌｌは第２の制
御用トランジスタで、そのベースには上記ホトカップラ
３のホトトランジスタのエミッタが、ベース抵抗Ｒ４１
を介して接続され、ベース、エミッタ間には抵抗Ｒ４２
が接続される。一方、制御用トランジスタＳｌｌのコレ
クタにはパワートランジスタＳ４、Ｂ５、Ｂ６のベース
が各独立のダイオードＤ３１． Ｂ３２、［）３３を介
して接続される。
ワートランジスタ５ＩＰ−５ｓ用ベース電源で、総て同
一構成をなし、ベース電源Ｕｌについて具体的に説明す
ると、ダイオードＤｌｌ、コンデンサＣ１、トランスＴ
１、ダイオードＤｌｌを図示の通りに接続して構成され
、ダイオードＤＩ＋のカソードはペースドライブ回路Ｂ
１の出力トランジスタのコレクタヘダイオードＤＩＤの
アノードはパワートランジスタＳ１のエミツタに接続さ
れる。Ｕ４は同じくベース電源で、上記ベース電源Ｕ１
〜Ｕ３と均等な構成をなし、ダイオードＤＩ４、コンデ
ンサＣ４、トランスＴ４、ダイオードＤ４０を図示の通
りの接続によって構成される。そして、このベース電源
Ｕ４はパワートランジスタ５４〜Ｓ６のエミッタが共通
に電源Ｐのｅ極に接続されることに関連して、各パワー
トランジスタ５４〜Ｓ６に対し共用可能で、図示の接読
状態をなす。Ｒ２１、Ｒ２２、・・・・・Ｒ２６はベー
ス抵抗で、それぞれベースドライブ回路Ｂｘ〜Ｂ６と各
パワートランジスタ５ｌ−５６トの間に図示の通りに接
続される。ＩＣは否定論理回路で、運転指令Ｘの否定出
力を得、当該否定論理回路ＩＣの出力が制御用トランジ
スタ５１Ｇのベースに、ベース抵抗Ｒ３１を介して接続
される。そして、この第１の制御用トランジスタ５１０
０ベースエミツタ間には抵抗Ｒ３２が接続され、エミッ
タは接地される。３はホトカップラで、その発光ダイオ
ード３ａの入力極には抵抗Ｒ１７を介して制御電源２が
、出力極にはベースコントロール回路１からの出力端子
が各独立のダイオードＤ２１、Ｂ２２、Ｂ２３を図示の
極性に介して接続され、これと同時に各ダイオードＤ２
１、Ｂ２２、Ｂ２３の各カソードは上記制御用トランジ
スタＳ１０のコレクタに接続される。Ｓｌｌは第２の制
御用トランジスタで、そのベースには上記ホトカップラ
３のホトトランジスタのエミッタが、ベース抵抗Ｒ４１
を介して接続され、ベース、エミッタ間には抵抗Ｒ４２
が接続される。一方、制御用トランジスタＳｌｌのコレ
クタにはパワートランジスタＳ４、Ｂ５、Ｂ６のベース
が各独立のダイオードＤ３１． Ｂ３２、［）３３を介
して接続される。
上記構成において、運転指令Ｘが“１”を読出している
と、否定論理回路ＩＣの出力は“０″となり、第１の制
御用トランジスタ５１０はオフとなり、ホトカップラ３
は動作しない。従って、第２の制御用トランジスタＳｌ
ｌはオフ状態を保つ。そして、この運転指令Ｘが“１″
のときはベースコントロール回路１が動作し、ベースド
ライブ回路Ｂ１〜Ｂ６を定められた順序に従って動作さ
せ、これによってベース電源ｔＪｌ−Ｕ４より対応する
パワートランジスタ５１〜Ｓ６のベース回路に電流を供
給し、第３図に示す運転モードＡＩにおける導通制御を
なす。この動作のパワートランジスタ５ｌ−５６の導通
制御の詳細をパワートランジスタＳ４を例にとって述べ
ると、当該パワートランジスタＳ４のベース電流は従来
の回路構成と全く同様にベース電源Ｕ４内の電力供給用
トランスＴ４→ダイオードＤ４→ベースドライブ回路Ｂ
４→ベース抵抗Ｒ２４→パワートランジスタＳ４のベー
ス−パワートランジスタＳ４のエミッタ→ダイオードＤ
４０→トランスＴ４へと流れてパワートランジスタＳ４
をオンさせる。
と、否定論理回路ＩＣの出力は“０″となり、第１の制
御用トランジスタ５１０はオフとなり、ホトカップラ３
は動作しない。従って、第２の制御用トランジスタＳｌ
ｌはオフ状態を保つ。そして、この運転指令Ｘが“１″
のときはベースコントロール回路１が動作し、ベースド
ライブ回路Ｂ１〜Ｂ６を定められた順序に従って動作さ
せ、これによってベース電源ｔＪｌ−Ｕ４より対応する
パワートランジスタ５１〜Ｓ６のベース回路に電流を供
給し、第３図に示す運転モードＡＩにおける導通制御を
なす。この動作のパワートランジスタ５ｌ−５６の導通
制御の詳細をパワートランジスタＳ４を例にとって述べ
ると、当該パワートランジスタＳ４のベース電流は従来
の回路構成と全く同様にベース電源Ｕ４内の電力供給用
トランスＴ４→ダイオードＤ４→ベースドライブ回路Ｂ
４→ベース抵抗Ｒ２４→パワートランジスタＳ４のベー
ス−パワートランジスタＳ４のエミッタ→ダイオードＤ
４０→トランスＴ４へと流れてパワートランジスタＳ４
をオンさせる。
一方、インバータの運転休止モード期間は運転指令Ｘが
“Ｏ″を読出し、これによって否定論理回路ＩＣの出力
は“１７となり、第１の制御用トランジスタＳ１０が導
通する。これによって各ベースドライブ回路Ｂ４、Ｂ５
、Ｂ６がそれぞれ対応する調整抵抗Ｒ１４、Ｒ１５、Ｒ
１６及び対応するダイオードＤ２１、Ｂ２２、Ｂ２３を
通じて制御電源２より０電位間に電路が形成され、各ベ
ースドライブ回路Ｂ４〜Ｂ６は動作モードとなる。
“Ｏ″を読出し、これによって否定論理回路ＩＣの出力
は“１７となり、第１の制御用トランジスタＳ１０が導
通する。これによって各ベースドライブ回路Ｂ４、Ｂ５
、Ｂ６がそれぞれ対応する調整抵抗Ｒ１４、Ｒ１５、Ｒ
１６及び対応するダイオードＤ２１、Ｂ２２、Ｂ２３を
通じて制御電源２より０電位間に電路が形成され、各ベ
ースドライブ回路Ｂ４〜Ｂ６は動作モードとなる。
加えて、ホトカップラ３は、制御電源２より当該ホトカ
ップラ３の発光ダイオード、抵抗Ｒ１７、上記第１の制
御用トランジスタ８１０を含む回路に流れる電流により
動作モードに移行する。このホトカップラ３の動作に伴
い、ペース電源Ｕ４中のトランス □Ｔ４よりダイオー
ドＤ４Ｌホトカップラ３のホトトランジスタ、ベース抵
抗Ｒ４１％第２の制御用トランジスタＳＵのベース回路
を通じて電路が形成され、当該筒２の制御用トランジス
タ５１１が導通する。この状態のもとにおいて、今、ベ
ースドライブ回路Ｂ４を含む回路を例にとってみると、
ベース電源Ｕ４内のトランスＴ４→ダイオードＤ４１→
ベースドライブ回路Ｂ４→ベース抵抗Ｒ２４→ダイオー
ドＤ３１→第２の制御用トランジスタ５１１の主回路→
ダイオードＤ４０→トランスＴ４の閉回路に電流が流れ
る。他のベースドライブ回路Ｂ５、Ｂ６を含む回路につ
いてもそれぞれ対応するベース抵抗Ｒ２５、Ｒ２６、及
び対応するダイオード［）３２、Ｂ３３を含むバイパス
回路にも電流が流れる。
ップラ３の発光ダイオード、抵抗Ｒ１７、上記第１の制
御用トランジスタ８１０を含む回路に流れる電流により
動作モードに移行する。このホトカップラ３の動作に伴
い、ペース電源Ｕ４中のトランス □Ｔ４よりダイオー
ドＤ４Ｌホトカップラ３のホトトランジスタ、ベース抵
抗Ｒ４１％第２の制御用トランジスタＳＵのベース回路
を通じて電路が形成され、当該筒２の制御用トランジス
タ５１１が導通する。この状態のもとにおいて、今、ベ
ースドライブ回路Ｂ４を含む回路を例にとってみると、
ベース電源Ｕ４内のトランスＴ４→ダイオードＤ４１→
ベースドライブ回路Ｂ４→ベース抵抗Ｒ２４→ダイオー
ドＤ３１→第２の制御用トランジスタ５１１の主回路→
ダイオードＤ４０→トランスＴ４の閉回路に電流が流れ
る。他のベースドライブ回路Ｂ５、Ｂ６を含む回路につ
いてもそれぞれ対応するベース抵抗Ｒ２５、Ｒ２６、及
び対応するダイオード［）３２、Ｂ３３を含むバイパス
回路にも電流が流れる。
上記第１図示の実施例での説明においてはトランジスタ
インバータ運転休止時に直流入力電源のｅ極側に接続さ
れる３個のパワートランジスタのベースドライブ回路を
総て動作する回路を示しているが、必ずしも３個総ての
ベースドライブ回路を動作させる必要はなく、例えば、
ベースドライブ回路Ｂ４のみを動作するようにしてもよ
い。また、ホトカップラは互に絶縁状態を保って信号を
組違するための１手段であって、均等な作用をもたらす
要素に代替できることはいうまでもなく、他の構成要素
についてもいくつかの異なる形態とすることができ、上
記構成に限定されるものでない。
インバータ運転休止時に直流入力電源のｅ極側に接続さ
れる３個のパワートランジスタのベースドライブ回路を
総て動作する回路を示しているが、必ずしも３個総ての
ベースドライブ回路を動作させる必要はなく、例えば、
ベースドライブ回路Ｂ４のみを動作するようにしてもよ
い。また、ホトカップラは互に絶縁状態を保って信号を
組違するための１手段であって、均等な作用をもたらす
要素に代替できることはいうまでもなく、他の構成要素
についてもいくつかの異なる形態とすることができ、上
記構成に限定されるものでない。
本発明に係るトランジスタインバータの制御回路は運転
休止時に直流入力電源Ｐのｅ極に接続される側の少なく
とも一個のパワートランジスタのベースドライブ回路を
動作させるとともにこのベースドライブ回路の動作を伴
ってベース電源よりパワートランジスタのベース回路を
含まない閉回路に電流を流すような回路手段を備えたも
のである。このような構成に基づいて （１）トランジスタインバータの停止期間中はベース電
源からの電流をベース抵抗を経てパワートランジスタと
は別のバイパス回路を通して流れるのでパワートランジ
スタは総てオフ状態となりノイズ等による誤動作に強く
、安定に使用できる。
休止時に直流入力電源Ｐのｅ極に接続される側の少なく
とも一個のパワートランジスタのベースドライブ回路を
動作させるとともにこのベースドライブ回路の動作を伴
ってベース電源よりパワートランジスタのベース回路を
含まない閉回路に電流を流すような回路手段を備えたも
のである。このような構成に基づいて （１）トランジスタインバータの停止期間中はベース電
源からの電流をベース抵抗を経てパワートランジスタと
は別のバイパス回路を通して流れるのでパワートランジ
スタは総てオフ状態となりノイズ等による誤動作に強く
、安定に使用できる。
（２）トランジスタインバータの運転中、運転休止中も
等価な電流をベース電源より流し続けるので、ベース電
源にとって負荷変動が少なく、例えば負荷変動補正の付
いていない簡易形の安定化電源でも安定にドライブする
ことができる。
等価な電流をベース電源より流し続けるので、ベース電
源にとって負荷変動が少なく、例えば負荷変動補正の付
いていない簡易形の安定化電源でも安定にドライブする
ことができる。
（３）トランジスタインバータを構成するパワートラン
ジスタのうちエミッタが共通になっており、これが入力
直流電源のｅ側のスイッチングトランジスタのベースの
ベース電源よりの電流をバイパスしているので、１組の
バイパスドライブ回路と１ケのバイパス素子で構成でき
安価に目的を達成することができる。
ジスタのうちエミッタが共通になっており、これが入力
直流電源のｅ側のスイッチングトランジスタのベースの
ベース電源よりの電流をバイパスしているので、１組の
バイパスドライブ回路と１ケのバイパス素子で構成でき
安価に目的を達成することができる。
第１図は本発明の実施例を示す回路図、第２図ハ本発明
を実施するためのトランジスタインバータ回路図、第３
図は動作を示すグラフである。
を実施するためのトランジスタインバータ回路図、第３
図は動作を示すグラフである。
Claims (1)
- 【特許請求の範囲】 １、トランジスタインバータを構成するパワートランジ
スタそれぞれに対応するベースドライブ回路及び独立ま
たは一部共用のベース電源を備え、ベースコントロール
回路からの指令に基づいて各ベースドライブ回路を動作
させ、各パワートランジスタに所定の順番に従ってベー
ス電流を流す構成において、インバータの運転休止に連
動して上記パワートランジスタのうち入力直流電源の■
極に直接連らなる少なくとも一つのパワートランジスタ
用ベースドライブ回路を動作させるとともに、上記入力
直流電源の■側に連らなるパワートランジスタ用ベース
電源及び上記動作するベースドライブ回路を含み、この
ベースドライブ回路に対応するパワートランジスタ用ベ
ース回路を含まない閉回路を構成する回路手段を備えた
ことを特徴とするトランジスタインバータの制御回路。 ２、回路手段を、インバータの運転休止に連動してイン
バータを構成するパワートランジスタのうち入力直流電
源の■極に直接連らなる少なくとも一つのパワートラン
ジスタ用ベースドライブ回路を動作させるとともに互に
絶縁された回路に導通制御を与える素子群に動作指令を
与える第１の回路手段、及び上記導通制御を与える素子
群の動作に伴って上記入力直流電源の■側に連らなるパ
ワートランジスタのベース電源、上記動作するベースド
ライブ回路を含み、動作するベースドライブ回路に対応
するパワートランジスタのベース回路を含まない閉回路
を構成する第２の回路手段より構成した特許請求の範囲
第１項記載のトランジスタインバータの制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60012261A JPS61173679A (ja) | 1985-01-24 | 1985-01-24 | トランジスタインバ−タの制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60012261A JPS61173679A (ja) | 1985-01-24 | 1985-01-24 | トランジスタインバ−タの制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61173679A true JPS61173679A (ja) | 1986-08-05 |
| JPH0468868B2 JPH0468868B2 (ja) | 1992-11-04 |
Family
ID=11800427
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60012261A Granted JPS61173679A (ja) | 1985-01-24 | 1985-01-24 | トランジスタインバ−タの制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61173679A (ja) |
-
1985
- 1985-01-24 JP JP60012261A patent/JPS61173679A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0468868B2 (ja) | 1992-11-04 |
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