JPS61141043A - 冗長化システムにおける異常検出方式 - Google Patents
冗長化システムにおける異常検出方式Info
- Publication number
- JPS61141043A JPS61141043A JP59263004A JP26300484A JPS61141043A JP S61141043 A JPS61141043 A JP S61141043A JP 59263004 A JP59263004 A JP 59263004A JP 26300484 A JP26300484 A JP 26300484A JP S61141043 A JPS61141043 A JP S61141043A
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- JP
- Japan
- Prior art keywords
- counter
- arithmetic
- regular
- units
- unit
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
- G06F11/076—Error or fault detection not based on redundancy by exceeding limits by exceeding a count or rate limit, e.g. word- or bit count limit
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Hardware Redundancy (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、共通バス上に２つの演算制御二ニット（Ｍ
ＰＵ）を並設し、一方を制御演算を実行する常用系、他
方をこの常用系ＭＰＵの監視を行な５予備系とする待機
形冗長化システム、特にこのようなシステムにおける常
用系ＭＰＵの異常検出方式に関する。
ＰＵ）を並設し、一方を制御演算を実行する常用系、他
方をこの常用系ＭＰＵの監視を行な５予備系とする待機
形冗長化システム、特にこのようなシステムにおける常
用系ＭＰＵの異常検出方式に関する。
第２図は待機形冗長化システムの従来例を示すブロック
図である。
図である。
共通バス４には、冗長化構成された２つの演算制御ユニ
ット（ＭＰＵ）１１，１２、メモリユニット２および入
出力ユニツ） ３１ｓ３２がそれぞれ接続されている。
ット（ＭＰＵ）１１，１２、メモリユニット２および入
出力ユニツ） ３１ｓ３２がそれぞれ接続されている。
ＭＰＵｈ ＋ １２は制御演算を行なう中央処理部１１
と、バス４との間でデータのやりとりを行なうバスイン
タフェイス部１２とから構成されている。・メモリユニ
ット２は共用装置であり、２つのＭＰＵ１１，１２のい
ずれからもバス４を介してデータの読み、書きが可能で
ある。入出カニニット３１ ＊ ３２は外部プロセスと
の間で入出力信号を授受するユニットで、必要に応じて
さらに増設される。
と、バス４との間でデータのやりとりを行なうバスイン
タフェイス部１２とから構成されている。・メモリユニ
ット２は共用装置であり、２つのＭＰＵ１１，１２のい
ずれからもバス４を介してデータの読み、書きが可能で
ある。入出カニニット３１ ＊ ３２は外部プロセスと
の間で入出力信号を授受するユニットで、必要に応じて
さらに増設される。
このような構成において、冗長化されたＭＰＵ１１，１
２のうちのいずれか一方が常用系となってシステムの制
御演算を実行するとともに、所定周期をもってメモリユ
ニット２の成る領域へ所定コードを書き込み、他方は予
備系となって常用系が書き込んだ所定コードのチェック
を行表い、チェックが終了したらこれをクリアする動作
を繰り返す。したがって、常用系のＭＰＵがダウンする
と、以後所定コードを書き込まなくなるので、これによ
り予備系のＭＰＵは常用系ＭＰＵの異常を知ることがで
きる。
２のうちのいずれか一方が常用系となってシステムの制
御演算を実行するとともに、所定周期をもってメモリユ
ニット２の成る領域へ所定コードを書き込み、他方は予
備系となって常用系が書き込んだ所定コードのチェック
を行表い、チェックが終了したらこれをクリアする動作
を繰り返す。したがって、常用系のＭＰＵがダウンする
と、以後所定コードを書き込まなくなるので、これによ
り予備系のＭＰＵは常用系ＭＰＵの異常を知ることがで
きる。
しかしながら、上記の如き方式では異常検出のための情
報の書込み、クリアを他の装置からも共用されるメモリ
ユニットを用いて行な５ようにしているため、他の装置
から誤ってその所定コード格納領域にデータが書き込ま
れる可能性がある。
報の書込み、クリアを他の装置からも共用されるメモリ
ユニットを用いて行な５ようにしているため、他の装置
から誤ってその所定コード格納領域にデータが書き込ま
れる可能性がある。
また、メモリユニットが故障すると、予備系のＭＰＵは
常用系ＭＰＵが異常であるＫもかへわらず正常と判定し
たり、その逆に正常なのく異常と誤判定し、システムに
悪影響を及ばずおそれもあるという問題がある。
常用系ＭＰＵが異常であるＫもかへわらず正常と判定し
たり、その逆に正常なのく異常と誤判定し、システムに
悪影響を及ばずおそれもあるという問題がある。
〔問題点を解決するための手段および作用〕待機形冗長
化システムを構成する演算制御ユニットの各々に、その
内部からはインクリメントが可能で外部（バス）からは
その内容の読出しのみが可能なカウンタを設け、該カウ
ンタを常用系から所定周期で更新する一方、予備系から
とのカウ゛ンタの内容を所定周期で監視し、カラ／りの
更新停止をもって常用系の異常を検出する。
化システムを構成する演算制御ユニットの各々に、その
内部からはインクリメントが可能で外部（バス）からは
その内容の読出しのみが可能なカウンタを設け、該カウ
ンタを常用系から所定周期で更新する一方、予備系から
とのカウ゛ンタの内容を所定周期で監視し、カラ／りの
更新停止をもって常用系の異常を検出する。
第１図はこの発明の実施例を示すブロック図である。同
図からも明らかなように、この実施例はＭＰ Ｕ １１
＊ １２の各々にカウンタ１３を設ゆた点が特徴でおる
。
図からも明らかなように、この実施例はＭＰ Ｕ １１
＊ １２の各々にカウンタ１３を設ゆた点が特徴でおる
。
このカウンタ１３は、中央処理部１１からノ・−ド的ま
たはソフト的に与えられるクロックを順次カウントシ、
シたがって他の装置からはカウント１２を介して読み出
すことが可能である。こうすることにより、常用系のカ
ウンタ１３はその中央処理部１１が正常で多る限りはイ
ンクリメント動作を行なうので、予備系からこのカウン
タ１５の内容を監視することにより常用系の正常、異常
を判別することができる。例えば予備系から常用系カウ
ンタの内容を所定の周期で取り込み、その前回値と今回
値とを比較して今回値が大きくなっていれば正常、前回
値と今回値が等しければ異常と判定する。
たはソフト的に与えられるクロックを順次カウントシ、
シたがって他の装置からはカウント１２を介して読み出
すことが可能である。こうすることにより、常用系のカ
ウンタ１３はその中央処理部１１が正常で多る限りはイ
ンクリメント動作を行なうので、予備系からこのカウン
タ１５の内容を監視することにより常用系の正常、異常
を判別することができる。例えば予備系から常用系カウ
ンタの内容を所定の周期で取り込み、その前回値と今回
値とを比較して今回値が大きくなっていれば正常、前回
値と今回値が等しければ異常と判定する。
１〔効果〕
この発明によれば、演算制御ユニットの各々にカウンタ
を設け、このカウンタを内部から紘インクリメントを可
能とし外部からは読出しのみが可能な如く構成するよう
にしたので、他の装置による誤った書込みや他の装置の
故障等にかへわらず確実に常用系の異常を検出すること
ができ、これによってシステムの信頼性、安全性を向上
し得る利点がもたらされるものである。
を設け、このカウンタを内部から紘インクリメントを可
能とし外部からは読出しのみが可能な如く構成するよう
にしたので、他の装置による誤った書込みや他の装置の
故障等にかへわらず確実に常用系の異常を検出すること
ができ、これによってシステムの信頼性、安全性を向上
し得る利点がもたらされるものである。
第１図紘この発明の実施例を示すブロック図、第２図は
待機形冗長化システムの従来例を示すブロック図である
。 符号説明 １１．１２・・・・・・演算制御ユニット、２・・・・
・・メモリユニット、−３１１３２・・・・・・入出カ
ニニット、４・・・・・・共通バス、１１・・・・・・
中央処理部、１２・・・・・・バスインタフェイス部、
１３・・・・・・カウンタ。
待機形冗長化システムの従来例を示すブロック図である
。 符号説明 １１．１２・・・・・・演算制御ユニット、２・・・・
・・メモリユニット、−３１１３２・・・・・・入出カ
ニニット、４・・・・・・共通バス、１１・・・・・・
中央処理部、１２・・・・・・バスインタフェイス部、
１３・・・・・・カウンタ。
Claims (1)
- 共通バス上に２つの演算制御ユニットを並設し、その一
方を制御演算を行なう常用系とし他方を該常用系演算制
御ユニットの監視を行なう予備系として運用する冗長化
システムにおいて、前記各演算制御ユニットにはその内
部からはインクリメントが可能で外部からはその内容を
読み取ることのみが可能なカウンタを設け、該カウンタ
を前記常用系演算制御ユニットから所定周期で更新する
一方、前記予備系演算制御ユニットから該カウンタの内
容を所定周期をもつて監視し、カウンタの更新停止をも
つて常用系演算制御ユニットの異常を検出することを特
徴とする冗長化システムにおける異常検出方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59263004A JPS61141043A (ja) | 1984-12-14 | 1984-12-14 | 冗長化システムにおける異常検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59263004A JPS61141043A (ja) | 1984-12-14 | 1984-12-14 | 冗長化システムにおける異常検出方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61141043A true JPS61141043A (ja) | 1986-06-28 |
Family
ID=17383552
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59263004A Pending JPS61141043A (ja) | 1984-12-14 | 1984-12-14 | 冗長化システムにおける異常検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61141043A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57164345A (en) * | 1981-04-01 | 1982-10-08 | Nec Corp | Failure detecting system for composite microcomputer |
| JPS59123946A (ja) * | 1982-12-29 | 1984-07-17 | Fujitsu Ltd | システム制御方式 |
-
1984
- 1984-12-14 JP JP59263004A patent/JPS61141043A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57164345A (en) * | 1981-04-01 | 1982-10-08 | Nec Corp | Failure detecting system for composite microcomputer |
| JPS59123946A (ja) * | 1982-12-29 | 1984-07-17 | Fujitsu Ltd | システム制御方式 |
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