JPS6112423B2 - - Google Patents

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Publication number
JPS6112423B2
JPS6112423B2 JP55049770A JP4977080A JPS6112423B2 JP S6112423 B2 JPS6112423 B2 JP S6112423B2 JP 55049770 A JP55049770 A JP 55049770A JP 4977080 A JP4977080 A JP 4977080A JP S6112423 B2 JPS6112423 B2 JP S6112423B2
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JP
Japan
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data
central system
terminal
terminal device
mode
Prior art date
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Expired
Application number
JP55049770A
Other languages
English (en)
Other versions
JPS56146344A (en
Inventor
Tetsuo Hosoe
Kenji Shimojima
Yasuyoshi Ooyama
Hisashi Tanaka
Juichi Tasaka
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP4977080A priority Critical patent/JPS56146344A/ja
Publication of JPS56146344A publication Critical patent/JPS56146344A/ja
Publication of JPS6112423B2 publication Critical patent/JPS6112423B2/ja
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/10Program control for peripheral devices
    • G06F13/12Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor
    • G06F13/122Program control for peripheral devices using hardware independent of the central processor, e.g. channel or peripheral processor where hardware performs an I/O function other than control of data transfer

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Computer And Data Communications (AREA)
  • Communication Control (AREA)

Description

【発明の詳細な説明】 本発明は端末制御装置に関する。
端末制御装置には、端末装置からの入力データ
を中央システムへ送信するモード、各種記憶装置
に格納するモード、さらにはこれら記憶装置のデ
ータを読出して中央システムに送信するモードが
備わつている。
ところで従来の端末制御装置は端末装置(端末
操作者)主体の制御方式を採つており、上記の各
モードの選択は端末装置上の鍵盤の各種キーやス
イツチの操作に依つて行なうようになつている。
したがつて端末装置のオペレータは入力データの
発生の都度、モード選択のための操作を繰り返さ
なければならず、オペレータの負担が大きかつ
た。またこのモード選択は、中央システム側の状
態に関係なく行なわれるため、中央システムが端
末からのデータを受信できる業務モードでない時
に端末データが送信されることがある。このよう
に中央システム側でトラフイツク制御を行ない得
ないため、端末システム(端末制御装置と端末装
置)が複数台中央システムに接続されるシステム
では、端末からのデータ送信による負荷が中央シ
ステムに集中し、システム全体の処理能力が低下
してしまうという問題があつた。
したがつて本発明の目的は、上記の如き問題を
解決できる端末制御装置を提供することにある。
しかして本発明による端末制御装置は、中央シ
ステムからのモード選択指令にしたがつて自動的
にモードを選択して実行させるように構成した点
に特徴があり、これにより端末装置のオペレータ
の負担を軽減し、かつ中央システム主体のトラフ
イツク制御を可能としてシステム全体の処理能力
の向上を達成できるようにしたものである。
第1図は本発明による通信制御装置の一実施例
の機能ブロツク図である。
同図において1は端末装置、2は本発明にかゝ
る端末制御装置である。3は情報レジスタ、4は
端末装置と端末制御装置間の信号線、5は端末制
御装置と中央システム間の信号線、6は端末装置
側データ送受信回路、7は中央システム側データ
送受信回路、8はデータ処理振分け回路、9は各
種記憶装置、10は鍵盤部、11は端末装置送受
信回路、12は表示部である。
上記各回路6,7,8の処理フローを第2,
3,4図にそれぞれ示し、これらを参照しながら
本実施例の動作を説明する。
(a) 端末からデータを入力した場合 操作者が端末装置の鍵盤部10のキーを打鍵
することにより発生するデータは、信号線10
aから端末装置送受信回路11、信号線4を介
して、端末制御装置2の端末装置側データ送受
信回路6に送信される。端末装置側データ送受
信回路6においては、第2図のフローチヤート
におけるステツプ、を経てステツプでデ
ータ処理振分け回路8に起動をかけ、制御を該
回路8に渡す。
データ処理振分け回路8においては、第4図
のフローチヤートにおけるステツプで端末装
置側からの起動であることを知ると、ステツプ
にすすむ。このステツプでデータ処理振分け
回路8は信号線3aを介して情報レジスタ3の
内容(中央システムからのモード情報)を読取
る。
その内容が中央システムへの送信モードを指
定している場合は、ステツプへすすんで中央
システム側データ送受信回路7に対し信号線8
bを介して起動をかける。中央システム側デー
タ送受信回路7は、データ処理振分け回路8か
ら起動を受け制御を渡されると、第3図のフロ
ーチヤートにおけるステツプ、を経由して
ステツプにすすみ、信号線5を介して中央シ
ステムへ端末装置からのデータを送信する。そ
の後、中央システムへの送信終了報告が中央シ
ステムから中央システム側データ送受信回路7
に受信されると、第3図フローチヤートのステ
ツプを経てステツプにすすみ、データ処理
振分け回路8に制御が戻される。これによりデ
ータ処理振分け回路8は、第4図フローチヤー
トのステツプ、、を経て中央システムへ
のデータ送信動作を終了する。
他方、前記データ処理振分け回路8が参照し
た情報レジスタ3の内容が記憶装置9への格納
モードを指定している場合は、第4図フローチ
ヤートのステツプへすすみ、端末装置1から
のデータを信号線8aを介して記憶装置9へ書
込む。
(b) 中央システム側送受信回路7が中央システム
から情報レジスタ3設定用メツセージを受信し
た場合 中央システム側データ送受信回路7は、第3
図フローチヤートのステツプ、を経由して
ステツプで情報レジスタ設定用メツセージの
受信を知ると、ステツプへすすんで中央シス
テムからのモード情報を信号線7aを介して情
報レジスタ3へ設定した後、信号線7bを介し
てデータ処理振分け回路8を起動し制御を移す
(ステツプ)。
データ処理振分け回路8は、第4図フローチ
ヤートのステツプ、を経由してステツプ
へすすみ、情報レジスタ3から信号線3aを介
して読取つたモード情報の内容を判定する。こ
のモード情報が記憶装置9からのデータ吸い上
げ以外の指定であれば、次の動作は何も行なわ
ない。
データ吸い上げ指定の場合は、次のステツプ
にすすみ、信号線9aを介して記憶装置9か
らデータを読出し、中央システム側データ送受
信回路7へ制御を渡す。中央システム側データ
送受信回路7は、第3図フローチヤートのステ
ツプ、を経由してステツプへすすみ、記
憶装置9から読出されたデータを信号線5を通
じて中央システムへ送信する。
その後、中央システムからデータ送信終了報
告が出されると、中央システム側データ送受信
回路7は第3図フローチヤートのステツプを
経由してステツプへすすみ、信号線8bを介
してデータ処理振分け回路8に起動をかけ制御
を渡す。データ処理振分け回路8は、第4図フ
ローチヤートのステツプ、を経由してステ
ツプにすすむ。そして情報レジスタ3のモー
ド情報が依然としてデータ吸い上げを指定して
いるなら、ステツプ、を経て中央システム
側データ送受信回路7へ再び制御を渡す。この
ように、データ吸い上げが指定されている間
は、記憶装置9内のデータが連続的に中央シス
テムへ送信される。
(c) 中央システムから通常メツセージを受信した
場合 中央システム側データ送受信回路7におい
て、第3図フローチヤートのステツプ、、
を経由してステツプでデータ処理振分け回
路8に制御を移す。
データ処理振分け回路8は、第4図フローチ
ヤートのステツプ、を経てステツプへす
すみ、端末装置側データ送受信回路6に信号線
8cを介して起動をかける。
端末装置側データ送受信回路6は、第2図フ
ローチヤートのステツプ、を経由してステ
ツプへすすみ、中央システムからの受信デー
タを信号線4を介して端末装置1へ送信する。
端末装置1では、受信したデータを端末装置受
信回路11から信号線11aを介して表示部1
2へ送り表示する。その後、端末装置側データ
送受信回路6で送信終了報告を受けると(ステ
ツプ)、処理を終了する。
本発明による端末制御装置は以上に述べた如く
であり、中央システム側主体のモード選択制御方
式をとつているため、端末装置のオペレータの負
担を軽減でき、またシステム全体の処理能力の向
上を図ることができる等の効果を有する。
【図面の簡単な説明】
第1図は本発明による端末制御装置の一実施例
を示す機能ブロツク図、第2図は第1図中の端末
装置側データ送受信回路の処理フローチヤート、
第3図は第1図中の中央システム側データ送受信
回路の処理フローチヤート、第4図は第1図中の
データ処理振分け回路の処理フローチヤートであ
る。 1……端末装置、2……端末制御装置、3……
情報レジスタ、6……端末装置側のデータ送受信
回路、7……中央システム側のデータ送受信回
路、8……データ処理振分け回路、9……各種の
記憶装置。

Claims (1)

    【特許請求の範囲】
  1. 1 中央システムの制御下で端末装置を制御する
    端末制御装置において、端末装置からの入力デー
    タを中央システムへ送信するモード、端末装置か
    らの入力データを当該端末制御装置内の記憶装置
    に格納するモード、あるいは前記記憶装置のデー
    タを読出して中央システムへ送信するモードのい
    ずれであるを示す情報を中央システムからの指令
    により設定するレジスタ手段と、該レジスタ手段
    の内容を読出し、それにしたがつて上記のいずれ
    かの処理モードを選択して実行する制御手段とを
    有することを特徴とする端末制御装置。
JP4977080A 1980-04-16 1980-04-16 Terminal control device Granted JPS56146344A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP4977080A JPS56146344A (en) 1980-04-16 1980-04-16 Terminal control device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4977080A JPS56146344A (en) 1980-04-16 1980-04-16 Terminal control device

Publications (2)

Publication Number Publication Date
JPS56146344A JPS56146344A (en) 1981-11-13
JPS6112423B2 true JPS6112423B2 (ja) 1986-04-08

Family

ID=12840397

Family Applications (1)

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JP4977080A Granted JPS56146344A (en) 1980-04-16 1980-04-16 Terminal control device

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JP (1) JPS56146344A (ja)

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61112264A (ja) * 1984-10-12 1986-05-30 Fujitsu Ltd スタンドアロン型集計装置
JPS61226860A (ja) * 1985-03-30 1986-10-08 Anritsu Corp カード信用取引端末装置
JPS62190544A (ja) * 1986-02-17 1987-08-20 Omron Tateisi Electronics Co プログラマブル・コントロ−ラの上位リンクユニツト

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JPS56146344A (en) 1981-11-13

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