JPS60249191A - 表示駆動回路 - Google Patents

表示駆動回路

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JPS60249191A
JPS60249191A JP59105586A JP10558684A JPS60249191A JP S60249191 A JPS60249191 A JP S60249191A JP 59105586 A JP59105586 A JP 59105586A JP 10558684 A JP10558684 A JP 10558684A JP S60249191 A JPS60249191 A JP S60249191A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は表示装置の駆動方式の回路構成に関するもので
ある〇 〔発明の背景〕 ディジタル画像処理は近年益々盛んになり、小型機器に
も液晶などの画像表糸が使用され、その駆動方法も改良
が加えられつつある。
〔発明の目的〕
本発明は表示装置のマトリクス駆動に於ける駆動回路を
構成する集積回路の耐圧を軽減する構成を提供するもの
である。
〔従来技術と問題点〕
従来、液晶例えばツイストネマチック液晶やゲストホス
ト液晶あるいは螢光体を絶縁基板上に複数の電極を平行
に配置した二枚の電極板間に挾持し、各対向電極間の電
位差を制御して前記平行配置された電極によって構成さ
れる画素を独立に選択駆動されるいわゆるマトリクス駆
動は公知である。
この場合一方のタイミング電極板の複数の電極線には順
次に時間の函数である一定波形のタイミング電圧を印加
し、他方の画素駆動選択の電極板の複数の電極線には独
立に電圧を印加する。例えば任意のタイミング電極線に
対して差電圧を増加する方向とするか減少とする方向と
するかを表示すべき情報と画素がどのタイミング電極線
に対応して配置されるかに従って定める。
このようなマトリックス駆動において任意の画素を取上
げてこの画素に印加する電圧を吟味すると、該画素が対
向するタイミング電極線の選択される位相に於ける駆動
電圧波形を非駆動電圧波形即ち非選択位相に於けるバイ
アス電圧波形とに分類される。バイアス電圧位相に於け
る電圧振巾を１とすると、ｎ本の異なるタイミング位相
をもつ０桁マトリクスに於ける電圧は一般に大略ｆ丁の
時が最もコントラストがよくなる。このことはマトリク
スの桁数ｎの増加とともにタイミング電圧が上昇するこ
とを示している。
しかし通常の安価なＣ／Ｍａｓ累積回路の耐圧は大体２
０Ｖ〜２２Ｖであって、液晶駆動の桁数が１００を越え
るようになるとｆＴ丁１倍すなわちバイアス電圧の１０
倍のタイミング電圧が必要になる。マトリクス駆動の原
理から明らかなように、マトリクス駆動ではタイミング
駆動電圧と画素駆動電圧の差が意味をもつ。従ってタイ
ミング電圧と画素電圧から等しい電圧を差し引いたり加
えたりする手法を用いて両駆動回路の電源電圧を近刊け
ることによりタイミング駆動回路の回路電圧を低下する
のが普通である。
〔発明の構成及び作用〕
本発明は第１のパルス発生回路上に重ねて第２のパルス
発生回路を作り、その最終タイミング駆動の出力電圧振
巾を第１あるいは第２のパルス発生回路の電源電圧より
も犬にする構成である。特に液晶駆動用ＩＣの耐圧設計
上の負担を軽減できる。
第１図は本発明の最も簡単な原理を示す図である。マト
リクス駆動に於てはタイミング波形は表示情報Ｗ依存し
ないで常に一定の波形でありこの波形を用いて高電圧の
タイミング波形ケ作る。第１図に於て１０は第１の駆動
回路、１１は直流電源、１２は第２の駆動回路である。
■１（ｔ）はパルス電圧波形を示す。ここで電源１１と
の関係で得られるＶ２（ｔ）　＝　Ｖ＋（ｔ）　Ｖ。な
る電位Ｖ２（ｔｌを考える。
■２（ｔ）はｖ、（Ｈに直流電源１１を重ねるか、ある
いはＶ＋（ｔ＋のピーク値をＯ■にクランプする回路に
より容易に実現できろ。
第２図に第１図をやや具体化した例を示す。第２図で２
０は第１の駆動回路でパルス源回路、２１はコンデンサ
、２２はクランプ用ダイオードである。２６は第２の駆
動回路である。第１図に於ては第２の駆動回路のハイレ
ベルはＶ＋（ｔ＋、ローレベルはＶ２（ｔ）になる。従
って第２の駆動回路２６の出力■３（ｔ）の取り得るレ
ベルは第４図の波形図に示すＶｓ（ｔ＋又はＶ４（＝０
）になる。
第３図に於ては第２の駆動回路２６のハイレベルなＶ＋
（ｔｔコロ−ベルなＶ２ｆｔ＋とする電源電圧の変動を
示している。第４図に於ては第３図の如き電源！　圧）
ｖｌ（１１のハイレベル時にＶ＋（ｔ）、ローレベル時
に於てＶ２ｆｔ＋を選択した場合の出力波形なＶ５（ｔ
＋、逆にＶ＋（りのハイレベル時に第２の駆動回路２６
がローレベル、　ｖ、（ｇのローレベル時に第２の駆動
回路２６がハイレベルを選択した場合の波形をＶ４（１
（＝　ｏ　）に示す。第２の駆動回路２６の２値しベル
出力電位はＶｓ（ｔ＋と■４の任意の組合せで波形がで
きる事になる。
第５図はこの考えによりビデオ表示用のタイミングパル
スを合成した場合の例を示す波形図である。第５図のＡ
−Ｂは短時間交流の（り返し波形、Ｃ−Ｄｔｒｘフレー
ム毎反転、Ｅ−Ｆはパルス巾変調の場合の波形である。
Ｖ５ｆｔ＋の電圧振巾はＶ＋（ｔ＋の２倍になっており
、かつＶ５Ｄ］とＶ、（ｔ）の任意の組合せ波形が取り
得る。しかも第２の１駆動回路の動作電源電圧は■。で
ある。０レベルを選択できこれを使えばパルス巾変調も
可能である。例えばタイミングパルス巾変調で全体の駆
動電圧の温度補正に使用できろ。本願の考えを採用する
事により例えば耐圧２０Ｖの液晶駆動ＩＣを用いて４０
Ｖの電圧振巾（ビーク−ピーク間）のタイミング信号を
取、出す事ができろ。
本願の回路構成は特に第２の駆動回路なＣ−Ｍｏ５ＩＣ
構成とし、液晶表示素子を駆動した場合に低電力、高効
率の効果を得ることができる。
第６図は本発明の各種実施例夕示す回路である。
第６図のＡはダイオードクランプ、Ｂはトランジスタク
ランプ、Ｃは電界効果トランジスタクランプの各実施例
を示す。６０は第１の駆動回路でパルス発生回路であり
電源電圧■。でパルス波高値■ｏのパルスを発生する。
６１．６６は直流カット用のコンデンサ、６２．６４は
クランプ用ダイオードでシリコンダイオードあるいは順
方向ドロップの少いショトキ−バリヤダイオードを用い
るとよい。６５．６７はそれぞれバイポーラ及び電界効
果トランジスタで、スイッチング制御用の信号をベース
もしくはゲートに印加しなければならない手間はかかる
が、クランプ時の電圧降下が少いので非常に良好なりラ
ンプが行える。６６．６８．６９は第２の駆動回路であ
る。
第９図は実際にマトリクス駆動を行なう場合のタイミン
グ駆動波形１゛、１、Ｆ、２と画素駆動電圧波形Ｓｎ０
例を示しである。Ｔ、、　、　Ｔ、２は既述のようＫＶ
、の電源電圧の第１及び第２の２ノベル電圧出力の駆動
回路により合成されたピーク、ピーク間電圧２　Ｖ　ｎ
の３レベルのタイミングパルスであ　。
り例えば±２０Ｖのパルスである。画素駆動電圧は低電
圧例えば±２．５Ｖ程度で済むので第１の駆動回路で直
接作成された２レベルの電圧波形を示す。タイミングパ
ルスＴＰ１、ＴＰ２の如く隣り合ったタイミングパルス
の極性を反転させるので画素駆動信号Ｓｎの極性切換の
タイミングは各タイミングパルス毎に一致して行なう必
要がない。又冗長な極性切換がなくて済む。
第８図はマ）　ＩＪクス液晶パネルの場合の電極配置を
示しており、８１０はタイミング駆動回路、８２０は画
素駆動回路、８６０は液晶表示パネル、８４２．８４４
．８４６．８４８．８５０はタイミング電極、８５０．
８５２．８５４．８５６、８５８は画素電極であり、互
に８μｍ程のすきまを置いて対向配置されその間にツイ
ストネマチック液晶材料が封入されている。
〔発明の効果〕
以上の如く本発明は耐圧の低い液晶駆動用ＩＣを用いて
も耐圧を超える振１］の駆動信号を得ることができるの
でＩＣの低電圧化高効率化が実現できる。
【図面の簡単な説明】
第１図は本発明の動作原理を示す図。第２図はクランプ
回路の構成図。第３図は第２の駆動回路の電源電位を示
す図。第４図は第２の駆動回路の出力電位の可能レベル
を示す図っ第５図は本発明の出力電圧波形図。第６図Ａ
、Ｂ、Ｃはクランプ回路例。第７図（・ママトリクス駆
動の電圧波形図。 第８図はマトリクス駆動の電極配置図。 ６０．１０．２０・・・・・第１の駆動回路、１２．２
６．６６．６９．６８・・・・・第２の駆動回路、 ２４・・・・・・クランプ回路。 第１図 第゛２図 第５図 −〉 Ｌｍ６ ト ｒν 手続補正臼 通 １、事件の表示 昭和５９年特許願第１０５５８６号 ２、発明の名称 表示駆動回路 ３、補正をする者 事件との関係　特許出願人 住所　東京都新宿区西新宿２丁目１番１号自発 ５、補正の対象 明軸婁 ６、補正の内容

Claims (1)

  1. 【特許請求の範囲】 （１）電極の形成された電極板を対向配置し、その間に
    挾持された表示物質を対向電極間の電位差によりマトリ
    クス駆動する表示装置において、第１の電極板上の電極
    群を駆動するタイミング駆動回路と、該第１の電極板に
    対向配置される第２の電極板上の電極群を駆動する画素
    駆動回路を備え、駆動回路は時間の画数のパルス列を発
    生する第１駆動回路と、該第］駆動回路出力の直流レベ
    ルを切り離して別のレベルに結合するクランプ回路と、
    該クランプされた電圧出力を電源として動作する第２の
    駆動回路を備え、該クランプ回路電圧と、該第２の駆動
    回路出力電圧との合成電圧を電極群に印加する事を特徴
    とする表示駆動回路。 （２）第２の駆動回路は、第１の駆動回路出力とフラン
    グ回路出力の合成電圧で駆動される事を特徴とする特許
    請求範囲第１項記載の表示駆動回路。 （３）第２の駆動回路は第１及び第２の２つのクランプ
    回路出力端に接続され、該第２の、駆動回路は該第１及
    び第２のクランプ回路の出力レベルの差の電圧で駆動さ
    れる事を特徴とする特許請求範囲第１項記載の表示駆動
    回路。 （４）第２の駆動回路の出力電圧は、該第２駆動回路の
    正及び負の電源電位の間で変化し、該第２の電源回路の
    電位変動と加算されて、出力電圧の接地に対する変動電
    圧成分は該第２の駆動回路の正負電源間電位差よりも犬
    である事を特徴とする特許請求範囲第１項記載の表示駆
    動回路。 （５）　クランプ回路は該第１駆動回路出力端に直列接
    続されるコンデンサと、該コンデンサの他端と、任意の
    クランプ電位とを支持する半導体スイッチング素子で構
    成された事を特徴とする特許請求範囲第１項記載の表示
    駆動回路。 （６）半導体スイッチング素子は半導体ダイオードであ
    る事を特徴とする特許請求範囲第５項記載の表示駆動回
    路。 （７）　半導体スイッチング素子はパイボーラトランジ
    スタ素子である事を特徴とする特許請求範囲第５項記載
    の表示駆動回路。 （８）半導体スイッチング素子は電界効果ｌ・ランジス
    ク素子である事を特徴とする特許請求範囲第５項記載の
    表示駆動回路。 （９）第２の駆動回路はパルス計数回路とデコーダ回路
    を備え、マトリクス駆動のタイミング駆動波形を合成す
    る構成である事を特徴とする特許請求範囲第１項記載の
    表示駆動回路。 ００）第２の駆動回路は、該第２の回路の電源電圧の正
    及び負の電位のいずれかに等しい２値電位レベルの出力
    回路からなり、かつ該出力電圧波形は電源の電位レベル
    と合成された３値タイミング駆動波形であり１画素駆動
    回路は固定電源電位の２値電位レベルの出力回路である
    単音特徴とする特許請求範囲第１項記載の表示駆動回路
    。 （１１）第２駆動回路の接地に対する駆動出力電圧波形
    と固定電源動作の画素駆動回路出力電圧波形は共に等し
    い位相で等しい電位となる休止位相駆動の位相を備えた
    事を特徴とする特許請求範囲第１項記載の表示駆動回路
    。
JP59105586A 1984-05-24 1984-05-24 表示駆動回路 Granted JPS60249191A (ja)

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