JPS60145778A - ドツトマトリクス液晶表示パネルの駆動回路 - Google Patents
ドツトマトリクス液晶表示パネルの駆動回路Info
- Publication number
- JPS60145778A JPS60145778A JP110384A JP110384A JPS60145778A JP S60145778 A JPS60145778 A JP S60145778A JP 110384 A JP110384 A JP 110384A JP 110384 A JP110384 A JP 110384A JP S60145778 A JPS60145778 A JP S60145778A
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- JP
- Japan
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- signal
- liquid crystal
- conversion circuit
- shift register
- circuit
- Prior art date
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- Pending
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- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明はドツトマトリクス液晶表示パネルの駆動回路
に関する。
に関する。
近年、携帯用小型テレビ受像機として、ブラウン管の代
りに液晶マトリクスパネルを使用した液晶テレビが開発
され、すでに実用化に至っている。
りに液晶マトリクスパネルを使用した液晶テレビが開発
され、すでに実用化に至っている。
第1−に液晶マ) IJクスパネルを用いて映像信号を
表示する場合の回路構成図を示す。即ち、映像信号増幅
回路(図示せず)で増幅さねた映像信号は、制御回路1
において水平周期信号および垂直同期信号に分離される
。この制御回路1は上記水平周期信号および垂直周期信
号をもとに各種制御信号を作成し、A/1)変換回路2
、走査電極駆動回路3、信号電極駆動回路4の動作を制
御する。
表示する場合の回路構成図を示す。即ち、映像信号増幅
回路(図示せず)で増幅さねた映像信号は、制御回路1
において水平周期信号および垂直同期信号に分離される
。この制御回路1は上記水平周期信号および垂直周期信
号をもとに各種制御信号を作成し、A/1)変換回路2
、走査電極駆動回路3、信号電極駆動回路4の動作を制
御する。
また、上記映像信号は上記A/D変換回路2によってに
ピットのデジタル信号に変換され、信号電極駆動回路4
に加えられる。
ピットのデジタル信号に変換され、信号電極駆動回路4
に加えられる。
ジタル信号を用いて液晶駆動用の隷種類の階調:波形を
作り、mxnの液晶マ) IJクスバネル5の各信号電
極に駆動信号Y、 −Y=を印加する。また、走査電極
駆動回路3は、液晶マ) IJクスバネル5のm本の走
査電極を線順次駆動する。
作り、mxnの液晶マ) IJクスバネル5の各信号電
極に駆動信号Y、 −Y=を印加する。また、走査電極
駆動回路3は、液晶マ) IJクスバネル5のm本の走
査電極を線順次駆動する。
第2図は、上記信号電極駆動回路4の従来の構成を示し
たものであり、第3図は信号電極駆動回路4の動作を示
すタイミングチャートである。なお、第2図および第3
図はに=3で階調が「8」、液晶マ) IJクスパネル
5の電極構造は二車マ) IJクス、画素数はr120
X160Jの場合について示したものであり、ビデオ信
号を1水平期間(IH)おき[16(1回サンプリング
するものとする。
たものであり、第3図は信号電極駆動回路4の動作を示
すタイミングチャートである。なお、第2図および第3
図はに=3で階調が「8」、液晶マ) IJクスパネル
5の電極構造は二車マ) IJクス、画素数はr120
X160Jの場合について示したものであり、ビデオ信
号を1水平期間(IH)おき[16(1回サンプリング
するものとする。
第2図において、11は3ピツ)X320段のシフトレ
ジスタで、 A/L)変換回路2からの3ビットデジタ
ル信号をサンプリングクロックφ$によりII 次aみ
込む。そして、このシフトレジスタ11に読み込まわた
データは、ロードパルスφL K M Mして動作する
3ピツ)X 320 段のバッファ12を介して8チヤ
ンネルのマルチプレクサ13−\送られる。また、この
マルチプレクサ13には、輝度変調パルス発生回路14
から輝度変調パルスPY、〜PY、が入力されている。
ジスタで、 A/L)変換回路2からの3ビットデジタ
ル信号をサンプリングクロックφ$によりII 次aみ
込む。そして、このシフトレジスタ11に読み込まわた
データは、ロードパルスφL K M Mして動作する
3ピツ)X 320 段のバッファ12を介して8チヤ
ンネルのマルチプレクサ13−\送られる。また、この
マルチプレクサ13には、輝度変調パルス発生回路14
から輝度変調パルスPY、〜PY、が入力されている。
上記輝度変調パルス発生回路14はクロックパルスCP
、およびタイミング信号Mによって、第3図に示す如く
夫々時間幅の異なる16種の輝度変調パルスPYo〜P
Y、を発生する。上記タイミング信号Mは、2H(Hは
水平走査周期)の周期で発生する。
、およびタイミング信号Mによって、第3図に示す如く
夫々時間幅の異なる16種の輝度変調パルスPYo〜P
Y、を発生する。上記タイミング信号Mは、2H(Hは
水平走査周期)の周期で発生する。
而して、上記マルチプレクサ13は、バッファ12から
のデータに従って輝度変調パルスPYo〜PY、を選択
し、信号亀〜S□。とじて2チヤンネル・アナログ・マ
ルチプレクサ157\出力する。また、このマルチプレ
クサ15には、駆動パルス発生回路16から2棟の選択
電圧Y!l、YN8が与えらねる。
のデータに従って輝度変調パルスPYo〜PY、を選択
し、信号亀〜S□。とじて2チヤンネル・アナログ・マ
ルチプレクサ157\出力する。また、このマルチプレ
クサ15には、駆動パルス発生回路16から2棟の選択
電圧Y!l、YN8が与えらねる。
この駆動パルス発生回路16は、そねぞねレベルの異な
るVo、V、、V、、V、の電圧をタイミング信号MK
同期して選択し、第3図に示す様に■。とvsとの間で
2H毎九反転する選択電圧Ys、V、とV、との間で2
H毎に反転する選択電圧YNsを出力する。
るVo、V、、V、、V、の電圧をタイミング信号MK
同期して選択し、第3図に示す様に■。とvsとの間で
2H毎九反転する選択電圧Ys、V、とV、との間で2
H毎に反転する選択電圧YNsを出力する。
そして、上記マルチプレクサ15は48号81〜8.1
0がハイレベルの時は選択電圧Ys、ローレベルでは選
択電圧YNsを選択し、第3図に示す様に駆動信号YI
(Y+〜Y8.)として液晶マトリクスパネル5−\出
力する。なお、第3図における駆動信号YIは、3ビツ
トデータが「010」で、輝度変調パルスPY、が選択
された場合の波形を示したものである。
0がハイレベルの時は選択電圧Ys、ローレベルでは選
択電圧YNsを選択し、第3図に示す様に駆動信号YI
(Y+〜Y8.)として液晶マトリクスパネル5−\出
力する。なお、第3図における駆動信号YIは、3ビツ
トデータが「010」で、輝度変調パルスPY、が選択
された場合の波形を示したものである。
然しなから、上述の如き構成にあっては、8種類の輝度
変調パルスPY、〜PY、をマルチプレクサ13に入力
したけ幻ばならないので、信号線が多くなると共に、マ
ルチプレクサ13を構成するゲートの数が多くなってし
まう。また、A/D変換回路において振幅値をコード化
して出力するためのデコーダも必要となり、こわらがL
SIのチツプザイズ粧の小型化、消費電力の低減を妨げ
てい□た。
変調パルスPY、〜PY、をマルチプレクサ13に入力
したけ幻ばならないので、信号線が多くなると共に、マ
ルチプレクサ13を構成するゲートの数が多くなってし
まう。また、A/D変換回路において振幅値をコード化
して出力するためのデコーダも必要となり、こわらがL
SIのチツプザイズ粧の小型化、消費電力の低減を妨げ
てい□た。
この発明は、上記事情に基づいてなされたもので、その
目的とするところは、ドツトマトリクス液晶パネルの駆
動回路の小型化、消費電力の低減化を実現することKあ
る。
目的とするところは、ドツトマトリクス液晶パネルの駆
動回路の小型化、消費電力の低減化を実現することKあ
る。
この発明は、A/D変換回路により複数ビット単位のデ
ジタル信号化されたテレビ映像信号を、シフトレジスタ
に一時記憶させた後パラレル/シリアル変換回路によっ
て階調信号を作成し、この階調信号に基づいて液晶マト
リクスパネルの信号電極駆動信号を得るものである。
ジタル信号化されたテレビ映像信号を、シフトレジスタ
に一時記憶させた後パラレル/シリアル変換回路によっ
て階調信号を作成し、この階調信号に基づいて液晶マト
リクスパネルの信号電極駆動信号を得るものである。
以下、本発明の一実施例を示す。第4図は液晶マトリク
スパネルの信号電極駆動回路を示したものであり、制御
回路および走査電極MJA動回路については従来例と同
様であるので、その説明を省略する。
スパネルの信号電極駆動回路を示したものであり、制御
回路および走査電極MJA動回路については従来例と同
様であるので、その説明を省略する。
図示しない映像信号増幅回路からの映稼信号は比較並列
型のA/1)変換回路21によって、7ビツトの並列デ
ータに変換され、7ビツトX rnステージのシフトレ
ジスタ22KIk次送らねる。このシフトレジスタに一
時記憶された7ビツトデータは、ロードパルスφLによ
ってパラレル/シリアル変換回路23に送られて1ビツ
トのシリアルデータに変換され、この1ビツトのシリア
ルデータは階調信号としてφ、のタイミングで2チヤン
ネル・アナログ・マルチプレクサ24に入力される。こ
のマルチプレサ24は前述と同様の動作により駆動信号
Yr(Y、−Y□。)を液晶マ) +7クスパネル(図
示せず)・\出力する。
型のA/1)変換回路21によって、7ビツトの並列デ
ータに変換され、7ビツトX rnステージのシフトレ
ジスタ22KIk次送らねる。このシフトレジスタに一
時記憶された7ビツトデータは、ロードパルスφLによ
ってパラレル/シリアル変換回路23に送られて1ビツ
トのシリアルデータに変換され、この1ビツトのシリア
ルデータは階調信号としてφ、のタイミングで2チヤン
ネル・アナログ・マルチプレクサ24に入力される。こ
のマルチプレサ24は前述と同様の動作により駆動信号
Yr(Y、−Y□。)を液晶マ) +7クスパネル(図
示せず)・\出力する。
第5図に、第4図の回路の詳細を示す。映像信号はサン
プル・ホールド回路211に入力され、そノホールト出
力は、7個のコンパレータC0〜C6によって、基準電
圧Vrefを8分割した各レベルの電圧と比較される、
このコンパレータC,〜C,ハ、映像信号の像幅が大き
くなるに従って上方から順にハイレベルを出力し、映像
信号の振幅が最大時には、全テのコンパレータがハイレ
ベルを出力する。
プル・ホールド回路211に入力され、そノホールト出
力は、7個のコンパレータC0〜C6によって、基準電
圧Vrefを8分割した各レベルの電圧と比較される、
このコンパレータC,〜C,ハ、映像信号の像幅が大き
くなるに従って上方から順にハイレベルを出力し、映像
信号の振幅が最大時には、全テのコンパレータがハイレ
ベルを出力する。
コンパレータC9〜C6の出力は、7ビツトのデジタル
信号となって7リツプ70ツブFF、〜FF□。で構成
される7ビツトxmステージ・シフトレジスタ22に送
られ、クロックφによって4Hの期間にm回シフトさね
て蓄えられる。
信号となって7リツプ70ツブFF、〜FF□。で構成
される7ビツトxmステージ・シフトレジスタ22に送
られ、クロックφによって4Hの期間にm回シフトさね
て蓄えられる。
各7リツプフロツブF F 、〜FF□。の出力は、4
Hの初め忙出力されるロードパルスφLによって7段の
シフトレジスタSIt、〜8FL、、。からなるパラレ
ル/シリアル変換回路23にロードされ、4Hの期間に
2回、同一波形が出力される。
Hの初め忙出力されるロードパルスφLによって7段の
シフトレジスタSIt、〜8FL、、。からなるパラレ
ル/シリアル変換回路23にロードされ、4Hの期間に
2回、同一波形が出力される。
第6図にタイムチャートを示す。Srの波形はフリップ
フロップFF、−FF、、。のデータによって8通り忙
変化し、(a)の波形はフリップフロップ221のデー
タが全て00”の場合、また(blの波形は全て11”
の場合を示している。
フロップFF、−FF、、。のデータによって8通り忙
変化し、(a)の波形はフリップフロップ221のデー
タが全て00”の場合、また(blの波形は全て11”
の場合を示している。
いま、映像信号の1個目のサンプル・ホールド値の撫幅
値■か、se Vraf < ■<晶V refである
場合を考える。この場合、コンパレータC,,−(、’
、の出力がハイレベルとなり、コンバレ〜りC8〜C0
の出力がローレベルとなる。従ってフリップフロップF
F、の出力り、〜D、は、Do =D+ = 1、Dv
=D、 =Dm=D、 =D、= oとなり、この7
ビツトのシリアルデータは、シフトレジスタ8FL、に
セットさねて、1ビツトの連続した階調信号S1として
マルチプレクサ24+C出力される。この時の出力波形
は、第6図において(C)の如く示される。
値■か、se Vraf < ■<晶V refである
場合を考える。この場合、コンパレータC,,−(、’
、の出力がハイレベルとなり、コンバレ〜りC8〜C0
の出力がローレベルとなる。従ってフリップフロップF
F、の出力り、〜D、は、Do =D+ = 1、Dv
=D、 =Dm=D、 =D、= oとなり、この7
ビツトのシリアルデータは、シフトレジスタ8FL、に
セットさねて、1ビツトの連続した階調信号S1として
マルチプレクサ24+C出力される。この時の出力波形
は、第6図において(C)の如く示される。
と4を受けたマルチプレクサ24は、S、がハイレベル
の時に選択′電圧Y8を、Slがローレベルの時に選択
電圧YNSを選択して、図示したYlの如き信号電圧を
得て、液晶マトリクパネルへ送出する。
の時に選択′電圧Y8を、Slがローレベルの時に選択
電圧YNSを選択して、図示したYlの如き信号電圧を
得て、液晶マトリクパネルへ送出する。
コノ発明は、D/A変換器のコンパレータニヨってデジ
タル化された映像信号を、複数段のシフトレジタに直接
取り込んで一時記憶させた後、パラレル/シリアル変換
回路により階調信号を作成し、この階調信号に基づいて
液晶マトリクスパネルの信号電極駆動信号を得る様にし
たので、A/D変換器のデコーダ、輝度褒詞パルス発生
回路、8チヤンネルマルチプレクサといった複雑な回路
が不要となり、代わりにパラレル/シリアル変換回路と
いう簡単な回路に置きかえらね、LSIチップの小型化
、消費電力の低減化に多大な効果を奏するものである。
タル化された映像信号を、複数段のシフトレジタに直接
取り込んで一時記憶させた後、パラレル/シリアル変換
回路により階調信号を作成し、この階調信号に基づいて
液晶マトリクスパネルの信号電極駆動信号を得る様にし
たので、A/D変換器のデコーダ、輝度褒詞パルス発生
回路、8チヤンネルマルチプレクサといった複雑な回路
が不要となり、代わりにパラレル/シリアル変換回路と
いう簡単な回路に置きかえらね、LSIチップの小型化
、消費電力の低減化に多大な効果を奏するものである。
第1図は液晶テレビ受像機における液晶マトリクスパネ
ル駆動系の概略構成を示す図、第2図は従来の信号電極
駆動回路を示すブロック図、第3図は第2図の動作を示
すタイミングチャート、第4図乃至第6図は本発明の一
実施例を示し、第4図は信号電極駆動回路を示すブロッ
ク図、第5図は第4図の回路の詳細図、第6図は第5図
σ)lih作を示すタイミングチャートである。 1・・・制御回路、2.21・・・A/l)変換回路、
3・・・走査電極駆動回路、4・・・信号電極駆動回路
、5・・・液晶マトリクスパネル、21.22・・シフ
トレジスタ、Co−C,・・・コンパレータ、FF、〜
FF、、。・・・フリップフロップ、23・・・パラレ
ル/シリアル変換回路、81(、、〜SR,・・・シフ
トレジスタ、15.24・・・2チヤンネル・アナログ
・マルチプレクサ。 出願人 カシオ計算機株式会社
ル駆動系の概略構成を示す図、第2図は従来の信号電極
駆動回路を示すブロック図、第3図は第2図の動作を示
すタイミングチャート、第4図乃至第6図は本発明の一
実施例を示し、第4図は信号電極駆動回路を示すブロッ
ク図、第5図は第4図の回路の詳細図、第6図は第5図
σ)lih作を示すタイミングチャートである。 1・・・制御回路、2.21・・・A/l)変換回路、
3・・・走査電極駆動回路、4・・・信号電極駆動回路
、5・・・液晶マトリクスパネル、21.22・・シフ
トレジスタ、Co−C,・・・コンパレータ、FF、〜
FF、、。・・・フリップフロップ、23・・・パラレ
ル/シリアル変換回路、81(、、〜SR,・・・シフ
トレジスタ、15.24・・・2チヤンネル・アナログ
・マルチプレクサ。 出願人 カシオ計算機株式会社
Claims (1)
- テレビ映像信号をデジタル信号に変換するA/D変換回
路と、このA/D変換回路から出力される複数ビット単
位のデジタル信号を一時記憶するシフトレジスタと、こ
のシフトレジスタ忙記憶された上記複数ピット単位のデ
ジタル信号を1ビツトの連続した階調信号に変換するパ
ラレル/シリアル変換回路と、このパラレル/シリアル
変換回路から出力される階調11号および一定周期毎に
′1”と0″が反転するパルスを組合わせて複数レベル
の゛1圧を順次選択して液晶マトリクスパネルの信号電
極駆動信号を得るマルキプレクサとを具備したことを特
徴とするドツトマトリクス液晶表示パネルの駆動回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP110384A JPS60145778A (ja) | 1984-01-07 | 1984-01-07 | ドツトマトリクス液晶表示パネルの駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP110384A JPS60145778A (ja) | 1984-01-07 | 1984-01-07 | ドツトマトリクス液晶表示パネルの駆動回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60145778A true JPS60145778A (ja) | 1985-08-01 |
Family
ID=11492143
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP110384A Pending JPS60145778A (ja) | 1984-01-07 | 1984-01-07 | ドツトマトリクス液晶表示パネルの駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60145778A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63163076U (ja) * | 1987-04-13 | 1988-10-25 | ||
US6208237B1 (en) | 1996-11-29 | 2001-03-27 | Matsushita Electric Industrial Co. Ltd. | Electro-mechanical and acoustic transducer for portable terminal unit |
KR100835145B1 (ko) | 2007-02-14 | 2008-06-04 | 주식회사 티엘아이 | 다수의 서브 픽셀을 구동하는 액정표시장치용 소스드라이버 구동회로 |
-
1984
- 1984-01-07 JP JP110384A patent/JPS60145778A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63163076U (ja) * | 1987-04-13 | 1988-10-25 | ||
US6208237B1 (en) | 1996-11-29 | 2001-03-27 | Matsushita Electric Industrial Co. Ltd. | Electro-mechanical and acoustic transducer for portable terminal unit |
KR100835145B1 (ko) | 2007-02-14 | 2008-06-04 | 주식회사 티엘아이 | 다수의 서브 픽셀을 구동하는 액정표시장치용 소스드라이버 구동회로 |
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