JPS5939044A - 絶縁分離集積回路用基板の製造方法 - Google Patents
絶縁分離集積回路用基板の製造方法Info
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- JPS5939044A JPS5939044A JP14830682A JP14830682A JPS5939044A JP S5939044 A JPS5939044 A JP S5939044A JP 14830682 A JP14830682 A JP 14830682A JP 14830682 A JP14830682 A JP 14830682A JP S5939044 A JPS5939044 A JP S5939044A
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- H01L21/76264—SOI together with lateral isolation, e.g. using local oxidation of silicon, or dielectric or polycristalline material refilled trench or air gap isolation regions, e.g. completely isolated semiconductor islands
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、絶縁分離による集積回路用基板の製造方法に
係るもので、特に、空気によって絶縁分離領域が形成さ
れる集積回路用基板の製造方法に関するものである。
係るもので、特に、空気によって絶縁分離領域が形成さ
れる集積回路用基板の製造方法に関するものである。
半導体集積回路における素子の分離の方法には種々ある
が、最も一般的に用いられているものはPIJ接合分離
である。しかし、近時、誘電体絶縁分離が、耐圧、容量
、スピード、リークなどの特性の面においてPN接合よ
りも優れているので、その利用が考えられている。しか
し、この誘電体絶縁分離においては、工数が多くなるこ
と、歩留下 が低化すること、などが実用化の上で大きな問題となっ
ている。
が、最も一般的に用いられているものはPIJ接合分離
である。しかし、近時、誘電体絶縁分離が、耐圧、容量
、スピード、リークなどの特性の面においてPN接合よ
りも優れているので、その利用が考えられている。しか
し、この誘電体絶縁分離においては、工数が多くなるこ
と、歩留下 が低化すること、などが実用化の上で大きな問題となっ
ている。
最も多く利用されている誘電体絶縁分離の方法は、単結
晶シリコン基板に異方性のエツチングによって溝番形成
し、その上に酸化膜を形成した後に多結晶シリコンを1
200℃近い温度で約400μ−m堆積させるものであ
る。このときの熱によってウェハが反ったり、損傷した
りする問題があり、またその′ために、シリコン基板を
研磨したときに単結晶シリコンの島が設計通りにできず
、削り過ぎとなった・す、完全に分離されなかったりし
7てしまうことが多い。
晶シリコン基板に異方性のエツチングによって溝番形成
し、その上に酸化膜を形成した後に多結晶シリコンを1
200℃近い温度で約400μ−m堆積させるものであ
る。このときの熱によってウェハが反ったり、損傷した
りする問題があり、またその′ために、シリコン基板を
研磨したときに単結晶シリコンの島が設計通りにできず
、削り過ぎとなった・す、完全に分離されなかったりし
7てしまうことが多い。
上り己のような誘電体絶縁分離技術における問題を解決
する方法についても種々考えられている。
する方法についても種々考えられている。
その一つに、溝を形成せずに、単結晶シリコンを部分的
に絶縁物に変換して絶縁分離領域を形成する方法がある
。
に絶縁物に変換して絶縁分離領域を形成する方法がある
。
上記の絶縁分離領域の形成方法の改良について、本発明
者はすでに特願昭57−67474において、陽極化成
を利用して単結晶シリコンの島の側面を囲む誘電体絶縁
分離領域を形成し、底面の絶絞層と接続することによっ
て単結晶シリコンの島を分前する方法を提案している。
者はすでに特願昭57−67474において、陽極化成
を利用して単結晶シリコンの島の側面を囲む誘電体絶縁
分離領域を形成し、底面の絶絞層と接続することによっ
て単結晶シリコンの島を分前する方法を提案している。
本発明は、この単結晶シリコンを部分的に酸化する絶縁
分1911集積回路用基板の製造方法の改良に係るもの
で、絶縁分離領域の誘電率を下けることによって、浮遊
容量の小さな集積回路用基板を得ることを目的とする。
分1911集積回路用基板の製造方法の改良に係るもの
で、絶縁分離領域の誘電率を下けることによって、浮遊
容量の小さな集積回路用基板を得ることを目的とする。
本発明による絶縁分離集積回路用基板の製造方法は、単
結晶シリコンの島と他の島との間の領域を酸化するだけ
でなく、フッ化水素に溶かして除去することによって空
気による分離領域を形成することによって上記の目的を
達成するものである。
結晶シリコンの島と他の島との間の領域を酸化するだけ
でなく、フッ化水素に溶かして除去することによって空
気による分離領域を形成することによって上記の目的を
達成するものである。
以下、図面に従って、本発明の実施例につき説明する。
第1図は、本発明の実施例を示す正面断面図である。
単結晶シリコン基板100表面にシリコン窒化膜(Si
3 N4 )Llを200〜2000λの厚みで形成す
る(A)。
3 N4 )Llを200〜2000λの厚みで形成す
る(A)。
このシリコン窒化膜110表面に多結晶シリコン12を
成長させる(B)。多結晶シリコン12の厚みは、単結
晶シリコン基板10を支持するのに十分々厚みとなるよ
うにするが、通常1200’C程度の温度テsio+、
を分゛解して400〜60011mの厚みに形成する。
成長させる(B)。多結晶シリコン12の厚みは、単結
晶シリコン基板10を支持するのに十分々厚みとなるよ
うにするが、通常1200’C程度の温度テsio+、
を分゛解して400〜60011mの厚みに形成する。
また、多結晶シリコン12の表面は凹凸が形成されるの
で、表面が平坦となるように粗削りを行なって、厚みが
400μm程度となるようにする。
で、表面が平坦となるように粗削りを行なって、厚みが
400μm程度となるようにする。
次に、平坦と々つた多結晶シリコン12を基準面として
単結晶シリコン1oの表面を研磨する(0)。
単結晶シリコン1oの表面を研磨する(0)。
単結晶シリコン10の厚みは素子を形成するのに十分な
厚みとするが、できるだけ薄くしておいた方が後の工程
で有利となる。通常、1oIim程度となる。
厚みとするが、できるだけ薄くしておいた方が後の工程
で有利となる。通常、1oIim程度となる。
単結晶シリコン10が所定の厚みでまで研磨された後に
単結晶シリコン10の表面にシリコン窒化膜13を形成
する(D)。シリコン窒化膜13は、絶縁分離領域とな
る部分の単結晶シリコンの表面が露出するように窓′7
5フ形成される。したがって、通常はシリコン窒化膜1
3の窓が格子状に形成される仁とになる。
単結晶シリコン10の表面にシリコン窒化膜13を形成
する(D)。シリコン窒化膜13は、絶縁分離領域とな
る部分の単結晶シリコンの表面が露出するように窓′7
5フ形成される。したがって、通常はシリコン窒化膜1
3の窓が格子状に形成される仁とになる。
なお、ここで、単結晶シリコン10がN型の導電性を有
する場合には、絶縁分離領域となる部分にホウ素などの
P型の不純物を拡散または注入しておく。すなわち、シ
リコン窒化膜13の窓から単結晶シリコン10内に下の
シリコン窒化膜に達するP型頭域14を形成しておくも
のであ鼠。単結晶シリコンがP型であれはこの工程は不
要である。
する場合には、絶縁分離領域となる部分にホウ素などの
P型の不純物を拡散または注入しておく。すなわち、シ
リコン窒化膜13の窓から単結晶シリコン10内に下の
シリコン窒化膜に達するP型頭域14を形成しておくも
のであ鼠。単結晶シリコンがP型であれはこの工程は不
要である。
単結晶シリコン10をフッ化水素(HF )中で陽極化
成すると、シリコン窒化膜13の窓とその下のP型の領
域14は多孔質シリコンとなる(E)。
成すると、シリコン窒化膜13の窓とその下のP型の領
域14は多孔質シリコンとなる(E)。
多孔質シリコンは酸化され易い性質があり、酸素雰囲気
中で酸化シリコン15に変化する(力。
中で酸化シリコン15に変化する(力。
このようにして形成されたシリコン酸化物15を再びフ
ッ化水素溶液に浸して溶かす(G)。単結晶シリコン1
0はシリコン窒化膜によって保護されているので、シリ
コン酸化物のみがフッ化水素によって溶けることになる
。なお、下側のシリコン窒化膜11FCよって、多結晶
シリコン12がフッ化水素で侵されることは防止するこ
とができる。
ッ化水素溶液に浸して溶かす(G)。単結晶シリコン1
0はシリコン窒化膜によって保護されているので、シリ
コン酸化物のみがフッ化水素によって溶けることになる
。なお、下側のシリコン窒化膜11FCよって、多結晶
シリコン12がフッ化水素で侵されることは防止するこ
とができる。
最後に、表面のシリコン窒化膜を除去すれば、空気でそ
れぞれの間が分離された単結晶シリコンの島10が形成
される。また、底面はシリコン窒化膜11で絶縁分離さ
゛れることになる。
れぞれの間が分離された単結晶シリコンの島10が形成
される。また、底面はシリコン窒化膜11で絶縁分離さ
゛れることになる。
なお、基体との絶縁分離をより完全にするために、多結
晶シリコン層の形成方法に変化をっけても良い。例えば
、第2図に示したように、シリコン窒化膜21とシリコ
ン酸化膜22の二層とした上に多結晶シリコンを成長さ
せるとか、第3図のようにシリコン窒化膜31、多結晶
シリコン32、シリコン酸化膜66、多結晶シリコン3
4、シリコン酸化膜35、多結晶シリコン36と多層に
形成するとかいったものである。このように多層とすれ
ば、底面の容量が直列に接続された形となるので、寄生
容量を大幅に減少させることができる。
晶シリコン層の形成方法に変化をっけても良い。例えば
、第2図に示したように、シリコン窒化膜21とシリコ
ン酸化膜22の二層とした上に多結晶シリコンを成長さ
せるとか、第3図のようにシリコン窒化膜31、多結晶
シリコン32、シリコン酸化膜66、多結晶シリコン3
4、シリコン酸化膜35、多結晶シリコン36と多層に
形成するとかいったものである。このように多層とすれ
ば、底面の容量が直列に接続された形となるので、寄生
容量を大幅に減少させることができる。
脣た、第4図のようにシリコン窒化膜41の上に導電性
多結晶シリコン層42を形成するとシールド効果を得る
こともできる。
多結晶シリコン層42を形成するとシールド効果を得る
こともできる。
本発明によれば、単結晶シリコンの島に形成される素子
と他の島に形成される素子との分離をはソ完全に行なう
ことができる。各々の島が空気で分離されているので、
素子間の寄生容量を非常に小さくすることができるから
である。シリコンの誘電率12、二酸化シリコンの誘電
率計4に対して空気の誘電率は1であるから、寄生容量
はPN接合分離の1/12、誘電体分離の約1/4とい
うことになる。
と他の島に形成される素子との分離をはソ完全に行なう
ことができる。各々の島が空気で分離されているので、
素子間の寄生容量を非常に小さくすることができるから
である。シリコンの誘電率12、二酸化シリコンの誘電
率計4に対して空気の誘電率は1であるから、寄生容量
はPN接合分離の1/12、誘電体分離の約1/4とい
うことになる。
しかも、単結晶シリコンの陽極化成、酸化、除去の工程
も研磨した後に行なうので比較的短時間でできるし、ま
た、確実に行なうことができる利点もある。
も研磨した後に行なうので比較的短時間でできるし、ま
た、確実に行なうことができる利点もある。
第1図は本発明の実施例を示す正面断面図、第2図〜第
4図はそれぞれ本発明の他の実施例を示す正面断面図で
ある。 11.13・・・・・・−・シリコン窒化膜。 12・・・・・・・・・多結晶シリコン。 14・・・・・・・・・P型領域。 15・・・・・・・・・シリコン酸化物特許出酊1人 東光株式会社
4図はそれぞれ本発明の他の実施例を示す正面断面図で
ある。 11.13・・・・・・−・シリコン窒化膜。 12・・・・・・・・・多結晶シリコン。 14・・・・・・・・・P型領域。 15・・・・・・・・・シリコン酸化物特許出酊1人 東光株式会社
Claims (1)
- 単結晶シリコン基板の一表面にシリコン窒化膜を形成し
、該シリコン窒化膜上に多結晶シリコン層をj[≦成し
、該単結晶シリコン基板を裏面から研磨して所定の厚さ
とし、該研磨された単結晶シリコン基板の表面の一部を
シリコン窒化膜で覆い、該シリコン窒化膜をマスクとし
てフッ化水素中で該単結晶シリコンを陽極化成して該シ
リコン窒化膜に覆われない部分とその下の領域を多孔質
化し、該多孔質化した単結晶シリコンを酸化してシリコ
ン酸化物とし、該シリコン酸化物をフッ化水素で溶かし
て除去することによって、シリコン窒化膜上に分離され
た複数の単結晶シリコンの島を形成することを性徴とす
る絶縁分離集積回路用基板の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14830682A JPS5939044A (ja) | 1982-08-26 | 1982-08-26 | 絶縁分離集積回路用基板の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP14830682A JPS5939044A (ja) | 1982-08-26 | 1982-08-26 | 絶縁分離集積回路用基板の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5939044A true JPS5939044A (ja) | 1984-03-03 |
Family
ID=15449832
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP14830682A Pending JPS5939044A (ja) | 1982-08-26 | 1982-08-26 | 絶縁分離集積回路用基板の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5939044A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS63250853A (ja) * | 1987-03-30 | 1988-10-18 | インターナシヨナル・ビジネス・マシーンズ・コーポレーシヨン | 材料層の平坦化方法 |
US5421958A (en) * | 1993-06-07 | 1995-06-06 | The United States Of America As Represented By The Administrator Of The United States National Aeronautics And Space Administration | Selective formation of porous silicon |
US6379870B1 (en) * | 2000-07-12 | 2002-04-30 | Honeywell International Inc. | Method for determining side wall oxidation of low-k materials |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5066185A (ja) * | 1973-10-12 | 1975-06-04 | ||
JPS5419367A (en) * | 1977-07-13 | 1979-02-14 | Matsushita Electric Ind Co Ltd | Production of semiconductor device |
-
1982
- 1982-08-26 JP JP14830682A patent/JPS5939044A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5066185A (ja) * | 1973-10-12 | 1975-06-04 | ||
JPS5419367A (en) * | 1977-07-13 | 1979-02-14 | Matsushita Electric Ind Co Ltd | Production of semiconductor device |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US5421958A (en) * | 1993-06-07 | 1995-06-06 | The United States Of America As Represented By The Administrator Of The United States National Aeronautics And Space Administration | Selective formation of porous silicon |
US6379870B1 (en) * | 2000-07-12 | 2002-04-30 | Honeywell International Inc. | Method for determining side wall oxidation of low-k materials |
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