JPH02126650A - 誘電体分離半導体装置の製造方法 - Google Patents
誘電体分離半導体装置の製造方法Info
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- JPH02126650A JPH02126650A JP27930388A JP27930388A JPH02126650A JP H02126650 A JPH02126650 A JP H02126650A JP 27930388 A JP27930388 A JP 27930388A JP 27930388 A JP27930388 A JP 27930388A JP H02126650 A JPH02126650 A JP H02126650A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野)
本発明は、2枚の基板を接着して得られる誘電体分離半
導体基板を用いて半導体装置を製造する方法に関する。
導体基板を用いて半導体装置を製造する方法に関する。
(従来の技術)
従来よシ、半導体装置の素子分離法として、pn接合分
離や誘電体分離が知られている。誘電体分離法は、pn
接合分離法に比べて以下のような優れた特徴を有する。
離や誘電体分離が知られている。誘電体分離法は、pn
接合分離法に比べて以下のような優れた特徴を有する。
■高温動作時においても漏れ電流が少ない。
■寄生サイリスタによるラッチアップがない。
■高耐圧素子を分離する場合にも分離に要する面積が少
ない。
ない。
■電圧印加の極性を考慮する必要がない。
■寄生容量が少ない。
誘電体分離構造を実現するためにはいくつかの方法が知
られている。例えば、シリコン基板を間に絶縁膜を挟ん
で直接接着する方法、SO8と呼ばれるサファイア基板
上にシリコンを気相成長させる方法、絶縁膜上に非晶質
シリコン膜を堆積してこれを再結晶化させる方法、シリ
コン基板の一部をエツチングし酸化膜を形成した後多結
晶シリコン膜を堆積し裏面から研磨して多結晶シリコン
膜で保持された島状シリコン層を得る方法、等である。
られている。例えば、シリコン基板を間に絶縁膜を挟ん
で直接接着する方法、SO8と呼ばれるサファイア基板
上にシリコンを気相成長させる方法、絶縁膜上に非晶質
シリコン膜を堆積してこれを再結晶化させる方法、シリ
コン基板の一部をエツチングし酸化膜を形成した後多結
晶シリコン膜を堆積し裏面から研磨して多結晶シリコン
膜で保持された島状シリコン層を得る方法、等である。
これらの中で、直接接着技術は、簡便に良質の誘電体分
離半導体基板を得ることができるものとして最近注目さ
れている。
離半導体基板を得ることができるものとして最近注目さ
れている。
第2図は、従来の直接接着技術による誘電体分離基板の
製造工程を示す。(a)に示すように、接着すべき面を
鏡面研磨した2枚のシリコン・ウェハ1.2を用意する
。一方のウェハ1には、図示のように表面に酸化膜3,
4を形成する。このような2枚のウェハ1,2を直接接
着して(b)に示すよように一体化する。続いて素子形
成を行なう活性層側、この例ではウェハ1側を研磨して
、(C)に示すように所定厚みに設定する。
製造工程を示す。(a)に示すように、接着すべき面を
鏡面研磨した2枚のシリコン・ウェハ1.2を用意する
。一方のウェハ1には、図示のように表面に酸化膜3,
4を形成する。このような2枚のウェハ1,2を直接接
着して(b)に示すよように一体化する。続いて素子形
成を行なう活性層側、この例ではウェハ1側を研磨して
、(C)に示すように所定厚みに設定する。
次にこのウェハ全面にマスク用酸化膜5を形成し、活性
層側のウェハ1に形成する7字溝部分の酸化膜を選択エ
ツチングする(d)。
層側のウェハ1に形成する7字溝部分の酸化膜を選択エ
ツチングする(d)。
次に活性層側のウェハ1を異方性エツチングにより選択
エツチングして、(e)に示すように酸化膜4に達する
深さの断面V字状の分離溝6を形成する。これによシ、
各素子形成領域が島状に分離される。その後更に各島状
のシリコン層を電気的に分離するため、マスク用酸化膜
5をエツチングによシ除去(f)シてから、(g)に示
すように酸化膜7を形成する。そして、各分離溝6に多
結晶シリコン8を埋め込み必要に応じて表面の平坦化処
理を行なって、(h)に示すような誘電体分離基板を得
る。
エツチングして、(e)に示すように酸化膜4に達する
深さの断面V字状の分離溝6を形成する。これによシ、
各素子形成領域が島状に分離される。その後更に各島状
のシリコン層を電気的に分離するため、マスク用酸化膜
5をエツチングによシ除去(f)シてから、(g)に示
すように酸化膜7を形成する。そして、各分離溝6に多
結晶シリコン8を埋め込み必要に応じて表面の平坦化処
理を行なって、(h)に示すような誘電体分離基板を得
る。
第3図は、この様な誘電体分離基板の一つの活性層にp
npトランジスタを形成した状態を示している。活性層
がp型である場合、ここにn型ベース層9、p型エミッ
タ層10を順次拡散形成してpnp トランジスタが得
られる。島状の活性層の酸化膜4,6との界面にはpW
層8t、8zが形成されている。これらはコレクタ電流
を良好にコレクタ電極に集めるためのもので、底部のp
型層81は接着前に予め第1の基板1に形成しておき、
溝部のp型層82は溝形成後に拡散形成される。
npトランジスタを形成した状態を示している。活性層
がp型である場合、ここにn型ベース層9、p型エミッ
タ層10を順次拡散形成してpnp トランジスタが得
られる。島状の活性層の酸化膜4,6との界面にはpW
層8t、8zが形成されている。これらはコレクタ電流
を良好にコレクタ電極に集めるためのもので、底部のp
型層81は接着前に予め第1の基板1に形成しておき、
溝部のp型層82は溝形成後に拡散形成される。
ところでこの様な誘電体分離基板を用いた半導体装置に
おいて、従来の方法では素子分離特性に次のような問題
があった。
おいて、従来の方法では素子分離特性に次のような問題
があった。
第4図を用いて説明する。第4図は、第2図の工程にお
ける一体化して活性層の厚みを調整した後の7字溝を形
成する工程を具体的に示したものである。第4図(a)
は、熱酸化膜11を活性層上に形成してこれをマスクと
して活性層を異方性エツチングによりエツチングし、7
字溝5を形成した状態である。この後(b)に示すよう
に、酸化i11を拡散マスクとして用いて溝側面に不純
物を拡散し、p+型層88を形成する。その後マスクと
して用いた酸化膜11はエツチング除去し、改めて熱酸
化によυ活性層表面および素子分離溝に良質の酸化膜を
形成する。このとき酸化膜エツチングには通常弗酸系の
エツチング液が用いられるが、7字溝5の底に露出して
いる酸化膜4も同時にエツチングされ、(C)に示すよ
うにサイドエツチングによる切込み12が生じる。この
後、7字溝5の側面に素子分離用の酸化膜6を形成する
と、(d)のような状態となる。この様に7字溝の底に
切込み12が生じた状態では、この部分の酸化膜厚が薄
くなり、分離耐圧が不十分になる。また切込み部12に
は、後の多結晶シリコン膜埋込み工程で完全に多結晶シ
リコン膜の埋込みができず、空洞ができた状態となシ、
これは素子の信頼性低下の原因となる。
ける一体化して活性層の厚みを調整した後の7字溝を形
成する工程を具体的に示したものである。第4図(a)
は、熱酸化膜11を活性層上に形成してこれをマスクと
して活性層を異方性エツチングによりエツチングし、7
字溝5を形成した状態である。この後(b)に示すよう
に、酸化i11を拡散マスクとして用いて溝側面に不純
物を拡散し、p+型層88を形成する。その後マスクと
して用いた酸化膜11はエツチング除去し、改めて熱酸
化によυ活性層表面および素子分離溝に良質の酸化膜を
形成する。このとき酸化膜エツチングには通常弗酸系の
エツチング液が用いられるが、7字溝5の底に露出して
いる酸化膜4も同時にエツチングされ、(C)に示すよ
うにサイドエツチングによる切込み12が生じる。この
後、7字溝5の側面に素子分離用の酸化膜6を形成する
と、(d)のような状態となる。この様に7字溝の底に
切込み12が生じた状態では、この部分の酸化膜厚が薄
くなり、分離耐圧が不十分になる。また切込み部12に
は、後の多結晶シリコン膜埋込み工程で完全に多結晶シ
リコン膜の埋込みができず、空洞ができた状態となシ、
これは素子の信頼性低下の原因となる。
(発明が解決しようとする課題)
以上のように接着技術によシ得られる誘電体分離基板を
用いた従来の半導体装置製造工程では、7字溝による横
方向の素子分離工程において、耐圧および信頼性の点で
問題があった。
用いた従来の半導体装置製造工程では、7字溝による横
方向の素子分離工程において、耐圧および信頼性の点で
問題があった。
本発明は、この様な問題を解決した誘電体分離半導体装
置の製造方法を提供することを目的とする。
置の製造方法を提供することを目的とする。
(課題を解決するだめの手段)
本発明の方法は、素子分離誘電体膜となる第1の絶縁膜
(酸化膜)を挟んで第1の半導体基板と第2の半導体基
板を接着して一体化した半導体基板にエツチング働マス
ク用の第2の膜を形成し、この膜を利用して素子分離用
の溝をエツチングで形成し)その後第2の膜を除去して
島状に分離された各活性層に所望の素子を形成するに際
して1溝エツチングのマスクに使う第2の票に窒化ケイ
素膜を使うことを特徴とする。
(酸化膜)を挟んで第1の半導体基板と第2の半導体基
板を接着して一体化した半導体基板にエツチング働マス
ク用の第2の膜を形成し、この膜を利用して素子分離用
の溝をエツチングで形成し)その後第2の膜を除去して
島状に分離された各活性層に所望の素子を形成するに際
して1溝エツチングのマスクに使う第2の票に窒化ケイ
素膜を使うことを特徴とする。
(作用)
本発明によれば、素子分離溝のエツチング・マスクとし
て窒化ケイ素膜を使用する。溝のエツチング後マスクを
除去するエツチングをする際に、窒化ケイ素膜なのでV
溝底部の酸化膜をエツチングしないエッチャントを使用
することができる。
て窒化ケイ素膜を使用する。溝のエツチング後マスクを
除去するエツチングをする際に、窒化ケイ素膜なのでV
溝底部の酸化膜をエツチングしないエッチャントを使用
することができる。
例えばリン酸がある。これによシ、■溝底部の酸化膜の
サイドエッチが防止され、この溝に多結晶シリコンを埋
め込んだ時に空洞が残ることもなく分離耐圧が十分で信
頼性の高い誘電体分離半導体装置を得ることができる。
サイドエッチが防止され、この溝に多結晶シリコンを埋
め込んだ時に空洞が残ることもなく分離耐圧が十分で信
頼性の高い誘電体分離半導体装置を得ることができる。
(実施例)
以下、本発明の詳細な説明する。
p型、比抵抗100Ω・傷、面方位(100)、厚み5
00μmのシリコン・ウェハを用いて、直接接着によシ
誘電体分離基板を作製した。接着に先立ち、一方のウェ
ハにはボロンイオン注入とアニールを行ない、熱酸化で
厚さ1μmの酸化膜を形成した。
00μmのシリコン・ウェハを用いて、直接接着によシ
誘電体分離基板を作製した。接着に先立ち、一方のウェ
ハにはボロンイオン注入とアニールを行ない、熱酸化で
厚さ1μmの酸化膜を形成した。
直接接着の具体的な工程は次の通シである。まず接着す
るウェハをH,S O,−H2O,混合液、HCl−H
20!混合液、王水等で洗浄した後、lO分程度水洗し
、スピンナーで脱水乾燥する。これらの処理を経たウェ
ハを、例えばクラス100以下の清浄な雰囲気中に設置
して実質的に異物が介在しない状態でその鏡面研磨面同
志を密着させる。これにより、2枚のウェハはある程度
の強度をもって接着する。
るウェハをH,S O,−H2O,混合液、HCl−H
20!混合液、王水等で洗浄した後、lO分程度水洗し
、スピンナーで脱水乾燥する。これらの処理を経たウェ
ハを、例えばクラス100以下の清浄な雰囲気中に設置
して実質的に異物が介在しない状態でその鏡面研磨面同
志を密着させる。これにより、2枚のウェハはある程度
の強度をもって接着する。
こうして接着した基板を拡散炉等で熱処理することによ
シ、接着強度が上がり、2枚のウェハは完全に一体化さ
れる。接着強度の向上は約200℃以上の熱処理で観測
される。熱処理の雰囲気は特に選ばす1酸素、窒素、水
素、不活性ガス、水蒸気、或いはこれらの混合雰囲気中
で行なうことができる。本実施例では、洗浄を迅So、
−H!0.混合液とHCL−H!0.混合液で行ない
、熱処理は少量の酸素を含む窒素中で1100℃、2時
間行なった。
シ、接着強度が上がり、2枚のウェハは完全に一体化さ
れる。接着強度の向上は約200℃以上の熱処理で観測
される。熱処理の雰囲気は特に選ばす1酸素、窒素、水
素、不活性ガス、水蒸気、或いはこれらの混合雰囲気中
で行なうことができる。本実施例では、洗浄を迅So、
−H!0.混合液とHCL−H!0.混合液で行ない
、熱処理は少量の酸素を含む窒素中で1100℃、2時
間行なった。
こうして直接接着による誘電体分離基板を形成した後、
活性層となる側を研磨して活性層として必要な厚み50
μmに調整した。
活性層となる側を研磨して活性層として必要な厚み50
μmに調整した。
この後の工程を、素子分離溝の領域に着目して第1図(
a)〜(e)を参照して説明する。21は第1のシリコ
ン・ウェハであシ、接着後前述のように活性層として必
要な所定厚みに調整されている。
a)〜(e)を参照して説明する。21は第1のシリコ
ン・ウェハであシ、接着後前述のように活性層として必
要な所定厚みに調整されている。
22は第2のシリコン・ウェハであシ、第1のウェハ2
1との間に熱酸化による1μmの酸化膜(第1の膜)2
3が素子分離誘電体膜として形成されている。第1のシ
リコン・ウェハ21の底面には予めp型層24.が拡散
形成されている。こうして一体化された基板の活性層表
面にCVD法によシ0.3μmの窒化ケイ素膜25(第
2の膜)を形成シ、こレヲハターニングしてエッチンク
ψマスクとして用い、アルカリ性溶液で異方性エツチン
グを行なって酸化膜23に達する素子分離用のV字溝2
6を形成する( (a) )。次にv字溝26の側面に
深さ約3μmのp型層24鵞を形成する( (b) )
。
1との間に熱酸化による1μmの酸化膜(第1の膜)2
3が素子分離誘電体膜として形成されている。第1のシ
リコン・ウェハ21の底面には予めp型層24.が拡散
形成されている。こうして一体化された基板の活性層表
面にCVD法によシ0.3μmの窒化ケイ素膜25(第
2の膜)を形成シ、こレヲハターニングしてエッチンク
ψマスクとして用い、アルカリ性溶液で異方性エツチン
グを行なって酸化膜23に達する素子分離用のV字溝2
6を形成する( (a) )。次にv字溝26の側面に
深さ約3μmのp型層24鵞を形成する( (b) )
。
このp型層24zの形成は例えば、ボロンをドープした
多結晶シリコン漠を用いた固相拡散による。
多結晶シリコン漠を用いた固相拡散による。
この時7字溝26の側面に形成されるポロンガラス27
は希弗酸により素子分離誘電体膜(第1の絶縁膜)23
が侵れないようにエツチング除去する( (C) )。
は希弗酸により素子分離誘電体膜(第1の絶縁膜)23
が侵れないようにエツチング除去する( (C) )。
そして、マスクとして用いた窒化ケイ素膜25を熱リン
酸でエツチング除去する( (d) )。
酸でエツチング除去する( (d) )。
次に熱酸化を行なって1μmの酸化膜(第3の絶縁膜)
28をV字溝側面および活性層表面に形成する( (e
) )。この後は図示しないが、V字溝26内に多結晶
シリコン膜を埋込み、必要に応じて平坦化処理を行なっ
て、誘電体分離基板を完成する。そして通常の工程に従
って、島状に分離された各活性層に所望の素子を形成す
る。例えば、ng層、p型層を順次拡散形成してpnp
トランジスタを得る。
28をV字溝側面および活性層表面に形成する( (e
) )。この後は図示しないが、V字溝26内に多結晶
シリコン膜を埋込み、必要に応じて平坦化処理を行なっ
て、誘電体分離基板を完成する。そして通常の工程に従
って、島状に分離された各活性層に所望の素子を形成す
る。例えば、ng層、p型層を順次拡散形成してpnp
トランジスタを得る。
この実施例によれば、誘電体分離基板の素子分離溝底部
に分離絶縁膜の薄い部分ができることはなく、また従来
のように多結晶シリコン膜埋込み後に溝底部に空洞が残
されることもない。従来の方法では活性層と7字溝内の
多結晶シリコン膜間の絶縁耐圧が、1μmの酸化膜でも
400Vであったのに対し、実施例では5oovの耐圧
が得られている。また、基板を切断して観察した結果、
この実施例による基板では7字溝内に空洞が認められな
かった。
に分離絶縁膜の薄い部分ができることはなく、また従来
のように多結晶シリコン膜埋込み後に溝底部に空洞が残
されることもない。従来の方法では活性層と7字溝内の
多結晶シリコン膜間の絶縁耐圧が、1μmの酸化膜でも
400Vであったのに対し、実施例では5oovの耐圧
が得られている。また、基板を切断して観察した結果、
この実施例による基板では7字溝内に空洞が認められな
かった。
また窒化ケイ素膜以外に素子分離溝のエツチング用マス
クとして、弗酸系エッチャントに侵れない金属膜を使用
した場合も、窒化ケイ素膜と同様の効果が得られる。
クとして、弗酸系エッチャントに侵れない金属膜を使用
した場合も、窒化ケイ素膜と同様の効果が得られる。
以上では、直接接着による誘電体分離基板の実施例を説
明したが、本発明は他の接着法、例えば静電接着法やス
ピンオングラス接着法等を用いた誘電体分離基板を用い
た場合に同様に適用することが可能である。
明したが、本発明は他の接着法、例えば静電接着法やス
ピンオングラス接着法等を用いた誘電体分離基板を用い
た場合に同様に適用することが可能である。
以上述べたように本発明によれば、接着技術による誘電
体分離基板の分離溝底部のサイドエツチングを効果的に
防止し、分離耐圧が高く信頼性の高い半導体装置を得る
ことができる。
体分離基板の分離溝底部のサイドエツチングを効果的に
防止し、分離耐圧が高く信頼性の高い半導体装置を得る
ことができる。
第1図(a)〜(e)は、本発明の一実施例の誘電体分
離基板の製造工程を示す図、第2図(a)〜(h)は従
来の製造工程を説明するだめの図、第3図は誘電体分離
基板にトランジスタを形成した様子を示す図、第4図(
a)〜(d)は従来法の問題点を説明するための要部工
程を示す図である。 21・・・第1のシリコン・ウェハ、22・・・第2の
シリコン・ウェハ、23・・・酸化膜(第1の絶縁膜)
、24・・・p+型層、25・・・窒化ケイ素膜(第2
の膜)、26・・・7字溝、27・・・ボロンガラス、
28・・・酸化膜(第3の膜)。 代理人 弁理士 則 近 憲 佑 同 松山光速 第 図 第 図 第 図 第 図 〜才 C’J
離基板の製造工程を示す図、第2図(a)〜(h)は従
来の製造工程を説明するだめの図、第3図は誘電体分離
基板にトランジスタを形成した様子を示す図、第4図(
a)〜(d)は従来法の問題点を説明するための要部工
程を示す図である。 21・・・第1のシリコン・ウェハ、22・・・第2の
シリコン・ウェハ、23・・・酸化膜(第1の絶縁膜)
、24・・・p+型層、25・・・窒化ケイ素膜(第2
の膜)、26・・・7字溝、27・・・ボロンガラス、
28・・・酸化膜(第3の膜)。 代理人 弁理士 則 近 憲 佑 同 松山光速 第 図 第 図 第 図 第 図 〜才 C’J
Claims (2)
- (1)半導体素子が形成される第1のシリコン基板と、
これを保持し台となる第2のシリコン基板が酸化膜を介
して一体化しており、第1のシリコン基板が第1のシリ
コン基板の表面から酸化膜まで達する溝で複数に分離さ
れている誘電体分離基板の製造工程中、酸化膜に達する
溝を掘る工程において、第1のシリコン基板の表面に窒
化ケイ素膜を形成し、溝を掘る部分の窒化ケイ素膜を選
択的に除去し、この窒化ケイ素膜をマスクにしたエッチ
ングで酸化膜に達する溝を掘ることを特徴とする誘電体
分離半導体装置の製造方法。 - (2)半導体素子が形成される第1のシリコン基板とこ
れを保持し、台となる第2のシリコン基板が酸化膜を介
して一体化しており、第1のシリコン基板が第1のシリ
コン基板の表面から酸化膜まで達する溝で複数に分離さ
れている誘電体分離基板において、表面にマスク膜を形
成し、パタニングしたマスク膜を利用して誘電体分離基
板に選択的にエッチングや拡散をする際に、窒化ケイ素
をマスク膜として使用することを特徴とする誘電体分離
半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27930388A JPH02126650A (ja) | 1988-11-07 | 1988-11-07 | 誘電体分離半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP27930388A JPH02126650A (ja) | 1988-11-07 | 1988-11-07 | 誘電体分離半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH02126650A true JPH02126650A (ja) | 1990-05-15 |
Family
ID=17609287
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP27930388A Pending JPH02126650A (ja) | 1988-11-07 | 1988-11-07 | 誘電体分離半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH02126650A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05166919A (ja) * | 1991-12-18 | 1993-07-02 | Mitsubishi Electric Corp | 半導体装置及びその製造方法 |
US5750432A (en) * | 1995-06-07 | 1998-05-12 | Harris Corporation | Defect control in formation of dielectrically isolated semiconductor device regions |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60106165A (ja) * | 1983-11-15 | 1985-06-11 | Fujitsu Ltd | 半導体装置の製造方法 |
-
1988
- 1988-11-07 JP JP27930388A patent/JPH02126650A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60106165A (ja) * | 1983-11-15 | 1985-06-11 | Fujitsu Ltd | 半導体装置の製造方法 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05166919A (ja) * | 1991-12-18 | 1993-07-02 | Mitsubishi Electric Corp | 半導体装置及びその製造方法 |
US5750432A (en) * | 1995-06-07 | 1998-05-12 | Harris Corporation | Defect control in formation of dielectrically isolated semiconductor device regions |
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