JPS5875359A - 回線試験方式 - Google Patents

回線試験方式

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Publication number
JPS5875359A
JPS5875359A JP17431681A JP17431681A JPS5875359A JP S5875359 A JPS5875359 A JP S5875359A JP 17431681 A JP17431681 A JP 17431681A JP 17431681 A JP17431681 A JP 17431681A JP S5875359 A JPS5875359 A JP S5875359A
Authority
JP
Japan
Prior art keywords
oscillator
link
digital
test
time division
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP17431681A
Other languages
English (en)
Inventor
Masao Hashimoto
雅男 橋本
Susumu Iwasaki
進 岩崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP17431681A priority Critical patent/JPS5875359A/ja
Publication of JPS5875359A publication Critical patent/JPS5875359A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04MTELEPHONIC COMMUNICATION
    • H04M3/00Automatic or semi-automatic exchanges
    • H04M3/22Arrangements for supervision, monitoring or testing
    • H04M3/24Arrangements for supervision, monitoring or testing with provision for checking the normal operation
    • H04M3/244Arrangements for supervision, monitoring or testing with provision for checking the normal operation for multiplex systems

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Monitoring And Testing Of Exchanges (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、デジタル変換機の回線試験方式に関する。
従来のデジタル変換機のPR発振器を用いる試験システ
ムにおいて、試験台でのPB発振は、6台ごとにアナロ
グのFBB振器を備え、各試験台よ)又換機側へ発信す
るように構成されていた。
そのためPB発振器は、アナログ発振器の合成周波であ
るから各試験台ごとに必要とな9、多重度゛がないとい
う欠点があった。
不発明の目的は、上記欠点を解決し、各試験台より該デ
ジタルPB発撮器を時分割多重利用できるようにした回
線試験方式を提供することにある。
本発明の回線試験方式は、デジタル電話変換機のPB発
振器を用いる試験システムにおいて、時分割通話路全具
備し、咳時分割通話略にPB発発振周数数PCMパター
ン系列系列外時分割多重動作生するデジタルPB発振器
を収容し、N(II(N=1以上の′!i数)の試験台
で該デジタルPB発振器を時分割多重利用することを特
徴とする。
次に本発明について図面をm−して説明する。
第1図は本発明の一実施例を示す中継方式図である。付
帯系装置内に設置され、マイクロプロセッサμPで制御
される付帯系保守用時分割変換機M−LINK、本体の
時分割交換機T D 8 W、  保守用時分割交換機
M−LINK  に収容され、本体交換+dTD8Wに
対向するトランクTRKXI〜TRKX閣。
本体交換機TD8Wに収容され、保守用リンクM−L 
I NK に対向するトランクTRKt〜TRK鴎。
保守用時分割交換機M−LINK  にそれぞれライン
試験装置LTE1〜L T E mを介して収容された
n台の試験台T1〜T、及びデジタルPB発振器PBO
8C,その他のサービス回路SVTを有するサービス装
置aVEを備えている。
試験台Ti(i=l〜n)には11々にアナログのPB
発振器は収容せず、デジタルなデータによ多発生するP
B発振器t−鏡時分割又換4fiM−LINKに収容し
である。各試験台TiからPB発発振桁行場合、時分1
tlJ父換機M−LINK2制御するマイクロプロセッ
サμPが各試験台からの指示に従い、デジタルPB発振
器PBO8Cを時分割多重利用することにより各試験台
TiからPB発振できる。
第2図は、第1図におけるディジタルPB発振器の一実
施例を示すブロック図である。
ディジタルPB発振器PBO8Cはマイクロプロセッサ
μPによ多制御される。
該発振器PBO8Cは、PB発振に必要な、高群低群の
合成周波をPCM符号化により全パターン系列をメモリ
ーMEMI〜MBMI 6に用意し、マイクロプロセッ
サμPの制御信号SELによ)該当パターンが選択され
る。選択されたメモリーは、内部カウンタCNTによ)
該メモリーのアドレスをアクセスし、このカウンタCN
Tが周期カウンタであることから該当バター7を発振さ
せ、パラレル−シリアル変換口wr8FTにおいてシリ
アルデータ変換後、時分割交換機に対して、PB発振出
力0UTPUT t−出力する。
又、このPCMデータをもつメモリーMEMI〜MEM
I 6に対し、該データのパリティチェックがパリティ
チェック回路PCHKで行なわれる。
このときハリティチェック回路PCHKではメモリME
MI−MEM16の出力とパリティビットを格納したメ
モリーMEMPの出力とによ抄パリティチェックが行な
われ、パリティ−エラーERR,ORをマイクロプロセ
ッサμPが検出できるようになっている。
本発明は、以上説明したように、デジタル電話交換機の
PB発振器を用いる試験システムにおいて時分割通話路
t−具備し、N111の試験台を該通話路に接続させ、
高群低群の合成波をPCMの符号化したパターン系列を
データとしてメモリにもつFBB振器を該時分割通話路
に収容させることにより各試験台からのPB発振を、各
試験台ごとにアナログの発振器を持つ必要はなく、デジ
タルのPB発振器を用いて、時分割多重利用できる効果
がある。
【図面の簡単な説明】
N1図は、本発明の回線試験方式の一実施例を示す中継
方式図、第2図は第1図におけるディジタルPB発振器
の一実施例を示すブロック図である。 T1〜Tn・・・・・・試験台、TD8W・・・・・・
本体時分割交換機、M−LINK−・・・・・付帯系保
守用時分割父換機、μP交換機・・・M−LINK  
を制御するマイクロプロセ、す、PBO8C・・・・・
・デジイタルPB発振器、TRK、〜TRKm・・・・
・・本体交換機に収容されるM−LINKに対向するト
ランク、TRKXt〜TRKXm・・・・・保守用リン
クM−LINKに収容される本体交換機に対向するトラ
ンク、LTE、−LTEm・・・・・・ライン試験装置
、SvT・・・・・・PBB振器以外のディジタルサー
ビス回路、SEL・・・・・・マイクロプロセッサμP
からPB発振の選択信号、CNT・・・・・・PCM符
号化されたデータを周期的に出力するための内部カウン
タ、MEM1〜MEM16・・・・・・PB発振の高群
低群の組み会せごとにPCM符号化されたデータを格納
したメモIJ−1MEMP・・・・・・MEM1〜MB
MI 6の格納データのパリティチェック用に付加した
パリティビットを格納したメモリー、8FT・・・・・
・パラレル−シリアル変換回路、PCHK・・・・・・
パリティチェック回路、0UTPUT・・・・・・PB
発振したPCM1!:、時分割変換9M−LINKへ出
力する端子、ERROR・・・・・・マイクロプロセッ
サがPB発振器のパリティエラー横用用端子。

Claims (1)

    【特許請求の範囲】
  1. 時分割通話路を備えたデジタル電話変換機の該時分割通
    話路にPBB振周波数のN多重のPCMパターン系列を
    時分割多重動作で発生するデジタルPB発振器を収容し
    、N個(N=1以上の整数)の試験台で該デジタルFB
    発振器を時分割多重利用することを特徴とする回線試験
    方式。
JP17431681A 1981-10-29 1981-10-29 回線試験方式 Pending JPS5875359A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17431681A JPS5875359A (ja) 1981-10-29 1981-10-29 回線試験方式

Applications Claiming Priority (1)

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JP17431681A JPS5875359A (ja) 1981-10-29 1981-10-29 回線試験方式

Publications (1)

Publication Number Publication Date
JPS5875359A true JPS5875359A (ja) 1983-05-07

Family

ID=15976514

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Application Number Title Priority Date Filing Date
JP17431681A Pending JPS5875359A (ja) 1981-10-29 1981-10-29 回線試験方式

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS537244A (en) * 1976-07-08 1978-01-23 Canon Inc Image forming device

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS537244A (en) * 1976-07-08 1978-01-23 Canon Inc Image forming device

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