JPS5871724A - デイジタル−アナログ変換回路 - Google Patents
デイジタル−アナログ変換回路Info
- Publication number
- JPS5871724A JPS5871724A JP17114581A JP17114581A JPS5871724A JP S5871724 A JPS5871724 A JP S5871724A JP 17114581 A JP17114581 A JP 17114581A JP 17114581 A JP17114581 A JP 17114581A JP S5871724 A JPS5871724 A JP S5871724A
- Authority
- JP
- Japan
- Prior art keywords
- resistance
- transistor
- digital
- ladder
- resistance network
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/66—Digital/analogue converters
- H03M1/74—Simultaneous conversion
- H03M1/78—Simultaneous conversion using ladder network
- H03M1/785—Simultaneous conversion using ladder network using resistors, i.e. R-2R ladders
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はディジタル−アナログ変換装置に関し、特に高
精度なディジタル−アナログ変換装置を提供するもので
ある。
精度なディジタル−アナログ変換装置を提供するもので
ある。
ディジタル−アナログ変換装置(以下DACと略す)の
中で最も一般的なものにはしご型DACが有る。第1図
に示す回路は電流出力はしご型DACで出力は1ovt
tと1ovrz に流れ出る電流の差となる。ここでこ
の出力端は電流出力の為10UT s及びlOυT2を
接地又は等測的に接地電位とする事によシこの回路に流
れる電流社次の通シとなる。
中で最も一般的なものにはしご型DACが有る。第1図
に示す回路は電流出力はしご型DACで出力は1ovt
tと1ovrz に流れ出る電流の差となる。ここでこ
の出力端は電流出力の為10UT s及びlOυT2を
接地又は等測的に接地電位とする事によシこの回路に流
れる電流社次の通シとなる。
以上の関係が成立している。ここでこのDACの梢度を
左右する原因を考えると最も太き表ものはQ、〜Qnの
スイッチのon抵抗が考えられる。従来は少しでもon
抵抗の小さいものを使用するかこのon抵抗を含め2R
となる様に設計していた。しかしこれらの方法はプロセ
スによるしきい値のバラツキ等の変動によるon抵抗の
変動が有る為厳密な)t、2Hの相対比を取る事が難し
く高精度化の障害となっていた。
左右する原因を考えると最も太き表ものはQ、〜Qnの
スイッチのon抵抗が考えられる。従来は少しでもon
抵抗の小さいものを使用するかこのon抵抗を含め2R
となる様に設計していた。しかしこれらの方法はプロセ
スによるしきい値のバラツキ等の変動によるon抵抗の
変動が有る為厳密な)t、2Hの相対比を取る事が難し
く高精度化の障害となっていた。
本発明は以上の点に鑑みてなされたものでon抵抗の変
動による精度の悪化が生じない為高精度のDACが提供
できる〇 第2図に本発明の回路図を示すここで柚のOn抵抗B、
MlとMl’のOn抵抗RMI’ は同じで以下kLM
z=Ryi 、−・1Mn =凡Mn’となる。またN
SHに使用されるトランジスタM、のon抵抗の%の値
をM、にさらにその%をMsに同様にMn迄それぞれの
bitに重みをつけると次の関係になるRM 1 =2
” XRM 2 ”2” XRM3 = ・・・= 2
’ ”−” ’ XRM!1・・・・・・(2) さらに従来このタイプのDACの末端は2Rの抵抗で接
地されていたがこζにL8Bを切シ換えているMnlM
n’と同じ形状のトランジスタyUn“を直列KI&続
して、このトランジスタのゲートは他の切シ換えゲート
を動かしている回路の電源に接続するここでMn 、M
u’ 、Mu“はすべて同じRon に、なるように
チャンネル長0幅共に同じ大きさ作っておくとプロセス
によるしきい値の変動等の影響は3つ共同じに受ける為
RMn=RMr’ =RrMm“の胸係は崩れることは
ない、このようにすると常にq n=q n’の関係が
得られさらにq’ n−1を考えると(Mn=勧n“と
おく) とな[qn−1の回路のインピーダンスと一致する事が
判る従ってQn−1””qn−1以下同様にとがる。
動による精度の悪化が生じない為高精度のDACが提供
できる〇 第2図に本発明の回路図を示すここで柚のOn抵抗B、
MlとMl’のOn抵抗RMI’ は同じで以下kLM
z=Ryi 、−・1Mn =凡Mn’となる。またN
SHに使用されるトランジスタM、のon抵抗の%の値
をM、にさらにその%をMsに同様にMn迄それぞれの
bitに重みをつけると次の関係になるRM 1 =2
” XRM 2 ”2” XRM3 = ・・・= 2
’ ”−” ’ XRM!1・・・・・・(2) さらに従来このタイプのDACの末端は2Rの抵抗で接
地されていたがこζにL8Bを切シ換えているMnlM
n’と同じ形状のトランジスタyUn“を直列KI&続
して、このトランジスタのゲートは他の切シ換えゲート
を動かしている回路の電源に接続するここでMn 、M
u’ 、Mu“はすべて同じRon に、なるように
チャンネル長0幅共に同じ大きさ作っておくとプロセス
によるしきい値の変動等の影響は3つ共同じに受ける為
RMn=RMr’ =RrMm“の胸係は崩れることは
ない、このようにすると常にq n=q n’の関係が
得られさらにq’ n−1を考えると(Mn=勧n“と
おく) とな[qn−1の回路のインピーダンスと一致する事が
判る従ってQn−1””qn−1以下同様にとがる。
(8)式に示すようKそれぞれの電流に2°〜2n−1
の重みが付きl0UT l、 l0UT z よシアナ
ログ量が取シ出せる。
の重みが付きl0UT l、 l0UT z よシアナ
ログ量が取シ出せる。
ここでNlと鵬の抵抗の比を考えるとRMドクー1RM
Iの関係が有るから同じチャンネル長を維持して幅のみ
を変化させる方法を取ると多bitの時LSl上で十分
な比を取れない事が生じる一例として12bitのDA
CでMnの幅eloμとするとMlのうにり、8Bに近
いbitのトランジスタを立て積みにする方法が有る。
Iの関係が有るから同じチャンネル長を維持して幅のみ
を変化させる方法を取ると多bitの時LSl上で十分
な比を取れない事が生じる一例として12bitのDA
CでMnの幅eloμとするとMlのうにり、8Bに近
いbitのトランジスタを立て積みにする方法が有る。
これはエツチング及び拡散層の押し込み等のプロセスの
変動によシ幅を変化させたトランジスタとの比が崩れる
事を避ける為であシ、これによ、9DACの専有面積が
減少し他のロジックと共存するLSlの内蔵も容易とな
る。
変動によシ幅を変化させたトランジスタとの比が崩れる
事を避ける為であシ、これによ、9DACの専有面積が
減少し他のロジックと共存するLSlの内蔵も容易とな
る。
以上詳細に説明したようにプロセスによるしきい値の変
動、エツチング、拡散層の押し込み等によるトランジス
タの特性の変化が起きても本発明の方法を取る事によシ
高精度のDACが実状できる0
動、エツチング、拡散層の押し込み等によるトランジス
タの特性の変化が起きても本発明の方法を取る事によシ
高精度のDACが実状できる0
第1図は従来のDACの回路図、第2図は本発明による
DACの回路図、第3図は本発明によるDACの他の実
施例を示す図である。 Q1〜Qn・・・・・・スイッチ、Ml〜M”−に〜M
t1’・・・・・・トランジスタ。
DACの回路図、第3図は本発明によるDACの他の実
施例を示す図である。 Q1〜Qn・・・・・・スイッチ、Ml〜M”−に〜M
t1’・・・・・・トランジスタ。
Claims (2)
- (1)はしご形ディジタルーアナログ変換回路において
抵抗網を切シ換えるトランジスタのオン抵抗を上記抵抗
網に対応させてビット毎に重みを付けたことを特徴とす
るディジタル−アナログ変換回路。 - (2)末端の接地電位に接続される抵抗と直列に最下位
ビットを切シ換えるトランジスタと同じ大きさのトラン
ジスタを接続したことを特徴とする特許請求の範囲第1
項記載のディジタル−アナログ変換回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17114581A JPS5871724A (ja) | 1981-10-26 | 1981-10-26 | デイジタル−アナログ変換回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP17114581A JPS5871724A (ja) | 1981-10-26 | 1981-10-26 | デイジタル−アナログ変換回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5871724A true JPS5871724A (ja) | 1983-04-28 |
Family
ID=15917814
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP17114581A Pending JPS5871724A (ja) | 1981-10-26 | 1981-10-26 | デイジタル−アナログ変換回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5871724A (ja) |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60105323A (ja) * | 1983-11-12 | 1985-06-10 | Nippon Gakki Seizo Kk | デイジタル−アナログ変換器 |
JPS61107235U (ja) * | 1984-12-17 | 1986-07-08 | ||
JPS61157030A (ja) * | 1984-12-28 | 1986-07-16 | Toshiba Corp | デイジタルアナログ変換回路 |
JPS6324654A (ja) * | 1986-07-16 | 1988-02-02 | Mitsubishi Electric Corp | 可変容量装置 |
JPS63287114A (ja) * | 1987-05-19 | 1988-11-24 | Sanyo Electric Co Ltd | Da変換回路 |
JPH01158823A (ja) * | 1987-10-05 | 1989-06-21 | General Electric Co <Ge> | スイッチ機能補償付きディジタル・アナログ変換器 |
JPH01165212A (ja) * | 1987-10-05 | 1989-06-29 | General Electric Co <Ge> | 多ビット並列ディジタル信号回路用のインピーダンス変換回路 |
JPH033521A (ja) * | 1989-05-31 | 1991-01-09 | Sony Corp | プログラマブル電流源 |
JPH0461521A (ja) * | 1990-06-29 | 1992-02-27 | Mitsubishi Electric Corp | ディジタル・アナログ変換器 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55156422A (en) * | 1979-05-25 | 1980-12-05 | Nec Corp | Digital-analog converter |
-
1981
- 1981-10-26 JP JP17114581A patent/JPS5871724A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55156422A (en) * | 1979-05-25 | 1980-12-05 | Nec Corp | Digital-analog converter |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60105323A (ja) * | 1983-11-12 | 1985-06-10 | Nippon Gakki Seizo Kk | デイジタル−アナログ変換器 |
JPS61107235U (ja) * | 1984-12-17 | 1986-07-08 | ||
JPS61157030A (ja) * | 1984-12-28 | 1986-07-16 | Toshiba Corp | デイジタルアナログ変換回路 |
JPS6324654A (ja) * | 1986-07-16 | 1988-02-02 | Mitsubishi Electric Corp | 可変容量装置 |
JPS63287114A (ja) * | 1987-05-19 | 1988-11-24 | Sanyo Electric Co Ltd | Da変換回路 |
JPH01158823A (ja) * | 1987-10-05 | 1989-06-21 | General Electric Co <Ge> | スイッチ機能補償付きディジタル・アナログ変換器 |
JPH01165212A (ja) * | 1987-10-05 | 1989-06-29 | General Electric Co <Ge> | 多ビット並列ディジタル信号回路用のインピーダンス変換回路 |
JPH033521A (ja) * | 1989-05-31 | 1991-01-09 | Sony Corp | プログラマブル電流源 |
JPH0461521A (ja) * | 1990-06-29 | 1992-02-27 | Mitsubishi Electric Corp | ディジタル・アナログ変換器 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3115296B2 (ja) | 自己較正a―dおよびd―a変換器 | |
EP1956716B1 (en) | Systems and methods for providing compact digitally controlled trim of multi-segment circuits | |
US4558242A (en) | Extended reference range, voltage-mode CMOS D/A converter | |
JPH06314977A (ja) | 電流出力型デジタル/アナログ変換回路 | |
JPH0810832B2 (ja) | デイジタル―アナログ変換器 | |
GB1363073A (en) | Generation of trigonometrical and other functions by interpolation between point values | |
WO1997043833A1 (en) | Improved switch architecture for r/2r digital to analog converters | |
JPS5871724A (ja) | デイジタル−アナログ変換回路 | |
JPH0734542B2 (ja) | D−a変換回路 | |
CN115441876A (zh) | R-2r梯形电阻网络电路 | |
JPH0377430A (ja) | D/aコンバータ | |
JP3059859B2 (ja) | 符号−絶対値形d/aコンバータ及びその動作方法 | |
EP0743758B1 (en) | Quadratic digital/analog converter | |
JPH0262123A (ja) | 直並列型a/d変換器 | |
EP0169147A2 (en) | A method and apparatus for minimizing digital-to-analog converter correction trims | |
JPH06268523A (ja) | D/a変換器 | |
KR19980034656A (ko) | 고속 저전력 디지탈 아날로그 컨버터 | |
JP2002076895A (ja) | 電流セル型デジタル・アナログ変換器 | |
Kochetkov et al. | High-linearity Radiation-hardened Segmented 12-bit Digital-to-analog Converter Using Binary-weighted Switches | |
JPH05252038A (ja) | アナログ/デジタル変換器 | |
KR0149707B1 (ko) | 디지탈/아날로그 변환회로 | |
Kato | A LINEARITY OPTIMIZATION METHOD FOR CMOS DAC USING R-2R LADDER NETWORK | |
JPH0884078A (ja) | D/a変換器 | |
EP1636907A1 (en) | Analog-to-digital converter | |
SU1096696A1 (ru) | Аналоговое запоминающее устройство |