JPS58154911A - 利得制御増幅器 - Google Patents
利得制御増幅器Info
- Publication number
- JPS58154911A JPS58154911A JP3772382A JP3772382A JPS58154911A JP S58154911 A JPS58154911 A JP S58154911A JP 3772382 A JP3772382 A JP 3772382A JP 3772382 A JP3772382 A JP 3772382A JP S58154911 A JPS58154911 A JP S58154911A
- Authority
- JP
- Japan
- Prior art keywords
- gain control
- diode
- voltage
- diodes
- resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/32—Modifications of amplifiers to reduce non-linear distortion
- H03F1/3211—Modifications of amplifiers to reduce non-linear distortion in differential amplifiers
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G1/00—Details of arrangements for controlling amplification
- H03G1/0005—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal
- H03G1/0088—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal using discontinuously variable devices, e.g. switch-operated
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、利得制御増幅器、特にテレビジョンの中間周
波増幅器などにおいて、混変調歪みなどの歪みを抑圧す
ることのできる利得制御増幅器に関する。
波増幅器などにおいて、混変調歪みなどの歪みを抑圧す
ることのできる利得制御増幅器に関する。
従来のテレビジョン受像機等に使用されている、利得制
御機能をもつ半導体集積回路による中間周波増幅回路の
方式としては、トランジスタのエミッタ帰還インピーダ
ンスを変化させる方式が広く用いられ、その例として第
1図のような回路がある。第1図に於て、1と2は差動
増幅器を構成するトランジスタ、3と4は信号入力端子
、6と6は出力負荷抵抗、7と8は出力端子、9と10
は利得制御ダイオード、11はダイオード9,1oへ供
給する電流を制御する抵抗、12.13はトランジスタ
1,2のエミッタ電流とダイオード9゜10の電流を流
す為の抵抗、14は利得制御用電圧印加端子、15は直
流電源電圧印加端子である。
御機能をもつ半導体集積回路による中間周波増幅回路の
方式としては、トランジスタのエミッタ帰還インピーダ
ンスを変化させる方式が広く用いられ、その例として第
1図のような回路がある。第1図に於て、1と2は差動
増幅器を構成するトランジスタ、3と4は信号入力端子
、6と6は出力負荷抵抗、7と8は出力端子、9と10
は利得制御ダイオード、11はダイオード9,1oへ供
給する電流を制御する抵抗、12.13はトランジスタ
1,2のエミッタ電流とダイオード9゜10の電流を流
す為の抵抗、14は利得制御用電圧印加端子、15は直
流電源電圧印加端子である。
以上の回路要素で信号入力端子3,4に加えられた入力
信号は構成された利得制御増幅器では、トランジスタ1
と2を主体とする差動増幅器で増幅されて、出力端子7
と8から出力される。又、端子14から抵抗11を介し
て利得制御電圧が、ダイオード9,10のアノードに印
加され、ダイオード9,1oに流れる電流が変化し、そ
のインピーダンスが変化するところとなり、利得制御が
なされる。
信号は構成された利得制御増幅器では、トランジスタ1
と2を主体とする差動増幅器で増幅されて、出力端子7
と8から出力される。又、端子14から抵抗11を介し
て利得制御電圧が、ダイオード9,10のアノードに印
加され、ダイオード9,1oに流れる電流が変化し、そ
のインピーダンスが変化するところとなり、利得制御が
なされる。
ところで、かかる従来の利得制御回路では、ダイオード
9,100電流は端子14の印加電圧によって、第2図
に示されるように変化する。、これはダイオードの電圧
−電流特性の基本式より簡単に示される。ここでInは
ダイオードに流れる電流、VDはダイオードの両端の電
圧、Isはダイオードの飽和電流、kはボルツマン定数
、qは電子の電荷、Tは絶対温度である。この様に、ダ
イオードは非線形素子で、電圧−電流特性は直線性が悪
い為に、インピーダンスの変化も非線形であり、特に、
電流の立ち上がり付近では、最も直線性が悪い。したが
って、従来の利得制御回路では、混変調歪みなどが多く
、又その為に利得制御範囲も狭く、81をも悪くすると
いう問題点があった。
9,100電流は端子14の印加電圧によって、第2図
に示されるように変化する。、これはダイオードの電圧
−電流特性の基本式より簡単に示される。ここでInは
ダイオードに流れる電流、VDはダイオードの両端の電
圧、Isはダイオードの飽和電流、kはボルツマン定数
、qは電子の電荷、Tは絶対温度である。この様に、ダ
イオードは非線形素子で、電圧−電流特性は直線性が悪
い為に、インピーダンスの変化も非線形であり、特に、
電流の立ち上がり付近では、最も直線性が悪い。したが
って、従来の利得制御回路では、混変調歪みなどが多く
、又その為に利得制御範囲も狭く、81をも悪くすると
いう問題点があった。
本発明は従来の利得制御回路に存在した、上述の問題点
を排除すべくなされたもので、利得制御ダイオードの組
を複数とし、それぞれのダイオードの片方が抵抗を介し
て接続されることを特徴としたものである。
を排除すべくなされたもので、利得制御ダイオードの組
を複数とし、それぞれのダイオードの片方が抵抗を介し
て接続されることを特徴としたものである。
第3図は、本発明の一実施例であり、図中、第1図と同
一の回路要素には、同一の番号を付している。ここで、
16,17.1B、19.20は利得制御特性を決定す
る抵抗、21.22はさらに付加されたところの利得制
御用ダイオードである。
一の回路要素には、同一の番号を付している。ここで、
16,17.1B、19.20は利得制御特性を決定す
る抵抗、21.22はさらに付加されたところの利得制
御用ダイオードである。
この回路で、利得制御電圧印加端子14に加わる電圧が
十分低く、ダイオード9,10,21゜22が導通して
いない状態ではトランジスタ1のエミッタ電流は、12
と16.17.19の抵抗に分割され、この時の利得は
これらの抵抗によって決まる。この状態では、ダイオー
ド9,210カソードの電位は、ダイオード21の方が
低いので端子14の印加電圧を次第に高くしてゆくと、
21の方が先に導通をはじめる。すなわち、21のイン
ピーダンス変化による利得制御が開始される。さらに、
端子14の電圧を次第に高くしてゆくと、抵抗19によ
る電圧降下の分だけ遅れて、ダイオード9も導通をはじ
め、9のインピーダンス変化による利得制御も加わって
くる。一方、トランジスタ2のエミッタ電流の変化モ、
タイオード10.同22ならびに抵抗20,18.16
の回路構成により同様に行なわれる。
十分低く、ダイオード9,10,21゜22が導通して
いない状態ではトランジスタ1のエミッタ電流は、12
と16.17.19の抵抗に分割され、この時の利得は
これらの抵抗によって決まる。この状態では、ダイオー
ド9,210カソードの電位は、ダイオード21の方が
低いので端子14の印加電圧を次第に高くしてゆくと、
21の方が先に導通をはじめる。すなわち、21のイン
ピーダンス変化による利得制御が開始される。さらに、
端子14の電圧を次第に高くしてゆくと、抵抗19によ
る電圧降下の分だけ遅れて、ダイオード9も導通をはじ
め、9のインピーダンス変化による利得制御も加わって
くる。一方、トランジスタ2のエミッタ電流の変化モ、
タイオード10.同22ならびに抵抗20,18.16
の回路構成により同様に行なわれる。
以上、第3図における、利得制御の動作を簡単に述べだ
が、利得制御開始時には、ダイオード21のカソード側
に直列に抵抗19が存在するので、ダイオードの立ち上
がり付近での直線性の悪さを抑えることができる。す々
わち、利得制御開始時における直線性を改善することが
できる。
が、利得制御開始時には、ダイオード21のカソード側
に直列に抵抗19が存在するので、ダイオードの立ち上
がり付近での直線性の悪さを抑えることができる。す々
わち、利得制御開始時における直線性を改善することが
できる。
第4図は本発明の他の実施例を示す利得制御回路図であ
る。同図において、第3図と同一番号は同一物を示し、
25.26は利得制御用ダイオード、23.24は利得
制御特性を決定する抵抗である。本実施例ではトランジ
スタ1のエミッタ電流は抵抗17.19が存在するので
、端子14の印加電圧を序々に上昇させるとダイオード
25゜21+19と順次動作が初まる。従って、第3図
で示す実施例の場合より更に、低歪みの利得制御が実現
出来る。
る。同図において、第3図と同一番号は同一物を示し、
25.26は利得制御用ダイオード、23.24は利得
制御特性を決定する抵抗である。本実施例ではトランジ
スタ1のエミッタ電流は抵抗17.19が存在するので
、端子14の印加電圧を序々に上昇させるとダイオード
25゜21+19と順次動作が初まる。従って、第3図
で示す実施例の場合より更に、低歪みの利得制御が実現
出来る。
第6図はトランジスタ9’、10’をダイオード接続し
たもので、第3図及び第4図のダイオード9.10に対
応する。
たもので、第3図及び第4図のダイオード9.10に対
応する。
第6図は利得制御電圧を別々に印加する方式を示したも
ので、一方は端子14より抵抗11を介してダイオード
21.22の接続点に印加し、他方は端子14′より抵
抗11′を介してダイオード9.1oの接続点に印加し
たものである。尚、第6図において第3図と同一番号は
同一物を示す。
ので、一方は端子14より抵抗11を介してダイオード
21.22の接続点に印加し、他方は端子14′より抵
抗11′を介してダイオード9.1oの接続点に印加し
たものである。尚、第6図において第3図と同一番号は
同一物を示す。
本実施例の場合、制御電圧が別々に印加されるので、第
3図で示す実施例の場合より更に低歪みの利得制御が実
現出来る効果がある。
3図で示す実施例の場合より更に低歪みの利得制御が実
現出来る効果がある。
以上の如く、本発明はテレビジョン受像機等に使用され
ている利得制御機能をもつ従来の中間周波増幅回路で問
題となった、利得制御開始時の直線性の悪化による混変
調歪みを減少させるばかりでなく、利得制御範囲も広く
することができ、−も改善できるものであり、半導体集
積回路化に好適な回路構成を具備しておシ、テレビジョ
ン受像機の中間周波増幅回路用として十分な性能を発揮
する半導体集積回路が実現できる。
ている利得制御機能をもつ従来の中間周波増幅回路で問
題となった、利得制御開始時の直線性の悪化による混変
調歪みを減少させるばかりでなく、利得制御範囲も広く
することができ、−も改善できるものであり、半導体集
積回路化に好適な回路構成を具備しておシ、テレビジョ
ン受像機の中間周波増幅回路用として十分な性能を発揮
する半導体集積回路が実現できる。
第1図は従来の利得制御回路側図、第2図はダイオード
の基本的な電圧−電流特性図、第3図は本発明の実施例
に係る利得制御回路図、第4図〜第6図は本発明の他の
実施例を示す回路図である。 1.2・・・・・・差動増幅器を構成するトランジスタ
、3.4・・・・・・入力端子、6,6・・・・・・負
荷抵抗、7゜8・・・・・・出力端子、9,10,21
,22,25゜26・・・・・・利得制御ダイオード、
9’、10’・・・・・・ダイオード接続されたトラン
ジスタ、11.11’・・・・・利得制御ダイオードへ
供給する電流を制御する抵抗、12+13・・・・・・
エミッタ抵抗、16,17゜18.19,20,23.
24・・・・・・利得制御特性を決定する抵抗、14.
14’・・・・・・利得制御用電圧印加端子、16・・
・・・・直流電源電圧印加端子。 第1図 第5図
の基本的な電圧−電流特性図、第3図は本発明の実施例
に係る利得制御回路図、第4図〜第6図は本発明の他の
実施例を示す回路図である。 1.2・・・・・・差動増幅器を構成するトランジスタ
、3.4・・・・・・入力端子、6,6・・・・・・負
荷抵抗、7゜8・・・・・・出力端子、9,10,21
,22,25゜26・・・・・・利得制御ダイオード、
9’、10’・・・・・・ダイオード接続されたトラン
ジスタ、11.11’・・・・・利得制御ダイオードへ
供給する電流を制御する抵抗、12+13・・・・・・
エミッタ抵抗、16,17゜18.19,20,23.
24・・・・・・利得制御特性を決定する抵抗、14.
14’・・・・・・利得制御用電圧印加端子、16・・
・・・・直流電源電圧印加端子。 第1図 第5図
Claims (2)
- (1)差動対トランジスタと、前記差動対トランジスタ
のエミッタ点に接続された一対の第1のダイオードと、
前記エミッタ点から抵抗を通じて前記第1のダイオード
より低電位側電源端に接続された第2のダイオードとを
備え、前記第1゜第2の各ダイオードを介して利得制御
電圧を供給することを特徴とする利得制御増幅器。 - (2)前記第2のダイオードが複数対のダイオード対か
ら構成され、前記ダイオード対のカソードは抵抗を介し
て差動対トランジスタのエミッタ点に接続されたことを
特徴とする特許請求の範囲第1項に記載の利得制御増幅
器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3772382A JPS58154911A (ja) | 1982-03-09 | 1982-03-09 | 利得制御増幅器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3772382A JPS58154911A (ja) | 1982-03-09 | 1982-03-09 | 利得制御増幅器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS58154911A true JPS58154911A (ja) | 1983-09-14 |
JPH0418482B2 JPH0418482B2 (ja) | 1992-03-27 |
Family
ID=12505417
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3772382A Granted JPS58154911A (ja) | 1982-03-09 | 1982-03-09 | 利得制御増幅器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58154911A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5947817A (ja) * | 1982-06-22 | 1984-03-17 | テキサス・インスツルメンツ・ドイツチエランド・ゲゼルシヤフト・ミツト・ベシユレンクテル・ハフツング | 高周波増幅器 |
US5668502A (en) * | 1995-04-04 | 1997-09-16 | U.S. Philips Corporation | Amplifier stage having a switchable gain and reduced distortion |
EP1681764A2 (en) * | 2000-02-15 | 2006-07-19 | Broadcom Corporation | Variable transconductance variable gain amplifier utilizing a degenerated differential pair |
-
1982
- 1982-03-09 JP JP3772382A patent/JPS58154911A/ja active Granted
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5947817A (ja) * | 1982-06-22 | 1984-03-17 | テキサス・インスツルメンツ・ドイツチエランド・ゲゼルシヤフト・ミツト・ベシユレンクテル・ハフツング | 高周波増幅器 |
US5668502A (en) * | 1995-04-04 | 1997-09-16 | U.S. Philips Corporation | Amplifier stage having a switchable gain and reduced distortion |
EP1681764A2 (en) * | 2000-02-15 | 2006-07-19 | Broadcom Corporation | Variable transconductance variable gain amplifier utilizing a degenerated differential pair |
EP1681764A3 (en) * | 2000-02-15 | 2008-11-26 | Broadcom Corporation | Variable transconductance variable gain amplifier utilizing a degenerated differential pair |
Also Published As
Publication number | Publication date |
---|---|
JPH0418482B2 (ja) | 1992-03-27 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5907262A (en) | Folded-cascode amplifier stage | |
US3497824A (en) | Differential amplifier | |
JP3088262B2 (ja) | 低歪差動増幅回路 | |
JP2622321B2 (ja) | 高周波数クロス接合折返しカスコード回路 | |
US3987369A (en) | Direct-coupled FET amplifier | |
US3946325A (en) | Transistor amplifier | |
JPH0447488B2 (ja) | ||
US4451800A (en) | Input bias adjustment circuit for amplifier | |
US4241314A (en) | Transistor amplifier circuits | |
US4757275A (en) | Wideband closed loop amplifier | |
GB2295289A (en) | Wideband constant impedance amplifiers | |
JPS58154911A (ja) | 利得制御増幅器 | |
JPH0712128B2 (ja) | 増幅器 | |
US6246290B1 (en) | High gain, current driven, high frequency amplifier | |
JP2509462Y2 (ja) | 増幅器 | |
JP3367875B2 (ja) | 対数変換回路及びこれを用いたトランスコンダクター | |
JPH06169225A (ja) | 電圧電流変換回路 | |
JPH0478044B2 (ja) | ||
JP3963251B2 (ja) | 電子回路 | |
JPH10341119A (ja) | 差動増幅回路 | |
KR840001120B1 (ko) | 증폭기 | |
JPH0517695Y2 (ja) | ||
JP2600648B2 (ja) | 差動増幅回路 | |
JPH0575368A (ja) | 非線型増幅器 | |
JPS6259485B2 (ja) |